JPH0547103A - 複合回転数制御基準クロツク生成装置 - Google Patents
複合回転数制御基準クロツク生成装置Info
- Publication number
- JPH0547103A JPH0547103A JP3205752A JP20575291A JPH0547103A JP H0547103 A JPH0547103 A JP H0547103A JP 3205752 A JP3205752 A JP 3205752A JP 20575291 A JP20575291 A JP 20575291A JP H0547103 A JPH0547103 A JP H0547103A
- Authority
- JP
- Japan
- Prior art keywords
- reference clock
- control reference
- clv
- control
- pseudo
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Optical Recording Or Reproduction (AREA)
- Rotational Drive Of Disk (AREA)
Abstract
(57)【要約】
【目的】 ＣＡＶ制御からＣＬＶ制御への切り換え時に
おいて、両制御基準クロックの有する周期以外のパルス
の出現を除去し、モータの回転状態を乱すことなくその
制御状態が移行することを目的とする。 【構成】 スイッチ１に入力されたＣＡＶ制御基準クロ
ック２とＣＬＶ制御基準クロック３の立ち上がりのタイ
ミングが一致したことをモノマルチ２０，２１、及びＤ
フリップフロップ２２で検出し、その検出信号Ｃで切り
換え指令４をＤフリップフロップ２３で同期化すること
によって得られた信号４１でスイッチ１を制御すること
により、その出力から疑似ＣＬＶ制御基準クロックを得
る構成としている。 【効果】 上記した構成によってＣＡＶ制御からＣＬＶ
制御への移行時にモータの回転状態を乱すことのない疑
似ＣＬＶ制御基準クロックを生成することができる。
おいて、両制御基準クロックの有する周期以外のパルス
の出現を除去し、モータの回転状態を乱すことなくその
制御状態が移行することを目的とする。 【構成】 スイッチ１に入力されたＣＡＶ制御基準クロ
ック２とＣＬＶ制御基準クロック３の立ち上がりのタイ
ミングが一致したことをモノマルチ２０，２１、及びＤ
フリップフロップ２２で検出し、その検出信号Ｃで切り
換え指令４をＤフリップフロップ２３で同期化すること
によって得られた信号４１でスイッチ１を制御すること
により、その出力から疑似ＣＬＶ制御基準クロックを得
る構成としている。 【効果】 上記した構成によってＣＡＶ制御からＣＬＶ
制御への移行時にモータの回転状態を乱すことのない疑
似ＣＬＶ制御基準クロックを生成することができる。
Description
【０００１】
【産業上の利用分野】本発明は、ディスクに情報を記録
する際の長時間化を図るため等角速度回転制御と等線速
度回転制御を組み合わせた複合回転数制御基準クロック
生成装置に関するものである。
する際の長時間化を図るため等角速度回転制御と等線速
度回転制御を組み合わせた複合回転数制御基準クロック
生成装置に関するものである。
【０００２】
【従来の技術】近年光ディスクを利用した映像や音楽を
記録する装置や媒体が、かなり普及してきている。この
様な光ディスクにおいて、記録時間を長くするために等
線速度（以下ＣＬＶと称す）回転が利用されている。し
かしながら特定トラックを捜す検索時などにおいて信号
トラックの位置を示すアドレス信号を正確に読み取る為
には一回転内の映像信号の水平同期信号の数が一定数で
ある方が、トラックを横切りながらタイミングの制御す
るためには好ましい。そのためにＣＬＶ回転でありなが
ら、水平同期信号のタイミングが隣接トラックで揃う特
定の領域では、一旦、等角速度回転（以下ＣＡＶと称
す）に切り替え、数トラックを記録した後、再びＣＬＶ
回転で記録し、複数の特定領域のアドレス読み取り精度
を向上している疑似ＣＬＶという記録制御方法が提案さ
れている。
記録する装置や媒体が、かなり普及してきている。この
様な光ディスクにおいて、記録時間を長くするために等
線速度（以下ＣＬＶと称す）回転が利用されている。し
かしながら特定トラックを捜す検索時などにおいて信号
トラックの位置を示すアドレス信号を正確に読み取る為
には一回転内の映像信号の水平同期信号の数が一定数で
ある方が、トラックを横切りながらタイミングの制御す
るためには好ましい。そのためにＣＬＶ回転でありなが
ら、水平同期信号のタイミングが隣接トラックで揃う特
定の領域では、一旦、等角速度回転（以下ＣＡＶと称
す）に切り替え、数トラックを記録した後、再びＣＬＶ
回転で記録し、複数の特定領域のアドレス読み取り精度
を向上している疑似ＣＬＶという記録制御方法が提案さ
れている。
【０００３】上記した疑似ＣＬＶを実現するためには、
ディスクの記録位置によって、ディスクモ−タ及び送り
モ−タの回転制御をＣＡＶ（等角速度）制御とＣＬＶ
（等線速度）制御が交互になされる必要があって、ディ
スクモ−タ及び送りモ−タの回転制御基準クロックとし
ての疑似ＣＬＶ制御基準クロックは、被記録信号の同期
信号等に同期したＣＡＶ制御基準クロックと記録位置と
所定の線速度から算出された周波数を有するＣＬＶ制御
基準クロックを切り換えることによって生成される。
ディスクの記録位置によって、ディスクモ−タ及び送り
モ−タの回転制御をＣＡＶ（等角速度）制御とＣＬＶ
（等線速度）制御が交互になされる必要があって、ディ
スクモ−タ及び送りモ−タの回転制御基準クロックとし
ての疑似ＣＬＶ制御基準クロックは、被記録信号の同期
信号等に同期したＣＡＶ制御基準クロックと記録位置と
所定の線速度から算出された周波数を有するＣＬＶ制御
基準クロックを切り換えることによって生成される。
【０００４】以下図面を参照しながら、従来の疑似ＣＬ
Ｖ制御基準クロック生成装置について説明する。
Ｖ制御基準クロック生成装置について説明する。
【０００５】図３は従来の疑似ＣＬＶ制御基準クロック
生成装置の構成を示すブロック図である。図３におい
て、１はスイッチ、２はＣＡＶ制御基準クロック、３は
ＣＬＶ制御基準クロック、４は切り換え指令、６及び７
はスイッチ１の入力端子、８はスイッチ１の出力端子で
あり、５はスイッチ１と切り換え指令４によって切り換
えられた疑似ＣＬＶ制御基準クロックである。
生成装置の構成を示すブロック図である。図３におい
て、１はスイッチ、２はＣＡＶ制御基準クロック、３は
ＣＬＶ制御基準クロック、４は切り換え指令、６及び７
はスイッチ１の入力端子、８はスイッチ１の出力端子で
あり、５はスイッチ１と切り換え指令４によって切り換
えられた疑似ＣＬＶ制御基準クロックである。
【０００６】以上のように構成された従来の疑似ＣＬＶ
制御基準クロック生成装置について、以下その動作を説
明する。まず、ＣＡＶ制御基準クロック２とＣＬＶ制御
基準クロック３はスイッチ１入力端子６及び７にそれぞ
れ入力されていて、ディスクの記録位置がＣＡＶかＣＬ
Ｖかを判定する手段によってその状態が決定される切り
換え指令４によってスイッチ１が動作し、スイッチ１の
出力端子８にそのいずれか一方が現れ、疑似ＣＬＶ制御
基準クロック５が生成されることになる。
制御基準クロック生成装置について、以下その動作を説
明する。まず、ＣＡＶ制御基準クロック２とＣＬＶ制御
基準クロック３はスイッチ１入力端子６及び７にそれぞ
れ入力されていて、ディスクの記録位置がＣＡＶかＣＬ
Ｖかを判定する手段によってその状態が決定される切り
換え指令４によってスイッチ１が動作し、スイッチ１の
出力端子８にそのいずれか一方が現れ、疑似ＣＬＶ制御
基準クロック５が生成されることになる。
【０００７】
【発明が解決しようとする課題】しかしながら、前述し
た従来の構成では、図３の各部のタイミングチャ−トで
ある図４のｔＡ及びｔＢとして示したような、ＣＡＶ制
御基準クロック２の立ち上がりから次のパルスの立ち上
がりまでの周期ｔ２、及びＣＬＶ制御基準クロック３の
立ち上がりから次のパルスの立ち上がりまでの周期ｔ３
と異なる周期のパルスが疑似ＣＬＶ制御基準クロックの
なかに現れ、周波数の変化がなめらかに行われないた
め、基準クロックと回転検出器の出力信号とを一対一で
比較することによって、速度・位相誤差を得るようなモ
−タの制御方式においては、その回転制御状態を乱すこ
とになり、記録する信号の品質を劣化させるという問題
点を有していた。
た従来の構成では、図３の各部のタイミングチャ−トで
ある図４のｔＡ及びｔＢとして示したような、ＣＡＶ制
御基準クロック２の立ち上がりから次のパルスの立ち上
がりまでの周期ｔ２、及びＣＬＶ制御基準クロック３の
立ち上がりから次のパルスの立ち上がりまでの周期ｔ３
と異なる周期のパルスが疑似ＣＬＶ制御基準クロックの
なかに現れ、周波数の変化がなめらかに行われないた
め、基準クロックと回転検出器の出力信号とを一対一で
比較することによって、速度・位相誤差を得るようなモ
−タの制御方式においては、その回転制御状態を乱すこ
とになり、記録する信号の品質を劣化させるという問題
点を有していた。
【０００８】本発明は、前述した従来の問題点を解決す
るもので、記録する信号品質がモータの回転制御状態の
乱れによって劣化しない疑似ＣＬＶ制御基準クロック生
成装置を提供することを目的とするものである。
るもので、記録する信号品質がモータの回転制御状態の
乱れによって劣化しない疑似ＣＬＶ制御基準クロック生
成装置を提供することを目的とするものである。
【０００９】
【課題を解決するための手段】この目的を達成するため
に本発明の疑似ＣＬＶ制御基準クロック生成装置は、Ｃ
ＡＶ制御基準クロックとＣＬＶ制御基準クロックの立ち
上がり（または立ち下がり）のタイミングが一致した直
後を検出し、その検出信号で切り換え指令をラッチする
ことによって、スイッチの新たな切り換え指令とするこ
とにより、スイッチの出力端子から疑似ＣＬＶ制御基準
信号を得るものである。
に本発明の疑似ＣＬＶ制御基準クロック生成装置は、Ｃ
ＡＶ制御基準クロックとＣＬＶ制御基準クロックの立ち
上がり（または立ち下がり）のタイミングが一致した直
後を検出し、その検出信号で切り換え指令をラッチする
ことによって、スイッチの新たな切り換え指令とするこ
とにより、スイッチの出力端子から疑似ＣＬＶ制御基準
信号を得るものである。
【００１０】
【作用】本発明は、前述した手段によって、ＣＡＶ制御
基準クロックとＣＬＶ制御基準クロックの切り換えが、
両クロックの立ち上がり（または立ち下がり）の一致し
た直後になされるため、周波数の移行がなめらかに行わ
れることになり、両クロックの有する周期と異なる周期
のパルスが生成された疑似ＣＬＶ制御基準クロックに現
われることがないため、ＣＡＶからＣＬＶ（またはＣＬ
ＶからＣＡＶ）に移行する時に、モ−タの回転状態を乱
すことのない疑似ＣＬＶ制御基準クロックを生成するこ
とができる。
基準クロックとＣＬＶ制御基準クロックの切り換えが、
両クロックの立ち上がり（または立ち下がり）の一致し
た直後になされるため、周波数の移行がなめらかに行わ
れることになり、両クロックの有する周期と異なる周期
のパルスが生成された疑似ＣＬＶ制御基準クロックに現
われることがないため、ＣＡＶからＣＬＶ（またはＣＬ
ＶからＣＡＶ）に移行する時に、モ−タの回転状態を乱
すことのない疑似ＣＬＶ制御基準クロックを生成するこ
とができる。
【００１１】
【実施例】以下本発明の一実施例について、図面を参照
しながら説明する。
しながら説明する。
【００１２】図１は本発明の疑似ＣＬＶ制御基準クロッ
ク生成装置の一実施例を示すブロック図であり、図２は
図１の各部のタイミングチャートであって、図１におい
て、２０はＣＡＶ制御基準クロック２（図２の２）の立
ち上がりでトリガーされ、パルス幅がＴＡの正極パルス
信号Ａ（図２のＡ）を出力するように設定されたモノマ
ルチであり、２１はＣＬＶ制御基準クロック３（図２の
３）の立ち上がりでトリガーされ、パルス幅がＴＢの負
極パルス信号Ｂ（図２のＢ）を出力するように設定され
たモノマルチである。（なお、ＴＡはＴＢより大きくな
るようにモノマルチ２０、２１は設定してある。）ま
た、モノマルチ２０及び２１の出力Ａ及びＢは、Ｄフリ
ップフロップ２２のデータ入力、クロック入力にそれぞ
れ入力されていて、Ｄフリップフロップ２２のＱ出力Ｃ
（図２のＣ）の状態が反転するのは、図２の点線で囲ん
だ部分に示すようにＣＡＶ制御基準クロック２とＣＬＶ
制御基準クロック３の立ち上がりのタイミングが一致し
た直後であり、この信号ＣはＤフリップフロップ２３の
クロック入力に入力されている。
ク生成装置の一実施例を示すブロック図であり、図２は
図１の各部のタイミングチャートであって、図１におい
て、２０はＣＡＶ制御基準クロック２（図２の２）の立
ち上がりでトリガーされ、パルス幅がＴＡの正極パルス
信号Ａ（図２のＡ）を出力するように設定されたモノマ
ルチであり、２１はＣＬＶ制御基準クロック３（図２の
３）の立ち上がりでトリガーされ、パルス幅がＴＢの負
極パルス信号Ｂ（図２のＢ）を出力するように設定され
たモノマルチである。（なお、ＴＡはＴＢより大きくな
るようにモノマルチ２０、２１は設定してある。）ま
た、モノマルチ２０及び２１の出力Ａ及びＢは、Ｄフリ
ップフロップ２２のデータ入力、クロック入力にそれぞ
れ入力されていて、Ｄフリップフロップ２２のＱ出力Ｃ
（図２のＣ）の状態が反転するのは、図２の点線で囲ん
だ部分に示すようにＣＡＶ制御基準クロック２とＣＬＶ
制御基準クロック３の立ち上がりのタイミングが一致し
た直後であり、この信号ＣはＤフリップフロップ２３の
クロック入力に入力されている。
【００１３】一方、切り換え指令４は、Ｄフリップフロ
ップ２３のデータ入力に入力されていて図２Ｘに示すタ
イミングでその状態が変化したとすると、Ｄフリップフ
ロップ２３のＱ出力４１（図２の４１）は図２に示すタ
イミングＹで状態が変化することになり、即ち、切り換
え指令４はＤフリップフロップ２２のＱ出力Ｃに同期化
されてスイッチ１を制御することになる。
ップ２３のデータ入力に入力されていて図２Ｘに示すタ
イミングでその状態が変化したとすると、Ｄフリップフ
ロップ２３のＱ出力４１（図２の４１）は図２に示すタ
イミングＹで状態が変化することになり、即ち、切り換
え指令４はＤフリップフロップ２２のＱ出力Ｃに同期化
されてスイッチ１を制御することになる。
【００１４】従って、スイッチ１の出力端子８に現われ
る信号がＣＡＶ制御基準クロック２からＣＬＶ制御基準
クロック３に切り換わるタイミングも図２Ｙに示すタイ
ミングと同一でり、スイッチ１の出力端子８から出力さ
れる信号５、即ち、図２の５に示すような疑似ＣＬＶ制
御基準クロックを得ることができ、ＣＡＶ制御基準クロ
ックからＣＬＶ制御基準クロックの切り換え時におい
て、両クロックの有する周期以外のパルスが現われるこ
とのない疑似ＣＬＶ制御基準クロックを生成することが
できる。
る信号がＣＡＶ制御基準クロック２からＣＬＶ制御基準
クロック３に切り換わるタイミングも図２Ｙに示すタイ
ミングと同一でり、スイッチ１の出力端子８から出力さ
れる信号５、即ち、図２の５に示すような疑似ＣＬＶ制
御基準クロックを得ることができ、ＣＡＶ制御基準クロ
ックからＣＬＶ制御基準クロックの切り換え時におい
て、両クロックの有する周期以外のパルスが現われるこ
とのない疑似ＣＬＶ制御基準クロックを生成することが
できる。
【００１５】
【発明の効果】以上説明したように本発明によると、Ｃ
ＡＶ制御基準クロックとＣＬＶ制御基準クロックの立ち
上がりのタイミングが一致した直後を検出するための検
出器を構成し、この検出器の出力信号に切り換え指令を
同期させてスイッチを切り換えることにより、生成され
た疑似ＣＬＶ制御基準クロックのなかにＣＡＶ制御基準
クロックとＣＬＶ制御基準クロックの有する周期以外の
パルスが現われることがないため、その周波数の移行が
なめらかにおこなわれることになり、モータの回転制御
状態が乱されることのない疑似ＣＬＶ制御基準クロック
生成装置を実現することができる。
ＡＶ制御基準クロックとＣＬＶ制御基準クロックの立ち
上がりのタイミングが一致した直後を検出するための検
出器を構成し、この検出器の出力信号に切り換え指令を
同期させてスイッチを切り換えることにより、生成され
た疑似ＣＬＶ制御基準クロックのなかにＣＡＶ制御基準
クロックとＣＬＶ制御基準クロックの有する周期以外の
パルスが現われることがないため、その周波数の移行が
なめらかにおこなわれることになり、モータの回転制御
状態が乱されることのない疑似ＣＬＶ制御基準クロック
生成装置を実現することができる。
【００１６】また、本実施例では、ＣＡＶ制御基準クロ
ックからＣＬＶ制御基準クロックへの切り換え時につい
てのみ説明したが、ＣＬＶ制御基準クロックからＣＡＶ
制御基準クロックへ切り換え時においても同様の効果を
得ることができ、さらに本実施例では、ＣＡＶ制御基準
クロックとＣＬＶ制御基準クロックの立ち上がりのタイ
ミングが一致した直後を検出するための検出器を構成し
た例について説明したが、立ち下がりのタイミングが一
致した直後を検出するための検出器を構成した場合につ
いても同様の効果を得ることができる。
ックからＣＬＶ制御基準クロックへの切り換え時につい
てのみ説明したが、ＣＬＶ制御基準クロックからＣＡＶ
制御基準クロックへ切り換え時においても同様の効果を
得ることができ、さらに本実施例では、ＣＡＶ制御基準
クロックとＣＬＶ制御基準クロックの立ち上がりのタイ
ミングが一致した直後を検出するための検出器を構成し
た例について説明したが、立ち下がりのタイミングが一
致した直後を検出するための検出器を構成した場合につ
いても同様の効果を得ることができる。
【図１】本発明の実施例における疑似ＣＬＶ制御基準ク
ロック生成装置のブロック図
ロック生成装置のブロック図
【図２】本発明の実施例における疑似ＣＬＶ制御基準ク
ロック生成装置の動作説明のためのタイミングチャート
ロック生成装置の動作説明のためのタイミングチャート
【図３】従来の疑似ＣＬＶ制御基準クロック生成装置の
ブロック図
ブロック図
【図４】従来の疑似ＣＬＶ制御基準クロック生成装置の
動作説明のためのタイミングチャート
動作説明のためのタイミングチャート
１ スイッチ ２０，２１ モノマルチ ２２，２３ Ｄフリップフロップ
Claims (1)
- 【請求項１】モータの回転制御のための等角速度回転制
御基準クロックと等線速度回転制御基準クロックを切り
換えるためのスイッチを有し、前記等角速度回転制御基
準クロックの立ち上がりエッジ（または立ち下がりエッ
ジ）部分をパルス化して出力するための第一のエッジ検
出器と、前記等線速度回転制御基準クロックの立ち上が
りエッジ（または立ち下がりエッジ）部分をパルス化し
て出力するための第二のエッジ検出器を有し、前記第一
のエッジ検出器の出力信号を前記第二のエッジ検出器の
出力信号で、または前記第二のエッジ検出器の出力信号
を前記第一のエッジ検出器の出力信号でラッチするため
の第一のラッチ回路を有し、前記等角速度回転制御基準
クロックと等線速度回転制御基準クロックを切り換える
ための切り換え指令信号を前記第一のラッチ回路の出力
信号でラッチするための第二のラッチ回路を有し、前記
第二のラッチ回路の出力信号を前記スイッチの切り換え
信号とすることを特徴とする複合回転数制御基準クロッ
ク生成装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3205752A JPH0547103A (ja) | 1991-08-16 | 1991-08-16 | 複合回転数制御基準クロツク生成装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3205752A JPH0547103A (ja) | 1991-08-16 | 1991-08-16 | 複合回転数制御基準クロツク生成装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0547103A true JPH0547103A (ja) | 1993-02-26 |
Family
ID=16512074
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3205752A Pending JPH0547103A (ja) | 1991-08-16 | 1991-08-16 | 複合回転数制御基準クロツク生成装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0547103A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH09180364A (ja) * | 1995-12-27 | 1997-07-11 | Samsung Electron Co Ltd | スピンドルモーターの駆動装置 |
-
1991
- 1991-08-16 JP JP3205752A patent/JPH0547103A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH09180364A (ja) * | 1995-12-27 | 1997-07-11 | Samsung Electron Co Ltd | スピンドルモーターの駆動装置 |
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