JPH0557664B2 - - Google Patents

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JPH0557664B2
JPH0557664B2 JP58162291A JP16229183A JPH0557664B2 JP H0557664 B2 JPH0557664 B2 JP H0557664B2 JP 58162291 A JP58162291 A JP 58162291A JP 16229183 A JP16229183 A JP 16229183A JP H0557664 B2 JPH0557664 B2 JP H0557664B2
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JP
Japan
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circuit
signal
synchronization
frequency
digital signal
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JP58162291A
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English (en)
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JPS6055504A (ja
Inventor
Shuichi Odaka
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Akai Electric Co Ltd
Original Assignee
Akai Electric Co Ltd
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Publication date
Application filed by Akai Electric Co Ltd filed Critical Akai Electric Co Ltd
Priority to JP58162291A priority Critical patent/JPS6055504A/ja
Publication of JPS6055504A publication Critical patent/JPS6055504A/ja
Publication of JPH0557664B2 publication Critical patent/JPH0557664B2/ja
Granted legal-status Critical Current

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    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11BINFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B20/00Signal processing not specific to the method of recording or reproducing; Circuits therefor
    • G11B20/10Digital recording or reproducing
    • G11B20/10527Audio or video recording; Data buffering arrangements
    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11BINFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B15/00Driving, starting or stopping record carriers of filamentary or web form; Driving both such record carriers and heads; Guiding such record carriers or containers therefor; Control thereof; Control of operating function
    • G11B15/18Driving; Starting; Stopping; Arrangements for control or regulation thereof
    • G11B15/46Controlling, regulating, or indicating speed

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  • Engineering & Computer Science (AREA)
  • Multimedia (AREA)
  • Signal Processing (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)

Description

【発明の詳細な説明】 この発明はアナログ信号をデイジタル信号に変
換して記録再生するPCM録音再生装置において、
再生されるデジタル信号の周期信号の周期が一定
となるように記録媒体の移送速度を制御するいわ
ゆるキヤプスタンサーボに関するものである。
PCM録音再生装置は、アナログ信号をデイジ
タル信号に変換してテープ上に記録し、再生時に
はテープ上のデイジタル信号を再生し、それをア
ナログ信号に再変換して元の音声信号を得るよう
にした録音再生装置であり、その一実用例として
マルチトラツクによる固定ヘツド方式のPCM録
音再生装置が公知である。
従来、固定ヘツド方式のPCM録音再生装置の
キヤプスタンサーボとしては、家庭用VTRにお
けるコントロールトラツクの様なサーボ用のトラ
ツクによりサーボをかける方法があるが、サーボ
用トラツクを別個に必要とするので音声信号また
は映像信号用のトラツクのトラツク巾が制約を受
ける。また上記サーボ用トラツクがドロツプアウ
ト等で失なわれた場合、たとえ該サーボ用トラツ
ク以外のトラツクが無事であつても、テープの走
行は保障できなくなるおそれがある。
また、第1図に示す様に、再生デイジタル信号
の時間軸補正処理、デインターリーブ、デスクラ
ンブル、誤り検出及び誤り訂正を行うための記憶
回路7と、上記再生デイジタル信号中の同期信号
によつて+1ずつカウントされ上記記憶回路7の
書き込みアドレスを指定する書き込みアドレス回
路8と、一定の周波数によつて+1ずつカウント
され上記記憶回路7の読み出しアドレスを指定す
る読み出しアドレス回路9と、上記書き込みアド
レス回路8の出力と上記読み出しアドレス回路9
の出力の差を演算する演算回路12と、上記演算
回路12において得られる値をアナログ値に変換
しそれをキヤプスタンサーボ回路26へ出力する
サーボ用D/A変換回路13とを備え、時間軸補
正用アドレス回路の書き込み側(書き込みアドレ
ス回路8の出力)と読み出し側(読み出しアドレ
ス回路9の出力)の差を演算回路12において演
算し、それをサーボ用D/A変換回路13におい
てD/A変換したものを直接キヤプスタンサーボ
回路26へ与えるものがある。しかし、適正な振
巾制限が行なわれていないので、キヤプスタンモ
ータの動作が安定せず、その結果復調不可能な速
度でキヤプスタンモータが回転し記録媒体上の同
期信号を検出できなくなつてキヤプスタンモータ
の制御が不可能となつてしまい、磁気テープ等の
記録媒体に傷をつけるという欠点を生じた。
この発明は上記した従来のものの欠点を除去す
るためになされたもので、時間軸補正用アドレス
回路の書き込み側と読み出し側の差をD/A変換
したものをさらに適正な位相補正と振巾制限を行
なつてキヤプスタンモータに加えて、簡単な構成
で安定してサーボがかかるPCM録音再生装置を
提供することを目的としている。
以下、この発明の一実施例を第2図について説
明する。第2図において、1は磁気テープ、2は
該磁気テープ1に接触し磁気テープ1上に同期信
号を含むデイジタル信号に変調されて記録された
信号をトラツク毎に再生する複数の磁気ヘツド、
3は該磁気ヘツドが再生した信号を各トラツク毎
にRZ(Return to Zero)信号に復調して出力す
る復調回路である。6は各トラツクに対応する様
に設けられた同期パターン検出回路4とブロツク
検出回路5によつて構成される同期検出回路であ
る。尚、該同期パターン検出回路4は各トラツク
毎に復調された信号中より同期信号を検出するが
ドロツプアウト等によつて同期信号が再生できな
かつた場合においても、自走周波数にて信号を出
力するドロツプアウト補償対策が施されている。
また、上記ブロツク検出回路5は上記同期パター
ン検出回路4が検出した各トラツク毎の同期信号
の中で最も早く検出できたトラツクの同期信号を
検出しそれを同期検出信号として出力する。7は
記憶回路であり、再生デイジタル信号の時間軸補
正処理、デインターリーブ、デスクランブル、誤
り検出及び誤り訂正を行うためのものである。8
は書き込みアドレス回路であり、上記同期検出回
路6からの同期検出信号によつて+1ずつカウン
トされ、上記記憶回路7への磁気テープ1からの
再生デイジタル信号の書き込みアドレスを指定す
る。9は読み出しアドレス回路であり、水晶振動
子等によつて得られる一定の周波数信号によつて
+1ずつカウントされ、上記記憶回路7への磁気
テープ1からの再生デイジタル信号の読み出しア
ドレスを指定する。10は誤り検出回路であり、
上記再生デイジタル信号の内容をパリテイ検査し
誤りが一定以上あるか否かを調べ誤りが一定以上
なら論理レベル“1”を出力し、誤りが一定以下
なら論理レベル“0”を出力する。以上の記憶回
路7、書き込みアドレス回路8、読み出しアドレ
ス回路9及び誤り検出回路10により符号訂正回
路11が構成される。12は演算回路であり、上
記符号訂正回路11から得られる上記書き込みア
ドレス回路8の値から上記読み出しアドレス9の
値を減算する。13はサーボ用D/A変換回路で
あり、上記演算回路12によつて得られるデイジ
タル値をアナログ値に変換する。14は位相補正
回路であり、上記サーボ用D/A変換回路13に
よつて得られるアナログ値の位相とゲインを調整
しキヤプスタンサーボ系を安定して動作させる。
15は振巾制限回路であり、上記位相補正回路1
4によつて位相とゲインが調整されたアナログ値
の上限と下限を制限することによつて、後述する
キヤプスタンモータ23の回転数の上限と下限を
制限し、上記復調回路3及び同期検出回路6の動
作を安定させる。16は上記振巾制限回路15に
よつて発振周波数が決定されるVCO(電圧制御発
振回路)であり、上記振巾制限回路15によつて
得られるアナログ値が大きくなれば該発振周波数
は高くなる特性を有する。以上の、演算回路1
2、サーボ用D/A変換回路13、位相補正回路
14、振巾制限回路15及びVCO16により第
1のクロツク発生回路17が構成される。尚、上
記アドレス値の差がない場合、該第1のクロツク
発生回路17の出力周波数は後述する周波数発電
機25(以下FGと呼ぶ)の周波数の4倍とする。
18は第2のクロツク発生回路であり、後述する
FG25の周波数の4倍の一定した周波数信号を
出力する。19は動作制御回路であり、この
PCM録音再生装置が録音状態か否かを検出し録
音状態なら論理レベル“1”を出力し、そうでな
いときには論理レベル“0”を出力する。20は
上記第1のクロツク発生回路17の出力信号と上
記第2のクロツク発生回路18の出力信号のいず
れか一方を選択する切換回路であり、上記誤り検
出回路10と動作制限回路19の出力がOR回路
21に入力することにより、誤りの量が一定以上
か、または録音状態であれば、上記第2のクロツ
ク発生回路18の出力信号を選択し、誤りの量が
一定以下でかつ録音状態でないのならば、上記第
1のクロツク発生回路17の出力信号を選択す
る。22は分周回路であり、上記切換回路20に
よつて得られる選択信号を後述するFG25の周
波数と等しくなるように1/4分周し、これをサー
ボ用基準信号とし、上記切換回路20が作動して
入力信号が切換つた際に、上記第1のクロツク発
生回路17の出力信号と第2のクロツク発生回路
18の出力信号の位相のずれによつて発生する出
力の位相変化を低減させている。23はサーボ回
路、24は上記磁気テープ1を駆動させるための
キヤプスタンモータ、25は、上記キヤプスタン
モータの回転周波数を検出するFGであり、上記
サーボ回路23は上記分周回路22の出力信号
(サーボ用基準信号)と上記FG25の出力信号が
同期するように上記キヤプスタンモータ24の回
転を制御する。以上の分周回路22、サーボ回路
23、キヤプスタンモータ24及びFG25によ
りキヤプスタンサーボ回路26が構成される。
次に動作について説明する。走行中の上記磁気
テープ1上に複数のトラツク毎に変調されて記録
されている信号を上記複数の磁気ヘツド2によつ
て各トラツク毎に再生し、その信号を上記復調回
路3においてRZ(Return to Zero)信号に復調
する。さらにこの復調された信号は上記同期検出
回路6において、同期信号が検出されて、これに
より磁気テープ1の走行速度に対応した信号(同
期検出信号)が得られる。この同期検出信号は上
記書き込みアドレス回路8に供給され、該書き込
みアドレス回路8の書き込みアドレスの値を増加
させる。また、上記読み出しアドレス回路9の読
み出しアドレスの値は一定の周波数で増加するの
で、該書き込みアドレスと読み出しアドレスの値
を比較することによつて、磁気テープ1の走行速
度が速すぎるか遅すぎるかを判断可能となる。即
ち、上記書き込みアドレスの値から読み出しアド
レスの値を減算した結果が大きくなればテープ走
行が速すぎるということとなり、その逆であれば
遅すぎるということとなる。したがつて上記した
様な減算を上記演算回路12において行い、該減
算によつて得られるデイジタル値を上記サーボ用
D/A変換回路13においてD/A変換し、さら
に上記D/A変換によつて得られるアナログ値の
位相とゲイン上記位相補正回路14において調整
する。次に、上記振巾制限回路15においてこの
位相とゲインが調整されたアナログ値の上限と下
限を制限して、これを上記VCO16に加え、該
VCO16の出力を第1のクロツクとする。この
第1のクロツクを上記分周回路22に加えると、
ここで1/4に分周されて上記サーボ回路23に供
給され、上記サーボ回路23は上記分周回路22
の出力信号と上記FG25の出力信号が同期する
ように上記キヤプスタンモータ24の回転を制御
する。
しかし、上記磁気テープ1上に無録音部分があ
つたり、大きなドロツプアウトが発生したり、あ
るいは録音機自体が録音状態(または、ポーズ、
FF、REW状態)である場合は上記磁気テープ1
から同期信号を検出してサーボをかけることは不
可能となる。したがつて、無録音部分及びドロツ
プアウトを上記誤り検出回路10において検出
し、録音状態であることを上記動作制御回路19
において検出することによつて、上記した様に磁
気テープ1上に無録音部分があつたり大きなドロ
ツプアウトが発生したりあるいは録音機自体が録
音状態である場合には、上記切換回路20を作動
させて、上記第1のクロツク発生回路17の出力
から上記第2のクロツク発生回路18の出力へ切
換えて、これを上記キヤプスタンサーボ回路26
に加えることによつて上記キヤプスタンモータ2
4の回転を制御している。
また、上記実施例ではデイジタル処理回路(演
算回路12)とアナログ処理回路(位相補正回路
14、振巾制限回路15及びVCO16)によつ
て第1のクロツク発生回路を構成しているが、全
てデイジタル処理回路で構成することも可能であ
る。
上記した如く本発明は、磁気テープ1等の記録
媒体から再生されたデイジタル信号を復調する復
調回路3と、再生デイジタル信号の同期信号を検
出する同期検出回路6と、上記再生デイジタル信
号の時間軸補正処理を行うための記憶回路7と、
上記同期検出回路6が検出した同期信号によつて
カウントされ上記記憶回路7の書き込みアドレス
を指定する書き込みアドレス回路8と、一定周波
数の信号によつてカウントされ上記記憶回路7の
読み出しアドレスを指定する読み出しアドレス8
と、上記書き込みアドレスの値と読み出しアドレ
スの値の差が大きくなると出力する周波数が高く
なる第1のクロツク発生回路17等のクロツク発
生回路と、上記クロツク発生回路の出力周波数を
基準クロツクとして上記記録媒体の移送速度を制
御するキヤプスタンサーボ回路26等の駆動制御
回路とを備え、上記再生デジタル信号の同期信号
の周期が一定となるように記録媒体の上記記録媒
体の移送速度を制御するようにしたPCM録音再
生装置において、上記クロツク発生回路17に出
力周波数の変動巾を制限する振巾制限回路15を
設けたので、上記キヤプスタンサーボ回路26の
基準クロツクの周波数の変動巾を制限することに
よつて、上記記録媒体を駆動させるためのキヤプ
スタンモータ24の回転数の上限と下限が制限さ
れ上記記録媒体の移送速度の上限と下限が制限で
きる。したがつて、上記記録媒体の移送速度が安
定し、上記記録媒体からの再生デイジタル信号の
同期によつて信号を復調する上記復調回路3の動
作も安定し、かつ記録媒体の移送速度も大巾に変
化しないので磁気テープ1等の記録媒体を傷める
おそれもない。また、余りに高い周波数を上記キ
ヤプスタンサーボ回路26の基準クロツクとして
与えると該サーボ回路の動作を保障できなくなる
が、上記の如くすれば、この欠点も除去できる。
【図面の簡単な説明】
第1図は従来例を示すブロツク図、第2図は本
発明の実施例を示すブロツク図である。 1……磁気テープ、3……復調回路、6……同
期検出回路、7……記憶回路、8……書き込みア
ドレス回路、9……読み出しアドレス回路、15
……振巾制限回路、17……第1のクロツク発生
回路、26……キヤプスタンサーボ回路。

Claims (1)

    【特許請求の範囲】
  1. 1 記録媒体から再生されたデイジタル信号を復
    調する復調回路と、再生デイジタル信号の同期信
    号を検出する同期検出回路と、上記再生デイジタ
    ル信号の時間軸補正処理を行うための記憶回路
    と、上記同期検出回路が検出した同期信号によつ
    てカウントされ上記記憶回路の書き込みアドレス
    を指定する書き込みアドレス回路と、一定周波数
    の信号によつてカウントされ上記記憶回路の読み
    出しアドレスを指定する読み出しアドレス回路
    と、上記書き込みアドレスの値と読み出しアドレ
    スの値の差が大きくなると出力する周波数が高く
    なるクロツク発生回路と、上記クロツク発生回路
    の出力周波数を基準クロツクとして記録媒体の移
    送速度を制御する駆動制御回路とを備え、上記再
    生デジタル信号の同期信号の周期が一定となるよ
    うに上記記録媒体の移送速度を制御するようにし
    たPCM録音再生装置において、上記クロツク発
    生回路に出力周波数の変動巾を制御する振巾制限
    回路を設けたことを特徴とするPCM録音再生装
    置。
JP58162291A 1983-09-02 1983-09-02 Pcm録音再生装置 Granted JPS6055504A (ja)

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JPS6055504A JPS6055504A (ja) 1985-03-30
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