JPH0561594A - デジタイザ - Google Patents
デジタイザInfo
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- JPH0561594A JPH0561594A JP24483691A JP24483691A JPH0561594A JP H0561594 A JPH0561594 A JP H0561594A JP 24483691 A JP24483691 A JP 24483691A JP 24483691 A JP24483691 A JP 24483691A JP H0561594 A JPH0561594 A JP H0561594A
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- JP
- Japan
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- input
- voltage
- coordinate
- digitizer
- strip
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Abstract
(57)【要約】
【目的】 正確な入力情報が得られる様にしてコンピュ
ータなどに正確なデジタイザの入力点の座標入力を出力
でき、しかも精度及び分解能の向上が図れるデジタイザ
を提供する。 【構成】 帯状抵抗体１７は５本の電極によって複数の
ブロックに分割される。それぞれのブロックに対して切
換回路１１を介して電圧を印加する。各ブロック毎に座
標入力情報を検出するように構成したので、電極間の距
離を短くすることが出来、したがって帯状抵抗体の印刷
ムラなどによる座標入力精度への影響が防止される。ま
た、帯状抵抗体１７の両端に基準電圧端子１６ａを設
け、各ブロックに印加された電圧を検出することによ
り、電極のパターン抵抗によって生じる電圧降下による
誤差を少なくすることが出来る。
ータなどに正確なデジタイザの入力点の座標入力を出力
でき、しかも精度及び分解能の向上が図れるデジタイザ
を提供する。 【構成】 帯状抵抗体１７は５本の電極によって複数の
ブロックに分割される。それぞれのブロックに対して切
換回路１１を介して電圧を印加する。各ブロック毎に座
標入力情報を検出するように構成したので、電極間の距
離を短くすることが出来、したがって帯状抵抗体の印刷
ムラなどによる座標入力精度への影響が防止される。ま
た、帯状抵抗体１７の両端に基準電圧端子１６ａを設
け、各ブロックに印加された電圧を検出することによ
り、電極のパターン抵抗によって生じる電圧降下による
誤差を少なくすることが出来る。
Description
【０００１】
【産業上の利用分野】本発明は、手書き文字や図形など
の入力装置として使用される、いわゆるデジタイザに係
り、特にコンピュータに図形を入力する場合や、コピー
マシンで印刷物の部分的な領域のみを指定してコピーす
るためにそれぞれの座標入力データを特定する際に用い
る座標入力シートを備えたデジタイザに関する。
の入力装置として使用される、いわゆるデジタイザに係
り、特にコンピュータに図形を入力する場合や、コピー
マシンで印刷物の部分的な領域のみを指定してコピーす
るためにそれぞれの座標入力データを特定する際に用い
る座標入力シートを備えたデジタイザに関する。
【０００２】
【従来の技術】従来よりデジタイザとしては、たとえ
ば、特開昭６１−１０４５１３号公報に示されているも
のがある。この場合には、絶縁基板上に抵抗膜を、マス
クを使った塗布、印刷、蒸着、スパッタ等を施すことに
より均一な帯状抵抗体を形成するようにしている。
ば、特開昭６１−１０４５１３号公報に示されているも
のがある。この場合には、絶縁基板上に抵抗膜を、マス
クを使った塗布、印刷、蒸着、スパッタ等を施すことに
より均一な帯状抵抗体を形成するようにしている。
【０００３】また、その他の従来例としては、特開昭６
２−１８４５１２号公報で示されている座標入力シート
を用いるデジタイザでは、図３にその原理図で示されて
いるように、２枚の座標入力シート１Ａ、１Ｂを備え、
それぞれの座標入力シート１Ａ、１Ｂは絶縁シートの両
端に電極２、３を対向配設し、かつ電極間に面抵抗４を
形成し、これら２枚の座標入力シート１Ａ、１Ｂを上下
に、それぞれの電極方向を９０度ずらして重ね、たとえ
ば下部座標入力シート１Ｂを押下する接指点のＸ座標位
置検出用、上部座標入力シート１ＡをＹ軸座標位置検出
用として用いる。
２−１８４５１２号公報で示されている座標入力シート
を用いるデジタイザでは、図３にその原理図で示されて
いるように、２枚の座標入力シート１Ａ、１Ｂを備え、
それぞれの座標入力シート１Ａ、１Ｂは絶縁シートの両
端に電極２、３を対向配設し、かつ電極間に面抵抗４を
形成し、これら２枚の座標入力シート１Ａ、１Ｂを上下
に、それぞれの電極方向を９０度ずらして重ね、たとえ
ば下部座標入力シート１Ｂを押下する接指点のＸ座標位
置検出用、上部座標入力シート１ＡをＹ軸座標位置検出
用として用いる。
【０００４】すなわち、図３の任意の点Ｐに座標入力シ
ート１Ａから接指する動作に伴い、上部座標入力シート
１Ａに対する電圧５Ａの印加によって、そのシート１Ａ
における接指入力点Ｐの分圧が、下部の座標入力シート
Ｂの分圧出力端６からＸ軸座標位置データとして取り出
される。
ート１Ａから接指する動作に伴い、上部座標入力シート
１Ａに対する電圧５Ａの印加によって、そのシート１Ａ
における接指入力点Ｐの分圧が、下部の座標入力シート
Ｂの分圧出力端６からＸ軸座標位置データとして取り出
される。
【０００５】次に下部座標入力シート１Ｂに対する電圧
５Ｂの印加によって、そのシート１Ｂにおける接指入力
点Ｐの分圧が上部座標入力シート１Ａの分圧出力端７か
らＹ軸座標位置データとして取り出され、しかしてこの
ような時分割によって接指入力点ＰのＸ−Ｙ座標上の位
置が求められる構成となっている。
５Ｂの印加によって、そのシート１Ｂにおける接指入力
点Ｐの分圧が上部座標入力シート１Ａの分圧出力端７か
らＹ軸座標位置データとして取り出され、しかしてこの
ような時分割によって接指入力点ＰのＸ−Ｙ座標上の位
置が求められる構成となっている。
【０００６】
【発明が解決しようとする課題】しかしながら、このよ
うな従来のデジタイザにおいては、帯状抵抗体の印刷ム
ラの影響により精度よく座標入力することができないと
いう問題があった。すなわち、上部座標入力シート１Ａ
の接指入力点分圧を考えると、電極２、３間の面抵抗４
の直線性が確保されていれば、電極間の電位差（たとえ
ば５Ｖ）に対し、上記接指入力点分圧は＋電極２からの
分離に反比例した値を示す。つまり、接指入力点Ｐが電
極２、３の中間位置とすると、２．５Ｖを示すはずであ
る。
うな従来のデジタイザにおいては、帯状抵抗体の印刷ム
ラの影響により精度よく座標入力することができないと
いう問題があった。すなわち、上部座標入力シート１Ａ
の接指入力点分圧を考えると、電極２、３間の面抵抗４
の直線性が確保されていれば、電極間の電位差（たとえ
ば５Ｖ）に対し、上記接指入力点分圧は＋電極２からの
分離に反比例した値を示す。つまり、接指入力点Ｐが電
極２、３の中間位置とすると、２．５Ｖを示すはずであ
る。
【０００７】しかし、実際には面抵抗４はその印刷ムラ
等の影響を受け、正確な抵抗直線性を示さず、従って上
記２．５Ｖラインは図５の鎖線の本来あるべき位置に対
し曲線のようにずれ、入力者が正確に中間点を接指した
にもかかわらず、それよりも外れた座標データが入力さ
れる事態が多発していた。これは下部座標入力シート１
Ｂについても同様である。
等の影響を受け、正確な抵抗直線性を示さず、従って上
記２．５Ｖラインは図５の鎖線の本来あるべき位置に対
し曲線のようにずれ、入力者が正確に中間点を接指した
にもかかわらず、それよりも外れた座標データが入力さ
れる事態が多発していた。これは下部座標入力シート１
Ｂについても同様である。
【０００８】本発明は上述した従来の技術の欠点を克服
するためになされたものであり、正確な入力情報が得ら
れる様にしてコンピュータなどに正確なデジタイザの入
力点の座標入力を出力でき、しかも精度及び分解能の向
上が図れるデジタイザを提供することを目的とする。
するためになされたものであり、正確な入力情報が得ら
れる様にしてコンピュータなどに正確なデジタイザの入
力点の座標入力を出力でき、しかも精度及び分解能の向
上が図れるデジタイザを提供することを目的とする。
【０００９】
【課題を解決するための手段】本発明のデジタイザは、
帯状抵抗体とストライプ状電極からなる２枚のシート
を、それぞれのシートの帯状抵抗体が交互に直交する方
向に積層され、かつ各シート間を絶縁するドットスペー
サを有するデジタイザであって、帯状抵抗体を複数のブ
ロックに分割するために配設された複数本の電極と、帯
状抵抗体の両端に設けられた基準電圧端子と、各ブロッ
クに対して電圧を印加するための切換回路とを有し、基
準電圧端子から各ブロックに印加された電圧を読み込
み、読み込んだ電圧と入力された位置の分電圧とから入
力座標を検出する検出手段とを備えることを特徴とす
る。
帯状抵抗体とストライプ状電極からなる２枚のシート
を、それぞれのシートの帯状抵抗体が交互に直交する方
向に積層され、かつ各シート間を絶縁するドットスペー
サを有するデジタイザであって、帯状抵抗体を複数のブ
ロックに分割するために配設された複数本の電極と、帯
状抵抗体の両端に設けられた基準電圧端子と、各ブロッ
クに対して電圧を印加するための切換回路とを有し、基
準電圧端子から各ブロックに印加された電圧を読み込
み、読み込んだ電圧と入力された位置の分電圧とから入
力座標を検出する検出手段とを備えることを特徴とす
る。
【００１０】
【作用】上記構成のデジタイザにおいては、帯状抵抗体
を複数の電極を用いて複数のブロックに分割し、それぞ
れのブロックに対して切換回路を介して電圧を印加し、
座標入力情報を検出するように構成したので、電極間の
距離を短くすることが出来、したがって帯状抵抗体の印
刷ムラなどによる座標入力精度への影響が防止される。
を複数の電極を用いて複数のブロックに分割し、それぞ
れのブロックに対して切換回路を介して電圧を印加し、
座標入力情報を検出するように構成したので、電極間の
距離を短くすることが出来、したがって帯状抵抗体の印
刷ムラなどによる座標入力精度への影響が防止される。
【００１１】また、帯状抵抗体の両端に基準電圧端子を
設け、各ブロックに印加された電圧を検出することによ
り、電極のパターン抵抗によって生じる電圧降下による
誤差を少なくすることが出来る。
設け、各ブロックに印加された電圧を検出することによ
り、電極のパターン抵抗によって生じる電圧降下による
誤差を少なくすることが出来る。
【００１２】これにより正確な入力情報が得られるた
め、コンピュータなどの出力手段に正確な座標入力情報
を入力でき、精度面の向上を図ることが出来る。
め、コンピュータなどの出力手段に正確な座標入力情報
を入力でき、精度面の向上を図ることが出来る。
【００１３】また、電極間の距離を短くすることによ
り、同じ分解能のＡ／Ｄ変換器を使ってデジタイザの分
解能を上げることが出来る。
り、同じ分解能のＡ／Ｄ変換器を使ってデジタイザの分
解能を上げることが出来る。
【００１４】
【実施例】以下、本発明に係るデジタイザの一実施例を
図面に基づいて説明する。図１は本発明のデジタイザの
一実施例の構成を示す回路ブロック図、図２は図１で示
したデジタイザによる座標入力図作成のフローチャート
である。
図面に基づいて説明する。図１は本発明のデジタイザの
一実施例の構成を示す回路ブロック図、図２は図１で示
したデジタイザによる座標入力図作成のフローチャート
である。
【００１５】図１で示すように本発明のデジタイザは９
０°直行して配設される２枚のＸ、Ｙ座標用の座標入力
シート１０Ａ、１０Ｂと、その座標入力シート１０Ａ、
１０Ｂに接続される切換回路１１、１２、１３と、切換
回路１２から入力されるＸ、Ｙ座標のアナログ信号をデ
ジタル信号に変換するＡ／Ｄコンバータ１４と、このＡ
／Ｄコンバータ１４に連繋される検出手段としてのＣＰ
Ｕ１５とから概略構成されている。
０°直行して配設される２枚のＸ、Ｙ座標用の座標入力
シート１０Ａ、１０Ｂと、その座標入力シート１０Ａ、
１０Ｂに接続される切換回路１１、１２、１３と、切換
回路１２から入力されるＸ、Ｙ座標のアナログ信号をデ
ジタル信号に変換するＡ／Ｄコンバータ１４と、このＡ
／Ｄコンバータ１４に連繋される検出手段としてのＣＰ
Ｕ１５とから概略構成されている。
【００１６】上記座標シート１０Ａ、１０Ｂの帯状抵抗
体である均一抵抗体１７、１７はそれぞれ５本のドライ
ブ電極１６にて４分割されていて、そのドライブ電極間
に各別に電圧ＶCCが印加されるように切換回路１１、１
３の各接点ａ〜ｄが設けられている。ドライブ電極１６
の両端には基準電圧端子１６ａが設けられている。
体である均一抵抗体１７、１７はそれぞれ５本のドライ
ブ電極１６にて４分割されていて、そのドライブ電極間
に各別に電圧ＶCCが印加されるように切換回路１１、１
３の各接点ａ〜ｄが設けられている。ドライブ電極１６
の両端には基準電圧端子１６ａが設けられている。
【００１７】これら切換回路１１、１３の電圧印加接点
部Ａ、Ｄには電圧ＶCC（本実施例では５［Ｖ］）が供給
されるように接続され、アース用としてアース接点Ｂ、
Ｅが設けられている。 また、上記切換回路１１、１３
には、上記ＣＰＵ１５の制御により開閉されるスイッチ
１１ａ、１１ｂおよび１３ａ、１３ｂが配設されてい
る。
部Ａ、Ｄには電圧ＶCC（本実施例では５［Ｖ］）が供給
されるように接続され、アース用としてアース接点Ｂ、
Ｅが設けられている。 また、上記切換回路１１、１３
には、上記ＣＰＵ１５の制御により開閉されるスイッチ
１１ａ、１１ｂおよび１３ａ、１３ｂが配設されてい
る。
【００１８】上記切換回路１２には、Ｘ、Ｙ座標のペン
あるいは押指による位置を検出するための座標入力シー
ト１０Ａ、１０Ｂの入力点が各別に求められるように、
上記座標入力シート１０Ａ、１０Ｂからの座標入力情
報、および各ブロックに印加された電圧情報用の接点
ａ、ｂ、ｃ、ｄをＣＰＵ１５の制御で選択するスイッチ
１２ａが配設され、図中Ｃはアナログ信号入力用の接点
である。
あるいは押指による位置を検出するための座標入力シー
ト１０Ａ、１０Ｂの入力点が各別に求められるように、
上記座標入力シート１０Ａ、１０Ｂからの座標入力情
報、および各ブロックに印加された電圧情報用の接点
ａ、ｂ、ｃ、ｄをＣＰＵ１５の制御で選択するスイッチ
１２ａが配設され、図中Ｃはアナログ信号入力用の接点
である。
【００１９】また、座標入力シート１０Ａは、Ｙ軸上の
Ｌy 幅の押圧入力点を検出し、かつ、座標入力シート１
０ＢはＸ軸上のＬX 幅の押圧入力点を検出するように構
成されている。
Ｌy 幅の押圧入力点を検出し、かつ、座標入力シート１
０ＢはＸ軸上のＬX 幅の押圧入力点を検出するように構
成されている。
【００２０】また、図中１８、…は、銀のストライプ状
電極である。
電極である。
【００２１】上記構成よりなるこの実施例におけるデジ
タイザのフローを図２に示すフローチャートに基づいて
説明する。まずステップ１００では、ＣＰＵ１５により
Ａ−ｏｐｅｎ、Ｂ−ｏｐｅｎ、Ｃ−ａ、Ｄ−ａ、Ｅ−ｏ
ｐｅｎの制御がなされ、接指した位置の座標検出信号が
アナログ信号の押下電圧として切換回路１２を介してＡ
／Ｄコンバータ１４に入力される。
タイザのフローを図２に示すフローチャートに基づいて
説明する。まずステップ１００では、ＣＰＵ１５により
Ａ−ｏｐｅｎ、Ｂ−ｏｐｅｎ、Ｃ−ａ、Ｄ−ａ、Ｅ−ｏ
ｐｅｎの制御がなされ、接指した位置の座標検出信号が
アナログ信号の押下電圧として切換回路１２を介してＡ
／Ｄコンバータ１４に入力される。
【００２２】ステップ１０１では、Ａ／Ｄコンバータ１
４に入力された押下電圧Ｖが、Ｖ＞Ｖcc（５Ｖ）−０．
５Ｖ、すなわち、Ｖ＞５Ｖ−０．５Ｖ＝４．５［Ｖ］の
時にＣＰＵ１５は押下あり（ＹＥＳ）と判断し、次のス
テップ１０２に移行する。また、ステップＳ１０１で、
押下電圧Ｖが、印加電圧Ｖcc［５Ｖ］のとき、Ｖ≦Ｖcc
−０．５Ｖ、すなわち、Ｖ≦５Ｖ−０．５Ｖ＝４．５
［Ｖ］の時ＣＰＵ１５は、押下なし（ＮＯ）と判断し、
上記ステップ１００に戻り、上述した要領で押下検知を
繰り返す。
４に入力された押下電圧Ｖが、Ｖ＞Ｖcc（５Ｖ）−０．
５Ｖ、すなわち、Ｖ＞５Ｖ−０．５Ｖ＝４．５［Ｖ］の
時にＣＰＵ１５は押下あり（ＹＥＳ）と判断し、次のス
テップ１０２に移行する。また、ステップＳ１０１で、
押下電圧Ｖが、印加電圧Ｖcc［５Ｖ］のとき、Ｖ≦Ｖcc
−０．５Ｖ、すなわち、Ｖ≦５Ｖ−０．５Ｖ＝４．５
［Ｖ］の時ＣＰＵ１５は、押下なし（ＮＯ）と判断し、
上記ステップ１００に戻り、上述した要領で押下検知を
繰り返す。
【００２３】ステップ１０２では、座標入力シート１０
Ｂ上のどのブロックに入力点が存在しているかがサーチ
される。ここではＣＰＵ１５が各スイッチを、Ａ−ｏｐ
ｅｎ、Ｂ−ｏｐｅｎ、Ｃ−ａ、Ｄ−ａ、Ｅ−ｄ、に制御
し、切換回路１２のａ接点からＡ／Ｄコンバータ１４に
入力点のＸ座標上の位置がアナログ信号として入力さ
れ、デジタル信号に変換された後、ＣＰＵ１５の演算部
にて Ｘ＝Ｌx ×（Ｖ／Ｖcc） の式からなる演算が行なわれ、入力点がＸ座標のどのブ
ロックにあるかが決定される。
Ｂ上のどのブロックに入力点が存在しているかがサーチ
される。ここではＣＰＵ１５が各スイッチを、Ａ−ｏｐ
ｅｎ、Ｂ−ｏｐｅｎ、Ｃ−ａ、Ｄ−ａ、Ｅ−ｄ、に制御
し、切換回路１２のａ接点からＡ／Ｄコンバータ１４に
入力点のＸ座標上の位置がアナログ信号として入力さ
れ、デジタル信号に変換された後、ＣＰＵ１５の演算部
にて Ｘ＝Ｌx ×（Ｖ／Ｖcc） の式からなる演算が行なわれ、入力点がＸ座標のどのブ
ロックにあるかが決定される。
【００２４】次にステップ１０３では座標入力シート１
０Ａ上のどのブロックに入力点が存在しているかがサー
チされる。ここでは、ＣＰＵ１５が各スイッチをＡ−
ａ、Ｂ−ｄ、Ｃ−ｃ、Ｄ−ｏｐｅｎ、Ｅ−ｏｐｅｎに制
御し、切換回路１２のｂ接点からＡ／Ｄコンバータ１４
に入力点のＹ座標上の位置がアナログ信号として入力さ
れ、デジタル信号に変換された後、ＣＰＵ１５の演算部
にて Ｙ＝Ｌy ×（Ｖ／ＶCC） の式からなる演算が行なわれ、入力点がＹ座標上のどの
ブロックかが決定される。
０Ａ上のどのブロックに入力点が存在しているかがサー
チされる。ここでは、ＣＰＵ１５が各スイッチをＡ−
ａ、Ｂ−ｄ、Ｃ−ｃ、Ｄ−ｏｐｅｎ、Ｅ−ｏｐｅｎに制
御し、切換回路１２のｂ接点からＡ／Ｄコンバータ１４
に入力点のＹ座標上の位置がアナログ信号として入力さ
れ、デジタル信号に変換された後、ＣＰＵ１５の演算部
にて Ｙ＝Ｌy ×（Ｖ／ＶCC） の式からなる演算が行なわれ、入力点がＹ座標上のどの
ブロックかが決定される。
【００２５】さらにステップ１０４では、決定されたＸ
座標のブロックに電圧Ｖcc（５Ｖ）を印加する。この
際、ＣＰＵ１５により各スイッチは、Ａ−ｏｐｅｎ、Ｂ
−ｏｐｅｎ、Ｄ−ｃ、Ｅ−ｃとし、スイッチＣはまずｃ
に接続してブロックのＶcc側の電圧（ＶXH）を読み込
み、その後ｄに切換えてアース側の電圧（ＶXL）を読み
込み、最後にａに切換えて入力位置の分圧電圧（ＶX ）
を読み込む。
座標のブロックに電圧Ｖcc（５Ｖ）を印加する。この
際、ＣＰＵ１５により各スイッチは、Ａ−ｏｐｅｎ、Ｂ
−ｏｐｅｎ、Ｄ−ｃ、Ｅ−ｃとし、スイッチＣはまずｃ
に接続してブロックのＶcc側の電圧（ＶXH）を読み込
み、その後ｄに切換えてアース側の電圧（ＶXL）を読み
込み、最後にａに切換えて入力位置の分圧電圧（ＶX ）
を読み込む。
【００２６】こうして、Ａ／Ｄコンバータ１４にＸ座標
上のアナログ信号からなる入力信号が入力されると、こ
のアナログ信号をデジタル信号に置き換えてＣＰＵ１５
に入力する。
上のアナログ信号からなる入力信号が入力されると、こ
のアナログ信号をデジタル信号に置き換えてＣＰＵ１５
に入力する。
【００２７】次にステップ１０５では、そうして入力さ
れたＸ座標上の座標位置がＣＰＵ１５の演算部にて Ｘ＝Ｘn ＋Ｌxn・（ＶX −ＶXL）／（ＶXH−ＶXL） を用いて演算され、入力点のＸ座標上の位置が決定され
る。
れたＸ座標上の座標位置がＣＰＵ１５の演算部にて Ｘ＝Ｘn ＋Ｌxn・（ＶX −ＶXL）／（ＶXH−ＶXL） を用いて演算され、入力点のＸ座標上の位置が決定され
る。
【００２８】次にステップ１０６に移行し、ＣＰＵ１５
は各スイッチをＡ−ｂ、Ｂ−ｂ、Ｃ−ｂ、Ｄ−ｏｐｅ
ｎ、Ｅ−ｏｐｅｎとして決定されたＹ座標のブロックに
電圧Ｖcc（５Ｖ）を印加する。次いでステップ１０７
で、ＣＰＵ１５はスイッチＣをまずａに接続してブロッ
クのＶcc側の電圧（ＶYH）を読み込み、その後ｂに切換
えてアース側の電圧（ＶYL）を読み込み、最後にｃに切
換えて入力位置の分圧電圧（ＶX ）を読み込む。こうし
て入力されたＹ座標上の座標位置がＣＰＵ１５の演算部
にて Ｙ＝Ｙn ＋Ｌyn・（ＶY −ＶYL）／（ＶXH−ＶXL） で求められ、入力点のＹ座標上の位置が決定される。
は各スイッチをＡ−ｂ、Ｂ−ｂ、Ｃ−ｂ、Ｄ−ｏｐｅ
ｎ、Ｅ−ｏｐｅｎとして決定されたＹ座標のブロックに
電圧Ｖcc（５Ｖ）を印加する。次いでステップ１０７
で、ＣＰＵ１５はスイッチＣをまずａに接続してブロッ
クのＶcc側の電圧（ＶYH）を読み込み、その後ｂに切換
えてアース側の電圧（ＶYL）を読み込み、最後にｃに切
換えて入力位置の分圧電圧（ＶX ）を読み込む。こうし
て入力されたＹ座標上の座標位置がＣＰＵ１５の演算部
にて Ｙ＝Ｙn ＋Ｌyn・（ＶY −ＶYL）／（ＶXH−ＶXL） で求められ、入力点のＹ座標上の位置が決定される。
【００２９】以上の説明から明らかなように、本実施例
のデジタイザによれば、座標入力シート１０Ａ、１０Ｂ
の帯状抵抗体１７を複数のブロックに、それぞれ５本の
電極を配して４分割され、配設される電極１６、…間の
距離が短縮されることにより、均一抵抗体１７の印刷ム
ラによる座標入力精度への影響を少なくし、正確な入力
情報が得られる。
のデジタイザによれば、座標入力シート１０Ａ、１０Ｂ
の帯状抵抗体１７を複数のブロックに、それぞれ５本の
電極を配して４分割され、配設される電極１６、…間の
距離が短縮されることにより、均一抵抗体１７の印刷ム
ラによる座標入力精度への影響を少なくし、正確な入力
情報が得られる。
【００３０】また、帯状抵抗体の両端に基準電圧端子を
設け各ブロックに印加された電圧を検出することによ
り、電極のパターン抵抗によって生じる電圧降下による
誤差を少なくすることが出来る。
設け各ブロックに印加された電圧を検出することによ
り、電極のパターン抵抗によって生じる電圧降下による
誤差を少なくすることが出来る。
【００３１】このためコンピュータ等の出力手段に正確
な入力点の座標入力点を入力でき、しかも従来と同じ分
解能のＡ／Ｄ変換器を使用して分解能を従来の４倍程度
に向上させることが出来るとともに、精度面の向上をも
図ることが出来る。
な入力点の座標入力点を入力でき、しかも従来と同じ分
解能のＡ／Ｄ変換器を使用して分解能を従来の４倍程度
に向上させることが出来るとともに、精度面の向上をも
図ることが出来る。
【００３２】
【発明の効果】以上のように本発明のデジタイザによれ
ば、帯状抵抗体を複数のブロックに複数本の電極を配設
して分割し、そうして電極間の距離を短くすることによ
り、帯状抵抗体の印刷ムラによる座標入力精度への影響
を少なくすることが出来る。
ば、帯状抵抗体を複数のブロックに複数本の電極を配設
して分割し、そうして電極間の距離を短くすることによ
り、帯状抵抗体の印刷ムラによる座標入力精度への影響
を少なくすることが出来る。
【００３３】また、帯状抵抗体の両端に基準電圧端子を
設け各ブロックに印加された電圧を検出することにより
電極のパターン抵抗によって生じる電圧降下による誤差
を少なくすることが出来る。
設け各ブロックに印加された電圧を検出することにより
電極のパターン抵抗によって生じる電圧降下による誤差
を少なくすることが出来る。
【００３４】従って、正確な入力情報が得られる様にし
てコンピュータなどの出力手段に正確なデジタイザの入
力点の座標入力を出力でき、しかも精度及び分解能の向
上が図れるなどの効果が期待できる。
てコンピュータなどの出力手段に正確なデジタイザの入
力点の座標入力を出力でき、しかも精度及び分解能の向
上が図れるなどの効果が期待できる。
【図１】本発明のデジタイザの一実施例の構成を示すブ
ロック図である。
ロック図である。
【図２】図１のデジタイザの動作を説明するためのフロ
ーチャートである。
ーチャートである。
【図３】従来の座標入力シートを用いたデジタイザの原
理図である。
理図である。
【図４】従来の座標入力シートの平面図である。デジタ
イザの断面図である。
イザの断面図である。
１０Ａ、１０Ｂ 座標入力シート １４ Ａ／Ｄ変換器 １５ ＣＰＵ（検出手段） １６ａ 基準電圧端子 １７ 帯状抵抗体 １８ ストライプ状電極
Claims (1)
- 【請求項１】 帯状抵抗体とストライプ状電極からなる
２枚のシートを、それぞれのシートの帯状抵抗体が交互
に直交する方向に積層され、かつ前記各シート間を絶縁
するドットスペーサを有するデジタイザであって、上記
帯状抵抗体を複数のブロックに分割するために配設され
た複数本の電極と、上記帯状抵抗体の両端に設けられた
基準電圧端子と、上記各ブロックに対して電圧を印加す
るための切換回路とを有し、前記基準電圧端子から各ブ
ロックに印加された電圧を読み込み、読み込んだ電圧と
入力された位置の分電圧とから入力座標を検出する検出
手段とを備えることを特徴とするデジタイザ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24483691A JPH0561594A (ja) | 1991-08-30 | 1991-08-30 | デジタイザ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP24483691A JPH0561594A (ja) | 1991-08-30 | 1991-08-30 | デジタイザ |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0561594A true JPH0561594A (ja) | 1993-03-12 |
Family
ID=17124691
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP24483691A Pending JPH0561594A (ja) | 1991-08-30 | 1991-08-30 | デジタイザ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0561594A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61173332A (ja) * | 1984-12-25 | 1986-08-05 | Seiko Epson Corp | 入力装置 |
| JPS62117025A (ja) * | 1985-11-18 | 1987-05-28 | Iwatsu Electric Co Ltd | 座標検出装置 |
-
1991
- 1991-08-30 JP JP24483691A patent/JPH0561594A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61173332A (ja) * | 1984-12-25 | 1986-08-05 | Seiko Epson Corp | 入力装置 |
| JPS62117025A (ja) * | 1985-11-18 | 1987-05-28 | Iwatsu Electric Co Ltd | 座標検出装置 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A02 | Decision of refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A02 Effective date: 19980303 |