JPH0562866B2 - - Google Patents

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JPH0562866B2
JPH0562866B2 JP60223030A JP22303085A JPH0562866B2 JP H0562866 B2 JPH0562866 B2 JP H0562866B2 JP 60223030 A JP60223030 A JP 60223030A JP 22303085 A JP22303085 A JP 22303085A JP H0562866 B2 JPH0562866 B2 JP H0562866B2
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JP
Japan
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address
image
memory
read
cycle
Prior art date
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Application number
JP60223030A
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English (en)
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JPS6282779A (ja
Inventor
Hiroyuki Iida
Tadashi Okada
Harukuni Mori
Akio Nishimura
Noryuki Sagishima
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP60223030A priority Critical patent/JPS6282779A/ja
Publication of JPS6282779A publication Critical patent/JPS6282779A/ja
Publication of JPH0562866B2 publication Critical patent/JPH0562866B2/ja
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Description

【発明の詳細な説明】 産業上の利用分野 本発明は、例えばテレビジヨン信号に縮小など
の特殊効果を与え、同一画面上に同時に複数の縮
小画像を動画のまま得ることが出来る画像特殊効
果装置に関するものである。
従来の技術 従来この種の画像特殊効果装置として、A/D
変換されたデジタル信号を、書込みアドレスを制
御し画素を間引いて1フレーム分の容量を持つ画
像メモリに書込むことにより入力画像を縮小し、
そのメモリを読出すとき読出しアドレスを水平方
向、垂直方向に鋸波状に制御することにより入力
画像(入力映像信号)を複数の縮小された動画信
号に変換するようなものが提案されている。この
ような原理に基づく画像特殊効果装置として第7
図に示す構成のものが考えられる。同図で第8図
に示される入力画像はA/D変換器1でデイジタ
ル化され書込みアドレス発生回路3により1フレ
ーム分の容量を持つ画像メモリ2に画素が間引か
れて第9図に示すように縮小された画像に変換さ
れる。
更に読出しアドレス発生回路4は第12図に示
すような鋸歯状の読出しアドレスを発生し、その
読出しアドレスにより入力画像を画像メモリ2か
ら読出すことによつて第8図のような縮小画像を
得る。
このように上記従来の画像特殊効果装置でも書
込みアドレス制御回路が入力画像を縮小し、読出
しアドレス制御回路が鋸歯状に読出しアドレスを
発生することにより、一画面上に入力画像を動画
のまま複数個表示することができる。
発明が解決しようとする問題点 しかしながら、上記従来の画像特殊効果装置で
は、鋸歯状波の周期と振幅を変化すことにより、
一画面上に表示する入力画像の数を制御するた
め、同一形状の画像だけであり、入力画像を色々
な形、例えば球や円筒などに張りつけ、それらを
一画面上に同時に動画のまま表示することができ
ないという問題があつた。本発明はこのような従
来の問題を解決するものであり、入力画像を色々
な形、例えば球や円筒、円錐などに張りつけ、そ
れを同一画面上に複数個動画のまま表示すること
のできる優れた画像特殊効果装置を提供すること
を目的とするものである。
問題点を解決するための手段 本発明は、上記問題点を解決するために入力画
像を球、円筒などの色々な形状に張りつける読出
しアドレス発生回路と、そのアドレスを格納する
アドレスメモリとアドレスメモリを制御するアド
レスメモリ制御回路とデイジタル化された入力画
像を記憶する画像メモリを備えるように構成した
ものである。
作 用 本発明は上記のように構成することにより、入
力画像を色々な形に張りつけ、それを一画面上に
複数に入力画像が動画のまま表示することができ
る効果を得るものである。
実施例 第1図は本発明の一実施例の構成を示すもので
あり、1はA/D変換器、2は画像メモリ、5は
D/A変換器、6は書込みアドレス発生回路、7
はアドレスメモリ、7a〜7cはアドレスメモリ1
〜3,8はアドレスメモリ制御回路、9は読出し
アドレス発生回路、10,11はそれぞれ第1、
第2の切換スイツチである。ここで、入力画像
(入力映像信号)はA/D変換器1によりデイジ
タル信号に変換され書込みアドレス発生回路6に
従つて順番に画像メモリ2に書込まれる。読出し
アドレス発生回路9は入力画像を色々な形状、例
えば球に張りつけたときの画像メモリ2の読出し
アドレスを発生し、発生されたアドレスは、ライ
トサイクルにあるアドレスメモリに書込まれる。
同時に、前フイールド時にライトサイクルであつ
たアドレスメモリ7をリードサイクルとして読出
し、書込まれていたアドレスに従つて画像メモリ
2から入力画像を読出す。また前フイールド時に
読出しサイクルだつたアドレスメモリ7は、次の
サイクルに備えてクリアサイクルとなりクリアさ
れる。このように3枚のアドレスメモリ7a〜7c
はライト、リード、クリアサイクルを順にくり返
す。アドレスメモリ制御回路8を操作することに
よりアドレスメモリ7のクリアサイクルを止めて
2枚のアドレスメモリでリードサイクルとライト
サイクルをくり返すこともできる。画像メモリ2
に書込まれた映像データはアドレスメモリ7から
読出されたアドレスにより読出されD/A変換器
5によつてアナログの映像信号に変換され出力さ
れるように構成されている。
次に上記実施例の動作について説明する。入力
画像はA/D変換器1によりデイジタル化され書
込みアドレス発生回路6により順番に画像メモリ
2に書込まれる。次に、読出しアドレス発生回路
9は第2図のように入力画像を例えば球に張りつ
けたときの画像メモリ2に対する読出しアドレス
を発生し、3枚のアドレスメモリ7a〜7cのうち
ライトサイクルにあるアドレスメモリの球の存在
する位置に読出しアドレスを書込む。通常3枚の
アドレスメモリ7a〜7cは、アドレスメモリ制御
回路8により第3図のようにフイールド毎にライ
トサイクル、リードサイクル、クリアサイクルを
くり返している。そのために読出しアドレス発生
回路9で発生された形状の読出しアドレスは、演
算されるのに1フイールドの時間を使用するので
結果的にアドレスメモリ7に1つの形状しかメモ
リされない。しかし、メモリアドレス制御回路8
を操作し、第4図のようにクリアサイクルを止め
2枚のアドレスメモリ7により切換スイツチ1
0,11、を介してライトサイクルとリードサイ
クルを交互に行うと、あるフイールドで第2図で
示された球の読出しアドレスをアドレスメモリ7
に書込んだままフイールドで例えば第5図のよう
に読出しアドレス発生回路9が発生した別の形状
である入力画像を円筒に張りつけたときの読出し
アドレスを読出したアドレス発生回路9により発
生し、アドレスメモリ7にクリアを行わないで重
ね書きすることができる。リードサイクルにある
アドレスメモリ7はアドレスメモリ制御回路8に
より順番に読出され、読出されたアドレスに従つ
て画像メモリ2から入力画像を読出し、D/A変
換器5によつてアナログ画像に変換され出力画像
12を得る。
本発明は上記実施例により示した構成により次
のような作用を有する。すなわちデイジタル化さ
れた入力画像は、順番に画像メモリ7a〜7cに書
込まれ、次に、アドレス発生回路6が入力画像を
例えば球や円筒に張りつけたときに対応する画像
メモリ2の読出しアドレスを発生し、その読出し
アドレスを張りつけた物体を表示する位置のアド
レスメモリ7に書込み、アドレスメモリ7を順番
に読出し所定の位置に書込まれていたアドレスに
従つて画像メモリ2を読出すことにより入力画像
が球や円筒に張りついているような画像を得る。
ここで、アドレスメモリ制御回路8を操作し、ア
ドレスメモリ7のクリアサイクルを止めアドレス
メモリ制御回路8が発生した別の形状の読出しア
ドレスをアドレスメモリ7の別の位置に書込み、
次に、アドレスメモリ7を順番に読出し、読出さ
れたアドレスにより画像メモリ2を読出すことに
よつて入力画像が動画のまま複数の異種形状に張
りついた画像を得ることができる。
発明の効果 本発明は上記のような構成であり、1つの画面
上に任意の形状に動画のまま入力画像を張りつけ
た画像を任意の位置にいくつでも後書き優先で表
示することができ、特殊効果装置の機能を大巾に
拡大できる利点を有するものである。
【図面の簡単な説明】
第1図は本発明の一実施例における特殊効果装
置のブロツク図、第2図は入力画像を球に張りつ
けたときのアドレスメモリのイメージ図、第3図
は通常のアドレスメモリのタイミングチヤート、
第4図は本発明の効果を得るときのアドレスメモ
リのタイミングチヤート、第5図は入力画像を円
筒に張りつけたときのアドレスメモリのイメージ
図、第6図は本発明により得られた出力画像の一
例の説明図、第7図は従来の特殊効果装置のブロ
ツク図、第8図は入力画像を示す図、第9図は書
込みアドレスを制御し、入力画像を縮小し、画像
メモリに書込んだ図、第10図は読出しアドレス
を制御し縮小した入力画像を1画面に4つ表示し
た図、第11図は通常の読出しアドレスと時間の
関係を示したグラフ、第12図は第10図の出力
画像を得るときの読出しアドレスと時間の関係を
示したグラフである。 1…A/D変換器、2…画像メモリ、5…D/
A変換器、7…アドレスメモリ、8…アドレスメ
モリ制御回路、9…読出しアドレス発生回路、1
0,11…切換スイツチ。

Claims (1)

    【特許請求の範囲】
  1. 1 デジタル変換された入力映像信号を、書込み
    アドレス信号によつて画像1フレーム分を記憶す
    る画像メモリと、縮小された所望形状に対応する
    画像1フレーム分のアドレスが記憶された読出し
    アドレス発生回路と、上記アドレス発生回路の1
    フイールド分のデータを、リードサイクル時に書
    込み、ライトサイクル時に読出し、クリアサイク
    ル時に消去する複数のアドレスメモリと、これら
    アドレスメモリの各サイクルをそれぞれ指定する
    アドレスメモリ制御回路とを備え、この制御回路
    の指定によつて上記アドレス発生回路が発生した
    所望形状のアドレスを、上記アドレスメモリのデ
    ータをクリアせずに重ね書きすることにより、上
    記所望形状の図形の背景を通常の動画にできるこ
    とを特徴とする画像特殊効果装置。
JP60223030A 1985-10-07 1985-10-07 画像特殊効果装置 Granted JPS6282779A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP60223030A JPS6282779A (ja) 1985-10-07 1985-10-07 画像特殊効果装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP60223030A JPS6282779A (ja) 1985-10-07 1985-10-07 画像特殊効果装置

Publications (2)

Publication Number Publication Date
JPS6282779A JPS6282779A (ja) 1987-04-16
JPH0562866B2 true JPH0562866B2 (ja) 1993-09-09

Family

ID=16791741

Family Applications (1)

Application Number Title Priority Date Filing Date
JP60223030A Granted JPS6282779A (ja) 1985-10-07 1985-10-07 画像特殊効果装置

Country Status (1)

Country Link
JP (1) JPS6282779A (ja)

Families Citing this family (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0232286U (ja) * 1988-08-22 1990-02-28

Also Published As

Publication number Publication date
JPS6282779A (ja) 1987-04-16

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