JPH0568154B2 - - Google Patents
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- JPH0568154B2 JPH0568154B2 JP59076915A JP7691584A JPH0568154B2 JP H0568154 B2 JPH0568154 B2 JP H0568154B2 JP 59076915 A JP59076915 A JP 59076915A JP 7691584 A JP7691584 A JP 7691584A JP H0568154 B2 JPH0568154 B2 JP H0568154B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- voltage
- transistor
- circuit
- current source
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
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- Details Of Television Scanning (AREA)
- Pulse Circuits (AREA)
- Picture Signal Circuits (AREA)
- Processing Of Color Television Signals (AREA)
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、一定の幅を持つた信号に付随した信
号、例えば映像信号の場合には水平の同期信号に
付随したバーストゲート信号のような信号を発生
させるのに適した回路に関するものである。
号、例えば映像信号の場合には水平の同期信号に
付随したバーストゲート信号のような信号を発生
させるのに適した回路に関するものである。
従来例の構成とその問題点
映像信号における同期信号のような一定の幅を
持つた信号に付随して、例えばブランキング信号
やバーストゲート信号や、ペデスタルクランプ信
号のような信号を発生する必要が有る場合があ
る。例えば水平帰線区間で映像信号の出力を禁止
するのにブランキング信号を用いている。またカ
ラー映像信号を処理する場合には、同期信号の後
に附加されているバースト信号をぬき出して、各
種のカラー信号の処理を行なう為に、バーストゲ
ート信号を用いている。また、輝度信号の直流成
分を再生したり、各種の処理を行なう為に、輝度
信号を特定の電位にクランプする為、ペデスタル
クランプ信号を用いている。
持つた信号に付随して、例えばブランキング信号
やバーストゲート信号や、ペデスタルクランプ信
号のような信号を発生する必要が有る場合があ
る。例えば水平帰線区間で映像信号の出力を禁止
するのにブランキング信号を用いている。またカ
ラー映像信号を処理する場合には、同期信号の後
に附加されているバースト信号をぬき出して、各
種のカラー信号の処理を行なう為に、バーストゲ
ート信号を用いている。また、輝度信号の直流成
分を再生したり、各種の処理を行なう為に、輝度
信号を特定の電位にクランプする為、ペデスタル
クランプ信号を用いている。
このような信号の例を第１図に示す。同図ａは
映像信号の水平同期信号と、その前後を示してい
る。ｂは同期分離された水平同期信号を示す。ｃ
はブランキング信号を示す。ｄはバーストゲート
信号を示しており、この信号は、水平同期信号と
一定の関係を持つた信号であり、一般に水平同期
信号を規準として作られる。この信号は、ペデス
タルクランプ信号として用いることも出来る。
映像信号の水平同期信号と、その前後を示してい
る。ｂは同期分離された水平同期信号を示す。ｃ
はブランキング信号を示す。ｄはバーストゲート
信号を示しており、この信号は、水平同期信号と
一定の関係を持つた信号であり、一般に水平同期
信号を規準として作られる。この信号は、ペデス
タルクランプ信号として用いることも出来る。
ところで厳密さが要求されない場合には、これ
らの信号の代りに同図ｅに示すような、同期信号
の開始点で“High”になり、ほぼブランキング
区間の終りの点で“Low”になるような信号を
ブランキング信号として用いたり、ｆに示すよう
な同期信号の終つた点で“High”になり、バー
スト信号の後のブランキング区間で“Low”に
なる信号をバーストゲート信号又はペデスタルク
ランプ信号として用いても良い。
らの信号の代りに同図ｅに示すような、同期信号
の開始点で“High”になり、ほぼブランキング
区間の終りの点で“Low”になるような信号を
ブランキング信号として用いたり、ｆに示すよう
な同期信号の終つた点で“High”になり、バー
スト信号の後のブランキング区間で“Low”に
なる信号をバーストゲート信号又はペデスタルク
ランプ信号として用いても良い。
第２図には、第１図ｅ又はｆのような信号を発
生させる回路の従来例を示す。端子１には映像信
号が入力され、同期分離回路２で、同期信号が分
離される。３は定電流源、４は同期信号が入力さ
れない期間で閉じるスイツチ回路である。これら
３及び４で同期信号が入力されない時に動作する
電流源を構成している。
生させる回路の従来例を示す。端子１には映像信
号が入力され、同期分離回路２で、同期信号が分
離される。３は定電流源、４は同期信号が入力さ
れない期間で閉じるスイツチ回路である。これら
３及び４で同期信号が入力されない時に動作する
電流源を構成している。
今、十分長い期間にわたつて、同期信号が入力
されなかつたとすると、コンデンサー７は、定電
流源３によつて充電され、端子１５の電圧は定電
圧源９の電圧と、ダイオード９の順方向電圧の和
で決まる電圧に固定される。６は定電流源であ
り、５は同期信号区間で閉じるスイツチ回路であ
る。これら５と６で同期信号が入力された時に動
作する電流源を構成している。１０は電圧比較
器、１１は論理回路、１２は出力端子を示す。
されなかつたとすると、コンデンサー７は、定電
流源３によつて充電され、端子１５の電圧は定電
圧源９の電圧と、ダイオード９の順方向電圧の和
で決まる電圧に固定される。６は定電流源であ
り、５は同期信号区間で閉じるスイツチ回路であ
る。これら５と６で同期信号が入力された時に動
作する電流源を構成している。１０は電圧比較
器、１１は論理回路、１２は出力端子を示す。
第３図は、第２図の動作を示す説明図である。
同図ａは同期分離回路２で分離された同期信号を
示す。ｂは端子１５の電圧を示す。同期信号が入
力される前の電圧V0は、電圧源９の電圧をV9、
ダイオード８の順方向電圧をVD8とすると、 V0
＝V9＋VD8 ……(1) と表わされる。定電流源６の電流をI6、同期信号
区間の長さをT1、コンデンサー７の容量値をC7
とすると、同期信号区間における端子１５の電圧
変化量ΔV1は ΔV1＝I6・T1／Ｃ ……(2) となる。次に、同期信号が終つた後、端子１５の
電圧がV0にもどるまでの時間をT2、電流源３の
電流をI3とすると、(3)式が成り立つ。
同図ａは同期分離回路２で分離された同期信号を
示す。ｂは端子１５の電圧を示す。同期信号が入
力される前の電圧V0は、電圧源９の電圧をV9、
ダイオード８の順方向電圧をVD8とすると、 V0
＝V9＋VD8 ……(1) と表わされる。定電流源６の電流をI6、同期信号
区間の長さをT1、コンデンサー７の容量値をC7
とすると、同期信号区間における端子１５の電圧
変化量ΔV1は ΔV1＝I6・T1／Ｃ ……(2) となる。次に、同期信号が終つた後、端子１５の
電圧がV0にもどるまでの時間をT2、電流源３の
電流をI3とすると、(3)式が成り立つ。
ΔV1＝I3・T2／Ｃ ……(3)
(2)，(3)式より、
T2＝I6・T1／I3 ……(4)
と表わされる。
(4)式よりT1は映像信号個有の値である為I6とI3
の比を適当に選ぶことにより、T2の値は任意に
選ぶことが出来る。電圧比較器１０は、端子１５
の電圧が、(1)式で求まる電圧V0より、わずかに
低くなつたことを検出する。第３図ｃに電圧比較
器１０の出力を示す。この信号は前述のように、
ブランキング信号として用いることが出来る。論
理回路１１は排他的論理和回路として動作し、第
３図ｄに示す信号を出力する。この信号が
“High”になる期間は、ほぼT2となり、T2の値
はI3とI6の比を適当に選ぶことにより、任意に設
定できる。この信号は第１図ｄに示す信号に対応
しており、例えばバーストゲート信号やペデスタ
ルクランプ信号として用いることが出来る。
の比を適当に選ぶことにより、T2の値は任意に
選ぶことが出来る。電圧比較器１０は、端子１５
の電圧が、(1)式で求まる電圧V0より、わずかに
低くなつたことを検出する。第３図ｃに電圧比較
器１０の出力を示す。この信号は前述のように、
ブランキング信号として用いることが出来る。論
理回路１１は排他的論理和回路として動作し、第
３図ｄに示す信号を出力する。この信号が
“High”になる期間は、ほぼT2となり、T2の値
はI3とI6の比を適当に選ぶことにより、任意に設
定できる。この信号は第１図ｄに示す信号に対応
しており、例えばバーストゲート信号やペデスタ
ルクランプ信号として用いることが出来る。
次に、電圧比較器１０の例を第４図に示す。同
図において、７，８，９及び１５は第２図と同じ
である。トランジスター２３，２４，２５，３
０、抵抗２６，２９，３１、定電圧源３２で構成
される回路は、トランジスター２３及び２４のベ
ース電圧を比較し、トランジスター２３のベース
電圧が、トランジスター２４のベース電圧より低
くなると、端子３３に“High”の電圧を出力す
る。ダイオード２０、トランジスター２７、抵抗
２１，２２，２８は、前述のV0よりもわずかに
低い電圧を発生させる回路である。
図において、７，８，９及び１５は第２図と同じ
である。トランジスター２３，２４，２５，３
０、抵抗２６，２９，３１、定電圧源３２で構成
される回路は、トランジスター２３及び２４のベ
ース電圧を比較し、トランジスター２３のベース
電圧が、トランジスター２４のベース電圧より低
くなると、端子３３に“High”の電圧を出力す
る。ダイオード２０、トランジスター２７、抵抗
２１，２２，２８は、前述のV0よりもわずかに
低い電圧を発生させる回路である。
ところで、第４図の例では端子３３に“High”
が出力される時には、トランジスター２３が導通
しており、そのベース電流IBQ23が流れる。この電
流はコンデンサー７に対しては、充電電流となる
為、この影響を考慮した場合、第２図の端子１２
で得られる出力信号の周期T20は、(4)式より T20＝（I6−IBQ23）／I3＋IBQ23・T1 ……(5) となり、(4)式で求まるT2に対して、誤差を生じ
る。この誤差は特に、第２図の回路をIC化した
場合に、大きく表われて来る。すなわち、IC内
部では小さい容量のコンデンサーしか実現できな
い為、(2)又は(3)式で示すΔV1を適当な値にするの
にI3及びI6を小さく設定しなければならず、IBQ23
の影響が無視できなくなる為である。
が出力される時には、トランジスター２３が導通
しており、そのベース電流IBQ23が流れる。この電
流はコンデンサー７に対しては、充電電流となる
為、この影響を考慮した場合、第２図の端子１２
で得られる出力信号の周期T20は、(4)式より T20＝（I6−IBQ23）／I3＋IBQ23・T1 ……(5) となり、(4)式で求まるT2に対して、誤差を生じ
る。この誤差は特に、第２図の回路をIC化した
場合に、大きく表われて来る。すなわち、IC内
部では小さい容量のコンデンサーしか実現できな
い為、(2)又は(3)式で示すΔV1を適当な値にするの
にI3及びI6を小さく設定しなければならず、IBQ23
の影響が無視できなくなる為である。
また、前述のV0よりわずかに低い電圧を発生
させる為に、前述のように特別の回路が必要にな
り、全体の素子数が多くなる。
させる為に、前述のように特別の回路が必要にな
り、全体の素子数が多くなる。
発明の目的
本発明は、従来例におけるような電圧比較器
が、コンデンサーの充放電回路に悪影響を与える
ことを無くすとともに、回路構成を大幅に簡略化
された一定の幅を持つた信号に付随した信号を発
生する信号発生装置を提供することにある。
が、コンデンサーの充放電回路に悪影響を与える
ことを無くすとともに、回路構成を大幅に簡略化
された一定の幅を持つた信号に付随した信号を発
生する信号発生装置を提供することにある。
発明の構成
本発明の構成は、電荷が充放電されるコンデン
サーに対して、そのエミツターが接続され、その
ベースには、定電圧源が接続され、そのコレクタ
ーより出力が取り出されるトランジスターによつ
て、電圧比較回路を構成するとともに、このトラ
ンジスターによつて上記電荷が充分放電されるコ
ンデンサーの初期電圧の設定を行なうことによ
り、上記の目的を達成しようとするものである。
サーに対して、そのエミツターが接続され、その
ベースには、定電圧源が接続され、そのコレクタ
ーより出力が取り出されるトランジスターによつ
て、電圧比較回路を構成するとともに、このトラ
ンジスターによつて上記電荷が充分放電されるコ
ンデンサーの初期電圧の設定を行なうことによ
り、上記の目的を達成しようとするものである。
実施例の説明
第５図は、本発明の一実施例を示す。同図にお
いて、第２図と同一の素子は同一の番号を付し
た。接点１５には、トランジスター４０のエミツ
ターが接続されている。またトランジスター４０
のベースには定電圧源４２が、コレクターには抵
抗４１及びトランジスター３０のベースが接続さ
れている。トランジスター３０のエミツターは、
接地されており、コレクターは抵抗３１を通して
電源へ接続されている。トランジスター３０のコ
レクター出力は、第２図の電圧比較器１０の出力
に相当し、論理回路１１へ接続されている。
いて、第２図と同一の素子は同一の番号を付し
た。接点１５には、トランジスター４０のエミツ
ターが接続されている。またトランジスター４０
のベースには定電圧源４２が、コレクターには抵
抗４１及びトランジスター３０のベースが接続さ
れている。トランジスター３０のエミツターは、
接地されており、コレクターは抵抗３１を通して
電源へ接続されている。トランジスター３０のコ
レクター出力は、第２図の電圧比較器１０の出力
に相当し、論理回路１１へ接続されている。
以下に、第５図の動作を説明する。第２図の場
合と同様、同期信号が入力される前の区間では、
定電流源３の電流によりコンデンサー７が充電さ
れ、十分時間がたつた後は、端子１５の電圧は、
(6)式で求まる電圧V01に固定される。
合と同様、同期信号が入力される前の区間では、
定電流源３の電流によりコンデンサー７が充電さ
れ、十分時間がたつた後は、端子１５の電圧は、
(6)式で求まる電圧V01に固定される。
V01＝VBEQ40＋V42 ……(6)
ここに、VBEQ40はトランジスター４０のベー
ス・エミツター間電圧、V42は定電圧源４２の電
圧を示す。この時、定電流源３の電流はトランジ
スター４０のエミツターからコレクターへ流れた
後、抵抗４１へ流入する。この電流により抵抗４
１の両端に電圧が発生し、トランジスター３０が
“ON”になり、トランジスター３０のコレクタ
ー電圧は、ほぼアース電位になる。
ス・エミツター間電圧、V42は定電圧源４２の電
圧を示す。この時、定電流源３の電流はトランジ
スター４０のエミツターからコレクターへ流れた
後、抵抗４１へ流入する。この電流により抵抗４
１の両端に電圧が発生し、トランジスター３０が
“ON”になり、トランジスター３０のコレクタ
ー電圧は、ほぼアース電位になる。
一方、同期信号が入力されると、スイツチ４が
開き、スイツチ５が閉じるので定電流源６の電流
により、コンデンサー７は放電され始め接点１５
の電圧は降下し始める。コンデンサー７の放電が
開始されると、トランジスター４０は、ただちに
遮断され、従つて、そのコレクターには電流が流
れず、抵抗４１の両端は、ともにアース電位とな
る。従つて、トランジスター３０は“OFF”に
なり、そのコレクター電圧は、電源電圧に等しく
なる。
開き、スイツチ５が閉じるので定電流源６の電流
により、コンデンサー７は放電され始め接点１５
の電圧は降下し始める。コンデンサー７の放電が
開始されると、トランジスター４０は、ただちに
遮断され、従つて、そのコレクターには電流が流
れず、抵抗４１の両端は、ともにアース電位とな
る。従つて、トランジスター３０は“OFF”に
なり、そのコレクター電圧は、電源電圧に等しく
なる。
次に、同期信号区間が終ると、コンデンサー７
は、電流源３によつて、再び充電され始め、端子
１５の電圧は上昇する。接点１５の電圧が再び
V01に達するとトランジスター４０は導通し、接
点１５の電圧はV01に固定され、定電流源３の電
流はトランジスター４０のエミツターを通つてコ
レクターへ出力される。この時、トランジスター
３０のコレクター電圧は、前述と同様にアース電
圧となる。トランジスター３０のコレクター出力
は、論理回路１１へ入力される。この時、同期信
号の波形、接点１５の電圧、トランジスター３０
のコレクターの電圧、論理回路１１の出力電圧
は、各々第３図のａ，ｂ，ｃ，ｄに相当する。こ
こで、ｃはブランキング信号として、ｄはバース
トゲート信号又はペデスタルクランプ信号として
用いることができる。
は、電流源３によつて、再び充電され始め、端子
１５の電圧は上昇する。接点１５の電圧が再び
V01に達するとトランジスター４０は導通し、接
点１５の電圧はV01に固定され、定電流源３の電
流はトランジスター４０のエミツターを通つてコ
レクターへ出力される。この時、トランジスター
３０のコレクター電圧は、前述と同様にアース電
圧となる。トランジスター３０のコレクター出力
は、論理回路１１へ入力される。この時、同期信
号の波形、接点１５の電圧、トランジスター３０
のコレクターの電圧、論理回路１１の出力電圧
は、各々第３図のａ，ｂ，ｃ，ｄに相当する。こ
こで、ｃはブランキング信号として、ｄはバース
トゲート信号又はペデスタルクランプ信号として
用いることができる。
ところで、第５図の本発明の実施例において
は、コンデンサー７の電圧がV01よりも下つた区
間においては、トランジスター４０は遮断状態に
有る。従つて、トランジスター４０は、コンデン
サー７の充電及び放電の時定数には従来例の場合
と異なり影響を与えず、端子１２に出力される信
号の幅は式(4)で求まる値に対して正しく得られ
る。
は、コンデンサー７の電圧がV01よりも下つた区
間においては、トランジスター４０は遮断状態に
有る。従つて、トランジスター４０は、コンデン
サー７の充電及び放電の時定数には従来例の場合
と異なり影響を与えず、端子１２に出力される信
号の幅は式(4)で求まる値に対して正しく得られ
る。
一方、第５図の４０，４１，４２で構成される
回路が、第４図では８，９，２０，２１，２２，
２３，２４，２５，２６，２７，２８，３２で構
成される回路に相当し、大幅に素子数を減らして
いる。
回路が、第４図では８，９，２０，２１，２２，
２３，２４，２５，２６，２７，２８，３２で構
成される回路に相当し、大幅に素子数を減らして
いる。
なお、第５図において、スイツチ回路４が同期
信号が入力された時に閉じ、スイツチ回路５が、
同期信号が入力されない時に閉じるように構成し
た場合には、トランジスター４０をNPNトラン
ジスターに置き換えることで、容易にブランキン
グ信号やバーストゲート信号、ペデスタルクラン
プ信号等の信号を作ることが出来ることは明らか
である。
信号が入力された時に閉じ、スイツチ回路５が、
同期信号が入力されない時に閉じるように構成し
た場合には、トランジスター４０をNPNトラン
ジスターに置き換えることで、容易にブランキン
グ信号やバーストゲート信号、ペデスタルクラン
プ信号等の信号を作ることが出来ることは明らか
である。
発明の効果
本発明によれば入力信号に応じて電荷が充放電
されるコンデンサーにエミツターが接続され、ベ
ースには一定電圧が供給され、コレクターから信
号を取り出すトランジスターを設けることによ
り、簡単な構成で、設計値どおりの特性を持つ、
一定の幅を持つた信号に付随した信号を得ること
が出来るものである。
されるコンデンサーにエミツターが接続され、ベ
ースには一定電圧が供給され、コレクターから信
号を取り出すトランジスターを設けることによ
り、簡単な構成で、設計値どおりの特性を持つ、
一定の幅を持つた信号に付随した信号を得ること
が出来るものである。
第１図は映像信号における同期信号及び同期信
号に付随した信号の例を示す波形図、第２図は同
期信号に付随した信号を発生する従来例の回路
図、第３図は第２図の動作を示す説明図、第４図
は従来の電圧比較器とその周辺を示す回路図、第
５図は本発明の一実施例を示す回路図である。 ２……同期分離回路、３……定電流源、４……
同期信号以外の区間で閉じるスイツチ回路、５…
…同期信号区間で閉じるスイツチ回路、６……定
電流源、７……コンデンサー、１０……電圧比較
器、１１……論理回路、４０……トランジスタ
ー、４１……抵抗、４２……定電圧源。
号に付随した信号の例を示す波形図、第２図は同
期信号に付随した信号を発生する従来例の回路
図、第３図は第２図の動作を示す説明図、第４図
は従来の電圧比較器とその周辺を示す回路図、第
５図は本発明の一実施例を示す回路図である。 ２……同期分離回路、３……定電流源、４……
同期信号以外の区間で閉じるスイツチ回路、５…
…同期信号区間で閉じるスイツチ回路、６……定
電流源、７……コンデンサー、１０……電圧比較
器、１１……論理回路、４０……トランジスタ
ー、４１……抵抗、４２……定電圧源。
Claims (1)
- 【特許請求の範囲】 １ 第１の電流源と、前記第１の電流源と逆極性
の第２の電流源と、一定の幅を持つた同期信号が
入力された時に前記第１の電流源の電流を通過さ
せる第１のスイツチ回路と、一定の幅を持つた同
期信号が入力されない時に前記第２の電流源の電
流を通過させる第２のスイツチ回路と、前記第１
及び第２のスイツチ回路に共通に接続されたコン
デンサーと、エミツターが前記コンデンサーと前
記第１・第２のスイツチ回路の接続点に接続さ
れ、ベースが定電圧源に接続され、コレクターか
ら信号が取り出されるトランジスターから構成さ
れたことを特徴とする信号発生回路。 ２ 一定の幅を持つた同期信号と、特許請求の範
囲第１項に記載のトランジスターのコレクターか
ら取り出された信号をもとに、同期信号に付随し
た信号を発生することを特徴とする信号発生回
路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59076915A JPS60220691A (ja) | 1984-04-17 | 1984-04-17 | 信号発生回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59076915A JPS60220691A (ja) | 1984-04-17 | 1984-04-17 | 信号発生回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60220691A JPS60220691A (ja) | 1985-11-05 |
| JPH0568154B2 true JPH0568154B2 (ja) | 1993-09-28 |
Family
ID=13618980
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59076915A Granted JPS60220691A (ja) | 1984-04-17 | 1984-04-17 | 信号発生回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60220691A (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH07105953B2 (ja) * | 1985-12-28 | 1995-11-13 | ソニー株式会社 | バ−ストゲ−トパルス形成回路 |
| US6043850A (en) * | 1997-05-08 | 2000-03-28 | Sony Corporation | Burst gate pulse generator circuit |
-
1984
- 1984-04-17 JP JP59076915A patent/JPS60220691A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS60220691A (ja) | 1985-11-05 |
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