JPH0579958U - ゲート保護ダイオード内蔵パワーmosfet - Google Patents
ゲート保護ダイオード内蔵パワーmosfetInfo
- Publication number
- JPH0579958U JPH0579958U JP1857992U JP1857992U JPH0579958U JP H0579958 U JPH0579958 U JP H0579958U JP 1857992 U JP1857992 U JP 1857992U JP 1857992 U JP1857992 U JP 1857992U JP H0579958 U JPH0579958 U JP H0579958U
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- Japan
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- zener diode
- bidirectional zener
- aluminum
- gate
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- Metal-Oxide And Bipolar Metal-Oxide Semiconductor Integrated Circuits (AREA)
- Insulated Gate Type Field-Effect Transistor (AREA)
Abstract
(57)【要約】
【目的】 PoMOSFETに内蔵している双方向性ツ
ェナーダイオードを高性能化する。 【構成】 双方向性ツェナダイオード9bをソースアル
ミ7の上に形成する。 【効果】 作り込みスペースを大きくとることができ、
PNジャンクッションの面積が大きくなるため,動作抵
抗の低減がはかれ、双方向性ツェナーダイオード9bを
高性能化することができる。
ェナーダイオードを高性能化する。 【構成】 双方向性ツェナダイオード9bをソースアル
ミ7の上に形成する。 【効果】 作り込みスペースを大きくとることができ、
PNジャンクッションの面積が大きくなるため,動作抵
抗の低減がはかれ、双方向性ツェナーダイオード9bを
高性能化することができる。
Description
【0001】 この考案は、ゲート保護ダイオード内蔵パワーMOSFETに関し、特に外部 からのサージによるゲート酸化膜破壊対策としてのゲート保護用双方向性ダイオ ードの作り込み構造に関する。
【0002】
従来のこの種のパワーMOSFET(以下、PoMOSFETという)の断面 を含む斜視図を図2に示す。
【0003】 ここで、1は基本セルであり、ソース層2、ベース層3、ポリシリコンゲート 4によって構成されている。5はSiサブストレートであり、6はその上に成長 させたエピタキシャル層であり、ここにソース層2とベース層3が形成される。 7はソースアルミであり、多数のセル部全体を覆っている。8はゲートアルミで あり、ボンディングパッド11を形成する。このゲートアルミ8とソースアルミ 7の間に、双方向性のツェナーダイオード9aが形成される。これは、ポリシリ コンでできている。双方向性ツェナーダイオード9a、ポリシリコンゲート4の 上下には酸化膜10があり、エピタキシャル層6やソースアルミとの絶縁をして いる。
【0004】 このように、従来のゲート保護用双方向性ダイオード内蔵型のPoMOSFE Tは、そのダイオードをゲートアルミ8とソースアルミ7との間に形成している 。
【0005】 なお、図示しないがゲートアルミ8はポリシリコンゲート4に電気的に接続し ており、双方向性ツェナーダイオード9aと、ポリシリコンゲート4は同一層と して形成し所定の不純物を導入し、エッチングしてそれぞれに分離形成する。
【0006】
【考案が解決しようとする課題】 ところで、前記の従来の双方向性ツェナーダイオード9aは、ゲートアルミ8 とソースアルミ7との間に形成していたため、作り込みのスペースが小さくP型 領域部とN型領域部の接合面積が狭いので動作抵抗が大きいという欠点があった 。
【0007】
この考案では、双方向性ツェナーダイオードを、ソース電極の上に形成してい る。
【0008】
前記のように、双方向性ツェナーダイオードをソース電極の上に形成すること により、作り込みスペースを広くとることができ、P型領域部とN型領域部の接 合面積を広くすることができるため,動作抵抗の低減がはかれ、双方向性ツェナ ーダイオードを高性能かすることが出来る。
【0009】
以下、この考案について図面を参照して説明する。
【0010】 図1はこの考案の一実施例のPoMOSFETの断面を含む斜視図である。図 2と同一部分には、同一参照符号を付して,その説明を省略する。本実施例にお いて双方向性ツェナーダイオード9aは、層間絶縁膜としての酸化膜10bを介 してソースアルミ7の上に配置する。
【0011】 双方向性ツェナーダイオード9bの一端はゲートアルミ8に接続し、他端は上 層アルミ12を介して、双方向性ツェナーダイオード9bを設けていない部分で ソースアルミ7に接続している。
【0012】 双方向性ツェナーダイオード9bの面積が大きい場合は、図1に示すように層 間絶縁膜としての酸化膜10cを介して、双方向性ツェナーダイオード9b上に も上層アルミ12を設け、酸化膜10b、双方向性ツェナーダイオード9bおよ び酸化膜10cを貫くするーホール(図示せず)を散在させ、ソースアルミ7と 接続することもできる。
【0013】 本実施例によれば、双方向性ツェナーダイオード9bをソースアルミ上に作り 込むことにより、作り込みスペースを広くとることができ、P型領域部とN型領 域部の接合面積が広くなるため、動作抵抗の低減がはかれる。
【0014】
以上説明したように、この考案は、静電耐量を向上させるためにMOSFET に作り込んだ双方向性ツェナーダイオードをソースアルミの上に形成したことに より、ダイオードの動作抵抗の低減がはかれ、高性能化することができる。
【図1】 この考案の一実施例のパワーMOSFETの
断面を含む斜視図。
断面を含む斜視図。
【図2】 従来のパワーMOSFETの断面を含む斜視
図。
図。
【符号の説明】 1 基本セル 2 ソース層 3 ベース層 4 ポリシリコンゲート 5 Siサブストレート 6 エピタキシャル層 7 ソースアルミ 8 ゲートアルミ 9b 双方向性ツェナーダイオード 10,10b,10c 酸化膜 11 ゲートボンディングパッド 12 上層アルミ
Claims (1)
- 【請求項1】ゲート保護用双方向性ダイオードをゲート
−ソース間に内蔵したパワーMOSFETにおいて、ゲ
ート保護用双方向性ダイオードをソース電極上に形成し
たことを特徴とするゲート保護ダイオード内蔵パワーM
OSFET。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1992018579U JP2576983Y2 (ja) | 1992-03-31 | 1992-03-31 | ゲート保護ダイオード内蔵パワーmosfet |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1992018579U JP2576983Y2 (ja) | 1992-03-31 | 1992-03-31 | ゲート保護ダイオード内蔵パワーmosfet |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0579958U true JPH0579958U (ja) | 1993-10-29 |
| JP2576983Y2 JP2576983Y2 (ja) | 1998-07-23 |
Family
ID=11975544
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1992018579U Expired - Lifetime JP2576983Y2 (ja) | 1992-03-31 | 1992-03-31 | ゲート保護ダイオード内蔵パワーmosfet |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2576983Y2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20160038011A (ko) * | 2013-07-29 | 2016-04-06 | 이피션트 파워 컨버젼 코퍼레이션 | 추가적인 소자를 생성하기 위한 폴리실리콘 층을 갖는 GaN 트랜지스터 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63102378A (ja) * | 1986-10-20 | 1988-05-07 | Matsushita Electronics Corp | 静電破壊防止用ダイオ−ド |
| JPH0456163A (ja) * | 1990-06-21 | 1992-02-24 | Fujitsu Ltd | 半導体装置およびその製造方法 |
-
1992
- 1992-03-31 JP JP1992018579U patent/JP2576983Y2/ja not_active Expired - Lifetime
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS63102378A (ja) * | 1986-10-20 | 1988-05-07 | Matsushita Electronics Corp | 静電破壊防止用ダイオ−ド |
| JPH0456163A (ja) * | 1990-06-21 | 1992-02-24 | Fujitsu Ltd | 半導体装置およびその製造方法 |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20160038011A (ko) * | 2013-07-29 | 2016-04-06 | 이피션트 파워 컨버젼 코퍼레이션 | 추가적인 소자를 생성하기 위한 폴리실리콘 층을 갖는 GaN 트랜지스터 |
| JP2016529710A (ja) * | 2013-07-29 | 2016-09-23 | エフィシエント パワー コンヴァーション コーポレーション | 追加の構成要素を創出するための、ポリシリコン層を有するGaNトランジスタ |
| US10312260B2 (en) | 2013-07-29 | 2019-06-04 | Efficient Power Conversion Corporation | GaN transistors with polysilicon layers used for creating additional components |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2576983Y2 (ja) | 1998-07-23 |
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