JPH06295346A - マイクロコンピュータ - Google Patents
マイクロコンピュータInfo
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- JPH06295346A JPH06295346A JP5081578A JP8157893A JPH06295346A JP H06295346 A JPH06295346 A JP H06295346A JP 5081578 A JP5081578 A JP 5081578A JP 8157893 A JP8157893 A JP 8157893A JP H06295346 A JPH06295346 A JP H06295346A
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- microcomputer
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- 238000006243 chemical reaction Methods 0.000 claims description 3
- 238000001514 detection method Methods 0.000 description 8
- 238000010586 diagram Methods 0.000 description 5
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- Test And Diagnosis Of Digital Computers (AREA)
- Microcomputers (AREA)
- Power Sources (AREA)
Abstract
(57)【要約】
【目的】開発支援装置で使用するマイクロコンピュータ
において、開発装置側の電源が遮断されても入出力制御
を可能とする。 【構成】マイクロコンピュータ外部と入出力をするため
の端子群と、外部電源と専用電源の各端子１０５，１１
３と、２つの電源を調停するための調停回路１２１を設
けることにより、外部電源が入っているかを検出し、電
源の切換えを行うことにより入出力の制御を可能とす
る。 【効果】開発装置の電源が遮断されても、専用電源側か
らの電源供給を可能とし、入出力制御ができ、実行履歴
データが得られる。
において、開発装置側の電源が遮断されても入出力制御
を可能とする。 【構成】マイクロコンピュータ外部と入出力をするため
の端子群と、外部電源と専用電源の各端子１０５，１１
３と、２つの電源を調停するための調停回路１２１を設
けることにより、外部電源が入っているかを検出し、電
源の切換えを行うことにより入出力の制御を可能とす
る。 【効果】開発装置の電源が遮断されても、専用電源側か
らの電源供給を可能とし、入出力制御ができ、実行履歴
データが得られる。
Description
【０００１】
【産業上の利用分野】本発明は、マイクロコンピュータ
に関し、特に開発支援装置接続時のマイクロコンピュー
タの電源制御回路に関する。
に関し、特に開発支援装置接続時のマイクロコンピュー
タの電源制御回路に関する。
【０００２】
【従来の技術】従来のマイクロコンピュータのブロック
図を示す図３を参照すると、このマイクロコンピュータ
２０１は、専用電源端子２１３より専用電源信号２１４
を介して供給される電源信号、および外部電源端子２０
５より外部電源信号２０６を介して入力される電源信号
により動作する。外部入出力インタフェース部２０７
は、外部電源端子２０５にかかる電圧が例えば２．７〜
６．０［Ｖ］の範囲で変動する。開発支援装置は５
［Ｖ］固定であり、開発支援装置側の電圧を固定する必
要があるため、入出力制御部１０９およびＣＰＵ部１１
６に対しては専用電源端子２１３より専用電源信号２１
４を介して供給される電源信号により動作させる。
図を示す図３を参照すると、このマイクロコンピュータ
２０１は、専用電源端子２１３より専用電源信号２１４
を介して供給される電源信号、および外部電源端子２０
５より外部電源信号２０６を介して入力される電源信号
により動作する。外部入出力インタフェース部２０７
は、外部電源端子２０５にかかる電圧が例えば２．７〜
６．０［Ｖ］の範囲で変動する。開発支援装置は５
［Ｖ］固定であり、開発支援装置側の電圧を固定する必
要があるため、入出力制御部１０９およびＣＰＵ部１１
６に対しては専用電源端子２１３より専用電源信号２１
４を介して供給される電源信号により動作させる。
【０００３】また、通常の命令実行時にＣＰＵ部１１６
で入出力命令を実行した場合、ＣＰＵ信号群１１５を介
して情報の入出力を行う。ＣＰＵ部１１６から受け取っ
た情報のＣＰＵ信号群１１５に対して、入出力制御部１
０９はマイクロコンピュータ２０１外部に対して入出力
制御信号１１７を入出力選択端子１１８より出力し、か
つ入出力制御部１０９は入出力制御信号群１０８を出力
する。外部入出力インタフェース部２０７は入出力信号
群１０８を外部電源端子２０５より入力される外部電源
信号２０６の電圧レベルに変換した信号を内部入出力信
号群１０４として出力し、外部入出力端子群１０２を介
してマイクロコンピュータ２０１の外部入出力信号群１
０３よりデータの授受を行う。
で入出力命令を実行した場合、ＣＰＵ信号群１１５を介
して情報の入出力を行う。ＣＰＵ部１１６から受け取っ
た情報のＣＰＵ信号群１１５に対して、入出力制御部１
０９はマイクロコンピュータ２０１外部に対して入出力
制御信号１１７を入出力選択端子１１８より出力し、か
つ入出力制御部１０９は入出力制御信号群１０８を出力
する。外部入出力インタフェース部２０７は入出力信号
群１０８を外部電源端子２０５より入力される外部電源
信号２０６の電圧レベルに変換した信号を内部入出力信
号群１０４として出力し、外部入出力端子群１０２を介
してマイクロコンピュータ２０１の外部入出力信号群１
０３よりデータの授受を行う。
【０００４】また、入力制御部１０９は実行履歴記憶回
路が判断可能な信号群を内部入出力実行履歴用信号群１
１２を通して外部入出力実行履歴用端子群１１０に出力
する。出力された外部入出力実行履歴用信号群１１１を
実行履歴回路に電圧変換なしで書き込む。
路が判断可能な信号群を内部入出力実行履歴用信号群１
１２を通して外部入出力実行履歴用端子群１１０に出力
する。出力された外部入出力実行履歴用信号群１１１を
実行履歴回路に電圧変換なしで書き込む。
【０００５】前記マイクロコンピュータを使用した従来
の開発支援装置を示す図４を参照すると、この従来の開
発支援装置３０１は、開発支援装置用として図３の前記
マイクロコンピュータ２０１が実装されていた。
の開発支援装置を示す図４を参照すると、この従来の開
発支援装置３０１は、開発支援装置用として図３の前記
マイクロコンピュータ２０１が実装されていた。
【０００６】接続形態としては、開発対象装置３０６上
に実装されるマイクロコンピュータのかわりにマイクロ
コンピュータ接続部３０７に、従来の開発支援装置３０
１が接続され、従来の開発支援装置３０１内に実装され
ているマイクロコンピュータ２０１が開発対象装置３０
６上に実装されるマイクロコンピュータのかわりに動作
する。この時、開発対象装置３０６に電源入力がある場
合には、電源信号は開発対象装置電源端子３０２を介し
て開発装置電源信号３０８を開発装置電源検出部３０５
に出力し、この開発装置電源検出部３０５は開発装置電
源信号３０８が入力されることにより開発支援装置外部
電源信号３０４を外部電源端子２０５に出力し、マイク
ロコンピュータ２０１は外部電源端子２０５より入力さ
れる電源信号により外部入出力端子群１０２に入出力す
る信号を生成することが可能となる。
に実装されるマイクロコンピュータのかわりにマイクロ
コンピュータ接続部３０７に、従来の開発支援装置３０
１が接続され、従来の開発支援装置３０１内に実装され
ているマイクロコンピュータ２０１が開発対象装置３０
６上に実装されるマイクロコンピュータのかわりに動作
する。この時、開発対象装置３０６に電源入力がある場
合には、電源信号は開発対象装置電源端子３０２を介し
て開発装置電源信号３０８を開発装置電源検出部３０５
に出力し、この開発装置電源検出部３０５は開発装置電
源信号３０８が入力されることにより開発支援装置外部
電源信号３０４を外部電源端子２０５に出力し、マイク
ロコンピュータ２０１は外部電源端子２０５より入力さ
れる電源信号により外部入出力端子群１０２に入出力す
る信号を生成することが可能となる。
【０００７】次に開発対象装置３０６に電源入力がない
場合には、電源信号は開発対象装置電源端子３０２から
開発装置電源信号３０８が出力されないので、開発装置
電源検出部３０５は開発支援装置外部電源信号３０４を
出力せずにマイクロコンピュータ２０１は外部電源端子
２０５より電源信号が入力されないので外部入出力端子
群１０２に入出力する信号を生成することが不可能とな
る。
場合には、電源信号は開発対象装置電源端子３０２から
開発装置電源信号３０８が出力されないので、開発装置
電源検出部３０５は開発支援装置外部電源信号３０４を
出力せずにマイクロコンピュータ２０１は外部電源端子
２０５より電源信号が入力されないので外部入出力端子
群１０２に入出力する信号を生成することが不可能とな
る。
【０００８】またマイクロコンンピュータ２０１に対し
ては開発支援装置用電源３１０から開発支援装置電源信
号３０９を介してマイクロコンピュータ２０１の外部電
源端子２１３に供給される。開発対象装置３０６の開発
対象装置入出力端子群３１３に入力されている外部入出
力信号群１０３および開発対象装置入出力制御端子３１
２に入力されている外部入出力制御信号３１１は、それ
ぞれ従来の開発支援装置３０１内の外部入出力端子群１
０２と入出力制御端子群１１８に接続される。実行履歴
を記憶する場合、外部入出力実行履歴用端子群１１０か
ら出力されるデータを、外部入出力実行履歴信号群１１
１を介して、実行履歴記憶回路３０３に書き込んでい
た。
ては開発支援装置用電源３１０から開発支援装置電源信
号３０９を介してマイクロコンピュータ２０１の外部電
源端子２１３に供給される。開発対象装置３０６の開発
対象装置入出力端子群３１３に入力されている外部入出
力信号群１０３および開発対象装置入出力制御端子３１
２に入力されている外部入出力制御信号３１１は、それ
ぞれ従来の開発支援装置３０１内の外部入出力端子群１
０２と入出力制御端子群１１８に接続される。実行履歴
を記憶する場合、外部入出力実行履歴用端子群１１０か
ら出力されるデータを、外部入出力実行履歴信号群１１
１を介して、実行履歴記憶回路３０３に書き込んでい
た。
【０００９】
【発明が解決しようとする課題】上述したマイクロコン
ピュータは、通常の使用では問題ないが、マイクロコン
ピュータの開発支援装置において、開発対象装置側の電
源が遮断されると、マイクロコンピュータの入出力制御
が動作しなくなるという問題点があった。
ピュータは、通常の使用では問題ないが、マイクロコン
ピュータの開発支援装置において、開発対象装置側の電
源が遮断されると、マイクロコンピュータの入出力制御
が動作しなくなるという問題点があった。
【００１０】
【課題を解決するための手段】本発明の構成は、マイク
ロコンピュータ外部と入出力処理をする外部入出力信号
群を備えるマイクロコンピュータにおいて、前記マイク
ロコンピュータ外部との入出力処理を制御する外部入出
力インタフェース部と、この外部入出力インタフェース
部を動作させるために前記マイクロコンピュータ外部よ
り供給される外部電源信号の端子と、前記外部入出力イ
ンタフェース部から入力される信号により動作する入出
力制御部と、この入出力制御部を動作させるための専用
電源信号の端子と、この端子から入力される専用電源信
号と前記外部電源信号の端子より入力される外部電源信
号との調停を行う電源調停回路と、この電源調停回路よ
り出力される外部入出力インタフェース電源信号線と、
前記電源調停回路で前記外部電源信号が入力されている
かを判定し前記マイクロコンピュータ外部に出力するた
めの電源状態端子と、前記マイクロコンピュータ内部の
ＣＰＵ部と前記入出力制御部とをつなぐ入出力ＣＰＵ信
号線群と、前記入出力インタフェース部で変換されたマ
イクロコンピュータが認識可能な値を前記マイクロコン
ピュータ外部へ出力するための外部入出力実行履歴用端
子群とを備えることを特徴とする。
ロコンピュータ外部と入出力処理をする外部入出力信号
群を備えるマイクロコンピュータにおいて、前記マイク
ロコンピュータ外部との入出力処理を制御する外部入出
力インタフェース部と、この外部入出力インタフェース
部を動作させるために前記マイクロコンピュータ外部よ
り供給される外部電源信号の端子と、前記外部入出力イ
ンタフェース部から入力される信号により動作する入出
力制御部と、この入出力制御部を動作させるための専用
電源信号の端子と、この端子から入力される専用電源信
号と前記外部電源信号の端子より入力される外部電源信
号との調停を行う電源調停回路と、この電源調停回路よ
り出力される外部入出力インタフェース電源信号線と、
前記電源調停回路で前記外部電源信号が入力されている
かを判定し前記マイクロコンピュータ外部に出力するた
めの電源状態端子と、前記マイクロコンピュータ内部の
ＣＰＵ部と前記入出力制御部とをつなぐ入出力ＣＰＵ信
号線群と、前記入出力インタフェース部で変換されたマ
イクロコンピュータが認識可能な値を前記マイクロコン
ピュータ外部へ出力するための外部入出力実行履歴用端
子群とを備えることを特徴とする。
【００１１】
【実施例】本発明の一実施例のマイクロコンピュータを
示す図１において、この実施例は、電源調停回路１２１
を有する以外は、図３と共通であるから同図と共通の参
照数字で示す。
示す図１において、この実施例は、電源調停回路１２１
を有する以外は、図３と共通であるから同図と共通の参
照数字で示す。
【００１２】このマイクロコンピュータ１０１は、専用
電源端子１１３より専用電源信号１１４を介して供給さ
れる電源信号および外部電源端子１０５より外部電源信
号１０６を介して供給される電源信号の２つの電源によ
り動作する。外部入出力インタフェース部１０７に対す
る電源は、電源調停回路１２１が外部電源信号１０６の
入力状態を検出し入力されていない場合は専用電源信号
１１４を、他の場合は外部電源信号１０６を選択し、外
部入出力インタフェース部電源信号１２２を介して外部
入出力インタフェース部１０７に供給する。このとき、
判定した外部電源信号１０６の判定結果を電源状態信号
１２０を介して電源状態端子１１９より出力する。
電源端子１１３より専用電源信号１１４を介して供給さ
れる電源信号および外部電源端子１０５より外部電源信
号１０６を介して供給される電源信号の２つの電源によ
り動作する。外部入出力インタフェース部１０７に対す
る電源は、電源調停回路１２１が外部電源信号１０６の
入力状態を検出し入力されていない場合は専用電源信号
１１４を、他の場合は外部電源信号１０６を選択し、外
部入出力インタフェース部電源信号１２２を介して外部
入出力インタフェース部１０７に供給する。このとき、
判定した外部電源信号１０６の判定結果を電源状態信号
１２０を介して電源状態端子１１９より出力する。
【００１３】また、通常の命令実行時にＣＰＵ部１１６
で入出力命令を実行した場合、ＣＰＵ信号群１１５を介
して情報の入出力を行う。ＣＰＵ信号群１１５の情報に
対して、入出力制御部１０９は、マイクロコンピュータ
１０１外部に対して入出力選択信号１１７を入出力選択
端子１１８より出力し、かつ入出力制御信号群１０８，
外部入出力インタフェース部１０７，内部入出力信号群
１０４，外部入出力端子群１０２を介して、マイクロコ
ンピュータ１０１の外部入出力信号群１０３とデータの
授受を行う。
で入出力命令を実行した場合、ＣＰＵ信号群１１５を介
して情報の入出力を行う。ＣＰＵ信号群１１５の情報に
対して、入出力制御部１０９は、マイクロコンピュータ
１０１外部に対して入出力選択信号１１７を入出力選択
端子１１８より出力し、かつ入出力制御信号群１０８，
外部入出力インタフェース部１０７，内部入出力信号群
１０４，外部入出力端子群１０２を介して、マイクロコ
ンピュータ１０１の外部入出力信号群１０３とデータの
授受を行う。
【００１４】入出力制御部１０９は、実行履歴記憶回路
が判断可能な信号群を内部入出力実行履歴用信号群１１
２を通して外部入出力実行履歴用端子群１１０に出力す
る。出力された外部入出力実行履歴用信号群１１１を実
行履歴記憶回路に電圧変換なしで書き込む。
が判断可能な信号群を内部入出力実行履歴用信号群１１
２を通して外部入出力実行履歴用端子群１１０に出力す
る。出力された外部入出力実行履歴用信号群１１１を実
行履歴記憶回路に電圧変換なしで書き込む。
【００１５】図１のマイクロコンピュータ１０１を使用
した開発支援装置の一例を示す図２を参照すると、図４
の従来のマイクロコンピュータを使用した開発支援装置
との違いは、従来の開発支援装置（図４）が開発対象装
置３０６から出力される開発装置電源信号３０８を開発
装置電源検出部３０５により電源検出していたのに対し
て、この開発支援装置（図２）では、開発対象装置３０
６から出力される開発装置電源信号３０８をマイクロコ
ンピュータ１０１の内部で判断し、開発装置電源検出部
４０５で判断可能な開発装置電源検出信号４１３を電源
状態端子１１９から出力することにより、開発装置電源
検出部４０５で電源検出が可能となる点である。
した開発支援装置の一例を示す図２を参照すると、図４
の従来のマイクロコンピュータを使用した開発支援装置
との違いは、従来の開発支援装置（図４）が開発対象装
置３０６から出力される開発装置電源信号３０８を開発
装置電源検出部３０５により電源検出していたのに対し
て、この開発支援装置（図２）では、開発対象装置３０
６から出力される開発装置電源信号３０８をマイクロコ
ンピュータ１０１の内部で判断し、開発装置電源検出部
４０５で判断可能な開発装置電源検出信号４１３を電源
状態端子１１９から出力することにより、開発装置電源
検出部４０５で電源検出が可能となる点である。
【００１６】尚、以上の説明において、マイクロコンピ
ュータ外部と入出力処理をするための端子群を外部入出
力信号群と称し、マイクロコンピュータ外部との入出力
処理を行う部分を外部入出力インタフェース部と称し、
外部入出力インタフェース部を動作させるためにマイク
ロコンピュータ外部より供給される第１の電源信号を外
部電源信号と称し、外部入出力インタフェース部との信
号により入出力動作を行う部分を入出力制御部と称し、
入出力制御部を動作させるためにマイクロコンピュータ
外部より供給される第２の電源信号を専用電源信号と称
し、マイクロコンピュータ内部の中央処理部分をＣＰＵ
部と称し、入出力制御部とをつなぐ信号群をＣＰＵ信号
群と称し、前記外部入出力インタフェース部と入出力制
御部とをつなぐ信号群を入出力制御信号群と称する。
ュータ外部と入出力処理をするための端子群を外部入出
力信号群と称し、マイクロコンピュータ外部との入出力
処理を行う部分を外部入出力インタフェース部と称し、
外部入出力インタフェース部を動作させるためにマイク
ロコンピュータ外部より供給される第１の電源信号を外
部電源信号と称し、外部入出力インタフェース部との信
号により入出力動作を行う部分を入出力制御部と称し、
入出力制御部を動作させるためにマイクロコンピュータ
外部より供給される第２の電源信号を専用電源信号と称
し、マイクロコンピュータ内部の中央処理部分をＣＰＵ
部と称し、入出力制御部とをつなぐ信号群をＣＰＵ信号
群と称し、前記外部入出力インタフェース部と入出力制
御部とをつなぐ信号群を入出力制御信号群と称する。
【００１７】
【発明の効果】以上説明した通り、本発明は、マイクロ
コンピュータの開発支援装置において、開発装置側の電
源が遮断された場合でも、専用電源側からの電源供給に
よりマイクロコンピュータの入出力制御ができ、実行履
歴データが得られ、高い信頼性が確保できる。
コンピュータの開発支援装置において、開発装置側の電
源が遮断された場合でも、専用電源側からの電源供給に
よりマイクロコンピュータの入出力制御ができ、実行履
歴データが得られ、高い信頼性が確保できる。
【図１】本発明の一実施例のブロック図である。
【図２】図のマイクロコンピュータを使用した開発支援
装置の一例のブロック図である。
装置の一例のブロック図である。
【図３】従来のマイクロコンピュータのブロック図であ
る。
る。
【図４】図３のマイクロコンピュータを使用した開発支
援装置の一例のブロック図である。
援装置の一例のブロック図である。
１０１，２０１ マイクロコンピュータ １０２ 外部入出力端子群 １０３ 外部入出力信号群 １０４ 内部入出力信号群 １０５，２０５ 外部電源端子 １０６，２０６ 外部電源信号 １０７，２０７ 外部入出力インタフェース部 １０８ 入出力制御信号群 １０９ 入出力制御部 １１０ 外部入出力実行履歴用端子群 １１１ 外部入出力実行履歴用信号群 １１２ 内部入出力実行履歴用信号群 １１３，２１３ 専用電源端子 １１４，２１４ 専用電源信号 １１５ ＣＰＵ信号群 １１６ ＣＰＵ部 １１７ 入出力制御信号 １１８ 入出力制御端子 １１９ 電源状態端子 １２０ 電源状態信号 １２１ 電源調停回路 １２２ 外部入出力インタフェース部電源信号 ３０１，４０１ 開発支援装置 ３０２ 開発装置電源端子 ３０３ 実行履歴記憶回路 ３０４ 開発支援装置外部電源信号 ３０５，４０５ 開発装置電源検出部 ３０６ 開発対象装置 ３０７ マイクロコンピュータ接続部 ３０８，４１３ 開発装置電源信号 ３０９ 開発支援装置電源信号 ３１０ 開発支援装置電源 ３１１ 外部入出力選択信号 ３１２ 開発対象装置入出力制御端子 ３１３ 開発対象装置外部入出力端子群 ３１４ 実行履歴記憶回路入出力端子群
Claims (1)
- 【請求項１】 マイクロコンピュータ外部と入出力処理
をする外部入出力信号群を備えるマイクロコンピュータ
において、前記マイクロコンピュータ外部との入出力処
理を制御する外部入出力インタフェース部と、この外部
入出力インタフェース部を動作させるために前記マイク
ロコンピュータ外部より供給される外部電源信号の端子
と、前記外部入出力インタフェース部から入力される信
号により動作する入出力制御部と、この入出力制御部を
動作させるための専用電源信号の端子と、この端子から
入力される専用電源信号と前記外部電源信号の端子より
入力される外部電源信号との調停を行う電源調停回路
と、この電源調停回路より出力される外部入出力インタ
フェース電源信号線と、前記電源調停回路で前記外部電
源信号が入力されているかを判定し前記マイクロコンピ
ュータ外部に出力するための電源状態端子と、前記マイ
クロコンピュータ内部のＣＰＵ部と前記入出力制御部と
をつなぐ入出力ＣＰＵ信号線群と、前記入出力インタフ
ェース部で変換されたマイクロコンピュータが認識可能
な値を前記マイクロコンピュータ外部へ出力するための
外部入出力実行履歴用端子群とを備えることを特徴とす
るマイクロコンピュータ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP08157893A JP3288114B2 (ja) | 1993-04-08 | 1993-04-08 | マイクロコンピュータ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP08157893A JP3288114B2 (ja) | 1993-04-08 | 1993-04-08 | マイクロコンピュータ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06295346A true JPH06295346A (ja) | 1994-10-21 |
| JP3288114B2 JP3288114B2 (ja) | 2002-06-04 |
Family
ID=13750198
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP08157893A Expired - Fee Related JP3288114B2 (ja) | 1993-04-08 | 1993-04-08 | マイクロコンピュータ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3288114B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7010703B1 (en) | 1999-10-20 | 2006-03-07 | Nec Corporation | Bus power-supply device and node |
-
1993
- 1993-04-08 JP JP08157893A patent/JP3288114B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7010703B1 (en) | 1999-10-20 | 2006-03-07 | Nec Corporation | Bus power-supply device and node |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3288114B2 (ja) | 2002-06-04 |
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