JPH0630355A - Ｂｓチューナのａｆｃ回路 - Google Patents
Ｂｓチューナのａｆｃ回路Info
- Publication number
- JPH0630355A JPH0630355A JP4118261A JP11826192A JPH0630355A JP H0630355 A JPH0630355 A JP H0630355A JP 4118261 A JP4118261 A JP 4118261A JP 11826192 A JP11826192 A JP 11826192A JP H0630355 A JPH0630355 A JP H0630355A
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- Japan
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- tuner
- afc
- aftv
- channel
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- Pending
Links
- 230000010355 oscillation Effects 0.000 claims description 15
- 230000000717 retained effect Effects 0.000 claims description 2
- 229940028444 muse Drugs 0.000 abstract description 17
- GMVPRGQOIOIIMI-DWKJAMRDSA-N prostaglandin E1 Chemical group CCCCC[C@H](O)\C=C\[C@H]1[C@H](O)CC(=O)[C@@H]1CCCCCCC(O)=O GMVPRGQOIOIIMI-DWKJAMRDSA-N 0.000 abstract description 17
- 101000760817 Homo sapiens Macrophage-capping protein Proteins 0.000 abstract description 5
- 102100024573 Macrophage-capping protein Human genes 0.000 abstract description 5
- 230000006866 deterioration Effects 0.000 abstract 1
- 238000010586 diagram Methods 0.000 description 4
- 230000000694 effects Effects 0.000 description 2
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- 230000002542 deteriorative effect Effects 0.000 description 1
Landscapes
- Television Receiver Circuits (AREA)
- Television Systems (AREA)
Abstract
(57)【要約】
【目的】 MUSE信号チャンネル選局時における受信性能
の低下を防止する。 【構成】 ハイビジョン放送におけるキードAFC パルス
AFCPが入力されるBSチューナ１と、BSチューナ１が出力
する、第２中間周波数を検波して得たAFT 電圧AFTV
(＋) , AFTV (−) が入力され、チャンネルを選局する
選局データSDが入力されて、選局データSD及びAFT 電圧
AFTV (＋) , AFTV (−) に基づくクロックCLK をBSチュ
ーナ１へ入力するBSCPU ２とを備え、MUSE信号チャンネ
ル選局時には、キードAFC パルスAFCPがBSチューナ１へ
入力されるまでの期間、BSCPU ２は選局データを保持し
て、AFC 動作を停止させる構成にする。
の低下を防止する。 【構成】 ハイビジョン放送におけるキードAFC パルス
AFCPが入力されるBSチューナ１と、BSチューナ１が出力
する、第２中間周波数を検波して得たAFT 電圧AFTV
(＋) , AFTV (−) が入力され、チャンネルを選局する
選局データSDが入力されて、選局データSD及びAFT 電圧
AFTV (＋) , AFTV (−) に基づくクロックCLK をBSチュ
ーナ１へ入力するBSCPU ２とを備え、MUSE信号チャンネ
ル選局時には、キードAFC パルスAFCPがBSチューナ１へ
入力されるまでの期間、BSCPU ２は選局データを保持し
て、AFC 動作を停止させる構成にする。
Description
【０００１】
【産業上の利用分野】本発明はハイビジョン放送を受信
するBS (衛星放送) チューナのAFC 回路に関するもので
ある。
するBS (衛星放送) チューナのAFC 回路に関するもので
ある。
【０００２】
【従来の技術】ハイビジョン放送を受信する従来のBSチ
ューナのAFC(自動周波数制御) 回路方式では、図１に示
す如くMUSE信号チャンネル選局直後の約１秒間、即ちチ
ャンネル選局時点ｔ0 から外部機器である例えばMUSEデ
コーダ又はMUSE／NTSCコンバータ等からキードAFC パル
スが入力される時点ｔ1 までの期間は、BSチューナが平
均値AFC 動作をする。そのためMUSE信号の送信内容によ
り、BSチューナの局部発振周波数が２〜MHz 以上変化す
る場合がある。いま、局部発振周波数が仮に高い方向へ
変化して、受信性能が低下し始める局部発振周波数ｆH
を超えると、BSチューナの第２中間周波数がFM復調帯域
の中心からズレるためハイビジョン放送の受信性能が低
下し易くなる。
ューナのAFC(自動周波数制御) 回路方式では、図１に示
す如くMUSE信号チャンネル選局直後の約１秒間、即ちチ
ャンネル選局時点ｔ0 から外部機器である例えばMUSEデ
コーダ又はMUSE／NTSCコンバータ等からキードAFC パル
スが入力される時点ｔ1 までの期間は、BSチューナが平
均値AFC 動作をする。そのためMUSE信号の送信内容によ
り、BSチューナの局部発振周波数が２〜MHz 以上変化す
る場合がある。いま、局部発振周波数が仮に高い方向へ
変化して、受信性能が低下し始める局部発振周波数ｆH
を超えると、BSチューナの第２中間周波数がFM復調帯域
の中心からズレるためハイビジョン放送の受信性能が低
下し易くなる。
【０００３】
【発明が解決しようとする課題】前述したようにMUSE信
号チャンネル選局時に、受信性能が低下すると、映像信
号系のトランケーションノイズ、S/N 、PCM 音声データ
のビットエラー等が現れるという問題がある。本発明は
斯かる問題に鑑み、MUSE信号チャンネル選局時に受信性
能が低下することがないBSチューナのAFC 回路を提供す
ることを目的とする。
号チャンネル選局時に、受信性能が低下すると、映像信
号系のトランケーションノイズ、S/N 、PCM 音声データ
のビットエラー等が現れるという問題がある。本発明は
斯かる問題に鑑み、MUSE信号チャンネル選局時に受信性
能が低下することがないBSチューナのAFC 回路を提供す
ることを目的とする。
【０００４】
【課題を解決するための手段】本発明に係るBSチューナ
のAFC 回路は、ハイビジョン放送におけるキードAFCパ
ルスが入力されるBSチューナのAFC 回路において、前記
BSチューナの中間周波数を検波して得たAFT 電圧が入力
され、該AFT 電圧及びチャンネルを選局する選局データ
に関連するクロックを、BSチューナへ入力するCPU を備
え、前記CPU に選局データを与えた時点から前記キード
AFC パルスが入力されるまでの期間は、選局データを保
持してAFC 動作を停止させ、チャンネル選局時における
BSチューナの局部発振周波数のずれを防止すべく構成し
てあることを特徴とする。
のAFC 回路は、ハイビジョン放送におけるキードAFCパ
ルスが入力されるBSチューナのAFC 回路において、前記
BSチューナの中間周波数を検波して得たAFT 電圧が入力
され、該AFT 電圧及びチャンネルを選局する選局データ
に関連するクロックを、BSチューナへ入力するCPU を備
え、前記CPU に選局データを与えた時点から前記キード
AFC パルスが入力されるまでの期間は、選局データを保
持してAFC 動作を停止させ、チャンネル選局時における
BSチューナの局部発振周波数のずれを防止すべく構成し
てあることを特徴とする。
【０００５】
【作用】MUSE信号チャンネルを選局した直後は、CPU に
より選局データを保持して、BSチューナにキードAFC パ
ルスが入力されるまでAFC 動作を停止させる。保持した
選局データによりBSチューナの局部発振周波数を制御
し、局部発振周波数のズレが少なくなる。キードAFC パ
ルスが入力されると、BSチューナが出力するAFT 電圧を
モニタして、CPU によりキードAFC 動作をさせる。
より選局データを保持して、BSチューナにキードAFC パ
ルスが入力されるまでAFC 動作を停止させる。保持した
選局データによりBSチューナの局部発振周波数を制御
し、局部発振周波数のズレが少なくなる。キードAFC パ
ルスが入力されると、BSチューナが出力するAFT 電圧を
モニタして、CPU によりキードAFC 動作をさせる。
【０００６】これにより、MUSE信号チャンネル選局直後
に、BSチューナの局部発振周波数が大きくズレず、ハイ
ビジョン放送の受信性能が低下しない。
に、BSチューナの局部発振周波数が大きくズレず、ハイ
ビジョン放送の受信性能が低下しない。
【０００７】
【実施例】以下本発明をその実施例を示す図面により詳
述する。図２は本発明に係るBSチューナのAFC 回路の要
部構成を示すブロック図である。外部機器からのBS中間
周波数BS−IFが入力されるBSチューナ１には、外部機器
であるMUSEデコーダ又はMUSE／NTSCコンバータ等が出力
するキードAFC パルスAFCPが入力される。このBSチュー
ナ１には例えば品番CXA1401MのICが用いられる。BSチュ
ーナ１が出力する第２中間周波数を検波して得たAFT 電
圧AFTV (＋) , AFTV (−) はBSCPU ２へ入力される。BS
CPU ２が出力するPLL データであるクロックCLK はBSチ
ューナ１の第２中間周波数を制御する図示しないPLL 回
路へ入力される。リモートコントロール送信器３が送信
するチャンネル選局信号は、チャンネル選局CPU ４へ送
信され、チャンネル選局CPU ４が出力する選局データSD
はBSCPU ２へ入力される。
述する。図２は本発明に係るBSチューナのAFC 回路の要
部構成を示すブロック図である。外部機器からのBS中間
周波数BS−IFが入力されるBSチューナ１には、外部機器
であるMUSEデコーダ又はMUSE／NTSCコンバータ等が出力
するキードAFC パルスAFCPが入力される。このBSチュー
ナ１には例えば品番CXA1401MのICが用いられる。BSチュ
ーナ１が出力する第２中間周波数を検波して得たAFT 電
圧AFTV (＋) , AFTV (−) はBSCPU ２へ入力される。BS
CPU ２が出力するPLL データであるクロックCLK はBSチ
ューナ１の第２中間周波数を制御する図示しないPLL 回
路へ入力される。リモートコントロール送信器３が送信
するチャンネル選局信号は、チャンネル選局CPU ４へ送
信され、チャンネル選局CPU ４が出力する選局データSD
はBSCPU ２へ入力される。
【０００８】次にこのBSチューナのAFC 回路のチャンネ
ル選局時の動作を、BSチューナ１及びBSCPU ２の動作内
容を示す図３とともに説明する。リモートコントロール
送信器３を操作してMUSE信号チャンネルを選局すると、
チャンネル選局CPU ４から選局データSDをBSCPU ２へ入
力し、選局データSDに関連するクロックCLK をBSチュー
ナ１の図示しないPLL 回路へ入力する。それによりBSチ
ューナ１の局部発振周波数が制御される。BSチューナ１
は、その第２中間周波数をAFT 検波する。AFT検波したA
FT 電圧AFTV (＋) , AFTV (−) は、第２中間周波数よ
り局部発振周波数が低いときはAFTV (＋) が「０」、AF
TV (−) が「１」になり、高いときはAFTV (＋) が
「１」、AFTV (−) が「０」になる。また第２中間周波
数と局部発振周波数が等しいときはAFTV (＋) , AFTV
(−) がともに「１」になる。このAFT電圧AFTV (＋) ,
AFTV (−) をBSCPU ２が取込む。このAFT 電圧AFTV
(＋) , AFTV (−) に基づいてクロックCLK を制御し、
第２中間周波数のズレを選局データSDに基づいて補正す
べく、局部発振周波数を制御する。
ル選局時の動作を、BSチューナ１及びBSCPU ２の動作内
容を示す図３とともに説明する。リモートコントロール
送信器３を操作してMUSE信号チャンネルを選局すると、
チャンネル選局CPU ４から選局データSDをBSCPU ２へ入
力し、選局データSDに関連するクロックCLK をBSチュー
ナ１の図示しないPLL 回路へ入力する。それによりBSチ
ューナ１の局部発振周波数が制御される。BSチューナ１
は、その第２中間周波数をAFT 検波する。AFT検波したA
FT 電圧AFTV (＋) , AFTV (−) は、第２中間周波数よ
り局部発振周波数が低いときはAFTV (＋) が「０」、AF
TV (−) が「１」になり、高いときはAFTV (＋) が
「１」、AFTV (−) が「０」になる。また第２中間周波
数と局部発振周波数が等しいときはAFTV (＋) , AFTV
(−) がともに「１」になる。このAFT電圧AFTV (＋) ,
AFTV (−) をBSCPU ２が取込む。このAFT 電圧AFTV
(＋) , AFTV (−) に基づいてクロックCLK を制御し、
第２中間周波数のズレを選局データSDに基づいて補正す
べく、局部発振周波数を制御する。
【０００９】前述したようにしてクロックCLK をBSチュ
ーナ１の図示しないPLL 回路へ入力する動作から、第２
中間周波数ズレを選局データSDに基づいて補正し、BSチ
ューナの局部発振周波数を制御するまでの一連の動作を
繰り返して局部発振周波数を収束させることになる。こ
の一連の動作は、MUSE信号チャンネル選局時も同様に行
われ、チャンネル選局直後、即ち図２に示すようにMUSE
信号チャンネル選局時点ｔ0 から約１秒間はキードAFC
パルスAFCPが入力されないので、BSチューナ１内のAFT
回路は保持した選局データに基づいて平均値AFC 動作を
する。このときMUSE信号の内容によっては局部発振周波
数が数MHz ズレる可能性があるのでキードAFC パルスが
入力されるまではAFC 動作を停止させる。つまりBSCPU
２に取込んだAFT 電圧AFTV (＋) , AFTV (−) を無視
し、選局プログラムによりMUSE信号チャンネル選局の選
局データを保持させる。
ーナ１の図示しないPLL 回路へ入力する動作から、第２
中間周波数ズレを選局データSDに基づいて補正し、BSチ
ューナの局部発振周波数を制御するまでの一連の動作を
繰り返して局部発振周波数を収束させることになる。こ
の一連の動作は、MUSE信号チャンネル選局時も同様に行
われ、チャンネル選局直後、即ち図２に示すようにMUSE
信号チャンネル選局時点ｔ0 から約１秒間はキードAFC
パルスAFCPが入力されないので、BSチューナ１内のAFT
回路は保持した選局データに基づいて平均値AFC 動作を
する。このときMUSE信号の内容によっては局部発振周波
数が数MHz ズレる可能性があるのでキードAFC パルスが
入力されるまではAFC 動作を停止させる。つまりBSCPU
２に取込んだAFT 電圧AFTV (＋) , AFTV (−) を無視
し、選局プログラムによりMUSE信号チャンネル選局の選
局データを保持させる。
【００１０】次にキードAFC パルスが入力された時点ｔ
1 では、キードAFC 動作をさせて、チャンネル選択直後
の局部発振周波数のズレを抑制する。それにより、チャ
ンネル選局時におけるハイビジョン放送の受信性能の低
下を防いで、ハイビジョン放送の受信状態を常に良好に
することができる。なお、本実施例ではチャンネル選局
のソフトウェアにより受信性能の低下を防止したが、ハ
ードウェアによりチャンネル選局時点ｔ0 からキードAF
C パルスAFCPが入力される時点ｔ1 までの期間、BSチュ
ーナ１におけるAFT 回路をミュートするようにしても同
様の効果が得られる。
1 では、キードAFC 動作をさせて、チャンネル選択直後
の局部発振周波数のズレを抑制する。それにより、チャ
ンネル選局時におけるハイビジョン放送の受信性能の低
下を防いで、ハイビジョン放送の受信状態を常に良好に
することができる。なお、本実施例ではチャンネル選局
のソフトウェアにより受信性能の低下を防止したが、ハ
ードウェアによりチャンネル選局時点ｔ0 からキードAF
C パルスAFCPが入力される時点ｔ1 までの期間、BSチュ
ーナ１におけるAFT 回路をミュートするようにしても同
様の効果が得られる。
【００１１】
【発明の効果】以上詳述したように本発明によれば、MU
SE信号チャンネル選局時の局部発振周波数ズレを抑制し
て受信性能の低下を防止できる。そのためハイビジョン
放送を常に良好な状態で受信できるBSチューナのAFC 回
路を提供できる優れた効果を奏する。
SE信号チャンネル選局時の局部発振周波数ズレを抑制し
て受信性能の低下を防止できる。そのためハイビジョン
放送を常に良好な状態で受信できるBSチューナのAFC 回
路を提供できる優れた効果を奏する。
【図１】従来のBSチューナのAFC 回路における動作内容
の説明図である。
の説明図である。
【図２】本発明に係るBSチューナのAFC 回路の要部構成
を示すブロック図である。
を示すブロック図である。
【図３】MUSE信号チャンネル選局時におけるAFC 動作内
容の説明図である。
容の説明図である。
１ BSチューナ ２ BSCPU ３ リモートコントロール送信器 ４ チャンネル選局CPU
Claims (1)
- 【請求項１】 ハイビジョン放送におけるキードAFC パ
ルスが入力されるBSチューナのAFC 回路において、 前記BSチューナの中間周波数を検波して得たAFT 電圧が
入力され、該AFT 電圧及びチャンネルを選局する選局デ
ータに関連するクロックを、BSチューナへ入力するCPU
を備え、前記CPU に選局データを与えた時点から前記キ
ードAFC パルスが入力されるまでの期間は、選局データ
を保持してAFC 動作を停止させ、チャンネル選局時にお
けるBSチューナの局部発振周波数のずれを防止すべく構
成してあることを特徴とするBSチューナのAFC 回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4118261A JPH0630355A (ja) | 1992-04-10 | 1992-04-10 | Ｂｓチューナのａｆｃ回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4118261A JPH0630355A (ja) | 1992-04-10 | 1992-04-10 | Ｂｓチューナのａｆｃ回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0630355A true JPH0630355A (ja) | 1994-02-04 |
Family
ID=14732252
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4118261A Pending JPH0630355A (ja) | 1992-04-10 | 1992-04-10 | Ｂｓチューナのａｆｃ回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0630355A (ja) |
-
1992
- 1992-04-10 JP JP4118261A patent/JPH0630355A/ja active Pending
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