JPH0636617B2 - ダイヤルパルス送出回路 - Google Patents
ダイヤルパルス送出回路Info
- Publication number
- JPH0636617B2 JPH0636617B2 JP60195714A JP19571485A JPH0636617B2 JP H0636617 B2 JPH0636617 B2 JP H0636617B2 JP 60195714 A JP60195714 A JP 60195714A JP 19571485 A JP19571485 A JP 19571485A JP H0636617 B2 JPH0636617 B2 JP H0636617B2
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- JP
- Japan
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- line
- relay
- circuit
- dial pulse
- transistor
- Prior art date
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Description
【発明の詳細な説明】 〔概要〕 ダイヤルパルス送出回路であって、該回路を電子回路に
より構成し実装上の方向性による制限をなくすと共に低
コスト化を図ろうとするものである。
より構成し実装上の方向性による制限をなくすと共に低
コスト化を図ろうとするものである。
本発明は、ダイヤルパルス送出回路に関する。
一般に、交換機のトランク回路（Trunk circuit）及
び、ＰＣＭ端局装置の交換機インタ・フェイス機能を持
つ信号変換回路（Signalling Converter circuit）には
ダイヤルパルス送出回路が設けられている。
び、ＰＣＭ端局装置の交換機インタ・フェイス機能を持
つ信号変換回路（Signalling Converter circuit）には
ダイヤルパルス送出回路が設けられている。
本発明は、このダイヤルパルス送出回路に関し、しかも
上記トランク回路と信号変換回路を結合するＡ線とＢ線
にそれぞれ独立にダイヤルパルスを送出する方式に関す
る。
上記トランク回路と信号変換回路を結合するＡ線とＢ線
にそれぞれ独立にダイヤルパルスを送出する方式に関す
る。
〔従来の技術〕 従来、交換機内トランク回路と、ＰＣＭ端局装置間にお
いて、２線でＡ線、Ｂ線それぞれ独立にダイヤルパルス
を送受信する回路は、第３図に示すような構成を有す
る。第３図は信号変換回路側からダイヤルパルスが送出
され、トランク回路が検出する場合を例にしてある。第
３図において、Ｖ１，Ｖ２はそれぞれ−50Ｖ，＋５Ｖ電
源、Ｅは地気、Ｄはダイヤルパルス送出用リレー、Ｄ
１，Ｄ２はダイヤルパルス送出用リレーの接点、ＤＲＶ
はダイヤルパルス送出用リレーＤのリレードライバー、
Ｃは制御デジタル信号、Ａ，Ｂは線路、Ｒ１はＡ線ダイ
ヤルパルス検出用抵抗、Ｒ２はＢ線ダイヤルパルス検出
用抵抗、DET1はＡ線ダイヤルパルス検出回路、DET2は、
Ｂ線ダイヤルパルス検出回路、ＩＮＶはインバータであ
る。
いて、２線でＡ線、Ｂ線それぞれ独立にダイヤルパルス
を送受信する回路は、第３図に示すような構成を有す
る。第３図は信号変換回路側からダイヤルパルスが送出
され、トランク回路が検出する場合を例にしてある。第
３図において、Ｖ１，Ｖ２はそれぞれ−50Ｖ，＋５Ｖ電
源、Ｅは地気、Ｄはダイヤルパルス送出用リレー、Ｄ
１，Ｄ２はダイヤルパルス送出用リレーの接点、ＤＲＶ
はダイヤルパルス送出用リレーＤのリレードライバー、
Ｃは制御デジタル信号、Ａ，Ｂは線路、Ｒ１はＡ線ダイ
ヤルパルス検出用抵抗、Ｒ２はＢ線ダイヤルパルス検出
用抵抗、DET1はＡ線ダイヤルパルス検出回路、DET2は、
Ｂ線ダイヤルパルス検出回路、ＩＮＶはインバータであ
る。
この構成によりダイヤルパルスを送出する場合、制御デ
ジタル信号ＣによりINV,DRVを介して、Ｄリレーが動作
する。例えば、Ｃが０の場合は（ブレイク）、Ｄの入力
も０になり、Ｄ１とＤ２が閉じる。反対にＣが１の場合
（メイク）、Ｄの入力は１で、Ｄ１とＤ２は復帰する。
このようにして、Ｄリレーの接点Ｄ１，Ｄ２が連続的に
開閉し、デジタルをアナログに変換して１０PPS、ある
いは２０PPSのパルス速度でダイヤルパルスが送出され
る。送出されたダイヤルパルスはトランク回路のDET1,D
ET2で検出される。
ジタル信号ＣによりINV,DRVを介して、Ｄリレーが動作
する。例えば、Ｃが０の場合は（ブレイク）、Ｄの入力
も０になり、Ｄ１とＤ２が閉じる。反対にＣが１の場合
（メイク）、Ｄの入力は１で、Ｄ１とＤ２は復帰する。
このようにして、Ｄリレーの接点Ｄ１，Ｄ２が連続的に
開閉し、デジタルをアナログに変換して１０PPS、ある
いは２０PPSのパルス速度でダイヤルパルスが送出され
る。送出されたダイヤルパルスはトランク回路のDET1,D
ET2で検出される。
このような、機械的なリレーによるダイヤルパルス送出
回路においては、リレーの高速動作や、歪の少ないパル
スの伝送が要求されるために、一般には性能のよいマー
キュリーリレーが用いられていた。
回路においては、リレーの高速動作や、歪の少ないパル
スの伝送が要求されるために、一般には性能のよいマー
キュリーリレーが用いられていた。
しかしながら、マーキュリーリレーには通常方向性があ
り、立てて使用しなければならない。このため実装の仕
方に制限が加わり、扱いにくいという問題点がある。そ
の上、コスト高である。マーキュリーリレーの中には、
方向性の無いものもあるがさらに高価である。
り、立てて使用しなければならない。このため実装の仕
方に制限が加わり、扱いにくいという問題点がある。そ
の上、コスト高である。マーキュリーリレーの中には、
方向性の無いものもあるがさらに高価である。
即ち、従来はダイヤルパルス送出回路を構成するのにマ
ーキュリーリレーを用いていたので実装上の方向性によ
る制限やコスト高であるという問題点があった。
ーキュリーリレーを用いていたので実装上の方向性によ
る制限やコスト高であるという問題点があった。
本発明の目的は、上記問題点を解決し、方向性がなくし
かも低コストのダイヤルパルス送出回路を提供すること
にある。
かも低コストのダイヤルパルス送出回路を提供すること
にある。
その手段は、第１図に示すように、従来のマーキュリー
リレーの代わりに、電子回路によって電子リレーを構成
しダイヤルパルスの送出をＡ線，Ｂ線それぞれ独立に行
うというものである。
リレーの代わりに、電子回路によって電子リレーを構成
しダイヤルパルスの送出をＡ線，Ｂ線それぞれ独立に行
うというものである。
すなわち、本発明のダイヤルパルス送出回路は、交換機
のトランク回路とＰＣＭ端局装置の交換機インタ・フェ
イス機能を持つ信号変換回路とを相互接続するＡ線とＢ
線とにそれぞれ設けられたリレー１，２と、前記Ａ線と
Ｂ線とに別々に設けられた各リレーを制御デジタル信号
Ｃに応答して駆動する駆動回路11,21とを具備し、前記
各リレーをそれぞれトランジスタで構成すると共に、前
記駆動回路をトランジスタと抵抗とで構成し、前記制御
デジタル信号に基づき該駆動回路により各リレーを駆動
させて前記Ａ線とＢ線に極性の異なるダイヤルパルスを
独立に且つ同時に送出するようにしたことを特徴とす
る。
のトランク回路とＰＣＭ端局装置の交換機インタ・フェ
イス機能を持つ信号変換回路とを相互接続するＡ線とＢ
線とにそれぞれ設けられたリレー１，２と、前記Ａ線と
Ｂ線とに別々に設けられた各リレーを制御デジタル信号
Ｃに応答して駆動する駆動回路11,21とを具備し、前記
各リレーをそれぞれトランジスタで構成すると共に、前
記駆動回路をトランジスタと抵抗とで構成し、前記制御
デジタル信号に基づき該駆動回路により各リレーを駆動
させて前記Ａ線とＢ線に極性の異なるダイヤルパルスを
独立に且つ同時に送出するようにしたことを特徴とす
る。
本発明によれば、ダイヤルパルス送出用のリレーをトラ
ンジスタにより構成したので実装する上で方向性は全く
考慮する必要がない。
ンジスタにより構成したので実装する上で方向性は全く
考慮する必要がない。
また、リレー駆動回路はトランジスタと抵抗のみにより
回路を構成できるので、従来と比較して極めて低コスト
となる。
回路を構成できるので、従来と比較して極めて低コスト
となる。
さらに、制御デジタル信号に基づき駆動回路により各リ
レーを駆動させてＡ線とＢ線に極性の異なるダイヤルパ
ルスを独立に且つ同時に送出しているので、仮に一方の
回線にノイズが重畳しても、交換機のトランク回路また
は信号変換回路側において極性の異なるダイヤルパルス
を合成して２倍の振幅を持つパルスを形成することによ
り、当該回線上のダイヤルパルスを正確に検出すること
ができる。
レーを駆動させてＡ線とＢ線に極性の異なるダイヤルパ
ルスを独立に且つ同時に送出しているので、仮に一方の
回線にノイズが重畳しても、交換機のトランク回路また
は信号変換回路側において極性の異なるダイヤルパルス
を合成して２倍の振幅を持つパルスを形成することによ
り、当該回線上のダイヤルパルスを正確に検出すること
ができる。
以下、本発明を、実施例により添付図面を参照して説明
する。
する。
第２図は、本発明の実施例の構成図である。第２図にお
いて、信号変換回路はＰＣＭ端局装置に接続され、制御
デジタル信号Ｃをリレー１と２によりアナログ変換しダ
イヤルパルスを送出する回路である。トランク回路は、
上記ダイヤルパルスを検出する回路である。また両回路
は独立のＡ線とＢ線で接続されている。
いて、信号変換回路はＰＣＭ端局装置に接続され、制御
デジタル信号Ｃをリレー１と２によりアナログ変換しダ
イヤルパルスを送出する回路である。トランク回路は、
上記ダイヤルパルスを検出する回路である。また両回路
は独立のＡ線とＢ線で接続されている。
信号変換回路はＡ線とＢ線のダイヤルパルス送出用トラ
ンジスタリレー１と２及びその駆動回路１１と２１とに
より構成されている。
ンジスタリレー１と２及びその駆動回路１１と２１とに
より構成されている。
Ａ線ダイヤルパルス送出用トランジスタリレー１はダー
リントン回路を構成するトランジスタ１ａと１ｂを有す
る。またＢ線ダイヤルパルス送出用トランジスタリレー
２も、同様にトランジスタ２ａと２ｂを有する。従来技
術（第３図）と対応付ければ、１と２はＤ１とＤ２に
（第３図）それぞれ相当する。
リントン回路を構成するトランジスタ１ａと１ｂを有す
る。またＢ線ダイヤルパルス送出用トランジスタリレー
２も、同様にトランジスタ２ａと２ｂを有する。従来技
術（第３図）と対応付ければ、１と２はＤ１とＤ２に
（第３図）それぞれ相当する。
Ａ線とＢ線のダイヤルパルス送出用トランジスタリレー
駆動回路１１と２１は、制御デジタル信号Ｃの値に応じ
て、対応するリレー１と２をオンオフさせるものであ
り、従来技術（第３図）のＤ、ＤＲＶ、ＩＮＶに相当す
る。
駆動回路１１と２１は、制御デジタル信号Ｃの値に応じ
て、対応するリレー１と２をオンオフさせるものであ
り、従来技術（第３図）のＤ、ＤＲＶ、ＩＮＶに相当す
る。
Ａ線ダイヤルパルス送出用トランジスタリレー駆動回路
１１は、抵抗111，112及び電源113（−５Ｖ）により構
成されている。上記抵抗111は、リレー１のトランジス
タ１ａと１ｂにベース電位を与え、抵抗112は制限抵抗
である。
１１は、抵抗111，112及び電源113（−５Ｖ）により構
成されている。上記抵抗111は、リレー１のトランジス
タ１ａと１ｂにベース電位を与え、抵抗112は制限抵抗
である。
Ｂ線ダイヤルパルス送出用トランジスタリレー駆動回路
２１は、トランジスタ211、抵抗214，215，212，216及
び電源213（＋５Ｖ）により構成されている。トランジ
スタ211は、リレー２のトランジスタ２ａ，２ｂを制御
する。抵抗214は制御トランジスタ211に、抵抗216はリ
レートランジスタ２ａと２ｂに、それぞれベース電位を
与える。
２１は、トランジスタ211、抵抗214，215，212，216及
び電源213（＋５Ｖ）により構成されている。トランジ
スタ211は、リレー２のトランジスタ２ａ，２ｂを制御
する。抵抗214は制御トランジスタ211に、抵抗216はリ
レートランジスタ２ａと２ｂに、それぞれベース電位を
与える。
また抵抗215，212は、制限抵抗である。
上記信号変換回路において、Ｅは地気、Ｉ１，Ｉ２はダ
イヤルパルス電流である。
イヤルパルス電流である。
一方、上記トランク回路は、Ａ線とＢ線のダイヤルパル
ス検出用抵抗Ｒ１とＲ２、及びその検出回路DET1，DET2
とから構成されている。Ｅは地気、またトランク回路と
信号変換回路のＶ１は電源（−５０Ｖ）である。
ス検出用抵抗Ｒ１とＲ２、及びその検出回路DET1，DET2
とから構成されている。Ｅは地気、またトランク回路と
信号変換回路のＶ１は電源（−５０Ｖ）である。
以下、上記構成を有する第２図の回路の動作を説明す
る。
る。
制御デジタル信号ＣがＨレベル（５Ｖ）の場合は、若し
駆動回路１１の抵抗111と112の値を同じに設定すれば、
リレートランジスタ１ａのベース電位は０Ｖとなる。
駆動回路１１の抵抗111と112の値を同じに設定すれば、
リレートランジスタ１ａのベース電位は０Ｖとなる。
従ってリレートランジスタ１ａと１ｂはいずれもオフ状
態である。
態である。
一方、ＣがＨレベル（５Ｖ）であるので駆動回路２１の
電源213（５Ｖ）からも電流は流れない。このため、リ
レートランジスタ２ａと２ｂもオフ状態である。
電源213（５Ｖ）からも電流は流れない。このため、リ
レートランジスタ２ａと２ｂもオフ状態である。
つまり、これは従来技術（第３図）で、Ｃが１、つまり
メイクの場合、Ｄ１とＤ２が開いたのと同じ状態であ
る。
メイクの場合、Ｄ１とＤ２が開いたのと同じ状態であ
る。
制御デジタル信号ＣがＬレベル（０Ｖ）の場合は、電源
113に向かって電流Ｉ４が流れるので、抵抗111と112を
同じ値に設定するとリレートランジスタ１ａのベース電
位は−2.５Ｖとなる。従って、電流Ｉ３が流れてリレー
トランジスタ１ａと１ｂがオンし、ダイヤルパルス電流
Ｉ１が流れる。
113に向かって電流Ｉ４が流れるので、抵抗111と112を
同じ値に設定するとリレートランジスタ１ａのベース電
位は−2.５Ｖとなる。従って、電流Ｉ３が流れてリレー
トランジスタ１ａと１ｂがオンし、ダイヤルパルス電流
Ｉ１が流れる。
一方、駆動回路２１に関しては、ＣがＬレベル（０Ｖ）
であるために、電源213（５Ｖ）から電流Ｉ５が流れ、
制御トランジスタ211のベース電位がエミッタ電位より
も低くなり抵抗212と216を介して電流Ｉ７が流れる。
であるために、電源213（５Ｖ）から電流Ｉ５が流れ、
制御トランジスタ211のベース電位がエミッタ電位より
も低くなり抵抗212と216を介して電流Ｉ７が流れる。
従って、抵抗216による電圧降下により、リレートラン
ジスタ２ａと２ｂにベース電位が与えられ、電流Ｉ６が
流れる。
ジスタ２ａと２ｂにベース電位が与えられ、電流Ｉ６が
流れる。
このためリレートランジスタ２ａと２ｂがオンし、ダイ
ヤルパルス電流Ｉ２が流れる。
ヤルパルス電流Ｉ２が流れる。
このＣがＬレベル（０Ｖ）の場合、従来技術（第３図）
のＣが０、つまりブレイクの場合でＤ１とＤ２が閉じた
状態と同じである。
のＣが０、つまりブレイクの場合でＤ１とＤ２が閉じた
状態と同じである。
尚、上記構成において、各リレー１と２のトランジスタ
1a，1b，2a，2bのベースエミッタ間電圧ＶBE11，
ＶBE12，ＶBE21，ＶBE22は、それぞれ約0.６Ｖに設定さ
れている。
1a，1b，2a，2bのベースエミッタ間電圧ＶBE11，
ＶBE12，ＶBE21，ＶBE22は、それぞれ約0.６Ｖに設定さ
れている。
上記のとおり、本発明によれば、ダイヤルパルス送出用
のリレーをトランジスタにより構成したので実装する上
で方向性は全く考慮する必要がない。
のリレーをトランジスタにより構成したので実装する上
で方向性は全く考慮する必要がない。
また、リレー駆動回路はトランジスタと抵抗のみにより
回路を構成できるので、従来と比較して極めて低コスト
となる。
回路を構成できるので、従来と比較して極めて低コスト
となる。
さらに、Ａ線とＢ線に極性の異なるダイヤルパルスを独
立に且つ同時に送出可能な構成としているので、仮に一
方の回線にノイズが重畳しても当該回線上のダイヤルパ
ルスを正確に検出することができる。
立に且つ同時に送出可能な構成としているので、仮に一
方の回線にノイズが重畳しても当該回線上のダイヤルパ
ルスを正確に検出することができる。
第１図は本発明の原理図、第２図は本発明の実施例の構
成図、第３図は従来技術の説明図である。 １…Ａ線ダイヤルパルス送出用トランジスタリレー、 ２…Ｂ線ダイヤルパルス送出用トランジスタリレー、 １１…Ａ線ダイヤルパルス送出用トランジスタリレー駆
動回路、 １２…Ｂ線ダイヤルパルス送出用トランジスタリレー駆
動回路、 1a，1b，2a，2b…リレートランジスタ、 111,112,212,214,215,216…抵抗、 211…制御トランジスタ、 113,213…駆動回路電源。
成図、第３図は従来技術の説明図である。 １…Ａ線ダイヤルパルス送出用トランジスタリレー、 ２…Ｂ線ダイヤルパルス送出用トランジスタリレー、 １１…Ａ線ダイヤルパルス送出用トランジスタリレー駆
動回路、 １２…Ｂ線ダイヤルパルス送出用トランジスタリレー駆
動回路、 1a，1b，2a，2b…リレートランジスタ、 111,112,212,214,215,216…抵抗、 211…制御トランジスタ、 113,213…駆動回路電源。
Claims (1)
- 【請求項１】交換機のトランク回路とＰＣＭ端局装置の
交換機インタ・フェイス機能を持つ信号変換回路とを相
互接続するＡ線とＢ線とにそれぞれ設けられたリレー
（１，２）と、 前記Ａ線とＢ線とに別々に設けられた各リレーを制御デ
ジタル信号（Ｃ）に応答して駆動する駆動回路（11,2
1）とを具備し、 前記各リレーをそれぞれトランジスタで構成すると共
に、前記駆動回路をトランジスタと抵抗とで構成し、前
記制御デジタル信号に基づき該駆動回路により各リレー
を駆動させて前記Ａ線とＢ線に極性の異なるダイヤルパ
ルスを独立に且つ同時に送出するようにしたことを特徴
とするダイヤルパルス送出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60195714A JPH0636617B2 (ja) | 1985-09-06 | 1985-09-06 | ダイヤルパルス送出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60195714A JPH0636617B2 (ja) | 1985-09-06 | 1985-09-06 | ダイヤルパルス送出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6257394A JPS6257394A (ja) | 1987-03-13 |
| JPH0636617B2 true JPH0636617B2 (ja) | 1994-05-11 |
Family
ID=16345751
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60195714A Expired - Lifetime JPH0636617B2 (ja) | 1985-09-06 | 1985-09-06 | ダイヤルパルス送出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0636617B2 (ja) |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS58133093A (ja) * | 1982-02-03 | 1983-08-08 | Nec Corp | ダイヤルパルス発生回路 |
-
1985
- 1985-09-06 JP JP60195714A patent/JPH0636617B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6257394A (ja) | 1987-03-13 |
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