JPH0645448A - 半導体装置 - Google Patents
半導体装置Info
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- JPH0645448A JPH0645448A JP21579592A JP21579592A JPH0645448A JP H0645448 A JPH0645448 A JP H0645448A JP 21579592 A JP21579592 A JP 21579592A JP 21579592 A JP21579592 A JP 21579592A JP H0645448 A JPH0645448 A JP H0645448A
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- 239000004065 semiconductor Substances 0.000 title claims abstract description 11
- 229910052751 metal Inorganic materials 0.000 claims abstract description 14
- 239000002184 metal Substances 0.000 claims abstract description 14
- 238000007747 plating Methods 0.000 claims description 6
- 238000000034 method Methods 0.000 claims description 2
- 230000010354 integration Effects 0.000 abstract description 5
- PCHJSUWPFVWCPO-UHFFFAOYSA-N gold Chemical compound [Au] PCHJSUWPFVWCPO-UHFFFAOYSA-N 0.000 description 12
- 239000010931 gold Substances 0.000 description 12
- 229910052737 gold Inorganic materials 0.000 description 12
- 229920002120 photoresistant polymer Polymers 0.000 description 11
- MAKDTFFYCIMFQP-UHFFFAOYSA-N titanium tungsten Chemical compound [Ti].[W] MAKDTFFYCIMFQP-UHFFFAOYSA-N 0.000 description 9
- 238000005530 etching Methods 0.000 description 5
- 238000000059 patterning Methods 0.000 description 4
- 230000002950 deficient Effects 0.000 description 3
- 238000004519 manufacturing process Methods 0.000 description 3
- 150000004767 nitrides Chemical class 0.000 description 3
- 238000007772 electroless plating Methods 0.000 description 2
- 238000009713 electroplating Methods 0.000 description 2
- 239000011368 organic material Substances 0.000 description 2
- 238000002161 passivation Methods 0.000 description 2
- 230000002238 attenuated effect Effects 0.000 description 1
- 239000011248 coating agent Substances 0.000 description 1
- 238000000576 coating method Methods 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000009413 insulation Methods 0.000 description 1
- 239000000463 material Substances 0.000 description 1
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 1
- 229920005591 polysilicon Polymers 0.000 description 1
- 238000004544 sputter deposition Methods 0.000 description 1
Landscapes
- Design And Manufacture Of Integrated Circuits (AREA)
Abstract
(57)【要約】
【目的】 半導体装置の冗長回路に設けられるヒューズ
を、低エネルギのレーザ光で溶断を可能とし、かつヒュ
ーズと配線とを積層可能にして高集積化を可能とする。 【構成】 下地絶縁膜6上に配線パターンを含む所要の
パターンで形成された薄い金属膜3,4と、この薄い金
属膜の一部を残した領域にめっき法により形成された配
線1とを備え、この配線1が形成されない部分の薄い金
属膜をヒューズ2として構成する。ヒューズ2が薄く形
成されるため、最上層の配線に配置できヒューズ溶断エ
ネルギを低減でき、かつ他の配線層との積層を可能にし
て高集積化を実現する。
を、低エネルギのレーザ光で溶断を可能とし、かつヒュ
ーズと配線とを積層可能にして高集積化を可能とする。 【構成】 下地絶縁膜6上に配線パターンを含む所要の
パターンで形成された薄い金属膜3,4と、この薄い金
属膜の一部を残した領域にめっき法により形成された配
線1とを備え、この配線1が形成されない部分の薄い金
属膜をヒューズ2として構成する。ヒューズ2が薄く形
成されるため、最上層の配線に配置できヒューズ溶断エ
ネルギを低減でき、かつ他の配線層との積層を可能にし
て高集積化を実現する。
Description
【0001】
【産業上の利用分野】本発明は半導体装置に関し、特に
レーザ光により溶断するヒューズを有する半導体装置に
関する。
レーザ光により溶断するヒューズを有する半導体装置に
関する。
【0002】
【従来の技術】半導体装置におけるメモリ部分は、同一
の回路を複数有し、かつ素子密度も非常に高く、他の回
路部分に比較して良品が得にくい。このため、従来から
冗長回路を予め配置した状態で半導体装置を製造し、そ
の後の電気的試験においてメモリ部分の状況を判断して
不良部分を切り離し、その代わりに冗長回路を接続する
ことにより、電気的に良品として使用するようにした構
成がとられている。この不良部分と冗長回路の切り離
し,接続を行うためにヒューズが用いられており、ヒュ
ーズをレーザ光により溶断することで回路の切断を行っ
ている。このレーザ光によるヒューズの溶断に際して
は、配線の熱伝導が高過ぎて非常に高エネルギのレーザ
光が必要となるため、ヒューズは配線層下にポリシリコ
ンを用いて形成し、レーザ光によりヒューズを溶断させ
ている。
の回路を複数有し、かつ素子密度も非常に高く、他の回
路部分に比較して良品が得にくい。このため、従来から
冗長回路を予め配置した状態で半導体装置を製造し、そ
の後の電気的試験においてメモリ部分の状況を判断して
不良部分を切り離し、その代わりに冗長回路を接続する
ことにより、電気的に良品として使用するようにした構
成がとられている。この不良部分と冗長回路の切り離
し,接続を行うためにヒューズが用いられており、ヒュ
ーズをレーザ光により溶断することで回路の切断を行っ
ている。このレーザ光によるヒューズの溶断に際して
は、配線の熱伝導が高過ぎて非常に高エネルギのレーザ
光が必要となるため、ヒューズは配線層下にポリシリコ
ンを用いて形成し、レーザ光によりヒューズを溶断させ
ている。
【0003】
【発明が解決しようとする課題】このような従来のヒュ
ーズでは、ヒューズ上に被着膜が多くなると、レーザ光
がヒューズに到達されるまでに減衰されてしまうため、
ヒューズの形成後にヒューズ上の被着部を選択的に除去
するエッチングが行われている。しかしながら、近年の
半導体装置では、配線層の数が増加する傾向にあり、配
線層間の絶縁膜の数も増大し、厚さも増加している。更
に、配線の段差を低減させるために有機系の塗布材料が
多用され、製造途中でヒューズ上の絶縁膜をエッチング
除去しておいても、その後に有機材料を塗布したときに
有機材料がその凹みに溜り、結果的には表面が平坦とな
り、絶縁膜の膜厚を薄くすることができないという問題
がある。
ーズでは、ヒューズ上に被着膜が多くなると、レーザ光
がヒューズに到達されるまでに減衰されてしまうため、
ヒューズの形成後にヒューズ上の被着部を選択的に除去
するエッチングが行われている。しかしながら、近年の
半導体装置では、配線層の数が増加する傾向にあり、配
線層間の絶縁膜の数も増大し、厚さも増加している。更
に、配線の段差を低減させるために有機系の塗布材料が
多用され、製造途中でヒューズ上の絶縁膜をエッチング
除去しておいても、その後に有機材料を塗布したときに
有機材料がその凹みに溜り、結果的には表面が平坦とな
り、絶縁膜の膜厚を薄くすることができないという問題
がある。
【0004】この対策として、全絶縁膜を成長させた後
にヒューズ上のエッチングを行うことが考えられるが、
エッチングにより形成される凹みは深くなるため、その
後の取扱いによって汚れ等が溜り易く、信頼性が悪くな
るという問題がある。また、ヒューズ上の絶縁膜をエッ
チングしてしまうことから、ヒューズ上には配線を配置
することができず、半導体装置の高集積化が難しくなる
という問題がある。本発明の目的は、低エネルギのレー
ザ光でのヒューズ溶断を可能とし、かつヒューズと配線
とを積層可能にして高集積化を可能にした半導体装置を
提供することにある。
にヒューズ上のエッチングを行うことが考えられるが、
エッチングにより形成される凹みは深くなるため、その
後の取扱いによって汚れ等が溜り易く、信頼性が悪くな
るという問題がある。また、ヒューズ上の絶縁膜をエッ
チングしてしまうことから、ヒューズ上には配線を配置
することができず、半導体装置の高集積化が難しくなる
という問題がある。本発明の目的は、低エネルギのレー
ザ光でのヒューズ溶断を可能とし、かつヒューズと配線
とを積層可能にして高集積化を可能にした半導体装置を
提供することにある。
【0005】
【課題を解決するための手段】本発明は、下地絶縁膜上
に配線パターンを含む所要のパターンで形成された薄い
金属膜と、この薄い金属膜の一部を残した領域にめっき
法により形成された配線とを備え、前記配線が形成され
ない薄い金属膜をヒューズとして構成する。
に配線パターンを含む所要のパターンで形成された薄い
金属膜と、この薄い金属膜の一部を残した領域にめっき
法により形成された配線とを備え、前記配線が形成され
ない薄い金属膜をヒューズとして構成する。
【0006】
【実施例】次に、本発明について図面を参照して説明す
る。図1は本発明の第1実施例を示しており、同図
(a)は平面レイアウト図、(b)はそのA−A線断面
図である。下地絶縁膜6上にチタンタングステン3が形
成され、この上にスパッタ法により形成されたスパッタ
金4が形成されている。更に、この上に電解めっき或い
は無電解めっきで形成された配線1が形成されている。
そして、この配線1は一部箇所で切断され、この切断部
は前記チタンタングステン3とスパッタ金4のみで構成
され、これでヒューズ2を形成している。そして、この
ヒューズ2及び配線1上にパッシベーション膜として窒
化膜5が被着されている。
る。図1は本発明の第1実施例を示しており、同図
(a)は平面レイアウト図、(b)はそのA−A線断面
図である。下地絶縁膜6上にチタンタングステン3が形
成され、この上にスパッタ法により形成されたスパッタ
金4が形成されている。更に、この上に電解めっき或い
は無電解めっきで形成された配線1が形成されている。
そして、この配線1は一部箇所で切断され、この切断部
は前記チタンタングステン3とスパッタ金4のみで構成
され、これでヒューズ2を形成している。そして、この
ヒューズ2及び配線1上にパッシベーション膜として窒
化膜5が被着されている。
【0007】この製造方法を図2を用いて説明する。先
ず、図2(a)のように、下地絶縁膜6上にチタンタン
グステン3を1000Åスパッタし、めっきの成長核となる
金4を 500Åスパッタする。その後、図2(b)のよう
に、フォトレジスト7により配線部以外を覆うようにパ
ターニングし、電解めっき又は無電解めっきを 1.2μm
の厚さでめっきする。次いで、図2(c)のように、フ
ォトレジスト7をエッチングしてヒューズを形成する箇
所にのみフォトレジスト7を残しスパッタ金4とチタン
タングステン3をエッチングする。このとき、フォトレ
ジスト7で覆われていない配線1の表面は2000Å程度エ
ッチングされるため、ヒューズ両端の配線上は2000Å程
度の突起が形成される。その後、フォトレジスト7を除
去し、その上にパッシベーション膜として窒化膜を1μ
m形成する。
ず、図2(a)のように、下地絶縁膜6上にチタンタン
グステン3を1000Åスパッタし、めっきの成長核となる
金4を 500Åスパッタする。その後、図2(b)のよう
に、フォトレジスト7により配線部以外を覆うようにパ
ターニングし、電解めっき又は無電解めっきを 1.2μm
の厚さでめっきする。次いで、図2(c)のように、フ
ォトレジスト7をエッチングしてヒューズを形成する箇
所にのみフォトレジスト7を残しスパッタ金4とチタン
タングステン3をエッチングする。このとき、フォトレ
ジスト7で覆われていない配線1の表面は2000Å程度エ
ッチングされるため、ヒューズ両端の配線上は2000Å程
度の突起が形成される。その後、フォトレジスト7を除
去し、その上にパッシベーション膜として窒化膜を1μ
m形成する。
【0008】この構成によれば、チタンタングステン3
とスパッタ金4とからなる非常に薄い金属パターンでヒ
ューズ2を構成することができ、このように形成された
ヒューズは通常の配線より熱伝導が低く、従来と同じエ
ネルギのレーザ光で溶断することができるため、冗長回
路用のヒューズとして充分利用することができる。
とスパッタ金4とからなる非常に薄い金属パターンでヒ
ューズ2を構成することができ、このように形成された
ヒューズは通常の配線より熱伝導が低く、従来と同じエ
ネルギのレーザ光で溶断することができるため、冗長回
路用のヒューズとして充分利用することができる。
【0009】図3は本発明の第2実施例の断面図であ
る。ここではヒューズ部のスパッタ金を無くしている。
この構成は、例えば図2(b)の工程後にフォトレジス
ト7を除去し、露呈されたスパッタ金4を 500Åエッチ
ングして除去しておき、その後に第1実施例と同様にチ
タンタングステン3をエッチングして形成する。このよ
うにすると、第1実施例よりも更にヒューズ部の金属厚
さが薄くでき、熱伝導を更に低くすることができる。
る。ここではヒューズ部のスパッタ金を無くしている。
この構成は、例えば図2(b)の工程後にフォトレジス
ト7を除去し、露呈されたスパッタ金4を 500Åエッチ
ングして除去しておき、その後に第1実施例と同様にチ
タンタングステン3をエッチングして形成する。このよ
うにすると、第1実施例よりも更にヒューズ部の金属厚
さが薄くでき、熱伝導を更に低くすることができる。
【0010】ここで、図2(a)の工程後に、スパッタ
金4とチタンタングステン3を配線部とヒューズ部分に
のみ残るようにエッチングした後、フォトレジスト7を
除去し、再度フォトレジストでパターニングした上で配
線部の金めっきを無電解金めっきによって形成してもよ
い。このようにすると、第1,第2実施例では配線1を
形成してからヒューズ部のみにフォトレジストをパター
ニングしているために、 1.2μmの配線段差に対し、跨
がるようにフォトレジストをパターニングしなければな
らず、パターニング精度を上げ難いが、この実施例では
平坦な表面にパターニングすればよく、パターニング精
度が向上する。
金4とチタンタングステン3を配線部とヒューズ部分に
のみ残るようにエッチングした後、フォトレジスト7を
除去し、再度フォトレジストでパターニングした上で配
線部の金めっきを無電解金めっきによって形成してもよ
い。このようにすると、第1,第2実施例では配線1を
形成してからヒューズ部のみにフォトレジストをパター
ニングしているために、 1.2μmの配線段差に対し、跨
がるようにフォトレジストをパターニングしなければな
らず、パターニング精度を上げ難いが、この実施例では
平坦な表面にパターニングすればよく、パターニング精
度が向上する。
【0011】
【発明の効果】以上説明したように本発明は、配線層を
含むパターン領域に設けた薄い金属膜でヒューズを形成
しているので、例えば多層配線を用いた半導体装置にお
いては、最上層の配線層にヒューズを形成することが可
能となり、絶縁膜をエッチングする必要はなくなり、ヒ
ューズ溶断を低エネルギで行うことが可能になるととも
に、ヒューズに重ねて配線を形成することができ、半導
体装置の高集積化を可能とする。
含むパターン領域に設けた薄い金属膜でヒューズを形成
しているので、例えば多層配線を用いた半導体装置にお
いては、最上層の配線層にヒューズを形成することが可
能となり、絶縁膜をエッチングする必要はなくなり、ヒ
ューズ溶断を低エネルギで行うことが可能になるととも
に、ヒューズに重ねて配線を形成することができ、半導
体装置の高集積化を可能とする。
【図1】本発明の第1実施例の平面図及びそのA−A線
断面図である。
断面図である。
【図2】図1の製造方法を工程順に示す断面図である。
【図3】本発明の第2実施例の断面図である。
1 配線 2 ヒューズ 3 チタンタングステン 4 スパッタ金 5 窒化膜 6 下地絶縁膜
Claims (1)
- 【請求項1】 下地絶縁膜上に配線パターンを含む所要
のパターンで形成された薄い金属膜と、この薄い金属膜
の一部を残した領域にめっき法により形成された配線と
を備え、前記配線が形成されない薄い金属膜をヒューズ
として構成したことを特徴とする半導体装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21579592A JP2830636B2 (ja) | 1992-07-22 | 1992-07-22 | 半導体装置の製造方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21579592A JP2830636B2 (ja) | 1992-07-22 | 1992-07-22 | 半導体装置の製造方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0645448A true JPH0645448A (ja) | 1994-02-18 |
| JP2830636B2 JP2830636B2 (ja) | 1998-12-02 |
Family
ID=16678374
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21579592A Expired - Fee Related JP2830636B2 (ja) | 1992-07-22 | 1992-07-22 | 半導体装置の製造方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2830636B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2004004009A1 (ja) * | 2002-06-28 | 2004-01-08 | Kabushiki Kaisha Toyota Jidoshokki | 半導体集積回路 |
-
1992
- 1992-07-22 JP JP21579592A patent/JP2830636B2/ja not_active Expired - Fee Related
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO2004004009A1 (ja) * | 2002-06-28 | 2004-01-08 | Kabushiki Kaisha Toyota Jidoshokki | 半導体集積回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JP2830636B2 (ja) | 1998-12-02 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |