JPH0677085U - Hdd用電源回路 - Google Patents
Hdd用電源回路Info
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- JPH0677085U JPH0677085U JP1241193U JP1241193U JPH0677085U JP H0677085 U JPH0677085 U JP H0677085U JP 1241193 U JP1241193 U JP 1241193U JP 1241193 U JP1241193 U JP 1241193U JP H0677085 U JPH0677085 U JP H0677085U
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Abstract
(57)【要約】
【目的】 入力電源の瞬停発生時に、電源回路ではこの
瞬停時間が微小であっても確実に瞬停を検出したい。 【構成】 入力電源Aに微小時間幅の瞬停が発生した場
合、パルス幅伸長回路4がその瞬停時間幅を引き伸ば
す。これをリレー2、3が応動して、電源Bは、この引
き伸ばした時間対応にOFFとなり、瞬停を確実にHD
D側に伝えることができる。
瞬停時間が微小であっても確実に瞬停を検出したい。 【構成】 入力電源Aに微小時間幅の瞬停が発生した場
合、パルス幅伸長回路4がその瞬停時間幅を引き伸ば
す。これをリレー2、3が応動して、電源Bは、この引
き伸ばした時間対応にOFFとなり、瞬停を確実にHD
D側に伝えることができる。
Description
【0001】
本考案は、HDD用の電源回路、特に、リレーの応動時間よりも短い瞬停対策 用のHDD用の電源回路に関する。
【0002】
ハードディスク(HDD)は高密度記憶用としてパソコン、マイコン、ワーク ステーション等の各種のコンピュータのメモリとして広汎に使われている。ハー ドディスクのアクセスのためには、磁気ヘッドの該当アドレスへのシーク動作、 及びシーク完了後のリード、ライト動作を必要とする。
【0003】 従来ハードディスクへのアクセス(シーク、リード、ライト動作)を行う際、 制御信号により、現在のハードディスクがどのような状態にあるかを確認しなが らハードディスクの制御を行っている。この制御信号の例としては、ヘッドがシ リンダゼロにきているか、目標シリンダにきているか、モータの回転数が安定し たか等である。
【0004】
ハードディスクの起動中、入力電源の瞬停が起こった場合で、なおかつ瞬停時 間が極めて短い時、ハードディスクとして電源OFFを認識できない場合が存在 する。その場合、電源投入時のイニシャル状態から作動せずそのままの状態から 引続き動作しようとするが、瞬時に電源OFFとなっているため本来は起こり得 ない制御信号状態が瞬間的に発生する。
【0005】 これは、電源回路を構成するリレーの応動時間に比して瞬停時間が短い時であ る。瞬停時間が短いと、リレーは瞬停に気づかないまま電源0Nが継続している ものとしての動作をし、入力電源電圧を瞬停にもかかわらず継続して発生する。 一方、ハードディスク側ではこの瞬停に応動してしまうことがある。電源回路は 応動せず、HDD側が応動することにより、瞬停がHDDに対して悪影響を及ぼ すことになる。HDDがますます高速化アクセスを必要とするから、この悪影響 は無視できない。悪影響の例としては、電源OFFにより本来の動作を行えない でヘッドが途中停止する等がある。このような場合、再度電源OFFとし、イニ シャル状態から立ち上げようとしても、復帰できないときが発生し、故障に至る 場合がある。
【0006】 本考案の目的は、電源回路内のリレーの応動時間よりも短い時間幅の瞬停が発 生しても、この瞬停を検出可能にするHDD用電源回路を提供するものである。
【0007】
本考案は、電源スイッチと、第1の常開接点と、パルス時間幅伸長回路と第2 の常開接点と常閉接点より成る直列回路と、上記電源スイッチと第1の常開接点 と直列回路とのそれぞれの一方の端子に共通に接続した電源入力端子と、上記第 2の常開接点と常閉接点との接続点に並列に接続された、上記第1の常開接点励 磁用の第1のリレーと上記第2の常開接点及び常閉接点励磁用の第2のリレーと 、上記電源スイッチと第1の常開接点と直列回路とのそれぞれの他方の側を共通 に接続して該接続点からHDD用の入力電源を出力する出力端子と、より成ると 共に、上記パルス時間幅伸長回路は、上記電源入力端子に印加される電源の瞬停 時に上記第1、第2のリレーが応動できるような時間幅の出力を発生する構成と する。
【0008】
本考案によれば、電源の瞬停時に、この瞬停時間が第1、第2のリレーの応動 時間より短い場合でも、パルス時間幅伸長回路の働きで瞬停時間が信号的に広が るため、第1、第2のリレーはその瞬停に応動して、HDD用電源を断にする。
【0009】
図1は本考案のHDD用電源回路の実施例図である。この電源回路は、電源ス イッチ1、第1の常開接点2a(ノーマル・オープン、即ちN・0接点)、第2 の常開接点3a、常閉接点3b(ノーマル・クローズ、即ちN・C接点)、パル ス幅伸長回路4、第1、第2のリレー2、3より成る。第1の常開接点2aはリ レー2の接点、第2の常開接点3a及び常閉接点3bはリレー3の接点である。 ここで、常開、常閉とはリレー2、3に電源が印加されていない時に常に開、常 に閉となる接点状態を云う。
【0010】 パルス幅伸長回路4は、リレー2、3で応動時間τ0よりも小さい時間幅τの 瞬停発生時に、τ1≧τ0となる時間幅τ1のパルスを発生する回路である。ここ で、応動時間とは、リレー2、3が接点2a、3a、3bを切り換(0NからO FF、又はOFFから0Nへの切り換えのこと)えるために必要な入力時間幅で あり、この入力時間幅よりも小さな時間幅の入力信号が入力してもリレー2、3 の0NからOFF、又はOFFから0Nへの切り換えは行わない。そこで、パル ス幅伸長回路4を設けておき、τ<τ0なるτの場合、τではなくτ1≧τ0なる τ1のパルス幅の信号を出力することによって、リレー2、3の接点2a、3a 、3bは確実に切り換わる。
【0011】 次に動作を説明する。図2はそのタイムチャートである。入力電源Aが既に0 からVccに立ち上がっているものとする。この状態でスイッチ1がOFFであれ ば、リレー2、3への電源系路(4→3a、及び2a→3b)はいずれもOFF であり、リレー2、3の励磁はない。従って、HDD用電源BはOFFのままで ある。そこで任意の時刻に電源スイッチ1を0Nにすると、A→1→3b(常閉 )→2、3の系路が形成され、リレー2、3へ電圧Aが供給される。このスイッ チ1は一定時間Τ0で自動的にOFFになるスイッチであり、Τ0》τ0に設定し ておけばこのスイッチ1の0Nにより、リレー2、3が動作し接点2aがOFF →0N、接点3aがOFF→0N、接点3bが0N→OFFとなる。接点3bが OFFとなることにより、A→1→3b→2、3の系路は断となるが、代わりに 自己保持用の系路A→4→3a→2、3が形成され、リレー2、3は継続して励 磁状態となる。これにより、スイッチ1が自動的にOFFになった後でもA→2 a→Bの系路が形成され、電源Aは電源Bとして出力されることになる。
【0012】 一方、τ<τ0なる時間幅τの瞬停が発生したとすると、これを受けてパルス 幅伸長回路4は、τ1≧τ0なるパルス幅の出力を発生する。このパルス幅τ1に よりリレー2、3は0N→OFFとなる。リレー2、3のOFFにより、2a、 3aが0N→OFFとなり、自己保持系路が断となり、A→2a→Bの系路も断 となり、電源BはOFFとなる。かくして、τ≦τ0なる微小な時間幅の瞬停が 発生しても、リレー2、3は確実にOFFとなり、HDD用電源Bは、Vcc→0 へと変化し、いわゆる電源断となる。
【0013】 以上はパルス幅伸長回路4が存在するためであるが、もし、この回路4がなけ れば、時間幅τの瞬停が発生した場合、リレー2、3は応動せず、従って、電源 Bは、瞬停があったにもかかわらず、断とならずにそのまま0Nを継続する。し かし、この途中で瞬停が発生したことは事実であり、瞬停状態はそのままBとし て出力されてしまう。HDD側では、この瞬停により一時的に影響を受ける。例 えばシーク動作中であれば、瞬停の期間中、シーク停止となる。しかし、シーク の制御を行っているマイコン側ではこのことを知らない。これはソフト上問題で ある。本実施例によれば、こうした事態をなくすことができる。
【0014】 尚、パルス幅伸長回路4の機能としては、τ<τ0なる場合のみ、τ1≧τ0と したが、このためには瞬停幅検出機能、及びτ1≧τ0なるτ1を発生する機能を 備えておくことが必要である。更に、リレー2、3の2つの例としたが、2a、 3a、3bの3接点駆動可能な1個のリレーによっても実現できる。
【0015】
本考案によれば、ハードディスク起動中の入力電源瞬停時、リレーの応動が確 実になされ、急峻な瞬停発生があっても、瞬停を正しく検出でき、HDDの誤制 御はなくなる。この誤制御がなくなることにより、HDD自体の破壊も防止でき る。
【図1】本考案のHDD電源回路の実施例図である。
【図2】図1の実施例のタイムチャートである。
1 電源スイッチ 2、3 リレー 4 パルス幅伸長回路 2a、3a 常開接点 3b 常閉接点
Claims (1)
- 【請求項1】 電源スイッチと、第1の常開接点と、パ
ルス時間幅伸長回路と第2の常開接点と常閉接点より成
る直列回路と、上記電源スイッチと第1の常開接点と直
列回路とのそれぞれの一方の端子に共通に接続した電源
入力端子と、上記第2の常開接点と常閉接点との接続点
に並列に接続された、上記第1の常開接点励磁用の第1
のリレーと上記第2の常開接点及び常閉接点励磁用の第
2のリレーと、上記電源スイッチと第1の常開接点と直
列回路とのそれぞれの他方の側を共通に接続して該接続
点からHDD用の入力電源を出力する出力端子と、より
成ると共に、上記パルス時間幅伸長回路は、上記電源入
力端子に印加される電源の瞬停時に上記第1、第2のリ
レーが応動できるような時間幅の出力を発生する構成と
するHDD用電源回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1993012411U JP2592513Y2 (ja) | 1993-03-19 | 1993-03-19 | Hdd用電源回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1993012411U JP2592513Y2 (ja) | 1993-03-19 | 1993-03-19 | Hdd用電源回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0677085U true JPH0677085U (ja) | 1994-10-28 |
| JP2592513Y2 JP2592513Y2 (ja) | 1999-03-24 |
Family
ID=11804527
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1993012411U Expired - Fee Related JP2592513Y2 (ja) | 1993-03-19 | 1993-03-19 | Hdd用電源回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2592513Y2 (ja) |
-
1993
- 1993-03-19 JP JP1993012411U patent/JP2592513Y2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP2592513Y2 (ja) | 1999-03-24 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |