JPH0677106A - フォトレジストパターンの形成方法 - Google Patents

フォトレジストパターンの形成方法

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JPH0677106A
JPH0677106A JP4225406A JP22540692A JPH0677106A JP H0677106 A JPH0677106 A JP H0677106A JP 4225406 A JP4225406 A JP 4225406A JP 22540692 A JP22540692 A JP 22540692A JP H0677106 A JPH0677106 A JP H0677106A
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JP
Japan
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photoresist
exposure amount
forming
pattern
exposing
Prior art date
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Pending
Application number
JP4225406A
Other languages
English (en)
Inventor
Shigeru Osawa
滋 大澤
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Toshiba Corp
Original Assignee
Toshiba Corp
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Filing date
Publication date
Application filed by Toshiba Corp filed Critical Toshiba Corp
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Publication of JPH0677106A publication Critical patent/JPH0677106A/ja
Pending legal-status Critical Current

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Landscapes

  • Photosensitive Polymer And Photoresist Processing (AREA)
  • Exposure And Positioning Against Photoresist Photosensitive Materials (AREA)
  • Exposure Of Semiconductors, Excluding Electron Or Ion Beam Exposure (AREA)

Abstract

(57)【要約】 【目的】 本発明は上記電極形成のためのフォトレジス
トパターンの形成にあたり、電極の大きさを安定させる
ために一定の庇部をフォトレジストパターンに形成する
ことを目的とする。 【構成】 回路が形成された基板上にポジタイプのフォ
トレジスト膜を形成する工程、電極形成予定域を除く領
域に適正露光量よりも少ない露光量で露光を施す工程、
前記露光領域よりも一回り小さい領域に適正露光量以上
の露光量の露光を施す工程、前記露光を施した部位のフ
ォトレジスト膜をアンモニアまたはアミン系化合物を含
む雰囲気中で、または単にベーキングを施し現像液に不
溶にする工程、全面に露光を施して現像する工程を含
み、前記フォトレジスト膜を逆テーパ、あるいは表面に
庇を有する形状のパターンに形成するフォトレジストパ
ターンの形成方法。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は半導体装置の製造方法に
係り、特にイメージリバース法を用いたリフトオフ法に
より電極を形成する際のフォトレジストパターン形成に
適用される。
【0002】
【従来の技術】リフトオフ法による電極形成は、半導体
装置の製造に広く用いられており、重要な技術の一つに
なっている。リフトオフ法により電極を形成するとき
は、まず逆テーパ状、あるいはフォトレジスト表面に庇
を有するフォトレジストパターンを形成する。次に蒸着
等により全面に電極金属層を形成し、次いでフォトレジ
ストを除去することによりフォトレジスト膜上の金属も
除去され、所定の部分だけに電極が形成される。逆テー
パ状、あるいはフォトレジスト膜表面に庇を有するフォ
トレジストパターンを形成する方法は各種提案されてい
るが、イメージリバース法はプロセスが簡単であり、ま
た安定に庇を有するフォトレジストパターンを得られ、
また広範囲に亘る種類のポジタイプのフォトレジストを
使用できることからしばしば用いられる方法である。イ
メージリバース法で用いるフォトレジストには、露光後
に単にベーキングするたけで露光部分が変質し現像液に
不溶になるものもある。しかしこの種のフォトレジスト
では膜厚が限られるので、通常は膜厚に自由度のある通
常のポジタイプのフォトレジストを用いる。
【0003】一般に行われているイメージリバース法に
よるリフトオフ工程を図4によって説明する。回路が形
成された基板101にポジタイプのフォトレジスト10
2をコートした後、マスク103を通して所定の部分の
フォトレジストを露光する(図4(a))。次にアンモ
ニア雰囲気中でベーキングすると、露光した部分のフォ
トレジスト112は変質したフォトレジスト122とな
り現像液に溶けなくなる(図4(b))。次に全面露光
を施して未露光のフォトレジスト部102も露光し露光
されたフォトレジスト部112となし(図4(c))、
現像すると変質した部分のフォトレジスト122だけが
残り、このときフォトレジストは逆テーパ状になるか、
フォトレジスト表面に庇が形成される(図5)。
【0004】
【発明が解決しようとする課題】上記において、庇の大
きさは主として最初の露光の条件によって決定される。
イメージリバース法では、通常のパターニングでの適正
露光量よりも少ない露光条件で行う。このとき露光量が
少ないほど庇の大きさが大きくなり、通常の使い方での
適正露光量、ないしそれ以上の露光量では庇は出来なく
なる。フォトレジスト膜の厚さが薄い場合は、電極金属
の蒸着のときのフォトレジスト膜の庇の下への潜り込み
は庇の大きさがある程度あればほぼ同じになる。しかし
フォトレジストの膜厚が厚い場合には、電極金属層のフ
ォトレジストの庇の下への潜り込みも大きくなる。従っ
て電極の大きさが庇の大きさで異なって、安定した電極
の大きさを維持できなくなるという問題があった。フォ
トレジストパターンの形成条件を一定にしても、フォト
レジストの製造ロットの違い、またフォトレジストパタ
ーンの形成条件のわずかなばらつきによっても、庇の大
きさが違ってくるためである。
【0005】本発明は上記電極形成のためのフォトレジ
ストパターンの形成にあたり、電極の大きさを安定させ
るために一定の庇部をフォトレジストパターンに形成す
ることを目的とする。
【0006】
【課題を解決するための手段】本発明に係るフォトレジ
ストパターンの形成方法は、回路が形成された基板上に
ポジタイプのフォトレジスト膜を形成する工程、電極形
成予定域を除く領域に適正露光量よりも少ない露光量で
露光を施す工程、前記露光領域よりも一回り小さい領域
に適正露光量以上の露光量の露光を施す工程、前記露光
を施した部位のフォトレジスト膜をアンモニアまたはア
ミン系化合物を含む雰囲気中で、または単にベーキング
を施し現像液に不溶にする工程、全面に露光を施して現
像する工程を含み、前記フォトレジスト膜を逆テーパ、
あるいは表面に庇を有する形状のパターンに形成する。
【0007】
【作用】本発明によるフォトレジストパターンの形成方
法では、適正露光量以上で露光した部分と、適正露光量
より少ない露光量で露光した部分のパターンの差が庇の
大きさになる。従ってフォトレジストの製造ロットの違
いによる適正露光量の差異や、フォトレジストパターン
形成の条件のばらつきに影響されることなく、いつも一
定の庇の大きさを有するフォトレジストパターンが形成
される。
【0008】
【実施例】以下、本発明の実施例につき図1ないし図3
を参照して説明する。
【0009】回路が形成された基板11の上にポジタイ
プのフォトレジスト膜12を形成した後、まず電極を形
成する領域(電極形成予定域)以外の部分を第一のフォ
トマスク13を通して所定の部分を露光する(図1
(a))。このときのマスクの露光させない部分の大き
さ13aはフォトレジストの開口径の大きさであり、ま
た露光量は通常のポジタイプのフォトレジストとして使
用するときの適正露光量(露光量Tとする)よりも少な
くする。図中の22は露光量Tより少ない露光が施され
た第一のフォトレジスト露光域である。
【0010】次に最初のパターンよりも一回り露光領域
が狭い第二のフォトマスク14を用い、露光量T以上の
露光を施して前記フォトレジスト露光域22の一部を第
二のフォトレジスト露光域32に形成する(図1
(b))。
【0011】次いでアンモニア雰囲気中でベーキングを
施すと、既に露光を施したフォトレジスト露光域が変質
し、現像液に不溶のフォトレジスト露光域52になる
(図1(c))。
【0012】次に全面を露光し、現像すると変質したフ
ォトレジスト52以外のフォトレジスト膜12、および
フォトレジスト膜42の庇部を除く部分が除去され、庇
を有する、あるいは逆テーパ状のフォトレジストパター
ンが得られる(図2)。次にこのときのフォトレジスト
膜のプロファイルを図3によって更に詳しく説明する。
【0013】イメージリバース法で現像の条件等、他の
条件を一定として、最初の露光条件を変えたとき、フォ
トレジストのプロファイルは次の様になる。第一のマス
クで露光量が少ないときはAで示すプロファイルにな
り、露光量が増加するに従ってB、Cとなり、露光量T
以上では、ほぼ垂直なプロファイルDになる。次に第一
のマスクよりも露光部分が一回り小さい第二のマスクを
通し、露光量T以上で露光すると、その結果得られるプ
ロファイルはEで示すようになる。従って2回の露光の
結果により得られるフォトレジストのプロファイルは、
A、BあるいはCと、Eとを合わせたものになる。庇の
形状は1回目の露光量によって異なるが、庇の大きさは
マスクの寸法の差、即ち{(14aの幅)−(13a
幅)}/2となるので常に一定になる。第一の露光と第
二の露光でのマスク合わせのずれが懸念されるが、現在
は合わせ精度を0.1μm以下に出来るので問題となら
ない。
【0014】以上述べたように、本発明によればイメー
ジリバース法で逆テーパ状、あるいはフォトレジスト膜
表面に庇を有するフォトレジストパターンを形成する際
に、庇の大きさを常に一定に出来る。従ってその後、全
面に蒸着等で電極金属層を形成し、リフトオフによって
所定部分にだけ電極を形成したときに、常に一定の大き
さの電極が得られる。
【0015】上記説明では露光の順序は第一のマスク1
3から第二のマスク14の順に行っていたが、逆に第二
のマスク14から第一のマスク13の順に露光しても全
く同じ結果が得られた。
【0016】また上記説明では通常のフォトレジストを
用い、パターン露光の後にアンモニア雰囲気中でベーキ
ングして露光部分のフォトレジストを変質させて現像液
に不溶化したが、単にベーキングを施すだけで露光部分
を変質させ、現像液に不溶化するフォトレジストを用い
た場合でも同様の結果が得られる。
【0017】
【発明の効果】本発明によればフォトレジストパターン
の形成において、適正露光量以上で露光した部分と、適
正露光量より少ない露光量で露光した部分のパターンの
差が庇の大きさになる。従ってフォトレジストの製造ロ
ットの違いによる適正露光量の差異や、フォトレジスト
パターン形成の条件のばらつきに影響されることなく、
いつも一定の庇の大きさを有するフォトレジストパター
ンが形成される。
【図面の簡単な説明】
【図1】(a)〜(c)は本発明の実施例に係るフォト
レジストパターンの形成方法の一部を工程順に示すいず
れも断面図。
【図2】本発明の実施例に係るフォトレジストパターン
の形成方法の一部を示す断面図。
【図3】本発明を説明するための断面図。
【図4】(a)〜(c)は従来のイメージリバース法に
よるフォトレジストパターンの形成方法の一部を工程順
に示すいずれも断面図。
【図5】従来のイメージリバース法によるフォトレジス
トパターンの形成方法の一部を示す断面図。
【符号の説明】
1、11 (回路が形成された)基板 2、12 ポジタイプのフォトレジスト膜 22、32 露光したフォトレジスト域 42、52 変質したフォトレジスト域 13、14 マスク

Claims (1)

    【特許請求の範囲】
  1. 【請求項1】 回路が形成された基板上にポジタイプの
    フォトレジスト膜を形成する工程、電極形成予定域を除
    く領域に適正露光量よりも少ない露光量で露光を施す工
    程、前記露光領域よりも一回り小さい領域に適正露光量
    以上の露光量の露光を施す工程、前記露光を施した部位
    のフォトレジスト膜をアンモニアまたはアミン系化合物
    を含む雰囲気中で、または単にベーキングを施し現像液
    に不溶にする工程、全面に露光を施して現像する工程を
    含み、前記フォトレジスト膜を逆テーパ、あるいは表面
    に庇を有する形状のパターンに形成するフォトレジスト
    パターンの形成方法。
JP4225406A 1992-08-25 1992-08-25 フォトレジストパターンの形成方法 Pending JPH0677106A (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US6962770B2 (en) * 2000-09-14 2005-11-08 Canon Kabushiki Kaisha Method of manufacturing an electroconductive film, and an apparatus including it
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JP2019145706A (ja) * 2018-02-22 2019-08-29 日亜化学工業株式会社 半導体素子の製造方法

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