JPH07193022A - 半導体装置の製造方法 - Google Patents

半導体装置の製造方法

Info

Publication number
JPH07193022A
JPH07193022A JP5348275A JP34827593A JPH07193022A JP H07193022 A JPH07193022 A JP H07193022A JP 5348275 A JP5348275 A JP 5348275A JP 34827593 A JP34827593 A JP 34827593A JP H07193022 A JPH07193022 A JP H07193022A
Authority
JP
Japan
Prior art keywords
impurity diffusion
film
semiconductor substrate
impurity
type
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP5348275A
Other languages
English (en)
Inventor
Yuichi Yamamoto
裕一 山本
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP5348275A priority Critical patent/JPH07193022A/ja
Publication of JPH07193022A publication Critical patent/JPH07193022A/ja
Pending legal-status Critical Current

Links

Landscapes

  • Bipolar Transistors (AREA)
  • Insulated Gate Type Field-Effect Transistor (AREA)

Abstract

(57)【要約】 【目的】 半導体基板に不純物拡散層を形成する際に生
じ易い、ロゼットと称する不要な拡散層の発生をを防止
し、かつ重なり状態の不純物拡散層の形成を少ない工程
数で形成することを可能にする。 【構成】 半導体基板1の表面上に第1の不純物を含む
第1の不純物拡散膜2を選択的に形成し、その上に第2
の不純物を含む第2の不純物拡散膜5を選択的に形成
し、かつ熱処理により第1および第2の各不純物拡散膜
2,5からそれぞれ不純物を半導体基板1に拡散させ、
重なり状の不純物拡散層6,7を形成する。シリコン酸
化膜等をマスクにした選択拡散法ではないため、ロゼッ
トの発生が防止される。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は半導体装置の製造方法に
関し、特に半導体基板に重なり状態の不純物拡散層を形
成する方法に関する。
【0002】
【従来の技術】従来、半導体基板に不純物拡散層を形成
する方法の一つとして、不純物拡散源として不純物を含
む膜を半導体基板の表面に形成し、熱処理により不純物
拡散源から半導体基板に不純物を拡散させる方法が提案
されている。図3はその一例を示しており、PNPトラ
ンジスタの各拡散層を形成する例を工程順に示してい
る。先ず、図3(a)のように、P型半導体基板21の
表面にシリコン酸化膜22を形成し、このシリコン酸化
膜22にはベース形成領域に窓を開口する。そして、図
3(b)のように、全面にN型不純物として砒素を含む
ガラス(SOG)からなるN型不純物拡散膜23を塗布
形成する。次いで、図3(c)のように熱処理を行うこ
とで、N型不純物拡散膜23から砒素を半導体基板21
に拡散させ、N型ベース領域24を形成する。
【0003】次いで、図3(d)のように、前記N型不
純物拡散膜23およびシリコン酸化膜22を除去した
後、改めてシリコン酸化膜25を形成し、今度はエミッ
タ領域とコレクタコンタクト領域の各形成領域に窓を開
口する。そして、全面にP型不純物としてボロンを含む
ガラスからなるP型不純物拡散膜26を塗布形成する。
次いで、熱処理を行うことで、P型不純物拡散膜26か
らボロンを半導体基板21およびベース領域24に拡散
させ、N型コレクタコンタクト領域27とN型エミッタ
領域28を形成する。
【0004】
【発明が解決しようとする課題】このような従来の不純
物拡散層の形成方法では、半導体基板21に対する選択
拡散を行う際にシリコン酸化膜22,25をマスクとし
ているため、シリコン酸化膜の融点降下により、例えば
図3(c)に示すように、半導体基板21の一部にロゼ
ットと称される好ましくない不純物拡散層29が発生す
ることがある。このような不純物拡散層29が前記した
PNPトランジスタの一部に発生すると、接合耐圧が劣
化される等、トランジスタの特性が損なわれることがあ
る。
【0005】また、従来の形成方法でPNPトランジス
タを形成する場合には、N型不純物拡散層とN型不純物
拡散層をそれぞれ個別に半導体基板に拡散させて形成し
ているため、熱処理がその都度必要となり、工程数が増
加される原因になるとともに、後工程の熱処理が前工程
で形成した不純物拡散層に影響を与えて所要の不純物拡
散層を得ることが難しくなるという問題もある。
【0006】この場合、特開平1−173755号公報
で提案されているように、不純物を含むSOGを半導体
基板上に直接形成し、熱処理によりこれらのSOGから
不純物を半導体基板に拡散させることで複数の不純物拡
散層を形成する方法を利用することが考えられるが、こ
の方法ではベース及びエミッタのように拡散層が重なり
状態に形成される構成を形成することはできず、これを
そのまま採用することは困難である。本発明の目的は、
ロゼットを防止するとともに、重なり状態の不純物拡散
層の形成を少ない工程数で形成することを可能にした半
導体装置の製造方法を提供することにある。
【0007】
【課題を解決するための手段】本発明は、半導体基板の
表面上に第1の不純物を含む第1の不純物拡散膜を選択
的に形成する工程と、第1の不純物拡散膜の上に第2の
不純物を含む第2の不純物拡散膜を選択的に形成する工
程と、熱処理により第1および第2の各不純物拡散膜か
らそれぞれ第1および第2の不純物を半導体基板に拡散
させる工程とを含んでいる。この場合、第1の不純物拡
散膜の表面に酸化膜を形成し、この酸化膜上に第2の不
純物拡散膜を形成してもよい。また、第1の不純物の導
電型と第2の不純物の導電型が異なり、或いは第1の不
純物の導電型と第2の不純物の導電型が同じで濃度が異
なる場合に適用できる。
【0008】
【実施例】次に、本発明について図面を参照して説明す
る。図1は本発明をPNPトランジスタにおける不純物
拡散層を形成する工程に適用した実施例を工程順に示す
断面図である。先ず、図1(a)のように、P型半導体
基板1の全面にN型不純物拡散膜としてN型不純物の砒
素を含むガラス(SOG)2を塗布形成する。そして、
N型ベース形成領域をフォトレジスト3でマスクした上
で、フォトリソグラフィ技術により前記N型不純物拡散
膜2を選択エッチングし、図1(b)のように、前記半
導体基板上のN型ベース形成領域にのみN型不純物拡散
膜2を形成する。
【0009】次いで、図1(c)のように、N型不純物
拡散膜2の表面上に化学的気相成長法により、例えば5
0nm程度の厚さにシリコン酸化膜4を形成する。この
シリコン酸化膜4の形成は、シリコン酸化膜を半導体基
板1の全面に形成した後に、前記したN型不純物拡散膜
2を形成する際に用いたフォトリソグラフィ技術のマス
クをそのまま利用して選択エッチングにより形成しても
よく、あるいは選択気相成長法によってN型不純物拡散
膜2の上面のみに形成することも可能である。
【0010】次いで、図1(d)のように、今度は全面
にP型不純物のボロンを含むガラスからなるP型不純物
拡散膜5を塗布形成し、前記と同様にフォトレジストを
マスクにした選択エッチングにより、エミッタ形成領域
である前記N型不純物拡散膜2上のシリコン酸化膜4の
上と、コレクタコンタクト形成領域の半導体基板1の表
面上にP型不純物拡散膜5を選択的に形成する。
【0011】しかる上で、例えば1250℃、2時間の
熱処理を実行することで、図1(e)のように、N型不
純物拡散膜2から砒素が半導体基板1に拡散されてベー
ス領域としてのN型不純物拡散層6が形成され、またP
型不純物拡散膜5からボロンが半導体基板1に拡散され
てエミッタ領域およびコレクタコンタクト領域としての
P型不純物拡散層7がそれぞれ形成される。
【0012】なお、このとき、一部のP型不純物拡散膜
5の表面上にはシリコン酸化膜4が形成されており、P
型不純物拡散膜5のボロンはこのシリコン酸化膜4とN
型不純物拡散膜2を通して半導体基板1に拡散されるた
め、シリコン酸化膜4の膜厚を適宜に設定しておくこと
で、ボロンが砒素よりも深く拡散されることが回避され
る。これを利用すれば、逆に砒素とボロンとの拡散が近
くなるようにシリコン酸化膜4の膜厚を設定しておけ
ば、ベース領域の薄いトランジスタを形成することが可
能となる。
【0013】この形成方法によれば、シリコン酸化膜を
マスクにした不純物拡散を行っていないため、従来のよ
うなロゼットにより不要部分に拡散層が形成されること
がない。したがって、PNPトランジスタの接合耐圧の
劣化等の問題が生じることはない。また、N型ベース領
域とP型エミッタ領域を1回の熱処理により形成してい
るため、工程数を削減でき、かつ前工程で形成した拡散
層に悪影響を与えることもない。
【0014】図2は本発明の第2実施例の工程の要部を
説明するための図であり、ここではLDD構造のMOS
トランジスタを形成した例を示している。先ず、図2
(a)のように、P型半導体基板11にゲート酸化膜1
2とゲート電極13を形成した後、ソース・ドレイン形
成領域にリンを低濃度に含むN型低濃度不純物拡散膜1
4を選択的に形成する。また、これらのN型不純物拡散
膜14の表面に薄くシリコン酸化膜15を形成した上
で、N型低濃度不純物拡散膜14よりも狭い領域に砒素
を高濃度に含むN型高濃度不純物拡散膜16を形成す
る。
【0015】しかる上で、熱処理を行うことにより、図
2(b)のように、N型低濃度不純物拡散膜からリンが
半導体基板11に拡散され、低濃度のLDDソース・ド
レイン領域17が形成される。また、これと同時にN型
高濃度不純物拡散膜16から砒素が半導体基板11に拡
散され、高濃度のソース・ドレイン領域17が形成され
る。したがって、このMOSトランジスタにおけるLD
D構造のソース・ドレイン領域を形成する場合でも、ロ
ゼットの発生を未然に防止でき、かつ1回の熱処理によ
りLDD構造を形成することができ、工程の簡略化が実
現できる。
【0016】なお、前記各実施例は本発明の一例を示し
たものであり、半導体素子を構成する種々の不純物拡散
層、特に異なる濃度や異なる導電型の不純物が重なり状
態に形成される構造の不純物拡散層の形成に採用でき
る。また、この場合、第1の不純物拡散膜の上面にシリ
コン酸化膜を形成することなく第2の不純物拡散膜を形
成し、これらを熱処理して拡散させるようにしてもよ
い。
【0017】
【発明の効果】以上説明したように本発明は、半導体基
板の表面上に第1の不純物を含む第1の不純物拡散膜を
選択的に形成し、この上に第2の不純物を含む第2の不
純物拡散膜を選択的に形成し、熱処理により各不純物拡
散膜からそれぞれ不純物を半導体基板に拡散させるの
で、重なり状態の不純物拡散層を一度の熱処理で形成す
ることができる。また、シリコン酸化膜をマクスとした
選択拡散法ではないため、不要な拡散層としてのロゼッ
トを防止することができる効果がある。また、第1の不
純物拡散膜の表面に酸化膜を形成し、この酸化膜上に第
2の不純物拡散膜を形成することで、酸化膜の厚さを調
整すれば各不純物拡散層の重なり状態を任意に制御し、
所望の不純物濃度分布の拡散層を形成することができる
効果もある。
【図面の簡単な説明】
【図1】本発明の第1実施例を製造工程順に示す断面図
である。
【図2】本発明の第2実施例の製造工程の要部を示す断
面図である。
【図3】従来の製造方法の一例を工程順に示す断面図で
ある。
【符号の説明】
1 半導体基板 2 N型不純物拡散膜 4 シリコン酸化膜 5 P型不純物拡散膜 6 N型拡散層 7 P型拡散層
フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 FI 技術表示箇所 H01L 29/78 21/336

Claims (5)

    【特許請求の範囲】
  1. 【請求項1】 半導体基板の表面上に第1の不純物を含
    む第1の不純物拡散膜を選択的に形成する工程と、前記
    第1の不純物拡散膜の上に第2の不純物を含む第2の不
    純物拡散膜を選択的に形成する工程と、熱処理により前
    記第1および第2の各不純物拡散膜からそれぞれ第1お
    よび第2の不純物を前記半導体基板に拡散させる工程と
    を含むことを特徴とする半導体装置の製造方法。
  2. 【請求項2】 第1の不純物拡散膜の表面に酸化膜を形
    成し、この酸化膜上に第2の不純物拡散膜を形成してな
    る請求項1の半導体装置の製造方法。
  3. 【請求項3】 第1の不純物の導電型と第2の不純物の
    導電型が異なる請求項1または2の半導体装置の製造方
    法。
  4. 【請求項4】 第1の不純物の導電型と第2の不純物の
    導電型が同じで、かつそれぞれの不純物濃度が異なる請
    求項1または2の半導体装置の製造方法。
  5. 【請求項5】 酸化膜の膜厚を第1および第2の各不純
    物の拡散速度に応じて設定してなる請求項2ないし4の
    いずれかの半導体装置の製造方法。
JP5348275A 1993-12-24 1993-12-24 半導体装置の製造方法 Pending JPH07193022A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP5348275A JPH07193022A (ja) 1993-12-24 1993-12-24 半導体装置の製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP5348275A JPH07193022A (ja) 1993-12-24 1993-12-24 半導体装置の製造方法

Publications (1)

Publication Number Publication Date
JPH07193022A true JPH07193022A (ja) 1995-07-28

Family

ID=18395945

Family Applications (1)

Application Number Title Priority Date Filing Date
JP5348275A Pending JPH07193022A (ja) 1993-12-24 1993-12-24 半導体装置の製造方法

Country Status (1)

Country Link
JP (1) JPH07193022A (ja)

Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS497626A (ja) * 1972-05-23 1974-01-23
JPS5923515A (ja) * 1982-07-29 1984-02-07 Matsushita Electronics Corp 不純物拡散方法
JPS59117217A (ja) * 1982-12-24 1984-07-06 Oki Electric Ind Co Ltd 半導体素子の製造方法

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS497626A (ja) * 1972-05-23 1974-01-23
JPS5923515A (ja) * 1982-07-29 1984-02-07 Matsushita Electronics Corp 不純物拡散方法
JPS59117217A (ja) * 1982-12-24 1984-07-06 Oki Electric Ind Co Ltd 半導体素子の製造方法

Similar Documents

Publication Publication Date Title
JPH05347383A (ja) 集積回路の製法
US6020231A (en) Method for forming LDD CMOS
JPS5922380B2 (ja) ハンドウタイソシノ セイゾウホウホウ
JPH07193018A (ja) 高耐圧半導体素子の製造方法
US3981072A (en) Bipolar transistor construction method
JPS60211877A (ja) 半導体装置の製造方法
JP3388590B2 (ja) ダイオード又はショットキークランプトランジスタを製造する方法
US7018778B1 (en) Single polisilicon emitter bipolar junction transistor processing technique using cumulative photo resist application and patterning
JPH07193022A (ja) 半導体装置の製造方法
JPS6142914A (ja) 半導体装置の製造方法
JP3167362B2 (ja) バイポーラ型mos半導体装置の製造方法
JPH0831601B2 (ja) 半導体装置の製造方法
US3969165A (en) Simplified method of transistor manufacture
JPH07131028A (ja) 薄膜トランジスタの製造方法
JP2666565B2 (ja) 半導体装置の製造方法
KR960035912A (ko) 반도체 소자의 트랜지스터 제조방법
JP3312040B2 (ja) 半導体装置の製法
KR0146079B1 (ko) 반도체 소자 제조방법
JP2722829B2 (ja) 半導体装置の製造方法
JPS6097662A (ja) 半導体装置の製造方法
KR850000037B1 (ko) 셀프얼라인 금속전극 복합 mos의 제조방법
KR100218372B1 (ko) 반도체소자의 듀얼게이트 제조방법
JPS6331097B2 (ja)
JPH09134971A (ja) Soi上の多数のマイクロ電子回路の製造方法
US20060160030A1 (en) Single polisilicon emitter bipolar junction transistor processing technique using cumulative photo resist application and patterning