JPH0727696Y2 - ピ−ク検出回路 - Google Patents
ピ−ク検出回路Info
- Publication number
- JPH0727696Y2 JPH0727696Y2 JP1987121051U JP12105187U JPH0727696Y2 JP H0727696 Y2 JPH0727696 Y2 JP H0727696Y2 JP 1987121051 U JP1987121051 U JP 1987121051U JP 12105187 U JP12105187 U JP 12105187U JP H0727696 Y2 JPH0727696 Y2 JP H0727696Y2
- Authority
- JP
- Japan
- Prior art keywords
- differential amplifier
- peak detection
- signal
- voltage
- circuit
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Lifetime
Links
- 238000001514 detection method Methods 0.000 title claims description 15
- 238000010586 diagram Methods 0.000 description 10
- 239000003990 capacitor Substances 0.000 description 7
- 230000000694 effects Effects 0.000 description 3
- 230000005415 magnetization Effects 0.000 description 2
- 230000004069 differentiation Effects 0.000 description 1
Landscapes
- Signal Processing For Digital Recording And Reproducing (AREA)
- Manipulation Of Pulses (AREA)
Description
【考案の詳細な説明】 〔産業上の利用分野〕 本考案はアナログ信号のピーク点に対応したディジタル
パルス信号を出力するピーク検出回路に関する。
パルス信号を出力するピーク検出回路に関する。
フロッピーディスク装置等の磁気記憶装置において、磁
化反転として記録されたデータを再生する場合、ヘッド
により読出さたアナログ信号のピーク点、即ち、微分後
の信号のゼロクロス点が磁化反転、即ち、データに対応
する。
化反転として記録されたデータを再生する場合、ヘッド
により読出さたアナログ信号のピーク点、即ち、微分後
の信号のゼロクロス点が磁化反転、即ち、データに対応
する。
従来、読出し信号からデータを検出するピーク検出回路
は、第４図に示すように、ヘッドからの読出し差動信号
V1a，V2aを入力とする微分増幅器１と、微分信号のゼロ
クロス点を検出するための電圧比較器４と、回路のダイ
ナミックレンジを確保するための振幅リミッタ用ダイオ
ード3a,3bから構成されている。
は、第４図に示すように、ヘッドからの読出し差動信号
V1a，V2aを入力とする微分増幅器１と、微分信号のゼロ
クロス点を検出するための電圧比較器４と、回路のダイ
ナミックレンジを確保するための振幅リミッタ用ダイオ
ード3a,3bから構成されている。
第５図は第４図の各部の信号波形図である。V1a，V2aが
微分増幅器１に入力されると、V3a，V3bの微分された信
号が出力される。なお、破線で示す波形は振幅リミッタ
用ダイオード3a,3bが無い場合の信号波形である。この
時、微分増幅器１の出力信号に直流電圧の不平衡部分、
即ち、オフセット電圧Vof0があると、電圧比較器４の出
力信号V4は真のピーク点からTER0だけの誤差を生じるこ
とになる。
微分増幅器１に入力されると、V3a，V3bの微分された信
号が出力される。なお、破線で示す波形は振幅リミッタ
用ダイオード3a,3bが無い場合の信号波形である。この
時、微分増幅器１の出力信号に直流電圧の不平衡部分、
即ち、オフセット電圧Vof0があると、電圧比較器４の出
力信号V4は真のピーク点からTER0だけの誤差を生じるこ
とになる。
第６図の回路は第４図の回路の欠点を改善するためにコ
ンデンサ2a,2bを挿入したものであり、これにより、微
分増幅器１の出力オフセット電圧Vof0による誤差TER0を
軽減するようにしたものである。
ンデンサ2a,2bを挿入したものであり、これにより、微
分増幅器１の出力オフセット電圧Vof0による誤差TER0を
軽減するようにしたものである。
第７図は第６図の回路の各部の信号波形図である。
V2a，V2bはオフセット電圧Vof0の影響によりダイオード
3a,3bにより振幅リミットされた波形が正側、負側で非
対称となり、コンデンサ2a,2bにより直流電圧分のカッ
トされた信号波形V3a，V3bには依然としてVof1のオフセ
ット電圧が残ることになり、電圧比較器４の出力信号V4
にも誤差TER1が残る。
V2a，V2bはオフセット電圧Vof0の影響によりダイオード
3a,3bにより振幅リミットされた波形が正側、負側で非
対称となり、コンデンサ2a,2bにより直流電圧分のカッ
トされた信号波形V3a，V3bには依然としてVof1のオフセ
ット電圧が残ることになり、電圧比較器４の出力信号V4
にも誤差TER1が残る。
上述した従来のピーク回路は、微分増幅器のオフセット
電圧が生ずる限りピーク検出信号に必ず誤差を生ずると
いう欠点がある。
電圧が生ずる限りピーク検出信号に必ず誤差を生ずると
いう欠点がある。
本考案のピーク検出回路は、差動アナログ信号を入力と
する微分増幅器と、微分増幅器の両出力信号の直流電圧
成分を除去するハイパスフィルタと、ハイパスフィルタ
の出力に接続された振幅制限回路と、振幅制限回路の両
出力信号を比較する電圧比較器とを有している。
する微分増幅器と、微分増幅器の両出力信号の直流電圧
成分を除去するハイパスフィルタと、ハイパスフィルタ
の出力に接続された振幅制限回路と、振幅制限回路の両
出力信号を比較する電圧比較器とを有している。
微分増幅器の直後にハイパスフィルタを設けることによ
り、従来のピーク検出回路では完全に除去することがで
きない、微分増幅器の出力オフセット電圧に起因するピ
ーク検出信号の誤差を皆無とすることが可能となる。
り、従来のピーク検出回路では完全に除去することがで
きない、微分増幅器の出力オフセット電圧に起因するピ
ーク検出信号の誤差を皆無とすることが可能となる。
次に、本考案の実施例について図面を参照して説明す
る。
る。
第１図は本考案のピーク検出回路の一実施例のブロック
図である。
図である。
微分増幅器１は、差動アナログ信号V1a，V2aを入力とし
ている。コンデンサ2a,2bは微分増幅器１の出力信号
V2a，V2bの直流電圧成分を除去するためのコンデンサで
ある。ダイオード3a,3bは回路のダイナミックレンジを
確保するための振幅制限回路としてのダイオードであ
る。電圧比較器４は微分された信号をデジタルパルス信
号に変換し、ピーク検出信号V4として出力すする。
ている。コンデンサ2a,2bは微分増幅器１の出力信号
V2a，V2bの直流電圧成分を除去するためのコンデンサで
ある。ダイオード3a,3bは回路のダイナミックレンジを
確保するための振幅制限回路としてのダイオードであ
る。電圧比較器４は微分された信号をデジタルパルス信
号に変換し、ピーク検出信号V4として出力すする。
第２図は第１図に示すピーク検出回路の各部の信号波形
図である。差動アナログ信号V1a，V2aが入力されると、
微分された信号V2a，V2bが微分増幅器１より出力され
る。なお、破線で示す信号波形はダイオード3a,3bによ
りクリップされない場合の波形である。V3a，V3bはコン
デンサ2a,2bにより、微分増幅器１の出力直流電圧を除
去した波形であり、前記直流電圧のオフセット電圧Vof
が完全に除去されている。したがって、電圧比較器４の
出力信号であるピーク検出信号V4は微分増幅器１のオフ
セット電圧Vofに起因する誤差は皆無となる。
図である。差動アナログ信号V1a，V2aが入力されると、
微分された信号V2a，V2bが微分増幅器１より出力され
る。なお、破線で示す信号波形はダイオード3a,3bによ
りクリップされない場合の波形である。V3a，V3bはコン
デンサ2a,2bにより、微分増幅器１の出力直流電圧を除
去した波形であり、前記直流電圧のオフセット電圧Vof
が完全に除去されている。したがって、電圧比較器４の
出力信号であるピーク検出信号V4は微分増幅器１のオフ
セット電圧Vofに起因する誤差は皆無となる。
第３図は本考案のピーク検出回路の具体的な回路例であ
る。微分増幅器１はトランジスタQ1a，Q1b、抵抗R1a，R
1b，R1c、コンデンサC1および定電流源I1a，I1bにより
構成されており、電圧比較器４はトランジスタQ3a，
Q3b，Q4a，Q4bおよび定電流源I2により構成されてい
る。なお、抵抗R2a，R2b，R2c，R2d，R2eおよびトラン
ジスタQ2は電圧比較器４の入力バイアス電圧を与えるた
めのものである。
る。微分増幅器１はトランジスタQ1a，Q1b、抵抗R1a，R
1b，R1c、コンデンサC1および定電流源I1a，I1bにより
構成されており、電圧比較器４はトランジスタQ3a，
Q3b，Q4a，Q4bおよび定電流源I2により構成されてい
る。なお、抵抗R2a，R2b，R2c，R2d，R2eおよびトラン
ジスタQ2は電圧比較器４の入力バイアス電圧を与えるた
めのものである。
以上説明したように本考案は、微分増幅器の直後に直流
電圧カット用のハイパスフィルタを設けることにより、
微分増幅器の出力オフセット電圧に起因するピーク検出
信号の誤差を完全に除去することができる効果がある。
電圧カット用のハイパスフィルタを設けることにより、
微分増幅器の出力オフセット電圧に起因するピーク検出
信号の誤差を完全に除去することができる効果がある。
第１図は本考案のピーク検出回路の一実施例の回路図、
第２図は第１図の各部信号の波形図、第３図は本考案の
ピーク検出回路の具体例の回路図、第４図は従来例の回
路図、第５図は第４図の各部信号の波形図、第６図は他
の従来例の回路図、第７図は第６図の各部信号の波形図
である。 １……微分増幅器、2a,2b……直流電圧成分カット用コ
ンデンサ、3a,3b……振幅制限用ダイオード、４……電
圧比較器。
第２図は第１図の各部信号の波形図、第３図は本考案の
ピーク検出回路の具体例の回路図、第４図は従来例の回
路図、第５図は第４図の各部信号の波形図、第６図は他
の従来例の回路図、第７図は第６図の各部信号の波形図
である。 １……微分増幅器、2a,2b……直流電圧成分カット用コ
ンデンサ、3a,3b……振幅制限用ダイオード、４……電
圧比較器。
Claims (1)
- 【請求項１】差動アナログ信号を入力とする微分増幅器
と、微分増幅器の両出力信号の直流電圧成分を除去する
ハイパスフィルタと、ハイパスフィルタの出力に接続さ
れた振幅制限回路と、振幅制限回路の両出力信号を比較
する電圧比較器とを有するピーク検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1987121051U JPH0727696Y2 (ja) | 1987-08-07 | 1987-08-07 | ピ−ク検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1987121051U JPH0727696Y2 (ja) | 1987-08-07 | 1987-08-07 | ピ−ク検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6428026U JPS6428026U (ja) | 1989-02-17 |
| JPH0727696Y2 true JPH0727696Y2 (ja) | 1995-06-21 |
Family
ID=31367710
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1987121051U Expired - Lifetime JPH0727696Y2 (ja) | 1987-08-07 | 1987-08-07 | ピ−ク検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0727696Y2 (ja) |
Family Cites Families (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61253608A (ja) * | 1985-05-01 | 1986-11-11 | Fujitsu Ltd | 磁気デイスク装置の読出し回路 |
| JPH0783244B2 (ja) * | 1986-01-13 | 1995-09-06 | 富士通株式会社 | パルス化回路 |
-
1987
- 1987-08-07 JP JP1987121051U patent/JPH0727696Y2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6428026U (ja) | 1989-02-17 |
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