JPH0730762A - 通信装置 - Google Patents
通信装置Info
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- JPH0730762A JPH0730762A JP15490493A JP15490493A JPH0730762A JP H0730762 A JPH0730762 A JP H0730762A JP 15490493 A JP15490493 A JP 15490493A JP 15490493 A JP15490493 A JP 15490493A JP H0730762 A JPH0730762 A JP H0730762A
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- Compression, Expansion, Code Conversion, And Decoders (AREA)
- Image Processing (AREA)
- Compression Or Coding Systems Of Tv Signals (AREA)
Abstract
(57)【要約】
【目的】白色画素にて構成される画像部分の符号化処理
速度を速めて、ＪＰＥＧ符号化の処理速度の高速化を図
る。 【構成】ステップＳ２２で、画像データの主走査方向の
８列分の画素が全白の場合、あらかじめＲＯＭ３内に記
憶させておいた、主走査方向８列分の画素が全白の場合
にＤＣＴ演算を実行した結果の値をメモリ蓄積する。Ｊ
ＰＥＧ符号化の単位である８＊８画素が全白ならば、ス
テップＳ２６で、この８＊８画素の直前の８＊８画素も
全白であったかどうかをチェックする。そして、これら
８＊８画素が全白だった場合、あらかじめＲＯＭ３に記
憶させておいた値をメモリ蓄積し、ステップＳ２９で、
制御パラメータである主走査ポインタの値を進める。
速度を速めて、ＪＰＥＧ符号化の処理速度の高速化を図
る。 【構成】ステップＳ２２で、画像データの主走査方向の
８列分の画素が全白の場合、あらかじめＲＯＭ３内に記
憶させておいた、主走査方向８列分の画素が全白の場合
にＤＣＴ演算を実行した結果の値をメモリ蓄積する。Ｊ
ＰＥＧ符号化の単位である８＊８画素が全白ならば、ス
テップＳ２６で、この８＊８画素の直前の８＊８画素も
全白であったかどうかをチェックする。そして、これら
８＊８画素が全白だった場合、あらかじめＲＯＭ３に記
憶させておいた値をメモリ蓄積し、ステップＳ２９で、
制御パラメータである主走査ポインタの値を進める。
Description
【０００１】
【産業上の利用分野】本発明は、ＤＣＴ演算を使用して
符号化を行なう通信装置に関するものである。
符号化を行なう通信装置に関するものである。
【０００２】
【従来の技術】従来より、ＤＣＴ（離散コサイン変換）
演算を使用した符号化、例えば、ＪＰＥＧ(Joint Photo
graphic Expert Group) を用いる通信装置では、画像を
構成する画素の状況など、画像の状態にかかわらずＤＣ
Ｔ演算を実行し、ＪＰＥＧ符号化している。
演算を使用した符号化、例えば、ＪＰＥＧ(Joint Photo
graphic Expert Group) を用いる通信装置では、画像を
構成する画素の状況など、画像の状態にかかわらずＤＣ
Ｔ演算を実行し、ＪＰＥＧ符号化している。
【０００３】
【発明が解決しようとする課題】しかしながら、上記従
来の通信装置では、画像の状態にかかわらずにＤＣＴ演
算を行なっているので、符号化処理速度の向上が困難に
なるという問題がある。本発明は、上記の課題に鑑みて
成されたもので、その目的は、出現確率が高い白色画素
にて構成される画像部分の符号化処理速度を速めて、Ｊ
ＰＥＧ符号化の処理速度の高速化を図った通信装置を提
供することである。
来の通信装置では、画像の状態にかかわらずにＤＣＴ演
算を行なっているので、符号化処理速度の向上が困難に
なるという問題がある。本発明は、上記の課題に鑑みて
成されたもので、その目的は、出現確率が高い白色画素
にて構成される画像部分の符号化処理速度を速めて、Ｊ
ＰＥＧ符号化の処理速度の高速化を図った通信装置を提
供することである。
【０００４】
【課題を解決するための手段】上記の目的を達成するた
めに、本発明は、画像データに対してＪＰＥＧ符号化／
復号化を行なう通信装置において、前記画像データを構
成する画素ブロックの内の８×８画素ブロックの画素全
てが白色である画素ブロックに対してＤＣＴ演算を施し
て得られる演算値をあらかじめ格納する手段と、現時点
での符号化の対象となる第１の８×８画素ブロックの画
素全てが白色画素であるか否かを判断する第１の判断手
段と、前記符号化の走査方向に関して、前記第１の８×
８画素ブロックの直前に位置する第２の８×８画素ブロ
ックの画素全てが白色画素であるか否かを判断する第２
の判断手段と、前記第１の８×８画素ブロックの画素全
てが白色画素であり、かつ、前記第２の８×８画素ブロ
ックの画素全てが白色画素である場合、該第１の８×８
画素ブロックに対しては、前記演算値を使用して符号化
処理を行なう手段とを備える。
めに、本発明は、画像データに対してＪＰＥＧ符号化／
復号化を行なう通信装置において、前記画像データを構
成する画素ブロックの内の８×８画素ブロックの画素全
てが白色である画素ブロックに対してＤＣＴ演算を施し
て得られる演算値をあらかじめ格納する手段と、現時点
での符号化の対象となる第１の８×８画素ブロックの画
素全てが白色画素であるか否かを判断する第１の判断手
段と、前記符号化の走査方向に関して、前記第１の８×
８画素ブロックの直前に位置する第２の８×８画素ブロ
ックの画素全てが白色画素であるか否かを判断する第２
の判断手段と、前記第１の８×８画素ブロックの画素全
てが白色画素であり、かつ、前記第２の８×８画素ブロ
ックの画素全てが白色画素である場合、該第１の８×８
画素ブロックに対しては、前記演算値を使用して符号化
処理を行なう手段とを備える。
【０００５】
【作用】以上の構成において、ＪＰＥＧ符号化の処理速
度の高速化を図るよう機能する。
度の高速化を図るよう機能する。
【０００６】
【実施例】以下、添付図面を参照して、本発明に係る好
適な実施例を詳細に説明する。図１は、本発明の実施例
に係る通信装置であるファクシミリ装置の構成を示すブ
ロック図である。同図において、符号２は中央制御部
（ＣＰＵ）であり、ＣＰＵ２は、バス３０を介してＲＯ
Ｍ３、及びＲＡＭ４と接続されている。このＲＯＭ３に
は、ＣＰＵ２が動作するためのプログラムが格納され、
ＣＰＵ２は、このプログラムに従って、本装置全体の動
作を制御する。また、ＲＡＭ４は、ＣＰＵ２のワークエ
リアとして使用されるものである。なお、ＣＰＵ２に
は、その動作クロックを発生する水晶発振器１が接続さ
れている。
適な実施例を詳細に説明する。図１は、本発明の実施例
に係る通信装置であるファクシミリ装置の構成を示すブ
ロック図である。同図において、符号２は中央制御部
（ＣＰＵ）であり、ＣＰＵ２は、バス３０を介してＲＯ
Ｍ３、及びＲＡＭ４と接続されている。このＲＯＭ３に
は、ＣＰＵ２が動作するためのプログラムが格納され、
ＣＰＵ２は、このプログラムに従って、本装置全体の動
作を制御する。また、ＲＡＭ４は、ＣＰＵ２のワークエ
リアとして使用されるものである。なお、ＣＰＵ２に
は、その動作クロックを発生する水晶発振器１が接続さ
れている。
【０００７】本ファクシミリ装置における読取り部は、
主にＣＣＤラインセンサ１１にて原稿画像の読取りが行
なわれ、さらに、読取モータ１２を備える。また、画像
記録部は、サーマルヘッドである記録ヘッド１０、記録
モータ１３及びこの記録モータ１３を駆動するモータ駆
動ＩＣ１７にて構成される。そして、本ファクシミリ装
置では、これらの読取り部及び画像記録部にて、受信し
た画像、あるいはコピー画像の記録が行なわれる。
主にＣＣＤラインセンサ１１にて原稿画像の読取りが行
なわれ、さらに、読取モータ１２を備える。また、画像
記録部は、サーマルヘッドである記録ヘッド１０、記録
モータ１３及びこの記録モータ１３を駆動するモータ駆
動ＩＣ１７にて構成される。そして、本ファクシミリ装
置では、これらの読取り部及び画像記録部にて、受信し
た画像、あるいはコピー画像の記録が行なわれる。
【０００８】モデム（MODEM)１４は、画像データ及び制
御手順データの変調／復調を行なうもので、網制御装置
（ＮＣＵ）１５を介して回線２３に接続される。このＮ
ＣＵは、回線２３のループ電流を保持したり、あるい
は、電話機２４との回線交換などを行なう。また、符号
９は、ＪＰＥＧ符号化ＬＳＩであり、後述するＪＰＥＧ
符号化を実行するための複数のＤＳＰが内蔵されてい
る。
御手順データの変調／復調を行なうもので、網制御装置
（ＮＣＵ）１５を介して回線２３に接続される。このＮ
ＣＵは、回線２３のループ電流を保持したり、あるい
は、電話機２４との回線交換などを行なう。また、符号
９は、ＪＰＥＧ符号化ＬＳＩであり、後述するＪＰＥＧ
符号化を実行するための複数のＤＳＰが内蔵されてい
る。
【０００９】図２は、本実施例に係るファクシミリ装置
の通信制御手順を示す概略フローチャートである。同図
において、ファクシミリ装置の電源がオンになると、Ｃ
ＰＵ２は、ステップＳ１でパラメータを初期化し、ステ
ップＳ２，Ｓ４，Ｓ６，Ｓ８では、それぞれ動作モード
としてコピー、送信、受信、そして、ファンクションが
選択されたか否か、つまり、装置に対する起動がかかっ
たどうかの判定をした後、その判定結果に基づいてコピ
ー処理（ステップＳ３）、送信処理（ステップＳ５）、
受信処理（ステップＳ７）、そして、ファンクション処
理（ステップＳ９）を実行する。例えば、ステップＳ４
では、本装置に原稿がセットされ、キー２９を構成する
ワンタッチキー（不図示）が押下されたことを、ＣＰＵ
２がゲートアレー１０を介して検出すると、ステップＳ
５の送信処理へ進む。
の通信制御手順を示す概略フローチャートである。同図
において、ファクシミリ装置の電源がオンになると、Ｃ
ＰＵ２は、ステップＳ１でパラメータを初期化し、ステ
ップＳ２，Ｓ４，Ｓ６，Ｓ８では、それぞれ動作モード
としてコピー、送信、受信、そして、ファンクションが
選択されたか否か、つまり、装置に対する起動がかかっ
たどうかの判定をした後、その判定結果に基づいてコピ
ー処理（ステップＳ３）、送信処理（ステップＳ５）、
受信処理（ステップＳ７）、そして、ファンクション処
理（ステップＳ９）を実行する。例えば、ステップＳ４
では、本装置に原稿がセットされ、キー２９を構成する
ワンタッチキー（不図示）が押下されたことを、ＣＰＵ
２がゲートアレー１０を介して検出すると、ステップＳ
５の送信処理へ進む。
【００１０】図３は、図２に示す通信制御手順における
ステップＳ５に示す送信処理の詳細フローチャートであ
る。同図において、ＣＰＵ２は、ステップＳ１１でパラ
メータの初期化を行ない、ステップＳ１２，Ｓ１３，Ｓ
１４のループで１ページ単位の画像の読取り、画像情報
のメモリ蓄積処理を行ない、１ページ分の処理が終了し
たならば、すなわち、ステップＳ１４での判断がＹＥＳ
であれば、ステップＳ１５でメモリデータのロード、ス
テップＳ１６で符号化及びメモリ蓄積処理を行なう。そ
して、ステップＳ１７で全ページの処理終了をチェック
する。
ステップＳ５に示す送信処理の詳細フローチャートであ
る。同図において、ＣＰＵ２は、ステップＳ１１でパラ
メータの初期化を行ない、ステップＳ１２，Ｓ１３，Ｓ
１４のループで１ページ単位の画像の読取り、画像情報
のメモリ蓄積処理を行ない、１ページ分の処理が終了し
たならば、すなわち、ステップＳ１４での判断がＹＥＳ
であれば、ステップＳ１５でメモリデータのロード、ス
テップＳ１６で符号化及びメモリ蓄積処理を行なう。そ
して、ステップＳ１７で全ページの処理終了をチェック
する。
【００１１】なお、ここでは、ステップＳ１５，Ｓ１６
の処理を通過する度に、１ページ分の画像処理を行な
う。全ページの処理が終了したならばステップＳ１８へ
進み、そこで、ページ単位のメモリ送信処理を行なう。
そして、続くステップＳ１９では、全ページについての
送信終了をチェックし、当該処理が終了したと判断され
ればリターン処理する。
の処理を通過する度に、１ページ分の画像処理を行な
う。全ページの処理が終了したならばステップＳ１８へ
進み、そこで、ページ単位のメモリ送信処理を行なう。
そして、続くステップＳ１９では、全ページについての
送信終了をチェックし、当該処理が終了したと判断され
ればリターン処理する。
【００１２】図４は、図３に示す送信処理手順の内、ス
テップＳ１４のページ処理終了判断の詳細フローチャー
トである。また、図５，図６は、後述する、原稿画像デ
ータのデータ全部が白データ（以下、全白という）であ
るか否かを判断する際の画素群の単位を示す図であり、
各ます目が、ＤＣＴ演算する際の１画素単位に対応す
る。
テップＳ１４のページ処理終了判断の詳細フローチャー
トである。また、図５，図６は、後述する、原稿画像デ
ータのデータ全部が白データ（以下、全白という）であ
るか否かを判断する際の画素群の単位を示す図であり、
各ます目が、ＤＣＴ演算する際の１画素単位に対応す
る。
【００１３】図４のステップＳ２１でパラメータの初期
化を行ない、ステップＳ２２で、画像データの主走査方
向の８列分の画素が、全白か否かを判断する。なお、こ
こでの判断は、図５に示す画素群を単位として行なう。
ステップＳ２２での判断結果がＹＥＳならば、処理をス
テップＳ２３へ進め、そこで、あらかじめＲＯＭ３内に
記憶させておいた、主走査方向８列分の画素が全白の場
合にＤＣＴ演算を実行した結果の値をメモリ蓄積し、続
くステップＳＳ２４で、制御パラメータである副走査ポ
インタの＋８のインクリメントを行なう。
化を行ない、ステップＳ２２で、画像データの主走査方
向の８列分の画素が、全白か否かを判断する。なお、こ
こでの判断は、図５に示す画素群を単位として行なう。
ステップＳ２２での判断結果がＹＥＳならば、処理をス
テップＳ２３へ進め、そこで、あらかじめＲＯＭ３内に
記憶させておいた、主走査方向８列分の画素が全白の場
合にＤＣＴ演算を実行した結果の値をメモリ蓄積し、続
くステップＳＳ２４で、制御パラメータである副走査ポ
インタの＋８のインクリメントを行なう。
【００１４】ステップＳ２５では、ＪＰＥＧ符号化の単
位である８＊８画素が全白か否かをチェックする。その
際、図６に示す画素群を単位として行なう。このチェッ
ク結果がＹＥＳならば、ステップＳ２６で、上記８＊８
画素の直前の８＊８画素（これも、ＪＰＥＧ符号化の単
位）も全白であったかどうかをチェックする。そして、
ステップＳ２６での判断結果がＹＥＳならば、ステップ
Ｓ２７で、８＊８画素が全白だった場合の結果、つま
り、あらかじめＲＯＭ３に記憶させておいた値をメモリ
蓄積し、処理をステップＳ２９へ進める。
位である８＊８画素が全白か否かをチェックする。その
際、図６に示す画素群を単位として行なう。このチェッ
ク結果がＹＥＳならば、ステップＳ２６で、上記８＊８
画素の直前の８＊８画素（これも、ＪＰＥＧ符号化の単
位）も全白であったかどうかをチェックする。そして、
ステップＳ２６での判断結果がＹＥＳならば、ステップ
Ｓ２７で、８＊８画素が全白だった場合の結果、つま
り、あらかじめＲＯＭ３に記憶させておいた値をメモリ
蓄積し、処理をステップＳ２９へ進める。
【００１５】一方、現処理の対象である８＊８画素が全
白ではない場合（ステップＳ２５での判断結果がＮ
Ｏ）、あるいは、それらの画素が全白であっても、その
直前の８＊８画素が全白ではない場合は、ステップＳ２
８で公知のＤＣＴ演算を行ない、ＪＰＥＧ符号化の結果
をメモリ蓄積する。ステップＳ２９では、制御パラメー
タである主走査ポインタの値を進め（＋８のインクリメ
ント）、続くステップＳＳ３０で、１ページ分の処理が
終了したかどうかをチェックする。そして、ここで１ペ
ージ分の処理が終了したと判断されれば、リターン処理
をする。
白ではない場合（ステップＳ２５での判断結果がＮ
Ｏ）、あるいは、それらの画素が全白であっても、その
直前の８＊８画素が全白ではない場合は、ステップＳ２
８で公知のＤＣＴ演算を行ない、ＪＰＥＧ符号化の結果
をメモリ蓄積する。ステップＳ２９では、制御パラメー
タである主走査ポインタの値を進め（＋８のインクリメ
ント）、続くステップＳＳ３０で、１ページ分の処理が
終了したかどうかをチェックする。そして、ここで１ペ
ージ分の処理が終了したと判断されれば、リターン処理
をする。
【００１６】上述のように、ＪＰＥＧでは、原稿画像の
８×８画素ブロックに対してＤＣＴ演算を施して符号化
するが、原稿画像の８×８画素ブロックが全白の場合、
ＤＣＴ演算の結果は既に明白である。しかも、原稿の中
での全白の部分の出現確率は、一般的に非常に高い。従
って、出現確率が非常に高い画像部分、つまり、全白部
分の符号化処理速度を、上述のように処理して速めれ
ば、ＪＰＥＧ符号化の処理速度の高速化が可能となるの
である。
８×８画素ブロックに対してＤＣＴ演算を施して符号化
するが、原稿画像の８×８画素ブロックが全白の場合、
ＤＣＴ演算の結果は既に明白である。しかも、原稿の中
での全白の部分の出現確率は、一般的に非常に高い。従
って、出現確率が非常に高い画像部分、つまり、全白部
分の符号化処理速度を、上述のように処理して速めれ
ば、ＪＰＥＧ符号化の処理速度の高速化が可能となるの
である。
【００１７】図７は、図４に示すステップＳ２５の全白
判断処理の詳細フローチャートである。図７のステップ
Ｓ４１で、パラメータ（ｉ，ｊ．．．）を初期化し、ス
テップＳ４２で、１画素分の画像データ（ｉ，ｊ）をロ
ードする。そして、ステップＳＳ４３で、その画素が白
か否かをチェックする。その結果、画素が白ではないな
らば、ステップＳ４４で、制御パラメータであるNOT-WH
ITE フラグに“１”をセットしてリターン処理をする。
判断処理の詳細フローチャートである。図７のステップ
Ｓ４１で、パラメータ（ｉ，ｊ．．．）を初期化し、ス
テップＳ４２で、１画素分の画像データ（ｉ，ｊ）をロ
ードする。そして、ステップＳＳ４３で、その画素が白
か否かをチェックする。その結果、画素が白ではないな
らば、ステップＳ４４で、制御パラメータであるNOT-WH
ITE フラグに“１”をセットしてリターン処理をする。
【００１８】しかし、ステップＳ４３での判断がＹＥＳ
ならば、ステップＳ４５で、制御パラメータである画素
ポインタ（ｉ）を＋１インクリメントし、処理をステッ
プＳＳ４６へ進める。このステップＳ４６では、上記ス
テップＳ４２，Ｓ４３，Ｓ４５の処理が、計８回行なわ
れたかどうかをチェックし、８回行なわれていないなら
ば、ステップＳ４２へ処理を戻す。
ならば、ステップＳ４５で、制御パラメータである画素
ポインタ（ｉ）を＋１インクリメントし、処理をステッ
プＳＳ４６へ進める。このステップＳ４６では、上記ス
テップＳ４２，Ｓ４３，Ｓ４５の処理が、計８回行なわ
れたかどうかをチェックし、８回行なわれていないなら
ば、ステップＳ４２へ処理を戻す。
【００１９】ステップＳ４６での８回ループ検索の結果
がＹＥＳならば、ステップＳ４７で、制御パラメータで
ある画素ポインタ（ｊ）を＋１インクリメントしてか
ら、ステップＳ４８の処理へ行く。このステップＳ４８
では、上記ステップＳ４２，Ｓ４３，Ｓ４５，Ｓ４６，
Ｓ４７の処理が、８＊８の画素分について行なわれたか
どうかをチェックし、その結果がＮＯならば、処理をス
テップＳ４８からステップＳ４２へ戻す。
がＹＥＳならば、ステップＳ４７で、制御パラメータで
ある画素ポインタ（ｊ）を＋１インクリメントしてか
ら、ステップＳ４８の処理へ行く。このステップＳ４８
では、上記ステップＳ４２，Ｓ４３，Ｓ４５，Ｓ４６，
Ｓ４７の処理が、８＊８の画素分について行なわれたか
どうかをチェックし、その結果がＮＯならば、処理をス
テップＳ４８からステップＳ４２へ戻す。
【００２０】そして、ステップＳ４８での判断結果がＹ
ＥＳならば、ステップＳ４９で、制御パラメータである
ALL-WHITE フラグに“１”をセットして、リターン処理
をする。なお、図７に示す処理において、ステップＳ４
９での処理を通過してリターンとなった場合には、図４
のステップＳ２５での判断はＹＥＳ側へ分岐する。ま
た、図７に示す処理で、ステップＳ４４での処理を通過
してリターンとなった場合には、図４のステップＳ２５
での判断はＮＯ側へ分岐する。
ＥＳならば、ステップＳ４９で、制御パラメータである
ALL-WHITE フラグに“１”をセットして、リターン処理
をする。なお、図７に示す処理において、ステップＳ４
９での処理を通過してリターンとなった場合には、図４
のステップＳ２５での判断はＹＥＳ側へ分岐する。ま
た、図７に示す処理で、ステップＳ４４での処理を通過
してリターンとなった場合には、図４のステップＳ２５
での判断はＮＯ側へ分岐する。
【００２１】図８は、図４に示すステップＳ２２の全白
判断処理の詳細フローチャートである。なお、図７に示
す処理及び図８に示す処理においては、処理を実施する
前に、図３のステップＳ１２，Ｓ１３にて１ページ分の
読取りと非圧縮データのメモリ蓄積が終了しているの
で、図４のステップＳ２２，Ｓ２５は、ＲＡＭ４内の非
圧縮データの全白チェックの一括処理である。
判断処理の詳細フローチャートである。なお、図７に示
す処理及び図８に示す処理においては、処理を実施する
前に、図３のステップＳ１２，Ｓ１３にて１ページ分の
読取りと非圧縮データのメモリ蓄積が終了しているの
で、図４のステップＳ２２，Ｓ２５は、ＲＡＭ４内の非
圧縮データの全白チェックの一括処理である。
【００２２】また、図７に示す処理が、画素（１，１）
から画素（８，８）に相当する８＊８画素ブロックに関
するものであるのに対して、図８に示す処理は、画素
（１，１）から画素（８，ｍ）に相当する主走査８ライ
ン分の画素ブロックを一括して行なう処理である。図８
のステップＳ５１で、パラメータ（ｉ，ｊ．．．）を初
期化し、ステップＳ５２で、１画素分の画像データ
（ｉ，ｊ）をロードする。そして、ステップＳＳ５３
で、その画素が白か否かをチェックする。この画素が白
ではないと判断されたならば、ステップＳ５４で、制御
パラメータであるNOT-WHITE フラグに“１”をセットし
てリターン処理をする。
から画素（８，８）に相当する８＊８画素ブロックに関
するものであるのに対して、図８に示す処理は、画素
（１，１）から画素（８，ｍ）に相当する主走査８ライ
ン分の画素ブロックを一括して行なう処理である。図８
のステップＳ５１で、パラメータ（ｉ，ｊ．．．）を初
期化し、ステップＳ５２で、１画素分の画像データ
（ｉ，ｊ）をロードする。そして、ステップＳＳ５３
で、その画素が白か否かをチェックする。この画素が白
ではないと判断されたならば、ステップＳ５４で、制御
パラメータであるNOT-WHITE フラグに“１”をセットし
てリターン処理をする。
【００２３】しかし、ステップＳ５３での判断がＹＥＳ
ならば、ステップＳ５５で、制御パラメータである画素
ポインタ（ｉ）を＋１インクリメントする。次のステッ
プＳ５６では、上記ステップＳ５２，Ｓ５３，Ｓ５５の
処理が、計ｍ回行なわれたかどうかをチェックし、ｍ回
行なわれていないならば、ステップＳ５２へ処理を戻
す。
ならば、ステップＳ５５で、制御パラメータである画素
ポインタ（ｉ）を＋１インクリメントする。次のステッ
プＳ５６では、上記ステップＳ５２，Ｓ５３，Ｓ５５の
処理が、計ｍ回行なわれたかどうかをチェックし、ｍ回
行なわれていないならば、ステップＳ５２へ処理を戻
す。
【００２４】ステップＳ５６でのｍ回ループ検索の結果
がＹＥＳならば、ステップＳ５７で、上記の画素ポイン
タ（ｉ）を１にする。そして、ステップＳ５８で、制御
パラメータである画素ポインタ（ｊ）を＋１インクリメ
ントしてから、ステップＳ５９の処理へ行く。このステ
ップＳ５９では、上記ステップＳ５２，Ｓ５３，Ｓ５５
〜Ｓ５８の処理が、８＊８の画素分について行なわれた
かどうかをチェックし、その結果がＮＯならば、処理を
ステップＳ５２へ戻す。
がＹＥＳならば、ステップＳ５７で、上記の画素ポイン
タ（ｉ）を１にする。そして、ステップＳ５８で、制御
パラメータである画素ポインタ（ｊ）を＋１インクリメ
ントしてから、ステップＳ５９の処理へ行く。このステ
ップＳ５９では、上記ステップＳ５２，Ｓ５３，Ｓ５５
〜Ｓ５８の処理が、８＊８の画素分について行なわれた
かどうかをチェックし、その結果がＮＯならば、処理を
ステップＳ５２へ戻す。
【００２５】そして、ステップＳ５９での判断結果がＹ
ＥＳならば、ステップＳ６０で、制御パラメータである
ALL-WHITE フラグに“１”をセットして、リターン処理
をする。このように、図７に示す処理と図８に示す処理
との違いは、図７では、ステップＳ４６で、横方向（主
走査方向）に８画素分についてチェックしているのに対
して、図８では、ステップＳ５６で、主走査の端から端
まで行なっている。また、図８では、主走査ラインが次
のラインへ移る際、ステップＳ５７で、制御パラメータ
である（画素ポインタ）ｉの値をイニシャライズし直す
必要がある点において、図７に示す処理と相違する。
ＥＳならば、ステップＳ６０で、制御パラメータである
ALL-WHITE フラグに“１”をセットして、リターン処理
をする。このように、図７に示す処理と図８に示す処理
との違いは、図７では、ステップＳ４６で、横方向（主
走査方向）に８画素分についてチェックしているのに対
して、図８では、ステップＳ５６で、主走査の端から端
まで行なっている。また、図８では、主走査ラインが次
のラインへ移る際、ステップＳ５７で、制御パラメータ
である（画素ポインタ）ｉの値をイニシャライズし直す
必要がある点において、図７に示す処理と相違する。
【００２６】以上説明したように、本実施例によれば、
原稿画像中での全白の部分の出現確率が高いことに着目
し、あらかじめ、所定の画素ブロック部分の全白につい
てＤＣＴ演算した結果を使用して全白部分の符号化処理
速度を速めることで、ＪＰＥＧ符号化の処理速度の高速
化が可能となる。なお、本発明は、複数の機器から構成
されるシステムに適用しても１つの機器から成る装置に
適用しても良い。また、本発明は、システムあるいは装
置にプログラムを供給することによって達成される場合
にも適用できることは言うまでもない。
原稿画像中での全白の部分の出現確率が高いことに着目
し、あらかじめ、所定の画素ブロック部分の全白につい
てＤＣＴ演算した結果を使用して全白部分の符号化処理
速度を速めることで、ＪＰＥＧ符号化の処理速度の高速
化が可能となる。なお、本発明は、複数の機器から構成
されるシステムに適用しても１つの機器から成る装置に
適用しても良い。また、本発明は、システムあるいは装
置にプログラムを供給することによって達成される場合
にも適用できることは言うまでもない。
【００２７】
【発明の効果】以上説明したように、本発明によれば、
所定の画素ブロックが全白の場合にはＤＣＴ演算を行な
わず、あらかじめ決めた値を使用して符号化処理を行な
うことで、符号化処理速度の向上ができるという効果が
ある。
所定の画素ブロックが全白の場合にはＤＣＴ演算を行な
わず、あらかじめ決めた値を使用して符号化処理を行な
うことで、符号化処理速度の向上ができるという効果が
ある。
【図１】本発明の実施例に係る通信装置であるファクシ
ミリ装置の構成を示すブロック図である。
ミリ装置の構成を示すブロック図である。
【図２】実施例に係るファクシミリ装置の通信制御手順
を示す概略フローチャートである。
を示す概略フローチャートである。
【図３】図２に示す通信制御手順におけるステップＳ５
に示す送信処理の詳細フローチャートである。
に示す送信処理の詳細フローチャートである。
【図４】図３に示す送信処理手順の内、ステップＳ１４
のページ処理終了判断の詳細フローチャートである。
のページ処理終了判断の詳細フローチャートである。
【図５】原稿画像データが全白であるか否かを判断する
際の画素群の単位を示す図である。
際の画素群の単位を示す図である。
【図６】原稿画像データが全白であるか否かを判断する
際の画素群の単位を示す図である。
際の画素群の単位を示す図である。
【図７】図４に示すステップＳ２５の全白判断処理の詳
細フローチャートである。
細フローチャートである。
【図８】図４に示すステップＳ２２の全白判断処理の詳
細フローチャートである。
細フローチャートである。
１ 水晶発振器 ２ ＣＰＵ ３ ＲＯＭ ４ ＲＡＭ ５，７，１０，１８ ゲートアレー ９ ＪＰＥＧ符号化ＬＳＩ １１ ＣＣＤ １２ 読取りモータ １３ 記録モータ １４ モデム １５ ＮＣＵ １６ センサ １７ モータ駆動ＩＣ １９ スピーカ ２３ 回線 ２４ 電話機 ２５ スピーカ駆動回路 ３０ バス
Claims (2)
- 【請求項１】 画像データに対してＪＰＥＧ(Joint Pho
tographic Expert Group) 符号化／復号化を行なう通信
装置において、 前記画像データを構成する画素ブロックの内の８×８画
素ブロックの画素全てが白色である画素ブロックに対し
てＤＣＴ（離散コサイン変換）演算を施して得られる演
算値をあらかじめ格納する手段と、 現時点での符号化の対象となる第１の８×８画素ブロッ
クの画素全てが白色画素であるか否かを判断する第１の
判断手段と、 前記符号化の走査方向に関して、前記第１の８×８画素
ブロックの直前に位置する第２の８×８画素ブロックの
画素全てが白色画素であるか否かを判断する第２の判断
手段と、 前記第１の８×８画素ブロックの画素全てが白色画素で
あり、かつ、前記第２の８×８画素ブロックの画素全て
が白色画素である場合、該第１の８×８画素ブロックに
対しては、前記演算値を使用して符号化処理を行なう手
段とを備えることを特徴とする通信装置。 - 【請求項２】 前記画像データの主走査方向に１列分の
８×８画素ブロックの画素全てが白色画素の場合、該画
素ブロックに対しては、前記ＤＣＴ演算を実行せずに前
記演算値を使用して符号化処理を行なうことを特徴とす
る請求項１に記載の通信装置。
Priority Applications (7)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15490493A JP3280120B2 (ja) | 1993-06-25 | 1993-06-25 | 通信装置 |
| CN94107740A CN1092446C (zh) | 1993-05-31 | 1994-05-30 | 图象处理方法和装置 |
| ES94303901T ES2154667T3 (es) | 1993-05-31 | 1994-05-31 | Procedimiento y aparato para el tratamiento de imagenes. |
| US08/252,169 US5650861A (en) | 1993-05-31 | 1994-05-31 | Image processing method and apparatus for application to an image file or image communication apparatus |
| KR1019940012017A KR0154352B1 (ko) | 1993-05-31 | 1994-05-31 | 화상 처리 방법 및 장치 |
| DE69426792T DE69426792T2 (de) | 1993-05-31 | 1994-05-31 | Bildverarbeitungsverfahren und -gerät |
| EP94303901A EP0627845B1 (en) | 1993-05-31 | 1994-05-31 | Image processing method and apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP15490493A JP3280120B2 (ja) | 1993-06-25 | 1993-06-25 | 通信装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0730762A true JPH0730762A (ja) | 1995-01-31 |
| JP3280120B2 JP3280120B2 (ja) | 2002-04-30 |
Family
ID=15594506
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP15490493A Expired - Fee Related JP3280120B2 (ja) | 1993-05-31 | 1993-06-25 | 通信装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3280120B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2792815A1 (fr) | 1999-04-28 | 2000-11-03 | G C Dental Ind Corp | Distributeur de matiere visqueuse dentaire |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11331822A (ja) | 1998-05-15 | 1999-11-30 | Matsushita Electric Ind Co Ltd | 監視カメラ装置 |
| JP2001036981A (ja) | 1999-07-16 | 2001-02-09 | Fujitsu Ltd | 遠隔制御装置および遠隔制御プログラムを記録したコンピュータ読み取り可能な記録媒体 |
-
1993
- 1993-06-25 JP JP15490493A patent/JP3280120B2/ja not_active Expired - Fee Related
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| FR2792815A1 (fr) | 1999-04-28 | 2000-11-03 | G C Dental Ind Corp | Distributeur de matiere visqueuse dentaire |
| BE1013532A3 (fr) | 1999-04-28 | 2002-03-05 | G C Dental Ind Corp | Distributeur de materiau dentaire visqueux. |
Also Published As
| Publication number | Publication date |
|---|---|
| JP3280120B2 (ja) | 2002-04-30 |
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