JPH0745916A - プリント配線基板 - Google Patents

プリント配線基板

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Publication number
JPH0745916A
JPH0745916A JP18583193A JP18583193A JPH0745916A JP H0745916 A JPH0745916 A JP H0745916A JP 18583193 A JP18583193 A JP 18583193A JP 18583193 A JP18583193 A JP 18583193A JP H0745916 A JPH0745916 A JP H0745916A
Authority
JP
Japan
Prior art keywords
substrate
wiring board
printed wiring
perforations
single substrate
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP18583193A
Other languages
English (en)
Inventor
Kenpei Nakamura
賢平 中村
Hidefumi Hatagoshi
英文 波多腰
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fuji Electric Co Ltd
Original Assignee
Fuji Electric Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fuji Electric Co Ltd filed Critical Fuji Electric Co Ltd
Priority to JP18583193A priority Critical patent/JPH0745916A/ja
Publication of JPH0745916A publication Critical patent/JPH0745916A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/0097Processing two or more printed circuits simultaneously, e.g. made from a common substrate, or temporarily stacked circuit boards
    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistors

Landscapes

  • Structure Of Printed Boards (AREA)

Abstract

(57)【要約】 【目的】自動実装時に多面取りシート基板より単体基板
が分離するすることなく、更には定尺基板より取れる単
体基板枚数および単体基板の有効実装面積を増加するプ
リント配線基板を得る。 【構成】多面取りシート基板1上に複数の多角形の単体
基板2を面付けして製作するプリント配線基板におい
て、単体基板2を構成する単体基板外周部6を形成する
スリット3の端部3a間の少なくとも1か所に切断線5
およびミシン目4を形成し、ミシン目4の数を少なくと
も2個設け、切断線5およびミシン目4を形成する位置
は単体基板外周部6より内側に設けて構成する。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】この発明は、多面取りシート基板
上に複数の単体基板を面付けし、部品を実装後各単体基
板を個片に分割するプリント配線基板に関する。
【0002】
【従来の技術】図2は従来例の多面取りシート基板内の
1枚の単体基板2を部分的に示した構成図である。実際
は多面取りシート基板1に単体基板2が複数枚面付けさ
れている。この種の混成集積回路のプリント配線基板を
製作する場合、大型寸法の定尺基板(1×1m2 又は1
×1.2m2 )の面上に複数の単体基板2を面付けして
おき、大型寸法の定尺基板を単位として各単体基板2毎
に回路構成、部品実装用ホール等を形成後、自動実装機
にセットできる大きさに切断され、多面取りシート基板
1を製作するのが一般的である。スリット3およびミシ
ン目4はこの多面取りシート基板1を製作するときに同
時加工される。スリット3は単体基板外周部6より外側
に幅Tが1mm、ミシン目4はスリット3の中心線上に
直径1mm、ミシン目4とスリット3の端部3aとの間
隔Pは1mmにて形成される。またミシン目4は1個で
ある。この場合単体基板2の大きさは切断線を延長して
形成される枠7により規制されている。
【0003】このミシン目4は図2では単体基板2の1
辺に1箇所であるが、単体基板2の大きさにより単体基
板2の1辺に複数箇所設ける場合もある。このようにし
て製作された多面取りシート基板1を自動実装機にセッ
トし、各単体基板2に部品を実装したのち、多面取りシ
ート基板1を切断線5の部分で各単体基板2の個片に分
割してプリント板を製作する工法が周知である。
【0004】
【発明が解決しようとする課題】前述の方法によれば、
ミシン目が1個であるため切断線相当部の合計距離が短
かいため支持力小さく、部品を自動実装する場合にかか
る力により切断線が剪断され、多面取りシート基板より
単体基板が分離するという問題が発生している。更に切
断線が単体基板外周部より外側にあるため、単体基板の
大きさが切断線を延長して形成される枠内で規制され、
その差分定尺基板より取れる単体基板枚数が減少し、更
には単体基板の有効実装面積も減少するという問題もあ
る。
【0005】この発明は前記の問題点に鑑みて成された
ものであり、その目的は自動実装時に多面取りシート基
板より単体基板が分離するすることなく、更に定尺基板
より取れる単体基板枚数および単体基板の有効実装面積
を増加するプリント配線基板を提供することにある。
【0006】
【課題を解決するための手段】この発明によれば前述の
目的は、多面取りシート基板上に複数の多角形の単体基
板を面付けして製作するプリント配線基板において、各
角部より隣接する角辺に延在し単体基板を構成する単体
基板外周部を形成するスリットの各端部を単体基板内方
へ突設させ、この突設した端部間に少なくとも1か所の
切断線およびミシン目を形成したものである。そして、
スリットの端部間でのミシン目の数を少なくとも2個と
することが有効である。更にミシン目を切断線上に形成
することが有効である。
【0007】
【作用】この発明の構成によれば、多面取りシート基板
上に複数の多角形の単体基板を面付けして製作するプリ
ント配線基板において、単体基板を構成する単体基板外
周部より内側に切断線およびミシン目が位置し、突出部
がなくなるので、この差分定尺基板よりの取れ枚数およ
び単体基板有効実装面積が増加する。更にミシン目の数
を少なくとも2個設けることにより、切断線の合計長さ
が増加し、その分自動実装時に受ける力に耐えうる支持
力が増加し、自動実装時に単体基板が分離することがな
くなる。
【0008】
【実施例】図1はこの実施例を示す構成図である。この
図ではスリット、ミシン目等を誇張して大きく表示して
ある。なお従来例と同じ機能を持つものは同じ符号を付
してある。図1に基づきこの実施例の説明をする。スリ
ット3、ミシン目4等の各寸法は従来例と同様にスリッ
ト3は単体基板外周部6より外側に幅Tが1mm、ミシ
ン目4はスリット3の中心線上に直径1mm、ミシン目
4とスリット3の端部3aおよびミシン目4の外周部と
の間隔Pは1mmとし、ミシン目4の数は2個とした。
単体基板2の外形寸法は1×1.2m2 定尺基板よりの
取れ枚数の効率のよい80×98mm2 とした。この定
尺基板より多面取りシート基板1に単体基板2が4枚面
付けされたものと、2枚面付けされたものとにプレス型
を用いプレス加工した。この加工はNCルーター等を用
いても容易に加工できる。ここで得られた多面取りシー
ト基板1を自動実装機にセットし、部品を実装した。こ
の間自動実装による力で単体基板2が分離する現象は発
生しなかった。この場合は単体基板2の外形寸法は1×
1.2m2 定尺基板よりの取れ枚数の効率のよい80×
98mm2 としたため、単体基板2の取れ枚数は9%、
単体基板2の実装有効面積は5.7%従来例より増加し
た。なお単体基板2の取れ枚数は単体基板2の外形寸法
の大きさにより増加しないこともあるが、単体基板2の
実装有効面積はかならず増加することを確認した。
【0009】部品実装後の単体基板2の分離は手で行っ
たが、何ら問題は発生しなかった。部品実装後の単体基
板2の分離は簡単なジグ等を使用することにより無理な
く分離することも可能である。
【0010】
【発明の効果】以上述べたようにこの発明によれば、多
面取りシート基板上に複数の多角形の単体基板を面付け
して製作するプリント配線基板において、単体基板を構
成する単体基板外周部より内側に切断線およびミシン目
を形成したことにより、自動実装時に多面取りシート基
板より単体基板が分離することなく、更には単体基板の
有効実装面積を増加させ、単体基板の外径寸法によって
は定尺基板より取れる単体基板枚数を大幅に増加するこ
とができる。又単体基板の外径寸法によっては大幅なプ
リント配線基板のコスト低減が可能となる。
【図面の簡単な説明】
【図1】この発明によるプリント配線基板の構成図
【図2】従来例によるプリント配線基板の構成図
【符号の説明】
1 多面取りシート基板 2 単体基板 3 スリット 3a 端部 4 ミシン目 5 切断線 6 単体基板外周部 7 枠

Claims (3)

    【特許請求の範囲】
  1. 【請求項1】多面取りシート基板上に複数の多角形の単
    体基板を面付けして製作するプリント配線基板におい
    て、各角部より隣接する角辺に延在し単体基板を構成す
    る単体基板外周部を形成するスリットの各端部を単体基
    板内方へ突設させ、この突設した端部間に少なくとも1
    か所の切断線およびミシン目を形成したことを特徴とす
    るプリント配線基板。
  2. 【請求項2】請求項1記載の配線基板において、ミシン
    目の数を少なくとも2個とすることを特徴とするプリン
    ト配線基板。
  3. 【請求項3】請求項1又は2記載の配線基板において、
    ミシン目を切断線上に形成したことを特徴とするプリン
    ト配線基板。
JP18583193A 1993-07-28 1993-07-28 プリント配線基板 Pending JPH0745916A (ja)

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JP18583193A JPH0745916A (ja) 1993-07-28 1993-07-28 プリント配線基板

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JPH0745916A true JPH0745916A (ja) 1995-02-14

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JP18583193A Pending JPH0745916A (ja) 1993-07-28 1993-07-28 プリント配線基板

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
FR2762959A1 (fr) * 1997-01-29 1998-11-06 Motorola Inc Procede et panneau de plaques de circuit pour l'elimination en grande partie ou delaminage et de l'affaissement dans une ligne d'assemblage pour la fabrication de plaques de circuits complexes
EP0852896A4 (en) * 1996-06-28 2000-05-24 Motorola Inc METHOD AND BOARD BENEFITS TO PREVENT DELAMINATION AND SOCKING IN THE ASSEMBLY ROAD FOR THE PRODUCTION OF BOARDS
JPWO2025169636A1 (ja) * 2024-02-07 2025-08-14

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FR2762959A1 (fr) * 1997-01-29 1998-11-06 Motorola Inc Procede et panneau de plaques de circuit pour l'elimination en grande partie ou delaminage et de l'affaissement dans une ligne d'assemblage pour la fabrication de plaques de circuits complexes
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