JPH0785490B2 - 集積回路装置 - Google Patents

集積回路装置

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JPH0785490B2
JPH0785490B2 JP61012376A JP1237686A JPH0785490B2 JP H0785490 B2 JPH0785490 B2 JP H0785490B2 JP 61012376 A JP61012376 A JP 61012376A JP 1237686 A JP1237686 A JP 1237686A JP H0785490 B2 JPH0785490 B2 JP H0785490B2
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integrated circuit
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義宏 間淵
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    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
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    • H10W20/00—Interconnections in chips, wafers or substrates
    • H10W20/40—Interconnections external to wafers or substrates, e.g. back-end-of-line [BEOL] metallisations or vias connecting to gate electrodes
    • H10W20/41—Interconnections external to wafers or substrates, e.g. back-end-of-line [BEOL] metallisations or vias connecting to gate electrodes characterised by their conductive parts
    • H10W20/427—Power or ground buses
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D84/00—Integrated devices formed in or on semiconductor substrates that comprise only semiconducting layers, e.g. on Si wafers or on GaAs-on-Si wafers
    • H10D84/90—Masterslice integrated circuits
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    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10D—INORGANIC ELECTRIC SEMICONDUCTOR DEVICES
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    • Y10S257/923—Active solid-state devices, e.g. transistors, solid-state diodes with means to optimize electrical conductor current carrying capacity, e.g. particular conductor aspect ratio

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  • Internal Circuitry In Semiconductor Integrated Circuit Devices (AREA)
  • Semiconductor Integrated Circuits (AREA)

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明は集積回路装置に関し、特にセル化された機能セ
ル相互の電源配線に関する。
〔従来の技術〕
従来の集積回路装置の設計方法の一つに、ポリセル方式
とよばれる、高さ一定で幅が論理機能によって異なるセ
ル幅方向に複数個並べ、このような列を複数列設けてそ
れらを相互に接続してLSI論理を構成する方法がある。
この方式における電源配線の方設方法は、第２図に示す
ようにセルの高さが一定であることを利用して、セル１
内の一定の高さ位置に高電位側電源配線２（VDD）、低
電位側電源配線３（GND）の２本の電源配線を配置し、
それを一列に並べた時に全てのセルのVDD、GND配線が互
いにつながるようにする。この方式によればセル間の電
源配線の接続はセルを列状に配置するだけで完成し、特
別な電源配線の布設処理は不要であるので、自動設計に
も十分に適合させることができるものである。
〔発明が解決しようとする問題点〕 しかしながら上述したポリセル方式の集積回路装置で
は、かかる高さ一定のセルだけでなく、任意の高さのセ
ル、特にマクロセルと呼ばれる幅も高さも通常大きなセ
ルがそこに同時に含まれると、上述した電源配線の布設
ルールがポリセル部分とマクロセル部分との境界が成立
しなくなってしまう。この、マクロセル部分の電源配線
とポリセル部分の電源配線との接続は、それが人手によ
って行われる場合には種々のケースバイケースの対応が
可能であり、通常さしたる問題は生じないが、自動設計
で接続処理を完成させることは不可能であるという欠点
があった。
〔問題点を解決するための手段〕
本発明では、上記のようなポリセル部分としての第１の
セル形成領域とマクロセル部分としての第２のセル形成
領域とが混在するものに対し、第２のセル形成領域の周
囲に沿って第１の電源配線を設け、この第１の電源配線
にポリセル部分の電源配線とマクロセル部分の電源配線
とがそれぞれ延長されて接続されていることを特徴とす
る。
〔実施例〕
以下、本発明を実施例にて説明する。
第１図は、本発明の一実施例であり、上述したポリセル
方式の機能セル列の一部にマクロセルをはめ込んだチッ
プレイアウトの一部を、電源配線のみを抽出し、かつそ
れぞれの電源配線を点線及び実線で示したものである。
ここに於て斜線を付した部分にマクロセルが存在し、そ
れ以外の領域には第２図に示すポリセルが配列されてい
る。特に第１図に示す実施例に於ては、マクロセルの外
周をとり囲む２本の電源配線を除いて斜線領域内にある
電源配線はマクロセルに固定された電源配線である。
第１図から明らかなように、ポリセル部10の電源配線と
マクロセル部９の電源配線とは、その境界部に布設され
た電源配線の方に延長させることで必ず境界部電源配線
と遭偶するので、その位置で相互接続を果たすことがで
きる。特にポリセル部のセル列間距離が異なっていても
本接続ルールは妨げられることがない。そしてかかる接
続ルールは、十分に自動設計処理化することが可能であ
る。
以上では、マクロセルの外周をとり囲む２本の電源配線
を布設する場合を述べたが、この２本の電源配線はマク
ロセルに固定の電源配線であってもよい。この場合、こ
の２本の電源配線を布設する作業が省けるのでなお自動
化に好都合となる。
一方、マクロセル内に固定の配線と、ポリセル部に固定
の配線とを延長するとき、異電位のものが相位にぶつか
ることがありうる。第３図はかかる場合の対応方法を２
通り示したもので、第３図（Ａ）は丸で囲まれた内部で
マクロセル領域９内の第１層GND配線２を境界部電源配
線の第２層GND配線６に接続したいが、ポリセル領域10
から延在する第１層VDD配線３にぶつかるため、境界部
電源配線に第２層GND配線７を追加布設し、それと、マ
クロセル領域内の第１層GND配線２とを接続したもので
ある。尚、第２層GND配線７と６とは他の個所で接続し
ておく。第３図（Ａ）に示す手段により、原理上、あら
ゆる場合について第１層配線を曲折しないで境界部に布
設された第２層配線に接続することが可能になり、設計
自動化をより完成し易くなる。これに対し第３図（Ｂ）
は丸で囲まれた部分で生ずる同様の事情を、ポリセル領
域側から延長する第１層VDD配線８を同図上の方向に持
ちあげてから第２層VDD配線５に接続することにより解
消している。第３図（Ｂ）の手段は、（Ａ）に示した手
段よりも少ないスペースで異電位配線のぶつかりを解消
できる反面、配線の曲折という、自動処理にとってやや
高度の内容を含む点で（Ａ）よりも自動化は難しい。
尚、第３図（Ａ）に示す第２層配線７は、既に述べたマ
クロセル外周の２本の配線と同様、マクロセルに固定の
パタンとしてもよい。
〔発明の効果〕
以上に述べたように本発明によれば、マクロセルとポリ
セルの２つの領域の電源配線を簡単なルールで相互に接
続することが可能になり、また簡単なルールの故に設計
自動化にも容易に適合させることができるという効果が
ある。
【図面の簡単な説明】
第１図及び第３図は本発明をマクロセルとポリセルの境
界部分に適用した実施例を示す図、第２図は従来のポリ
セル上の電源配線布設方法を示す図である。

Claims (1)

    【特許請求の範囲】
  1. 【請求項１】第１の機能セルが行列方向に配置された第
    １のセル形成領域と、前記第１の機能セルとは大きさが
    異なる第２の機能セルが配置された第２のセル形成領域
    とを混在して有する集積回路装置において、前記第２の
    セル形成領域の周囲に沿って第１の電源配線が形成さ
    れ、この第１の電源配線に前記第１の機能セルを横切る
    第２の電源配線と前記第２の機能セルを横切る第３の電
    源配線とがそれぞれ延長されて接続され、これによって
    前記第２および第３の電源配線が電気的に導通状態とさ
    れていることを特徴とする集積回路装置。
JP61012376A 1986-01-22 1986-01-22 集積回路装置 Expired - Lifetime JPH0785490B2 (ja)

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US07/006,502 US4833520A (en) 1986-01-22 1987-01-21 Semiconductor integrated circuit having wirings for power supply suited for computer-aided-design
EP87100819A EP0231821B1 (en) 1986-01-22 1987-01-21 A semiconductor integrated circuit having wirings for power supply

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JPS62169444A JPS62169444A (ja) 1987-07-25
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