JPH0816405A - システム初期化装置 - Google Patents

システム初期化装置

Info

Publication number
JPH0816405A
JPH0816405A JP6144933A JP14493394A JPH0816405A JP H0816405 A JPH0816405 A JP H0816405A JP 6144933 A JP6144933 A JP 6144933A JP 14493394 A JP14493394 A JP 14493394A JP H0816405 A JPH0816405 A JP H0816405A
Authority
JP
Japan
Prior art keywords
processing unit
central processing
initialization
storage device
bus
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP6144933A
Other languages
English (en)
Inventor
Tsutomu Sekibe
勉 関部
Tomohiko Kitamura
朋彦 北村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP6144933A priority Critical patent/JPH0816405A/ja
Publication of JPH0816405A publication Critical patent/JPH0816405A/ja
Pending legal-status Critical Current

Links

Landscapes

  • Computer And Data Communications (AREA)
  • Stored Programmes (AREA)
  • Information Transfer Between Computers (AREA)

Abstract

(57)【要約】 【目的】初期化ROMを搭載せず、他のハードウェア資
産を活用したシステムの初期化手順を提供することによ
り、部品点数の少ないシステム構成を実現する。 【構成】電源投入後、バス制御装置13は補助記憶装置
14に書き込まれている初期化シーケンスプログラムを
システムバス10を介して主記憶装置12へ転送した
後、中央処理装置11のリセット状態を解除させる。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は、ワークステーション等
のシステム初期化装置に関する。
【0002】
【従来の技術】図3は、従来の典型的なシステム初期化
装置の構成を示す図である。電源投入後、中央処理装置
11はシステムバス10上でアドレス0番地に割り当て
られた初期化ROM(読み出し専用メモリ)35から初
期化シーケンスプログラムのデータを読み出し、その内
容に従ってシステム全体の初期化シーケンスを実行す
る。
【0003】
【発明が解決しようとする課題】上記のように、従来の
システム初期化装置では、システムの初期化を実行する
ためにROMを必要とする。このROMは電源投入後の
システム立ち上げの際に1回アクセスされるだけであ
り、その後のシステム動作においては全く必要とされな
い。したがって、従来の装置構成ではアクセス使用頻度
の極めて低いデバイスがシステム構成要素として必要と
なるという問題点を有していた。
【0004】本発明は、上記に示した従来のシステム初
期化装置の課題を考慮し、アクセス頻度の低い初期化R
OMを必要としないシステム初期化装置を提供すること
を目的とする。
【0005】
【課題を解決するための手段】上記目的を達成するた
め、本発明は、リセット解除後、ある定められたアドレ
スへの読み出しアクセスを発行し、その内容に応じてシ
ステム全体の初期化シーケンスを実行する中央処理装置
と、前記中央処理装置がリセット解除後にアクセスする
アドレスを含む領域に割り当てられた主記憶装置と、シ
ステム全体の初期化シーケンスプログラムをあらかじめ
記憶している補助記憶装置と、前記中央処理装置と前記
主記憶装置と前記補助記憶装置とを接続するシステムバ
スと、前記システムバスのプロトコルを制御するバス制
御装置とを具備し、前記バス制御装置は、電源投入後、
前記中央処理装置へのリセット信号の発生を持続させた
状態で、前記補助記憶装置に記憶されている初期化シー
ケンスプログラムを前記システムバスを介して前記主記
憶装置に転送し、転送完了後、前記中央処理装置のリセ
ットを解除することを特徴とするシステム初期化装置で
ある。
【0006】
【作用】本発明は上記の構成により、補助記憶装置内部
に記憶された初期化シーケンスプログラムがリセット解
除後中央処理装置がアクセスするアドレスに位置する主
記憶装置に転送されるため、システム構成要素として初
期化ROMを必要としないシステム初期化装置が実現さ
れる。
【0007】
【実施例】以下、本発明の実施例について図面を参照し
ながら説明する。
【0008】(実施例1)図1は、本発明の第1の実施
例であるシステム初期化装置の構成図である。同図のシ
ステム初期化装置では、中央処理装置11、主記憶装置
12、補助記憶装置14がそれぞれシステムバス10に
接続され、バス10上における各装置間のデータ転送プ
ロトコルをバス制御装置13が制御している。上記のよ
うに構成されたシステム初期化装置において、以下に、
システムが初期化される手順について説明する。
【0009】電源投入後、システム全体の動きを統括す
るのは中央処理装置11ではなく、バス制御装置13で
ある。したがって、バス制御装置13は中央処理装置1
1に対するリセット信号を発生させた状態のままで、初
期化手順の実行を始める。まず、システムバス10を介
して補助記憶装置14にあらかじめ記憶されている初期
化シーケンスプログラムを読み出す。初期化シーケンス
プログラムには、システムに接続された周辺機器装置の
初期設定方法、及び初期設定値、さらにはインタラプト
信号の処理方法などの中央処理装置11に対する情報が
含まれている。初期化シーケンスプログラムを読み出し
たバス制御装置13は、その内容を無条件に主記憶装置
12の0番地からのアドレス領域へ書き込む(この時、
バス制御装置13は、初期化シーケンスプログラムを補
助記憶装置14から主記憶装置12の0番地からのアド
レス領域へDMA(直接主記憶アクセス)転送すること
も可能である)。この書き込みが終了した後、バス制御
装置13は中央処理装置11のリセット状態を解除す
る。
【0010】リセット状態から解放された中央処理装置
11は、システムの初期化を実行するために、従来のシ
ステム構成では、初期化ROMが位置していたアドレス
への読み出しアクセスを発行するが、本実施例において
はそのアドレスには既に初期化シーケンスプログラムが
書き込まれた主記憶装置12が存在し、中央処理装置か
らの読み出しアクセスに対応する。
【0011】初期化シーケンスプログラムを読み出した
中央処理装置11は、従来のシステムと全く変わりな
く、読み出したプログラム内容に応じて動作することに
より、システムの初期化が終了する。
【0012】(実施例2)システムの一構成例として、
バス制御装置13は集積回路として実現することがで
き、その場合、周辺機器装置の制御回路をも同時に集積
化することはコンパクトなシステム構築を行なうための
常套手段である。上記の実施例1では、バス制御装置1
3が補助記憶装置14から読み出した初期化シーケンス
プログラムを無条件に主記憶装置12へ転送したが、バ
ス制御装置13が上記のように周辺機器装置の制御回路
を含んでいる場合には、初期化シーケンスプログラムに
含まれる周辺機器装置の初期設定は、主記憶装置12へ
転送せず、バス制御装置13で処理する方がシステムバ
ストラフィックを軽減させ、効率的な手法となる。
【0013】この場合、バス制御装置13は補助記憶装
置14から読み出した初期化シーケンスプログラムを解
読し、周辺機器装置の初期設定は自らが処理を行ない、
その他の初期化プログラムを主記憶装置12へ書き込
む。後の手順は、上記実施例1と同様に中央処理装置1
1のリセットを解放することにより、残りの初期化シー
ケンスプログラムを中央処理装置11が実行し、システ
ムの初期化が行なわれる。 (実施例3)ネットワーク
で接続されたサーバ・クライアントシステムのクライア
ントマシンなどでは、補助記憶装置を有していない場合
も多い。図2は、そのような場合における本発明の一実
施例である。
【0014】同図のシステム初期化装置では、図1にお
ける補助記憶装置の代わりとして、サーバマシン25に
ネットワークで接続されたネットワーク制御装置24が
システムバス10に接続されている。上記のように構成
されたシステム初期化装置では、電源投入後、バス制御
装置13が、ネットワーク制御装置24に対してコマン
ドを発行し、ネットワークを通してサーバマシン25か
ら初期化シーケンスプログラムを読み込む。初期化シー
ケンスプログラムがバス制御装置13内部に読み込まれ
た後の動作は実施例1、及び2と同様に行われる。
【0015】
【発明の効果】以上述べたところから明らかなように、
本発明によれば、システムの初期化シーケンスプログラ
ムを補助記憶装置、またはネットワークで接続された他
システム上に置き、電源投入後、主記憶装置へ転送する
ことにより、従来のシステム構成の一要素であった初期
化ROMが不必要となり、部品点数を削減したシステム
構成の実現が可能になる。
【0016】さらに、ネットワークから初期化シーケン
スプログラムを読み込む場合には、サーバマシンにおい
てシステムの初期化を一元的に管理することも可能であ
る。
【図面の簡単な説明】
【図1】本発明の第1、第2の実施例の構成図
【図2】本発明の第3の実施例の構成図
【図3】従来の画像表示制御装置の構成図
【符号の説明】
10 システムバス 11 中央処理装置 12 主記憶装置 13 バス制御装置 14 補助記憶装置 24 ネットワーク制御装置 25 サーバ
───────────────────────────────────────────────────── フロントページの続き (51)Int.Cl.6 識別記号 庁内整理番号 FI 技術表示箇所 7230−5B G06F 9/06 420 J

Claims (4)

    【特許請求の範囲】
  1. 【請求項1】リセット解除後、ある定められたアドレス
    への読み出しアクセスを発行し、その内容に応じてシス
    テム全体の初期化シーケンスを実行する中央処理装置
    と、前記中央処理装置がリセット解除後にアクセスする
    アドレスを含む領域に割り当てられた主記憶装置と、シ
    ステム全体の初期化シーケンスプログラムをあらかじめ
    記憶している補助記憶装置と、前記中央処理装置と前記
    主記憶装置と前記補助記憶装置とを接続するシステムバ
    スと、前記システムバスのプロトコルを制御するバス制
    御装置とを具備し、前記バス制御装置は、電源投入後、
    前記中央処理装置へのリセット信号の発生を持続させた
    状態で、前記補助記憶装置に記憶されている初期化シー
    ケンスプログラムを前記システムバスを介して前記主記
    憶装置に転送し、転送完了後、前記中央処理装置のリセ
    ットを解除することを特徴とするシステム初期化装置。
  2. 【請求項2】バス制御装置は、電源投入後、中央処理装
    置をリセットした状態で、補助記憶装置の初期化シーケ
    ンスプログラムを読み出し、前記初期化シーケンスプロ
    グラムのうち周辺機器装置の初期設定を実行した後、前
    記初期化シーケンスプログラムの他の部分を主記憶装置
    へ転送し、転送完了後、前記中央処理装置のリセットを
    解除することを特徴とする請求項1記載のシステム初期
    化装置。
  3. 【請求項3】リセット解除後、ある定められたアドレス
    への読み出しアクセスを発行し、その内容に応じてシス
    テム全体の初期化シーケンスを実行する中央処理装置
    と、前記中央処理装置がリセット解除後にアクセスする
    アドレスを含む領域に割り当てられた主記憶装置と、シ
    ステム全体の初期化シーケンスプログラムを記憶してい
    る他システムへ、ネットワークを通してアクセスする手
    段を有するネットワーク制御装置と、前記中央処理装置
    と前記主記憶装置と前記ネットワーク制御装置とを接続
    するシステムバスと、前記システムバスのプロトコルを
    制御するバス制御装置とを具備し、前記バス制御装置
    は、電源投入後、前記中央処理装置へのリセット信号の
    発生を持続させた状態で、前記ネットワーク制御装置に
    他システムに記憶されている初期化シーケンスプログラ
    ムを転送させ、そのデータを前記システムバスを介して
    前記主記憶装置に転送し、転送完了後、前記中央処理装
    置のリセットを解除することを特徴とするシステム初期
    化装置。
  4. 【請求項4】バス制御装置は、電源投入後、中央処理装
    置をリセットした状態で、前記ネットワーク制御装置か
    ら初期化シーケンスプログラムを読み出し、前記初期化
    シーケンスプログラムのうち周辺機器装置の初期設定を
    実行した後、前記初期化シーケンスプログラムの他の部
    分を主記憶へ転送し、転送完了後、前記中央処理装置の
    リセットを解除することを特徴とする請求項3記載のシ
    ステム初期化装置。
JP6144933A 1994-06-27 1994-06-27 システム初期化装置 Pending JPH0816405A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP6144933A JPH0816405A (ja) 1994-06-27 1994-06-27 システム初期化装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP6144933A JPH0816405A (ja) 1994-06-27 1994-06-27 システム初期化装置

Publications (1)

Publication Number Publication Date
JPH0816405A true JPH0816405A (ja) 1996-01-19

Family

ID=15373577

Family Applications (1)

Application Number Title Priority Date Filing Date
JP6144933A Pending JPH0816405A (ja) 1994-06-27 1994-06-27 システム初期化装置

Country Status (1)

Country Link
JP (1) JPH0816405A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001216164A (ja) * 2000-02-02 2001-08-10 Canon Inc プロセッサシステム及びその起動方法
US8176340B2 (en) 2007-02-06 2012-05-08 Freescale Semiconductor, Inc. Method and system for initializing an interface between two circuits of a communication device while a processor of the first circuit is inactive and waking up the processor thereafter

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2001216164A (ja) * 2000-02-02 2001-08-10 Canon Inc プロセッサシステム及びその起動方法
US8176340B2 (en) 2007-02-06 2012-05-08 Freescale Semiconductor, Inc. Method and system for initializing an interface between two circuits of a communication device while a processor of the first circuit is inactive and waking up the processor thereafter

Similar Documents

Publication Publication Date Title
JPH02267634A (ja) 割込み処理装置
JPH06187283A (ja) カード
US4729091A (en) Directing storage requests prior to address comparator initialization with a reference address range
JPH04363746A (ja) Dma機能を有するマイクロコンピュータシステム
US6065083A (en) Increasing I/O performance through storage of packetized operational information in local memory
JPH0212363A (ja) コンピユータ・システムの初期設定方法及びその装置
JP3126006B2 (ja) プログラマブルコントローラ
JPH0816405A (ja) システム初期化装置
JPH10105409A (ja) 装置用スレーブモジュール管理システム
JPH0554009A (ja) プログラムロード方式
JPS63184155A (ja) マルチプロセツサシステムのダウンロ−ド方式
JP3161319B2 (ja) マルチプロセッサシステム
JPS5854418A (ja) 割込み処理方式
JPH0240760A (ja) 情報処理装置
JPS6116104B2 (ja)
JP3168845B2 (ja) ディジタル信号処理装置
JP3139310B2 (ja) ディジタル信号処理装置
JP3127737B2 (ja) ディジタル信号処理装置
JP4174272B2 (ja) デバイス制御装置
JPH10320366A (ja) 非常駐型プログラム・ローディング方式
JPH01292451A (ja) 情報処理装置
JPH01233651A (ja) 通信制御方式
JPS5920030A (ja) 入出力命令制御方式
JPH064469A (ja) 入出力装置制御方式
JPH08106432A (ja) Dma制御回路