JPH08236654A - チップキャリアとその製造方法 - Google Patents

チップキャリアとその製造方法

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JPH08236654A
JPH08236654A JP7035359A JP3535995A JPH08236654A JP H08236654 A JPH08236654 A JP H08236654A JP 7035359 A JP7035359 A JP 7035359A JP 3535995 A JP3535995 A JP 3535995A JP H08236654 A JPH08236654 A JP H08236654A
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Yoshifumi Nakamura
嘉文 中村
Yoshihiro Bessho
芳宏 別所
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Matsushita Electric Industrial Co Ltd
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Abstract

(57)【要約】 【目的】 BGA(ボール・グリッド・アレイ)やLG
A(ランド・グリッド・アレイ)においてチップキャリ
アの外部接続電極と回路配線基板との熱膨張係数の違い
によって外部接続電極部にクラックが入のを防ぎ、熱衝
撃試験の信頼性の高い、実装するための回路配線基板の
種類に制限されず、あらゆるチップキャリア用回路配線
基板に適応できるチップキャリアを提供する。 【構成】 絶縁性基板20の表面20aに半導体素子3
の電極31に導通する接続配線21が設けられ、裏面2
0bに回路配線基板8の接続電極85に接続する外部接
続電極4が設けられたチップキャリア1であって、前記
外部接続電極4が導体からなる半田ボール2を有し、前
記外部接続電極4の側面部に樹脂層5が形成されてい
る。

Description

【発明の詳細な説明】
【0001】
【産業上の利用分野】本発明は回路配線基板上に半導体
素子を実装するのに用いるチップキャリアとその製造方
法に関する。さらに詳しくは、半導体素子の実装用及び
MCM(マルチ・チップ・モジュール)用チップキャリ
アとその製造方法に関する。
【0002】
【従来の技術】半導体装置の中にBGA(ボール・グリ
ッド・アレイ)パッケージやLGA(ランド・グリッド
・アレイ)パッケージというものが知られている。これ
らは、半導体素子を実装したチップキャリアの外部接続
電極がチップキャリアの裏面にグリッド状に配置されて
なる半導体装置である。この実装されてなる半導体装置
は、従来のQFP(クォータ・フラット・パッケージ)
に比べると、外部接続電極がパッケージの裏面にあるの
で半導体装置のサイズが大幅に小型化されるという利点
がある。また外部接続電極のピッチもQFPの0.3m
mや0.5mmに比べ1.5mmや1.27mmといった
粗いものであり、実装が容易にできる。そのためBGA
パッケージやLGAパッケージは、新たな半導体装置と
して脚光を浴びている。
【0003】従来のBGAパッケージ半導体装置を図6
に示す。図6において、1はチップキャリア、2は半田
ボール、3は半導体素子、4は外部接続電極である。チ
ップキャリア1は絶縁性基板60の表面60aに半導体
素子3の電極パッド31に導通する接続配線61が設け
られ、裏面には外部接続電極4が設けられて構成されて
いる。表面60aの接続配線61と裏面60bの外部引
出電極62とは、絶縁性基板60の表裏面を導通させる
バイアホール63、63、配線等を介して電気的に導通
されている。
【0004】半田ボール2はBGAでの外部への接続電
極としてチップキャリア1の裏面にグリッド状に並んで
おり、この半田ボール2にて図示しない回路配線基板と
の接続をとる。一方、LGAはボール無しの半田あるい
は、ソケットによって回路配線基板との接続を行なうよ
うに構成されている。
【0005】前記のBGAとLGAとの比較では、BG
Aでは半田ボールにて実装しているのでチップキャリア
と回路配線基板との実装間隔が広く、半田実装において
はLGAよりも実装信頼性は高い。そのためグリッド状
に外部接続電極を有する半導体装置においては、BGA
が主流となっている。しかし、コンピュータのCPUの
ようにグレードアップが必要な半導体装置においては、
LGAとソケットという組み合わせの形態のものも多く
使用されている。
【0006】
【発明が解決しようとする課題】しかしながら、BGA
やLGAのようなチップキャリアを半田により回路配線
基板に実装した場合、実装部が半田によりチップキャリ
アと回路配線基板が直接接続されているため、JIS
C0025に規定されているように、−40℃から+1
00℃に変化させる熱衝撃試験という環境信頼性試験を
行うと、チップキャリアと回路配線基板との熱膨張係数
の違いによって外部接続電極部にクラックが入り、外部
接続電極が剥がれ、オープンになり、接続が悪くなると
いう現象がおこる。そのためBGAやLGAは、熱衝撃
試験の信頼性の低いものとなっている。
【0007】本発明は前記問題を解決し、外部接続電極
部にクラックが入り、外部接続電極が剥がれるのを防
ぎ、信頼性の高くできるチップキャリアとその製造方法
を提供することを目的とする。
【0008】
【課題を解決するための手段】前記従来の問題を解決す
るため、本発明のチップキャリアは、絶縁性基板の表面
に半導体素子の電極に接続する接続配線が設けられ、裏
面に回路配線基板の接続電極に接続するための外部接続
電極が設けられたチップキャリアであって、前記外部接
続電極が導体からなるバンプを有し、該バンプを覆って
樹脂層が形成されていることを特徴とする。
【0009】前記構成のチップキャリアにおいては、前
記樹脂層をバンプ周囲に凸状に形成し、該バンプの先端
部を露出させていることが好ましい。また、前記構成の
チップキャリアにおいては、前記樹脂層を絶縁性基板の
裏面に層状に形成し、前記バンプの先端部を露出させて
いることが好ましい。
【0010】また、前記構成のチップキャリアにおいて
は、前記バンプが半田ボールからなることが好ましい。
また、前記構成のチップキャリアにおいては、前記バン
プがSn、Cu、Ag、Au、またはNiのうちの1種
以上を主成分とする導体からなることが好ましい。
【0011】また、前記構成のチップキャリアにおいて
は、前記バンプのチップキャリア側から少なくとも20
%以上の高さまで樹脂層にて覆っていることが好まし
い。本発明のチップキャリアの製造方法は、絶縁性基板
の表面に半導体素子の電極に接続する接続配線を設け、
回路配線基板の接続電極に接続するためのバンプを有す
る外部接続電極を前記絶縁性基板の裏面に形成し、前記
外部接続電極の側面部をペースト状の樹脂により覆い、
しかる後、前記樹脂ペーストが硬化する温度で熱処理す
ることにより樹脂層を形成することを特徴とする。
【0012】前記製造方法の構成においては、前記外部
接続電極間にペースト状の樹脂を流し込み、しかる後、
前記樹脂ペーストが硬化する温度で熱処理することによ
り樹脂層を形成することが好ましい。
【0013】前記製造方法の構成においては、前記外部
接続電極の形成された裏面に熱を供給して、樹脂を流し
込んで樹脂層を形成することが好ましい。また、前記製
造方法の構成においては、前記バンプからなる外部接続
電極の形成された裏面をペースト状の樹脂中に浸漬し、
しかる後、前記チップキャリアを樹脂中から取り出し、
前記樹脂が硬化する温度で熱処理して樹脂層を形成し、
その後、該樹脂層形成面を前記バンプが出現するまで加
工することが好ましい。
【0014】また、前記製造方法の構成においては、前
記外部接続電極面に樹脂を噴射し、前記外部接続電極面
に樹脂層を形成し、その後、該樹脂層形成面を前記バン
プが出現するまで加工することが好ましい。
【0015】また、前記製造方法の構成においては、前
記バンプが出現するまで研磨にて加工することが好まし
い。また、前記製造方法の構成においては、前記導体箔
上に半田バンプを形成することにより外部接続電極を形
成するに際し、スクリーン印刷により前記導体箔の表面
を露出させて樹脂ペーストを塗布して樹脂層を形成し、
該樹脂層が硬化する温度で熱処理した後、前記導体箔上
に半田ペーストを塗布し、半田ペーストが溶融する温度
で熱処理して半田バンプを形成して前記外部接続電極を
形成することが好ましい。
【0016】
【作用】本発明のチップキャリアは、前記のように絶縁
性基板の表面に半導体素子の電極に接続する接続配線が
設けられ、裏面に回路配線基板の接続電極に接続するた
めの外部接続電極が設けられたチップキャリアであっ
て、前記外部接続電極が導体からなるバンプを有し、該
バンプを覆って樹脂層が形成されている。したがって、
最も応力がかかりやすい外部接続電極のバンプと本体と
の界面の周囲を樹脂により覆うことにより強化すること
ができ、熱衝撃試験におけるバンプと本体との界面に集
中する歪応力を樹脂層にも広げ、各電極の半田部分にお
ける歪応力を緩和させることができる。その結果、チッ
プキャリアと回路配線基板との熱膨張係数の違いによっ
て外部接続電極部にクラックが入るのを防ぐことがで
き、外部接続電極の剥がれをなくすことができ、熱衝撃
試験の信頼性を向上させることができる。
【0017】前記構成のチップキャリアにおいて、前記
樹脂層をバンプ周囲に凸状に形成し、前記バンプの先端
部を露出させている好ましい例によれば、前記作用、効
果を得ることができるとともに、樹脂層の形成が容易で
あり、外部接続電極部をより強化することがすることが
できる。
【0018】また、前記構成のチップキャリアにおい
て、前記樹脂層を絶縁性基板の裏面に層状に形成し、前
記バンプの先端部を露出させている好ましい例によれ
ば、前記作用、効果を得ることができるとともに、樹脂
層の形成がより容易になり、生産性を向上でき、外部接
続電極部をより強固に強化することができる。
【0019】また、前記構成のチップキャリアにおい
て、前記バンプが半田ボールからなる好ましい例によれ
ば、前記作用、効果を得ることができるとともに、回路
配線基板の接続電極への接着の際の半田の塗布が不要に
なり、それだけ工程を少なくすることができる。
【0020】また、前記構成のチップキャリアにおい
て、前記バンプがSn、Cu、Ag、Au、またはNi
の1種以上を主成分とする導体からなる好ましい例によ
れば、前記作用、効果を得ることができるとともに、回
路配線基板の接続電極との接続安定性をよくすることが
でき、電気的に良好な接続を得ることができる。
【0021】また、前記構成のチップキャリアにおい
て、前記バンプのチップキャリア側から少なくとも20
%以上の高さまで樹脂層にて覆っている好ましい例によ
れば、前記作用、効果を得ることができるとともに、と
くに樹脂層による外部接続電極部を確実に強化すること
ができる。
【0022】本発明のチップキャリアの製造方法は、絶
縁性基板の表面に半導体素子の電極に接続する接続配線
を設け、回路配線基板の接続電極に接続するためのバン
プを有する外部接続電極を前記絶縁性基板の裏面に形成
し、前記外部接続電極の側面部をペースト状の樹脂によ
り覆い、しかる後、前記樹脂ペーストが硬化する温度で
熱処理することにより樹脂層を形成することを特徴とす
る。このように製造することにより、樹脂層の形成を容
易に行うことができ、樹脂層による外部接続電極部を確
実に強化することができる。その結果、前記のような信
頼性の高いチップキャリアを容易に製造することができ
る。
【0023】前記製造方法において、前記外部接続電極
間にペースト状の樹脂を流し込み、しかる後、前記樹脂
ペーストが硬化する温度で熱処理することにより樹脂層
を形成する好ましい例によれば、樹脂層の形成を容易に
行うとともに、容易に樹脂を硬化させることができ、樹
脂層による外部接続電極部を確実に強化することができ
る。
【0024】また、前記製造方法において、前記外部接
続電極の形成された裏面に熱を供給して、樹脂を流し込
んで樹脂層を形成する好ましい例によれば、流し込んで
樹脂層を形成するので、より迅速に、より容易に樹脂層
を形成することができ、樹脂層による外部接続電極部を
確実に強化することができる。
【0025】また、前記製造方法において、前記バンプ
からなる外部接続電極の形成された裏面をペースト状の
樹脂中に浸漬し、しかる後、前記チップキャリアを樹脂
中から取り出し、前記樹脂が硬化する温度で熱処理して
樹脂層を形成し、その後、該樹脂層形成面を前記バンプ
が出現するまで加工する好ましい例によれば、樹脂層の
形成をより迅速に、より容易に行うことができ、樹脂層
により外部接続電極部を強化したチップキャリアを製造
することができる。さらに、外部接続電極を確実に露出
させることができ、導通を確保することができる。
【0026】また、前記製造方法において、前記外部接
続電極面に樹脂を噴射し、前記外部接続電極面に樹脂層
を形成し、その後、該樹脂層形成面を前記バンプが出現
するまで加工する好ましい例によれば、樹脂層により外
部接続電極部を強化したチップキャリアを製造すること
ができ、樹脂層の形成をより迅速に、より容易に行うこ
とができる。
【0027】また、前記製造方法において、前記バンプ
が出現するまで研磨にて加工する好ましい例によれば、
樹脂層により外部接続電極部をさらに強化したチップキ
ャリアを製造することができ、樹脂層の形成をより迅速
に、より容易に行うことができる。
【0028】また、前記製造方法において、前記導体箔
上に半田バンプを形成することにより外部接続電極を形
成するに際し、スクリーン印刷により前記導体箔の表面
を露出させて樹脂ペーストを塗布して樹脂層を形成し、
該樹脂層が硬化する温度で熱処理した後、前記導体箔上
に半田ペーストを塗布し、半田ペーストが溶融する温度
で熱処理して半田バンプを形成して前記外部接続電極を
形成する好ましい例によれば、樹脂層により外部接続電
極部をさらに強化したチップキャリアを製造することが
でき、外部接続電極の形成と樹脂層の形成をより迅速
に、より容易に行うことができる。
【0029】前記のように、本発明によると、熱衝撃試
験における半田接続部に集中する歪応力を樹脂層にも広
げ、各部分における歪応力を緩和させることができる。
また、最も応力がかかりやすいチップキャリアと半田と
の界面を樹脂により強化できる。
【0030】
【実施例】以下、本発明のチップキャリアの一実施例に
ついて、図面を参照しながら説明する。
【0031】図1は本発明の一実施例におけるチップキ
ャリアの一部を示す断面図、図2は図1のチップキャリ
アをプリント配線基板に実装した状態の一部を示す断面
図、図3は半田ボールの側面に樹脂層がある他の実施例
のチップキャリアの一部を示す断面図である。
【0032】図1及び図2において、1は半導体素3を
実装するためのチップキャリア、2は外部電極22に接
続して導体からなるバンプを形成する半田ボール、4は
外部電極22と半田ボールからなる外部接続電極、5は
バンプを覆う脂層、8は半導体素子3を実装したチップ
キャリア1を実装するプリント配線基板である。
【0033】チップキャリア1は、前記従来のチップキ
ャリアと同様に構成され、ガラス・セラミック等の絶縁
性基板20の表面20aには、半導体素子3の電極パッ
ド31に導通するSn、Cu、Ag、Au、またはNi
を主成分とする接続電極21が設けられ、裏面20bに
は同様な成分からなる外部電極22が設けられている。
そして、この外部電極22と半田ボール2とにより外部
接続電極4が形成されている。また、表面20aの接続
電極21と裏面20bの外部電極22とはバイアホール
23を介して電気的に導通している。このチップキャリ
ア1の表裏面の電極の導通は、図に示すバイアホールに
限られず、基板に応じて基板面の配線を介して導通する
ようにされたものでもよい。
【0034】半田ボール2は、BGAでの外部への接続
電極として働くものであり、半田から形成され、絶縁性
基板20の裏面20bにグリッド状に並んで配置された
外部電極22に接着されて設けられている。半田ボール
2の直径は0.5〜1.0mm程度に形成する。小さす
ぎると接続不良が生じやすくなり、接続の信頼性が低く
なり、大きすぎると短絡を生じる可能性があるからであ
る。
【0035】樹脂層5は、チップキャリア1の外部接続
電極4とプリント配線基板の配線とが半田により接着さ
れる際、熱応力により電極が割れるのを防ぐため熱応力
を吸収するため設ける。この樹脂層5は、絶縁性基板2
0の裏面20bの外部接続電極4の間の全面に形成さ
れ、外部電極22と半田ボール2との界面から先端部2
a近くまで覆い、半田ボール2の先端部2aが露出する
ように0.1〜1.0mm程度の厚みに形成されてい
る。すなわち、樹脂層5の厚みはチップキャリア1とバ
ンプの界面を確実に覆うことができるように少なくとも
外部接続電極4の高さの20%以上で、半田ボール2の
半径から直径程度が好ましい。
【0036】樹脂層5に用いる樹脂としては、熱可塑性
樹脂または熱硬化性樹脂のいずれでもよい。この樹脂は
室温で約200000センチポイズより大きくない粘度
で、樹脂層5の形成作業ができる粘度を持つように樹脂
ペーストにして用いるのが好ましい。とくにエポキシ樹
脂が好ましい。
【0037】以上の方法で樹脂層を有する半田ボール付
きチップキャリアを作製した。前記のように構成された
チップキャリア1を図2に示すように、半田ボール2を
介してプリント配線基板8の接続配線85に接着して配
線基板8に実装する。この実装の際には、チップキャリ
ア1の外部接続電極4とプリント配線基板8の配線85
とを半田で接着するため熱が加えられるが、加熱により
外部接続電極4に熱応力が生じても、樹脂層5により熱
応力が緩和され、外部接続電極4の半田ボール2の界面
等で割れが生じ、接続不良等が生じるのを防ぐことがで
きる。
【0038】図3は本発明のチップキャリアの他の実施
例の一部を示す断面図である。本実施例のチップキャリ
アは、図1に示す実施例とは、半田ボール2の側面の周
囲に凸状に樹脂層7が設けられている点で相違する。図
1に示す実施例に相当する部分には同一符号を付して詳
細な説明は省略する。
【0039】樹脂層7は、半田ボール2の側面の周囲に
凸状に厚み0.1〜0.5mmに設けられており、絶縁
性基板20の裏面20b全面にほぼ同一の厚みに設けら
れている図1の例とは相違している。このように樹脂層
7を形成することは、半田ボール2の先端2aを容易に
露出させることができ、回路配線基板と良好な接続を容
易に得ることができる。
【0040】次に、より具体的実施例を用いて本発明を
説明する。 (実施例1)本実施例のチップキャリアは、図1に示す
ように構成している。前記のように、チップキャリア1
の基板20としては、汎用のガラス・セラミック製のも
のを使用し、基板配線導体としてCuを使用する。
【0041】本実施例のチップキャリアの製造は、ま
ず、前記ガラス・セラミック基板20の表面20aに
は、Cuにて半導体素子実装用の配線パターン21が設
けられ、裏面20bには外部電極22が格子状に設けら
れている。前記基板20の裏面20bの外部電極22に
共晶半田ペースト(63Pb/27Snの合金組成ペー
スト 千住金属(株)製)をメタル印刷にて塗布した。
前記塗布済み各外部電極22の半田ペースト上に半田ボ
ール2を配列し、外部接続電極としての外部接続端子4
を形成した。半田ボール2としては、 63Pb/27
Snの合金組成の半田で、ボール径は0.7mmφであ
る。前記半田ペーストと前記半田ボール2をピーク温度
240℃で10秒間の赤外線リフローにて溶融させた。
以上の方法でチップキャリア1の裏面20bの外部電極
22上に半田ボール2を形成した。
【0042】次いで、シリンジ中に注入した樹脂ペース
トを前記半田ボール形成済みチップキャリア裏面の前記
半田ボール2間に射出した。樹脂ペースト量は、半田ボ
ール2の径に対しほぼ半分が均等に埋められるまで(層
厚約0.4mm)とし、半田ボール2の先端2a部は露
出させておいた。減圧雰囲気にて150℃で2時間、前
記樹脂ペーストを硬化した。この樹脂ペーストとして
は、エポキシ系樹脂(ABLESTIK社のエイブルボ
ンド 975−2L 20000cps)を使用した。
このエポキシ樹脂は、室温で約200000センチポイ
ズより大きくない粘度を持っている。以上の方法で樹脂
層を有する半田ボール付きチップキャリアを作製した。
【0043】実装信頼性試験用配線パターンを有する汎
用のプリント配線基板上に共晶半田ペースト(63Pb
/27Snの合金組成ペースト 千住金属(株)製)を
メタル印刷し、前記印刷済み半田上に前記樹脂層形成済
みチップキャリアを実装した。前記実装体をピーク温度
240℃で10秒間の赤外線リフローにて半田を溶融さ
せてチップキャリア実装体を作製した(図2)。
【0044】以上の方法で作製したチップキャリア実装
体を環境信頼性試験の一つである前記の熱衝撃試験(−
40℃〜100℃)にて信頼性試験を行った。その結
果、1000サイクル抵抗値変化がほとんど無く保持で
きた。このことから外部接続電極の割れ等がないことが
判った。よって、熱衝撃試験において実装信頼性が弱い
といわれるBGAタイプチップキャリアにおいて、実装
信頼性の高いチップキャリアを作製できた。
【0045】(実施例2)本実施例のチップキャリア
は、図3に示すように構成している。本実施例のチップ
キャリアは前記実施例1とは樹脂層7が半田ボールの側
面に沿うように形成されている点でのみ、前記実施例1
と相違する。
【0046】本実施例のチップキャリアの製造方法は、
まず、前記実施例1と同様の方法でガラス・セラミック
基板20の外部電極22上に半田ボール2を形成して外
部電極22と半田ボール2からなる外部接続端子4を形
成した。
【0047】次いで、シリンジ中に注入した樹脂ペース
トを前記半田ボール2形成済みチップキャリア1の裏面
20bの前記各半田ボール2上に射出した。樹脂ペース
ト量は、前記ガラス・セラミック基板20と半田ボール
2との接続面が完全に埋まるが、半田ボール2の先端2
aは露出する厚み(約0.2mm)までとした。樹脂ペ
ースト射出後半田ボール2の先端部をエタノールにて洗
浄した。減圧雰囲気にて150℃−2時間で前記樹脂ペ
ーストを硬化した。樹脂ペーストとしては、実施例1と
同様のエポキシ樹脂を使用した。
【0048】実装信頼性試験用配線パターンを有する汎
用のプリント配線基板上に共晶半田ペースト(63Pb
/27Snの合金組成ペースト 千住金属(株)製)を
メタル印刷し、前記印刷済み半田上に前記樹脂層7形成
済みチップキャリア1を実装した。前記実装体をピーク
温度240℃で10秒間の赤外線リフローにて半田溶融
させた。
【0049】以上の方法でチップキャリア実装体を作製
し、この実装体を環境信頼性試験の一つである前記の熱
衝撃試験(−40℃〜100℃)にて信頼性試験を行っ
た。その結果、1000サイクル抵抗値変化がほとんど
無く保持できた。このことから外部接続電極の割れ等が
ないことが判った。よって、熱衝撃試験において実装信
頼性が弱いといわれるBGAタイプチップキャリアにお
いて、実装信頼性の高いチップキャリアを作製できた。
【0050】(実施例3)本実施例のチップキャリアは
図4に示すように構成している。図4において、9は半
導体素子3を実装したチップキャリア、11は半導体素
子3の接続電極31に導通させる配線パターン、13は
導体からなるバンプ14を覆っている樹脂層、15は基
板の表裏面を導通する導体が設けられたバイアホールで
ある。本実施例のチップキャリア9は、外部接続端子
(電極)4が導体からなるバンプ14で形成されている
点で前記実施例1のチップキャリア1とは相違する。
【0051】このチップキャリア9は、前記実施例1と
同様の方法でガラス・セラミック基板10の表面10a
に配線パターン11が設けられ、この配線パターン11
で半導体素子3の接続電極31と半田32により接着さ
れ、電気的に導通している。セラミック基板10の裏面
10bに外部電極12が設けられ、この外部電極12の
表面に導体からなるバンプ14が形成され、外部電極1
2とバンプ14とで外部接続端子4を形成している。基
板10の表面10aの配線パターン11および裏面10
bの外部電極11とはバイアホール15を介して導通し
ている。配線パターン11および外部電極12はCuを
使用して形成する。樹脂層13は導体からなるバンプ1
4の周囲を含む裏面10b全面に厚み約0.3mmに形
成されている。バンプ14の先端14a部は樹脂が除か
れ、導電性が確保されている。
【0052】本実施例のチップキャリア9の製造方法
は、まず、前記ガラス・セラミック基板10の表面10
aに、Cuにて半導体素子実装用の配線導体11のパタ
ーンを設け、裏面10bに外部電極10を格子状に設け
る。前記基板10の裏面10bの外部電極12にCuメ
ッキにてバンプ14を形成した。前記バンプ14の高さ
は200μmとした。
【0053】次いで、フラットなステンレス鋼上に樹脂
ペーストを均一の厚みになるように供給することにより
樹脂槽を形成し、前記樹脂ペースト上にバンプ14面
(裏面10b)を下面として前記バンプ14形成済みチ
ップキャリア9を下ろし、前記バンプ14とガラス・セ
ラミック基板10との界面まで漬ける。しかる後、前記
チップキャリア9を引き上げることにより、チップキャ
リア9を樹脂槽から取り出す。樹脂ペースト塗布済み前
記チップキャリア9をチップキャリア9のチップ実装面
の表面10aを下にしてホットプレート上に置き、加熱
することで樹脂ペーストを軟化させ、チップキャリア9
上に均一に樹脂ペースト層を形成した。ホットプレート
の温度は、60℃とした。しかる後、減圧雰囲気にて1
50℃で2時間かけて前記樹脂ペーストを硬化して樹脂
層11を形成した。樹脂ペーストとしては、実施例1と
同様のものを使用した。
【0054】なお本実施例でも樹脂層の形成は、前記実
施例のように形成してもよい。次いで、前記樹脂層13
の硬化済みチップキャリア9の樹脂層13側を導体から
なるバンプ14の表面14aが露出するまでやすりにて
研磨する。この時に導体からなるバンプ14上に形成さ
れた樹脂層13を破壊することで導体部分を表面に露出
することが可能となる。
【0055】実装信頼性試験用配線パターンを有する汎
用のプリント配線基板上に共晶半田ペースト(63Pb
/27Snの合金組成ペースト 千住金属(株)製)を
メタル印刷し、前記印刷済み半田上に前記研磨済みチッ
プキャリアを実装した。前記実装体をピーク温度240
℃で10秒間の赤外線リフローにて半田溶融させた。
【0056】以上の方法でチップキャリア実装体を作製
し、前記実装体を環境信頼性試験の一つである前記の熱
衝撃試験(−40℃〜100℃)にて信頼性試験を行っ
た結果、1000サイクル抵抗値変化がほとんど無く保
持できた。このことから外部接続電極の割れ等がないこ
とが判った。よって、熱衝撃試験において実装信頼性が
弱いといわれるBGAタイプチップキャリアにおいて、
実装信頼性の高いチップキャリアを作製できた。
【0057】(実施例4)図5は本実施例によるチップ
キャリアの製造方法の一部を示す工程図である。図5に
おいて、40はチップキャリアを形成する絶縁性の配線
基板で、配線基板40の表面には配線電極41が形成さ
れ、裏面には外部電極42が形成されるとともに樹脂層
43が形成されている。44はエッチング後の穴で、半
田バンプ45はエッチング後の穴44に形成される。
【0058】前記と同様に、チップキャリアの基板とし
ては、汎用のガラス・セラミックを使用し、基板配線導
体としてCuを使用した。まず、図5(a)に示すよう
に、前記ガラス・セラミック基板40の表面には、Cu
にて半導体素子実装用の配線電極41のパターンが形成
され、裏面には外部電極42が格子状に形成される。
【0059】次いで、図5(b)に示すように、前記基
板40の裏面全面に樹脂ペーストをメタル版を用いて、
ベタ印刷し、樹脂層43を厚み200μmに形成した。
前記印刷済み基板40を減圧雰囲気にて150℃で2時
間かけて前記樹脂ペーストを硬化した。樹脂ペーストと
しては、実施例1と同様のものを使用した。
【0060】次いで、図5(c)に示すように、前記樹
脂層43形成済み基板40の裏面の外部電極42上をエ
ッチングすることで外部電極42部の樹脂層43に穴4
4をあけ、前記電極42を露出させた。
【0061】次いで、図5(d)に示すように、前記外
部電極42上の穴44に共晶半田ペースト(63Pb/
27Snの合金組成ペースト 千住金属(株)製)をメ
タル印刷し、ピーク温度240℃で10秒間の赤外線リ
フローにて半田溶融させて導体層45を設けた。
【0062】そして、実装信頼性試験用配線パターンを
有する汎用のプリント配線基板上に共晶半田ペースト
(63Pb/27Snの合金組成ペースト 千住金属
(株)製)をメタル印刷し、前記印刷済み半田上に前記
樹脂層形成済みチップキャリアを実装した。前記実装体
をピーク温度240℃で10秒間の赤外線リフローにて
半田溶融させた。
【0063】以上の方法でチップキャリア実装体を作製
し、この実装体を環境信頼性試験の一つである前記の熱
衝撃試験(−40℃〜100℃)にて信頼性試験を行っ
た。その結果、1000サイクル抵抗値変化がほとんど
無く保持できた。このことから外部接続電極の割れ等が
ないことが判った。よって、熱衝撃試験において実装信
頼性が弱いといわれるBGAタイプチップキャリアにお
いて、実装信頼性の高いチップキャリアを作製できた。
【0064】
【発明の効果】本発明によると、プリント基板へのチッ
プキャリア実装時に最も応力がかかるガラス・セラミッ
ク基板と半田ボール形成界面の周囲に樹脂層を形成する
ことで、局所的な応力集中を防ぐことができ、また半田
ボールの接着強度も向上させることができる。その結
果、環境信頼性試験における信頼性の高いチップキャリ
アを提供できる。
【0065】また、本発明のチップキャリアの形態は、
あらゆるチップキャリア用回路配線基板に適応できる。
また、このチップキャリアを実装する配線回路基板の種
類も特に制限されず、あらゆる配線回路基板に実装する
ことが可能となる。
【図面の簡単な説明】
【図1】本発明のチップキャリアの一実施例の一部を示
す断面図である。
【図2】本発明の一実施例の樹脂層を形成した半田ボー
ルを有するチップキャリアを回路基板に装着した状態の
一部を示す断面図である。
【図3】本発明の他の実施例の樹脂層を形成した半田ボ
ールを有するチップキャリアの一部を示す断面図であ
る。
【図4】本発明の他の実施例の樹脂層を形成した半田ボ
ールを有するチップキャリアの一部を示す断面図であ
る。
【図5】本発明の一実施例のチップキャリアの製造方法
の一部の工程を説明する断面図である。
【図6】従来例のBGA(ボール・グリッド・アレイ)
パッケージの一部を示す断面図である。
【符号の説明】
1 チップキャリア 2 半田ボール 3 半導体素子 4 外部接続電極 5 樹脂層 7 半田ボールの側面の樹脂層 8 プリント配線基板(回路配線基板) 9 チップキャリア 10 ガラス・セラミック配線基板 11 接続配線 12 外部電極 13 樹脂層 14 導体からなるバンプ 20 ガラス・セラミック配線基板 21 接続配線 22 外部電極 23 バイアホール 31 接続電極 32 半田ボール 40 ガラス・セラミック配線基板 41 配線電極 42 外部接続電極 43 樹脂層 44 エッチング後の穴 45 半田バンプ 85 接続配線

Claims (13)

    【特許請求の範囲】
  1. 【請求項1】 絶縁性基板の表面に半導体素子の電極に
    接続する接続配線が設けられ、裏面に回路配線基板の接
    続電極に接続するための外部接続電極が設けられたチッ
    プキャリアであって、前記外部接続電極が導体からなる
    バンプを有し、該バンプの側面を覆って樹脂層が形成さ
    れていることを特徴とするチップキャリア。
  2. 【請求項2】 前記樹脂層をバンプ周囲に凸状に形成
    し、該バンプの先端部を露出させている請求項1記載の
    チップキャリア。
  3. 【請求項3】 前記樹脂層を絶縁性基板の裏面に層状に
    形成し、前記バンプの先端部を露出させている請求項1
    記載のチップキャリア。
  4. 【請求項4】 前記バンプが半田ボールからなる請求項
    1又は2に記載のチップキャリア。
  5. 【請求項5】 前記バンプがSn、Cu、Ag、Au、
    またはNiのうちの1種以上を主成分とする導体からな
    る請求項1〜3のいずれか1項に記載のチップキャリ
    ア。
  6. 【請求項6】 前記バンプのチップキャリア側から少な
    くとも20%以上の高さまで樹脂層にて覆っている請求
    項1〜5のいずれか1項に記載のチップキャリア。
  7. 【請求項7】 絶縁性基板の表面に半導体素子の電極に
    接続する接続配線を設け、回路配線基板の接続電極に接
    続するためのバンプを有する外部接続電極を前記絶縁性
    基板の裏面に形成し、前記外部接続電極の側面部をペー
    スト状の樹脂により覆い、しかる後、前記樹脂ペースト
    が硬化する温度で熱処理することにより樹脂層を形成す
    ることを特徴とするチップキャリアの製造方法。
  8. 【請求項8】 前記外部接続電極間にペースト状の樹脂
    を流し込み、しかる後、前記樹脂ペーストが硬化する温
    度で熱処理することにより樹脂層を形成する請求項7に
    記載のチップキャリアの製造方法。
  9. 【請求項9】 前記外部接続電極の形成された裏面に熱
    を供給して、樹脂を流し込んで樹脂層を形成する請求項
    7に記載のチップキャリアの製造方法。
  10. 【請求項10】 前記バンプからなる外部接続電極の形
    成された裏面をペースト状の樹脂中に浸漬し、しかる
    後、前記チップキャリアを樹脂中から取り出し、前記樹
    脂が硬化する温度で熱処理して樹脂層を形成し、その
    後、該樹脂層形成面を前記バンプが出現するまで加工す
    る請求項7に記載のチップキャリアの製造方法。
  11. 【請求項11】 前記外部接続電極面に樹脂を噴射し、
    前記外部接続電極面に樹脂層を形成し、その後、該樹脂
    層形成面を前記バンプが出現するまで加工する請求項7
    に記載のチップキャリアの製造方法。
  12. 【請求項12】 前記バンプが出現するまで研磨にて加
    工する請求項10または11に記載のチップキャリアの
    製造方法。
  13. 【請求項13】 前記導体箔上に半田バンプを形成する
    ことにより外部接続電極を形成するに際し、スクリーン
    印刷により前記導体箔の表面を露出させて樹脂ペースト
    を塗布して樹脂層を形成し、該樹脂層が硬化する温度で
    熱処理した後、前記導体箔上に半田ペーストを塗布し、
    半田ペーストが溶融する温度で熱処理して半田バンプを
    形成する請求項7に記載のチップキャリアの製造方法。
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