JPH0833311A - 複数個直列接続自己消弧形サイリスタの素子異常検知装置 - Google Patents
複数個直列接続自己消弧形サイリスタの素子異常検知装置Info
- Publication number
- JPH0833311A JPH0833311A JP18784194A JP18784194A JPH0833311A JP H0833311 A JPH0833311 A JP H0833311A JP 18784194 A JP18784194 A JP 18784194A JP 18784194 A JP18784194 A JP 18784194A JP H0833311 A JPH0833311 A JP H0833311A
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- Japan
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- circuit
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Abstract
(57)【要約】
【目的】各ゲート回路内に有する格別な故障検出回路で
複数個直列接続素子それぞれの異常検知を行う複数個直
列接続自己消弧形サイリスタの素子異常検知装置を提供
するものである。 【構成】直列接続された各自己消弧形サイリスタのゲー
ト回路内に、ゲートオフ信号指令出力レベルとゲートオ
フスイツチ出力側のバイアス電圧レベルを比較する手段
を設け、この比較手段出力を故障検出信号として得るよ
うに構成したものである。
複数個直列接続素子それぞれの異常検知を行う複数個直
列接続自己消弧形サイリスタの素子異常検知装置を提供
するものである。 【構成】直列接続された各自己消弧形サイリスタのゲー
ト回路内に、ゲートオフ信号指令出力レベルとゲートオ
フスイツチ出力側のバイアス電圧レベルを比較する手段
を設け、この比較手段出力を故障検出信号として得るよ
うに構成したものである。
Description
【0001】
【産業上の利用分野】本発明は高圧大容量電力変換器に
おける素子の異常検知を行う複数個直列接続自己消弧形
サイリスタの素子異常検知装置に関するものである。
おける素子の異常検知を行う複数個直列接続自己消弧形
サイリスタの素子異常検知装置に関するものである。
【0002】
【従来の技術】高圧大容量電力変換器においては、GT
OサイリスタやSIサイリスタである自己消弧形サイリ
スタ(以下素子と称する)の複数個を直列に接続した冗
長性の高い方式によるものが適用されている。かような
複数個直列接続された素子群にあって、素子の1個が故
障したとき、残りの素子の分担電圧が増大して過電圧が
付勢され、したがって素子が破壊することがある。この
種の故障検出装置として、図5に示すものが知られてい
る。
OサイリスタやSIサイリスタである自己消弧形サイリ
スタ(以下素子と称する)の複数個を直列に接続した冗
長性の高い方式によるものが適用されている。かような
複数個直列接続された素子群にあって、素子の1個が故
障したとき、残りの素子の分担電圧が増大して過電圧が
付勢され、したがって素子が破壊することがある。この
種の故障検出装置として、図5に示すものが知られてい
る。
【0003】図5は従来例を説明するため示した高圧大
容量の電力変換器の部分構成を示し、11,12,13は3個
直列接続例の素子、2は制御回路、3は素子11,12,13
にそれぞれ配されたゲート回路である。素子11において
はAはアノード、Kはカソード、Gはゲートを示す。ま
た、41,42,43は素子11,12,13にそれぞれ並列接続さ
れた発光ダイオードである。
容量の電力変換器の部分構成を示し、11,12,13は3個
直列接続例の素子、2は制御回路、3は素子11,12,13
にそれぞれ配されたゲート回路である。素子11において
はAはアノード、Kはカソード、Gはゲートを示す。ま
た、41,42,43は素子11,12,13にそれぞれ並列接続さ
れた発光ダイオードである。
【0004】すなわち、制御回路2の制御信号 211, 2
12, 213を得るゲート回路31,32,33による素子11,1
2,13による高圧大容量電力変換器については公知であ
りここでの説明は省略するが、その素子部の故障検出を
行うものは、各素子11,12,13の(A−K)間に設けら
れた各発光ダイオード(フォトカプラ)41,42,43が発
する光信号 411, 421, 431を、光ファイバを通し、制
御回路2にて電気信号に変換のうえその電気信号の状態
により、故障を監視するものとなっている。
12, 213を得るゲート回路31,32,33による素子11,1
2,13による高圧大容量電力変換器については公知であ
りここでの説明は省略するが、その素子部の故障検出を
行うものは、各素子11,12,13の(A−K)間に設けら
れた各発光ダイオード(フォトカプラ)41,42,43が発
する光信号 411, 421, 431を、光ファイバを通し、制
御回路2にて電気信号に変換のうえその電気信号の状態
により、故障を監視するものとなっている。
【0005】
【発明が解決しようとする課題】この種の従来技術にお
いては、高電圧が印加される主回路側の素子11,12,13
の端子間に並列に発光ダイオード41,42,43を取り付け
る際、高圧回路部分に近い所あるいは少し離れた所に発
光ダイオードを取り付け、さらにそこから発光ダイオー
ドが発する光を光ファイバで検出する。そのため、素子
の端子間から発光ダイオードまでの配線にも高圧が印加
され、したがって危険を伴うものであった。また、かよ
うにして素子の周辺の配線も複雑なものとなっていた。
いては、高電圧が印加される主回路側の素子11,12,13
の端子間に並列に発光ダイオード41,42,43を取り付け
る際、高圧回路部分に近い所あるいは少し離れた所に発
光ダイオードを取り付け、さらにそこから発光ダイオー
ドが発する光を光ファイバで検出する。そのため、素子
の端子間から発光ダイオードまでの配線にも高圧が印加
され、したがって危険を伴うものであった。また、かよ
うにして素子の周辺の配線も複雑なものとなっていた。
【0006】
【課題を解決するための手段】本発明は上述したような
点に鑑みなされたものであって、高圧大容量電力変換器
を構成する複数個直列接続素子の各々の(ゲートとカソ
ード)間に接続した各ゲート回路の内部に、オフ信号指
令とゲートオフスイッチ出力側との比較により格別な故
障検出信号を得るとともに、かような各ゲート回路から
制御回路に信号出力し得るように構成してなるものであ
る。
点に鑑みなされたものであって、高圧大容量電力変換器
を構成する複数個直列接続素子の各々の(ゲートとカソ
ード)間に接続した各ゲート回路の内部に、オフ信号指
令とゲートオフスイッチ出力側との比較により格別な故
障検出信号を得るとともに、かような各ゲート回路から
制御回路に信号出力し得るように構成してなるものであ
る。
【0007】
【作用】かかる解決手段により、つぎのごとき作用効果
が得られる。すなわち、各ゲート回路において素子が正
常なオフでは素子の(ゲートとカソード)間にオフバイ
アスをかけ、ドライバ出力のオフ信号指令とゲートオフ
信号の比較により、故障であるかどうかを判断できる。
故障と判断されたとき、その故障検出信号が制御回路に
送信されるものとなる。以下に、本発明を図面に基づい
てさらに詳細説明する。
が得られる。すなわち、各ゲート回路において素子が正
常なオフでは素子の(ゲートとカソード)間にオフバイ
アスをかけ、ドライバ出力のオフ信号指令とゲートオフ
信号の比較により、故障であるかどうかを判断できる。
故障と判断されたとき、その故障検出信号が制御回路に
送信されるものとなる。以下に、本発明を図面に基づい
てさらに詳細説明する。
【0008】
【実施例】図1は本発明の技術思想の理解を容易にする
ため図5に類して示したもので、5は制御回路、61,6
2,63はゲート回路である。ここで、制御回路5の制御
信号 511, 512, 513を得るゲート回路61,62,63のそ
れぞれが、素子11,12,13をドライブして高圧大容量電
力変換器として奏する点は、図5と同様である。
ため図5に類して示したもので、5は制御回路、61,6
2,63はゲート回路である。ここで、制御回路5の制御
信号 511, 512, 513を得るゲート回路61,62,63のそ
れぞれが、素子11,12,13をドライブして高圧大容量電
力変換器として奏する点は、図5と同様である。
【0009】そして、かかる各ゲート回路および制御回
路においては、各ゲート回路61,62,63の内部に故障検
出回路 611, 621, 631が配されてなり、各故障検出回
路より故障検出信号 612, 622, 632が制御回路5に出
力され、したがって制御回路5は故障を監視できるもの
である。これを、図2〜図4を参照して説明する。
路においては、各ゲート回路61,62,63の内部に故障検
出回路 611, 621, 631が配されてなり、各故障検出回
路より故障検出信号 612, 622, 632が制御回路5に出
力され、したがって制御回路5は故障を監視できるもの
である。これを、図2〜図4を参照して説明する。
【0010】図2は故障検出回路を有するゲート回路の
一例を示すもので、7は図1に示される各ゲート回路6
1,62,63に相当して効用可能なゲート回路である。ゲ
ート回路7において、71はオンバイアス電源、72はオフ
バイアス電源、73はドライバ、74,75はFETを用いた
スイッチ、76は故障検出回路である。すなわち、ゲート
回路7においては、制御回路5より出力された制御信号
511がドライバ73に入力される。そして、オン信号時に
はゲートオン指令に基づくゲートオン信号 731によりス
イッチ74をオンさせ、オンバイアス電源71の電圧を素子
11の(G−K)間に印加する。また、オフ信号時にはゲ
ートオフ信号指令 733に基づき発生されるゲートオフ信
号 732によりスイッチ75をオンさせ、オフバイアス電源
72を(G−K)間に印加し、素子11をオフ状態にする。
さらには、ゲート回路7内にスイッチ75側(FETのG
−D間)に故障検出回路76が並列に接続される。 760は
故障検出信号である。これを、図3および図4に示す。
一例を示すもので、7は図1に示される各ゲート回路6
1,62,63に相当して効用可能なゲート回路である。ゲ
ート回路7において、71はオンバイアス電源、72はオフ
バイアス電源、73はドライバ、74,75はFETを用いた
スイッチ、76は故障検出回路である。すなわち、ゲート
回路7においては、制御回路5より出力された制御信号
511がドライバ73に入力される。そして、オン信号時に
はゲートオン指令に基づくゲートオン信号 731によりス
イッチ74をオンさせ、オンバイアス電源71の電圧を素子
11の(G−K)間に印加する。また、オフ信号時にはゲ
ートオフ信号指令 733に基づき発生されるゲートオフ信
号 732によりスイッチ75をオンさせ、オフバイアス電源
72を(G−K)間に印加し、素子11をオフ状態にする。
さらには、ゲート回路7内にスイッチ75側(FETのG
−D間)に故障検出回路76が並列に接続される。 760は
故障検出信号である。これを、図3および図4に示す。
【0011】図3および図4は故障検出回路の一例をお
よびその信号出力のタイミングチャートをそれぞれ示す
もので、 761はフォトカプラ、 762は比較器である。図
3は示す故障検出回路76において、フォトカプラ 761は
オフバイアスのためのスイッチ75へのゲートオフ信号 7
32を検知する。比較器 762は、ゲートオフ信号 732を一
方の入力とし、またドライバ73にて制御信号 511入力よ
りオフ時に得られるゲートオフ信号指令 733を他方の入
力とし、両者を比較のうえ、異常があった場合には故障
検出信号 760を発生する。つまり図4に示した如く、ゲ
ートオフ信号指令 733が「H」,ゲートオフ信号732が
「L」,ゲートオフ信号指令 733が「L」でゲートオフ
信号 732が「H」のときは正常とする。ゲートオフ信号
733が「L」でゲートオフ信号 732「L」のとき素子に
異常があったものとみなし、故障検出信号 760は「L」
から「H」に変わり、信号発生し得る。
よびその信号出力のタイミングチャートをそれぞれ示す
もので、 761はフォトカプラ、 762は比較器である。図
3は示す故障検出回路76において、フォトカプラ 761は
オフバイアスのためのスイッチ75へのゲートオフ信号 7
32を検知する。比較器 762は、ゲートオフ信号 732を一
方の入力とし、またドライバ73にて制御信号 511入力よ
りオフ時に得られるゲートオフ信号指令 733を他方の入
力とし、両者を比較のうえ、異常があった場合には故障
検出信号 760を発生する。つまり図4に示した如く、ゲ
ートオフ信号指令 733が「H」,ゲートオフ信号732が
「L」,ゲートオフ信号指令 733が「L」でゲートオフ
信号 732が「H」のときは正常とする。ゲートオフ信号
733が「L」でゲートオフ信号 732「L」のとき素子に
異常があったものとみなし、故障検出信号 760は「L」
から「H」に変わり、信号発生し得る。
【0012】これをさらに具体的に説明すると、ゲート
回路7においては、素子11が正常でオフにて素子11の
(G−K)間にバイアスをかけ、オフバイアス電圧を供
給するスイッチ75の(G−S)間にも(+5V)程度の
ゲートオフ信号 732をドライバ73より出力させる。これ
より、素子11の故障時には(G−K)間にはバイアスが
かからなくなって、スイッチ75の(G−S)間のゲート
オフ信号 732も(OV)となり、故障検出信号 760を得
ることができる。
回路7においては、素子11が正常でオフにて素子11の
(G−K)間にバイアスをかけ、オフバイアス電圧を供
給するスイッチ75の(G−S)間にも(+5V)程度の
ゲートオフ信号 732をドライバ73より出力させる。これ
より、素子11の故障時には(G−K)間にはバイアスが
かからなくなって、スイッチ75の(G−S)間のゲート
オフ信号 732も(OV)となり、故障検出信号 760を得
ることができる。
【0013】さらには、かかる実施例はつぎの如きもの
であることは論ずるまでもない。 (1) ゲート回路内の故障検出回路によりそれぞれ素
子破壊で短絡状態になったことを制御回路で得られ、装
置として残りの素子を全てオン状態にて電流を別の保護
装置によるしゃ断のうえ素子にゲートブロックをかける
ことや、それぞれの故障検出信号を受けてから残りの素
子にゲートブロックをかけて装置を停止させることな
ど、回路構成によりいかようにも容易に適用し得る。 (2) 各ゲート回路にてゲート回路を動作させる電源
が故障した場合にはスイッチの(D−S)間に信号電圧
は出力されず短絡状態となって故障検出回路にてレベル
検出し、ゲート回路を動作させる電源が喪失した場合に
は素子にゲート信号が送られず素子にはオフバイアスが
かからなくなり、残りの素子の分担電圧の増加による過
電圧から素子破壊する恐れがあることを防ぎ、装置停止
を行うことができる。 (3) 制御回路の故障あるいは制御回路からゲート回
までの配線の短絡などにより、各素子のゲート回路への
制御信号の送信不能になっても、前述したような過電圧
保護を実現できる。
であることは論ずるまでもない。 (1) ゲート回路内の故障検出回路によりそれぞれ素
子破壊で短絡状態になったことを制御回路で得られ、装
置として残りの素子を全てオン状態にて電流を別の保護
装置によるしゃ断のうえ素子にゲートブロックをかける
ことや、それぞれの故障検出信号を受けてから残りの素
子にゲートブロックをかけて装置を停止させることな
ど、回路構成によりいかようにも容易に適用し得る。 (2) 各ゲート回路にてゲート回路を動作させる電源
が故障した場合にはスイッチの(D−S)間に信号電圧
は出力されず短絡状態となって故障検出回路にてレベル
検出し、ゲート回路を動作させる電源が喪失した場合に
は素子にゲート信号が送られず素子にはオフバイアスが
かからなくなり、残りの素子の分担電圧の増加による過
電圧から素子破壊する恐れがあることを防ぎ、装置停止
を行うことができる。 (3) 制御回路の故障あるいは制御回路からゲート回
までの配線の短絡などにより、各素子のゲート回路への
制御信号の送信不能になっても、前述したような過電圧
保護を実現できる。
【0014】
【発明の効果】以上説明したように本発明によれば、複
数個直列接続される素子の1個が破壊しても、ゲート回
路内の低圧部で異常検知し得ることで高圧分圧等も必要
なくなり、かような各素子の異常検知から残りの素子の
過電圧保護等を含めていかようにも簡単かつ容易に実施
可能にした簡便な構成の装置を提供できる。
数個直列接続される素子の1個が破壊しても、ゲート回
路内の低圧部で異常検知し得ることで高圧分圧等も必要
なくなり、かような各素子の異常検知から残りの素子の
過電圧保護等を含めていかようにも簡単かつ容易に実施
可能にした簡便な構成の装置を提供できる。
【図1】図1は本発明の技術思想の理解を容易にするた
め示した系統図である。
め示した系統図である。
【図2】図2は本発明によるゲート回路の一実施例の要
部構成を示す系統図である。
部構成を示す系統図である。
【図3】図3は図2の故障検出回路の一例を示す系統図
である。
である。
【図4】図4は図3の説明のため示したタイミングチャ
ートである。
ートである。
【図5】図5は従来例の電力変換器の部分構成を示す系
統図である。
統図である。
11 自己消弧形サイリスタ(素子) 12 自己消弧形サイリスタ(素子) 13 自己消弧形サイリスタ(素子) 2 制御回路 31 ゲート回路 32 ゲート回路 33 ゲート回路 41 発光ダイオード 42 発光ダイオード 43 発光ダイオード 5 制御回路 61 ゲート回路 62 ゲート回路 63 ゲート回路 611 故障検出回路 612 故障検出回路 613 故障検出回路 7 ゲート回路 71 オンバイアス電源 72 オフバイアス電源 73 ドライバ 74 スイッチ 75 スイッチ 76 故障検出回路 761 フォトカプラ 762 比較器
Claims (1)
- 【請求項1】 複数個直列に接続された自己消弧形サイ
リスタからなる電力変換器において、直列接続された各
自己消弧形サイリスタのゲート回路内に、ゲートオフ信
号指令出力レベルとゲートオフスイッチ出力側のバイア
ス電圧レベルを比較する手段を設け、該比較する手段出
力を故障検出信号として得るようにしたことを特徴とす
る複数個直列接続自己消弧形サイスリタの素子異常検知
装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18784194A JPH0833311A (ja) | 1994-07-18 | 1994-07-18 | 複数個直列接続自己消弧形サイリスタの素子異常検知装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP18784194A JPH0833311A (ja) | 1994-07-18 | 1994-07-18 | 複数個直列接続自己消弧形サイリスタの素子異常検知装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH0833311A true JPH0833311A (ja) | 1996-02-02 |
Family
ID=16213172
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP18784194A Pending JPH0833311A (ja) | 1994-07-18 | 1994-07-18 | 複数個直列接続自己消弧形サイリスタの素子異常検知装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0833311A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7352233B1 (en) * | 2004-06-14 | 2008-04-01 | Otward Mueller | Efficient thyristor-type power switches |
-
1994
- 1994-07-18 JP JP18784194A patent/JPH0833311A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7352233B1 (en) * | 2004-06-14 | 2008-04-01 | Otward Mueller | Efficient thyristor-type power switches |
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