JPH09200169A - データセレクタ回路 - Google Patents

データセレクタ回路

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Publication number
JPH09200169A
JPH09200169A JP692396A JP692396A JPH09200169A JP H09200169 A JPH09200169 A JP H09200169A JP 692396 A JP692396 A JP 692396A JP 692396 A JP692396 A JP 692396A JP H09200169 A JPH09200169 A JP H09200169A
Authority
JP
Japan
Prior art keywords
selector
data
signal
flop
flip
Prior art date
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Pending
Application number
JP692396A
Other languages
English (en)
Inventor
Kazuya Kikuchi
一哉 菊池
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Engineering Ltd
Original Assignee
NEC Engineering Ltd
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Filing date
Publication date
Application filed by NEC Engineering Ltd filed Critical NEC Engineering Ltd
Priority to JP692396A priority Critical patent/JPH09200169A/ja
Publication of JPH09200169A publication Critical patent/JPH09200169A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】 【課題】 必要なデータのみを選択することができ、ま
た動作速度が速いデータセレクタ回路を提供する。 【解決手段】 データセレクタ回路10を、第1のセレ
クタ11と第2のセレクタ12とで構成する。セレクタ
11は、OHセレクト信号に応じて各チャンネルの有効
データのみを選択して多重化することで多重OH信号を
生成するセレクタ手段13と、多重OH信号を低速側ク
ロックCLK1でリタイミングするフリップフロップ1
4と、多重OH信号をOHセレクト信号に従って所定の
フォーマットに応じた順番に並べ替え、さらに特定の選
択OH信号を分離するシリアル/パラレル変換部15と
を備える。第2のセレクタ12は、選択OH信号21〜
26と主信号とから選択して多重化するセレクタ16
と、選択後の信号を高速側クロックCLK2でリタイミ
ングするフリップフロップ17とを備える。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は、音声データと映像
データとの多重化データから必要なデータを選択して1
つのデータを作成するために使用されるデータセレクタ
回路に関する。
【0002】
【従来の技術】従来のこの種のデータセレクタ回路に関
して、例えば、特開平4−151921号公報に記載さ
れたものが知られている。この公報には、速度変換され
た複数のチャンネルの音声データと映像データとを多重
化する音声データ多重化装置において、多重化された複
数チャンネルの音声データのうち有効データのみを抽出
して多重化するセレクタと、このセレクタによって多重
化されたデータを書き込み、読み出すことにより各チャ
ンネルの音声データを所定フォーマットに従って並べ替
えて記憶するメモリと、このメモリ内の音声データ及び
映像データから必要なデータを選択することによって多
重化信号を作成するセレクタとから構成した音声データ
多重化装置が開示されている。
【0003】
【発明が解決しようとする課題】ところが、上記公報に
記載された技術の場合、送信データ中から必要なデータ
のみを選択、分離することができない。さらに、音声デ
ータを速度変換して多重データのフォーマットに並び替
えるためには、例えばFIFO等のメモリを必要とし、
またこのメモリの動作速度が遅いことから、例えば60
0MHzなどの高速動作が必要な場合には適用できない
という問題がある。
【0004】そこで本発明の課題は、必要なデータのみ
を選択することができ、また動作速度が速いデータセレ
クタ回路を提供することにある。
【0005】
【課題を解決するための手段】本発明のデータセレクタ
回路は、上記の課題を解決するため、音声データから有
効データを抽出して所定のフォーマットに並び替える第
1のセレクタと、前記音声データと主信号とを選択して
多重化データを生成する第2のセレクタと、を備えて成
る。
【0006】より具体的には、前記第1のセレクタは、
チャンネルセレクト信号に応じて有効データのみを選択
するセレクタ手段と、選択された信号を低速クロックで
リタイミングするフリップフロップと、リタイミング後
の信号を音声セレクト信号に従って多重データのフォー
マットに応じた時間順位で並べ替え、特定の選択音声信
号に分離するシリアル/パラレル変換部とを備えてい
る。また、前記第2のセレクタは、音声/主信号セレク
ト信号に従って選択音声信号と主信号とから必要なデー
タのみを選択して多重化するセレクタ手段と、選択後の
信号を高速クロックでリタイミングするフリップフロッ
プとを備えている。
【0007】すなわち、本発明では、入力された音声デ
ータの中から有効データを抽出し、主信号と多重してシ
リアルデータを生成するようにしたものである。そし
て、比較的高速動作が可能であるフリップフロップとセ
レクタとから構成されるため、回路全体で、例えば15
0MHzや600MHzなどでの高速動作が可能とな
る。
【0008】
【発明の実施の形態】以下に、本発明の実施の形態のデ
ータセレクタ回路を図面を参照して説明する。図1に示
すように、このデータセレクタ回路は、有効データの位
置が予めチャンネル順に時間的に遅らせるように速度変
換された音声データなどの音声信号C1〜C4(#1O
H信号〜#4OH信号)から有効データを抽出し、この
有効データを所定のフォーマットに並び替える第1のセ
レクタ11、第1のセレクタ11により並び替えがされ
たこの特定のデータのみを選択して、これと従来の映像
データに相当する主信号とを多重化して多重データD2
を生成する第2のセレクタ12とを備えている。
【0009】セレクタ11は、図2,図3に示すよう
に、OHセレクト信号に応じて各チャンネルのOHデー
タSnm(N=1,2,…、m=1,2,…6)のみを
選択して多重化することにより多重OH信号を生成する
セレクタ手段13と、この多重OH信号D1を低速側ク
ロックCLK1でリタイミングするフリップフロップ1
4と、多重OH信号をOHセレクト信号1〜6に従って
所定のフォーマットの配置に応じた順番に並べ替え、選
択OH信号31〜36を分離するシリアル/パラレル変
換部15とを備えている。
【0010】シリアル/パラレル変換部15は、図3に
示すように、多重OH信号D1をOHセレクト信号1〜
6で選択する複数のセレクタ(SEL)群15aと、所
定のフォーマットの配置に応じた順番に並び替えるフリ
ップフロップ(FF)群15bと、選択OH信号31〜
36を選択するフリップフロップ(FF)15c群とで
構成されている。
【0011】第2のセレクタ12は、選択OH信号31
〜36と主信号Dmとから選択して多重化するセレクタ
16と、選択後の信号を高速側クロックCLK2でリタ
イミングするフリップフロップ17とを備えている。
【0012】次に、この実施の形態のデータセレクタ回
路の動作を説明する。まず、第1のセレクタにおいて第
1のセレクタ手段13が、予め速度変換されたOH信号
#1〜4から有効データを抽出し、多重化して多重OH
信号D1を生成する。この多重OH信号D1をフリップ
フロップ14が低速側クロックCLK1で低速度にリタ
イミングする。シリアル/パラレル変換部15は、この
多重OH信号D1をフォーマットに合わせた時間順位で
パラレルに並べ替え、このデータ群から選択OH信号3
1〜36を選択する。
【0013】次に、第2のセレクタ12において第2の
セレクタ手段16が、選択OH信号31〜36等と主信
号Dmとを合わせた単位周期tの間、選択OH信号が変
化しないようにするため、OH/主信号セレクト信号に
応じて選択して、連続した六つのOH信号Snmと主信
号とが交互に並ぶフォーマットに形成する。最後にフリ
ツプフロップ17が高速側クロックCLK2でリタイミ
ングすることによって多重OH/主信号D2を生成す
る。
【0014】
【発明の効果】以上の説明から明らかなように、本発明
によれば、必要なデータのみを選択することができ、ま
た動作速度が速いデータセレクタ回路を提供することが
できる。
【図面の簡単な説明】
【図1】本発明の実施の形態に係るデータセレクタ回路
のブロック構成図。
【図2】図1のデータセレクタ回路のより詳細な構成を
示したブロック図。
【図3】図2のシリアル/パラレル変換部の詳細な構成
を示したブロック図。
【図4】本実施形態のデータセレクタ回路におけるデー
タ信号を示したタイムチャート。
【符号の説明】
1〜6 OHセレクト信号 11 第1のセレクタ 12 第2のセレクタ 13 セレクタ手段 14 フリップフロップ 15 シリアル/パラレル変換部 16 セレクタ手段 17 フリップフロップ 21〜26 選択OH信号 C1〜C4 OH信号 D1 多重OHデータ D2 多重データ

Claims (2)

    【特許請求の範囲】
  1. 【請求項1】 音声データから有効データを抽出して所
    定のフォーマットに並び替える第1のセレクタと、 前記並び替えがされた音声データと主信号とを選択して
    多重データを生成する第2のセレクタと、を備えて成る
    データセレクタ回路。
  2. 【請求項2】 前記第1のセレクタは、チャンネルセレ
    クト信号に応じて有効データのみを選択するセレクタ手
    段と、前記選択された信号を低速クロックでリタイミン
    グするフリップフロップと、前記リタイミング後の信号
    を多重データのフォーマットに応じた時間順位で並べ替
    えて特定の選択音声信号に分離するシリアル/パラレル
    変換部と、を備え、 前記第2のセレクタは、音声/主信号セレクト信号に従
    って選択音声信号と主信号とから必要なデータのみを選
    択して多重化するセレクタ手段と、選択後の信号を高速
    クロックでリタイミングするフリップフロップと、を備
    えることを特徴とする請求項1記載のデータセレクタ回
    路。
JP692396A 1996-01-18 1996-01-18 データセレクタ回路 Pending JPH09200169A (ja)

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JP692396A JPH09200169A (ja) 1996-01-18 1996-01-18 データセレクタ回路

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JP692396A JPH09200169A (ja) 1996-01-18 1996-01-18 データセレクタ回路

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JPH09200169A true JPH09200169A (ja) 1997-07-31

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ID=11651774

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