JPH09213088A - エンジン制御装置 - Google Patents
エンジン制御装置Info
- Publication number
- JPH09213088A JPH09213088A JP1735796A JP1735796A JPH09213088A JP H09213088 A JPH09213088 A JP H09213088A JP 1735796 A JP1735796 A JP 1735796A JP 1735796 A JP1735796 A JP 1735796A JP H09213088 A JPH09213088 A JP H09213088A
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- JP
- Japan
- Prior art keywords
- voltage
- write
- microcomputer
- flash memory
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Abstract
(57)【要約】
【課題】装置外部から書き込み電圧を供給するフラッシ
ュメモリ内蔵の電子制御装置において、書き込み電圧が
正確に供給されなかったとき、フラッシュメモリの誤書
き込みの発生を防ぐ。 【解決手段】フラッシュメモリ２ｄを内蔵した制御装置
１に書き込み電圧のモニタ回路９を設け、書き込み電圧
が公差外のときは、マイコン２へ異常信号を出力する。
ュメモリ内蔵の電子制御装置において、書き込み電圧が
正確に供給されなかったとき、フラッシュメモリの誤書
き込みの発生を防ぐ。 【解決手段】フラッシュメモリ２ｄを内蔵した制御装置
１に書き込み電圧のモニタ回路９を設け、書き込み電圧
が公差外のときは、マイコン２へ異常信号を出力する。
Description
【０００１】
【発明の属する技術分野】本発明は、エンジンの電子制
御装置に関する。
御装置に関する。
【０００２】
【従来の技術】従来、特願平6−284758 号明細書にある
ように電気的にデータの消去及び書き込みが可能な不揮
発性メモリ（以下フラッシュメモリ）を内蔵し、外部装
置との通信により、そのフラッシュメモリにデータの書
き込みが行える制御装置が発明されている。
ように電気的にデータの消去及び書き込みが可能な不揮
発性メモリ（以下フラッシュメモリ）を内蔵し、外部装
置との通信により、そのフラッシュメモリにデータの書
き込みが行える制御装置が発明されている。
【０００３】
【発明が解決しようとする課題】ある種類のフラッシュ
メモリでは、データの書き込みにフラッシュメモリの電
源電圧５ｖとは別に書き込み電圧１２ｖが必要である。
この書き込み電圧は、制御装置内部で５ｖから昇圧回路
で作る方法と、制御装置外部から供給する方法がある。
外部から供給する方法は、昇圧回路が不要なため回路構
成が簡素化できるが、供給電圧が正確に供給されないと
書き込みが正常に行えない恐れがある。
メモリでは、データの書き込みにフラッシュメモリの電
源電圧５ｖとは別に書き込み電圧１２ｖが必要である。
この書き込み電圧は、制御装置内部で５ｖから昇圧回路
で作る方法と、制御装置外部から供給する方法がある。
外部から供給する方法は、昇圧回路が不要なため回路構
成が簡素化できるが、供給電圧が正確に供給されないと
書き込みが正常に行えない恐れがある。
【０００４】
【課題を解決するための手段】これを防ぐためには、制
御装置外部から供給される書き込み電圧のモニタ回路を
制御装置内に設け、そのモニタ回路の出力をフラッシュ
メモリの書き込みを制御するＣＰＵへ入力し、書き込み
電圧が正確に供給されているかＣＰＵで判別できる構成
とする。
御装置外部から供給される書き込み電圧のモニタ回路を
制御装置内に設け、そのモニタ回路の出力をフラッシュ
メモリの書き込みを制御するＣＰＵへ入力し、書き込み
電圧が正確に供給されているかＣＰＵで判別できる構成
とする。
【０００５】上記構成により、外部から供給される書き
込み電圧が正確に供給されなかったときは、ＣＰＵはフ
ラッシュメモリの書き込み動作を行わず、フラッシュメ
モリへの誤書き込みを防止することができる。
込み電圧が正確に供給されなかったときは、ＣＰＵはフ
ラッシュメモリの書き込み動作を行わず、フラッシュメ
モリへの誤書き込みを防止することができる。
【０００６】
【発明の実施の形態】以下、本発明の一実施例を図面を
用いて説明する。
用いて説明する。
【０００７】図１は本発明の構成を示す回路図である。
エンジン制御装置１はマイクロコンピュータ（以下マイ
コン）２，５ｖ電源回路３及びここには図示しない入出
力処理回路により構成される。マイコン２はＣＰＵ２
ａ，ＲＡＭ２ｂ，シリアルコミュニケーションインター
フェイス（以下ＳＣＩ）２ｃ、そして電気的に消去，書
き込みが可能なフラッシュメモリ２ｄを内蔵している。
５ｖ電源回路３はバッテリ４から、イグニッションスイ
ッチ５によりオン／オフするリレー６を介して入力され
るバッテリ電圧ＶＢを５ｖに変換し、マイコン２の電源
ＶＣＣや、ここには図示しない入出力処理回路に５ｖを
供給する。また、５ｖ電源回路３は、エンジン制御装置
１にＶＢが供給された後、マイコン２のクロックを発生
する。ここには図示しない発振子の発振が安定するまで
の時間、ＲＥＳラインをＬｏに保持することによりマイ
コン２をリセットするパワーオンリセット機能を持って
いる。
エンジン制御装置１はマイクロコンピュータ（以下マイ
コン）２，５ｖ電源回路３及びここには図示しない入出
力処理回路により構成される。マイコン２はＣＰＵ２
ａ，ＲＡＭ２ｂ，シリアルコミュニケーションインター
フェイス（以下ＳＣＩ）２ｃ、そして電気的に消去，書
き込みが可能なフラッシュメモリ２ｄを内蔵している。
５ｖ電源回路３はバッテリ４から、イグニッションスイ
ッチ５によりオン／オフするリレー６を介して入力され
るバッテリ電圧ＶＢを５ｖに変換し、マイコン２の電源
ＶＣＣや、ここには図示しない入出力処理回路に５ｖを
供給する。また、５ｖ電源回路３は、エンジン制御装置
１にＶＢが供給された後、マイコン２のクロックを発生
する。ここには図示しない発振子の発振が安定するまで
の時間、ＲＥＳラインをＬｏに保持することによりマイ
コン２をリセットするパワーオンリセット機能を持って
いる。
【０００８】外部書き込み装置１０はエンジン制御装置
１に外部書き込み電圧ＶＰを供給する１２ｖ電源回路１
０ｂと、書き込みデータをシリアル通信で供給するため
のＳＣＩ回路１０ａ及び、書き込み結果を表示する表示
器１０ｃを内蔵している。次に、フラッシュメモリ２ｄ
へのデータ書き込み方法を説明する。
１に外部書き込み電圧ＶＰを供給する１２ｖ電源回路１
０ｂと、書き込みデータをシリアル通信で供給するため
のＳＣＩ回路１０ａ及び、書き込み結果を表示する表示
器１０ｃを内蔵している。次に、フラッシュメモリ２ｄ
へのデータ書き込み方法を説明する。
【０００９】マイコン２は電源ＶＣＣを供給した状態
で、Ｖｐｐに１２ｖを印加し、ＲＥＳ信号をＬｏからＨ
ｉとすることで、フラッシュメモリ消去，書き込みモー
ドに入る。そのモードに入ると、外部書き込み装置１０
から書き込みアドレスとデータをＳＣＩ２ｃを介して受
け取り、フラッシュメモリ２ｄの該当アドレス部分を消
去、データの書き込みを行う。
で、Ｖｐｐに１２ｖを印加し、ＲＥＳ信号をＬｏからＨ
ｉとすることで、フラッシュメモリ消去，書き込みモー
ドに入る。そのモードに入ると、外部書き込み装置１０
から書き込みアドレスとデータをＳＣＩ２ｃを介して受
け取り、フラッシュメモリ２ｄの該当アドレス部分を消
去、データの書き込みを行う。
【００１０】図２にフラッシュメモリ２ｄの消去，書き
込みを行う条件を示す。
込みを行う条件を示す。
【００１１】マイコン２へのＶｐｐの供給タイミング
が、ＶＣＣの供給より先になり、マイコン２にＶｐｐの
み印加される状態となると、フラッシュメモリ２ｄへの
誤書き込みの発生や、マイコン２へダメージを与える恐
れがある。ＣＰＵ２のＶｐｐへの１２ｖの供給は、外部
書き込み装置１０からエンジン制御装置１のＶＰへ１２
ｖが入力された状態で、トランジスタ８をオンとするこ
とにより行われるが、図１の実施例では、ＶＣＣ＞４.
７ｖ でトランジスタ８をオンさせる電圧検出回路７に
より、ＶＣＣが供給されていない状態で、Ｖｐｐのみマ
イコン２へ供給されることを防ぐ構成となっている。
が、ＶＣＣの供給より先になり、マイコン２にＶｐｐの
み印加される状態となると、フラッシュメモリ２ｄへの
誤書き込みの発生や、マイコン２へダメージを与える恐
れがある。ＣＰＵ２のＶｐｐへの１２ｖの供給は、外部
書き込み装置１０からエンジン制御装置１のＶＰへ１２
ｖが入力された状態で、トランジスタ８をオンとするこ
とにより行われるが、図１の実施例では、ＶＣＣ＞４.
７ｖ でトランジスタ８をオンさせる電圧検出回路７に
より、ＶＣＣが供給されていない状態で、Ｖｐｐのみマ
イコン２へ供給されることを防ぐ構成となっている。
【００１２】図３に示すタイミングチャートで、上記に
ついて説明する。
ついて説明する。
【００１３】外部書き込み装置１０をエンジン制御装置
１に接続すると、外部書き込み装置１からＶＰに１２ｖ
が供給される。このタイミングでは、マイコン２のＶｐ
ｐへは１２ｖは印加されていない。その後、イグニッシ
ョンスイッチ５をオンとすると、リレー６がオンとな
り、バッテリ４からエンジン制御装置１のＶＢに１２ｖ
が供給される。ＶＢが供給されると５ｖ電源回路３の出
力ＶＣＣが５ｖまで上昇していくが、ＶＣＣが４.７ｖ
になったとき、電圧検出回路７がトランジスタ８をオン
させ、Ｖｐｐに１２ｖが供給される。この後、５ｖ電源
回路３のパワーオンリセット機能により、リセットが解
除されると、マイコン２はフラッシュメモリ２ｄの消
去，書き込みモードに入る。
１に接続すると、外部書き込み装置１からＶＰに１２ｖ
が供給される。このタイミングでは、マイコン２のＶｐ
ｐへは１２ｖは印加されていない。その後、イグニッシ
ョンスイッチ５をオンとすると、リレー６がオンとな
り、バッテリ４からエンジン制御装置１のＶＢに１２ｖ
が供給される。ＶＢが供給されると５ｖ電源回路３の出
力ＶＣＣが５ｖまで上昇していくが、ＶＣＣが４.７ｖ
になったとき、電圧検出回路７がトランジスタ８をオン
させ、Ｖｐｐに１２ｖが供給される。この後、５ｖ電源
回路３のパワーオンリセット機能により、リセットが解
除されると、マイコン２はフラッシュメモリ２ｄの消
去，書き込みモードに入る。
【００１４】また、Ｖｐｐの電圧が１２ｖ±０.５ｖ の
範囲から外れると、書き込みが正確に行われない恐れが
ある。図１の実施例では、電圧検出回路９によりＶｐｐ
の電圧をモニタし、１２ｖ±０.５ｖ の範囲から外れる
と電圧検出回路９からマイコン２へ異常信号を出力す
る。異常信号を検出すると、ＣＰＵ２ａは、マイコン２
がフラッシュメモリ２ｄの消去，書き込みモードに入っ
ていても、フラッシュメモリ２ｄの消去，書き込み動作
は行わず、ＳＣＩ２ｃを介して外部書き込み装置１０へ
書き込み異常信号を送信する。書き込み異常信号を受信
した外部書き込み装置１０は、書き込み異常を表示させ
る。
範囲から外れると、書き込みが正確に行われない恐れが
ある。図１の実施例では、電圧検出回路９によりＶｐｐ
の電圧をモニタし、１２ｖ±０.５ｖ の範囲から外れる
と電圧検出回路９からマイコン２へ異常信号を出力す
る。異常信号を検出すると、ＣＰＵ２ａは、マイコン２
がフラッシュメモリ２ｄの消去，書き込みモードに入っ
ていても、フラッシュメモリ２ｄの消去，書き込み動作
は行わず、ＳＣＩ２ｃを介して外部書き込み装置１０へ
書き込み異常信号を送信する。書き込み異常信号を受信
した外部書き込み装置１０は、書き込み異常を表示させ
る。
【００１５】尚、図１の実施例では、電圧検出回路９を
マイコンの外部に設けてあるが、この代わりにマイコン
内蔵のＡ／Ｄ変換器により書き込み電圧モニタすること
により、電圧検出回路９なしで同一の機能を実現するこ
とも可能である。
マイコンの外部に設けてあるが、この代わりにマイコン
内蔵のＡ／Ｄ変換器により書き込み電圧モニタすること
により、電圧検出回路９なしで同一の機能を実現するこ
とも可能である。
【００１６】
【発明の効果】本発明によれば、外部から供給されるフ
ラッシュメモリ書き込み電圧が公差外のとき、消去，書
き込み動作は行われず、フラッシュメモリの誤書き込み
を防止することができる。また、外部書き込み装置に書
き込み異常を表示させることにより、書き込みが正確に
行われなかったことを知らせることができる。
ラッシュメモリ書き込み電圧が公差外のとき、消去，書
き込み動作は行われず、フラッシュメモリの誤書き込み
を防止することができる。また、外部書き込み装置に書
き込み異常を表示させることにより、書き込みが正確に
行われなかったことを知らせることができる。
【図１】本発明のエンジン制御装置のブロック図。
【図２】フラッシュメモリの消去，書き込み条件の説明
図。
図。
【図３】消去，書き込みモード時のタイミングチャー
ト。
ト。
１…エンジン制御装置、２…マイクロコンピュータ、２
ａ…ＣＰＵ、２ｄ…フラッシュメモリ、３…５ｖ電源回
路、４…バッテリ、７…電圧検出回路、８…トランジス
タ、９…電圧検出回路、１０…外部書き込み装置。
ａ…ＣＰＵ、２ｄ…フラッシュメモリ、３…５ｖ電源回
路、４…バッテリ、７…電圧検出回路、８…トランジス
タ、９…電圧検出回路、１０…外部書き込み装置。
Claims (1)
- 【請求項１】電気的にデータの消去及び書き込みが可能
である不揮発性メモリを装着したエンジン制御装置にお
いて、外部から供給する前記不揮発性メモリの書き込み
電圧のモニタ回路を装置に内蔵したことを特徴とするエ
ンジン制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1735796A JPH09213088A (ja) | 1996-02-02 | 1996-02-02 | エンジン制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1735796A JPH09213088A (ja) | 1996-02-02 | 1996-02-02 | エンジン制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09213088A true JPH09213088A (ja) | 1997-08-15 |
Family
ID=11941801
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1735796A Pending JPH09213088A (ja) | 1996-02-02 | 1996-02-02 | エンジン制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09213088A (ja) |
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2000339224A (ja) * | 1999-05-31 | 2000-12-08 | Matsushita Electric Ind Co Ltd | メモリシステム |
| KR100442493B1 (ko) * | 1997-09-10 | 2004-11-03 | 엘지산전 주식회사 | 모니터링장치 |
| WO2006126246A1 (ja) * | 2005-05-23 | 2006-11-30 | Hitachi Ulsi Systems Co., Ltd. | Ｒｆｉｄタグ装置 |
| JP2007226938A (ja) * | 2006-01-25 | 2007-09-06 | Citizen Holdings Co Ltd | 不揮発性半導体記憶装置 |
-
1996
- 1996-02-02 JP JP1735796A patent/JPH09213088A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR100442493B1 (ko) * | 1997-09-10 | 2004-11-03 | 엘지산전 주식회사 | 모니터링장치 |
| JP2000339224A (ja) * | 1999-05-31 | 2000-12-08 | Matsushita Electric Ind Co Ltd | メモリシステム |
| WO2006126246A1 (ja) * | 2005-05-23 | 2006-11-30 | Hitachi Ulsi Systems Co., Ltd. | Ｒｆｉｄタグ装置 |
| JP2007226938A (ja) * | 2006-01-25 | 2007-09-06 | Citizen Holdings Co Ltd | 不揮発性半導体記憶装置 |
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