JPH09275497A - 画像処理装置 - Google Patents
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- JPH09275497A JPH09275497A JP8084900A JP8490096A JPH09275497A JP H09275497 A JPH09275497 A JP H09275497A JP 8084900 A JP8084900 A JP 8084900A JP 8490096 A JP8490096 A JP 8490096A JP H09275497 A JPH09275497 A JP H09275497A
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Landscapes
- Image Processing (AREA)
- Storing Facsimile Image Data (AREA)
- Facsimile Image Signal Circuits (AREA)
Abstract
(57)【要約】
【課題】 画像処理装置において、前ライン参照用のバ
ッファメモリを共用化することにより、製造コストを低
減できるようにする。 【解決手段】 中間調画像を読み取るための高画質読取
処理を行う高画質読取処理手段を構成するゲートアレイ
７と、記録画像の外縁を滑らかにするためのスムージン
グ処理を行うスムージング手段を構成するゲートアレイ
７と、高画質読取処理手段とスムージング手段とにより
前ラインデータとして共通に参照される少なくとも１ラ
イン分の画像データ記憶領域を有する記憶手段を構成す
るバッファメモリ１０とを備えた。
ッファメモリを共用化することにより、製造コストを低
減できるようにする。 【解決手段】 中間調画像を読み取るための高画質読取
処理を行う高画質読取処理手段を構成するゲートアレイ
７と、記録画像の外縁を滑らかにするためのスムージン
グ処理を行うスムージング手段を構成するゲートアレイ
７と、高画質読取処理手段とスムージング手段とにより
前ラインデータとして共通に参照される少なくとも１ラ
イン分の画像データ記憶領域を有する記憶手段を構成す
るバッファメモリ１０とを備えた。
Description
【０００１】
【発明の属する技術分野】本発明は、中間調画像を読み
取るための高画質読取処理を行う高画質読取処理手段
と、記録画像の外縁を滑らかにするためのスムージング
処理を行うスムージング手段とを有する画像処理装置に
関するものである。
取るための高画質読取処理を行う高画質読取処理手段
と、記録画像の外縁を滑らかにするためのスムージング
処理を行うスムージング手段とを有する画像処理装置に
関するものである。
【０００２】
【従来の技術】中間調画像を読み取るための高画質読取
処理を行う高画質読取処理手段と、記録画像の外縁を滑
らかにするためのスムージング処理を行うスムージング
手段とを有する画像処理装置として、たとえばファクシ
ミリ装置が考えられる。
処理を行う高画質読取処理手段と、記録画像の外縁を滑
らかにするためのスムージング処理を行うスムージング
手段とを有する画像処理装置として、たとえばファクシ
ミリ装置が考えられる。
【０００３】ところで、高画質読取処理およびスムージ
ング処理に際しては、いずれも前ラインの画像データを
参照する必要があり、そのために少なくとも１ライン分
の画像データを記憶するバッファメモリが必要であっ
た。
ング処理に際しては、いずれも前ラインの画像データを
参照する必要があり、そのために少なくとも１ライン分
の画像データを記憶するバッファメモリが必要であっ
た。
【０００４】従来のファクシミリ装置では、高画質読取
処理およびスムージング処理のそれぞれを専用のＬＳＩ
で個別に処理しており、バッファメモリも各々個別に設
けられていた。
処理およびスムージング処理のそれぞれを専用のＬＳＩ
で個別に処理しており、バッファメモリも各々個別に設
けられていた。
【０００５】
【発明が解決しようとする課題】しかしながら、従来の
ファクシミリ装置では、高画質読取処理およびスムージ
ング処理のそれぞれについて個別にバッファメモリを設
けていたので、製造コストの上昇を招いていた。すなわ
ち、高画質読取処理は送信時に必要な処理であり、スム
ージング処理は受信時に必要な処理であるので、高画質
読取処理とスムージング処理とを同時に実行する必要は
ないにも拘らず、個別にバッファメモリを設けていたの
で、バッファメモリが無駄であった。
ファクシミリ装置では、高画質読取処理およびスムージ
ング処理のそれぞれについて個別にバッファメモリを設
けていたので、製造コストの上昇を招いていた。すなわ
ち、高画質読取処理は送信時に必要な処理であり、スム
ージング処理は受信時に必要な処理であるので、高画質
読取処理とスムージング処理とを同時に実行する必要は
ないにも拘らず、個別にバッファメモリを設けていたの
で、バッファメモリが無駄であった。
【０００６】また、コーピー動作のように、高画質読取
処理とスムージング処理との双方を行う場合でも、高画
質読取処理とスムージング処理とを同期させることによ
りバッファメモリを共用化できるので、必ずしも高画質
読取処理およびスムージング処理のそれぞれについて個
別にバッファメモリを設ける必要はない。
処理とスムージング処理との双方を行う場合でも、高画
質読取処理とスムージング処理とを同期させることによ
りバッファメモリを共用化できるので、必ずしも高画質
読取処理およびスムージング処理のそれぞれについて個
別にバッファメモリを設ける必要はない。
【０００７】本発明は、上記の点に鑑みて提案されたも
のであって、前ライン参照用のバッファメモリを共用化
することにより、製造コストの低減を図ることのできる
画像処理装置を提供することを目的としている。
のであって、前ライン参照用のバッファメモリを共用化
することにより、製造コストの低減を図ることのできる
画像処理装置を提供することを目的としている。
【０００８】
【課題を解決するための手段】上記目的を達成するた
め、請求項１に記載した発明の画像処理装置は、中間調
画像を読み取るための高画質読取処理を行う高画質読取
処理手段と、記録画像の外縁を滑らかにするためのスム
ージング処理を行うスムージング手段とを有する画像処
理装置であって、高画質読取処理手段とスムージング手
段とにより前ラインデータとして共通に参照される少な
くとも１ライン分の画像データ記憶領域を有する記憶手
段を備えている。
め、請求項１に記載した発明の画像処理装置は、中間調
画像を読み取るための高画質読取処理を行う高画質読取
処理手段と、記録画像の外縁を滑らかにするためのスム
ージング処理を行うスムージング手段とを有する画像処
理装置であって、高画質読取処理手段とスムージング手
段とにより前ラインデータとして共通に参照される少な
くとも１ライン分の画像データ記憶領域を有する記憶手
段を備えている。
【０００９】この画像処理装置によれば、記憶手段の少
なくとも１ライン分の画像データ記憶領域を高画質読取
処理とスムージング処理とで共用するので、画像データ
記憶領域の無駄が省け、製造コストを低減できる。しか
も、高画質読取処理に必要な画像データ記憶領域の容量
は、通常のスムージング処理に必要な画像データ記憶領
域の容量と比較して格段に大きいので、高画質読取処理
に必要な画像データ記憶領域を用いてスムージング処理
を行えば、複数ラインの画像データを参照できることか
ら、高性能なスムージング処理が可能になる。
なくとも１ライン分の画像データ記憶領域を高画質読取
処理とスムージング処理とで共用するので、画像データ
記憶領域の無駄が省け、製造コストを低減できる。しか
も、高画質読取処理に必要な画像データ記憶領域の容量
は、通常のスムージング処理に必要な画像データ記憶領
域の容量と比較して格段に大きいので、高画質読取処理
に必要な画像データ記憶領域を用いてスムージング処理
を行えば、複数ラインの画像データを参照できることか
ら、高性能なスムージング処理が可能になる。
【００１０】画像処理装置としては、ファクシミリ装置
が考えられるが、これに限らず、モデムを内蔵した複写
機やパーソナルコンピュータなどにも本発明を適用でき
る。さらには、通信装置に限らず、コピー機能を有する
が通信機能を有しないディジタル複写機のような装置に
も本発明を適用できる。高画質読取処理としては、誤差
拡散処理が考えられるが、これに限るものではない。高
画質読取処理手段は、ゲートアレイにより実現できる
が、これに限るものではない。スムージング手段は、ゲ
ートアレイにより実現できるが、これに限るものではな
い。記憶手段としては、ＳＲＡＭやＤＲＡＭが考えられ
るが、これに限るものではない。
が考えられるが、これに限らず、モデムを内蔵した複写
機やパーソナルコンピュータなどにも本発明を適用でき
る。さらには、通信装置に限らず、コピー機能を有する
が通信機能を有しないディジタル複写機のような装置に
も本発明を適用できる。高画質読取処理としては、誤差
拡散処理が考えられるが、これに限るものではない。高
画質読取処理手段は、ゲートアレイにより実現できる
が、これに限るものではない。スムージング手段は、ゲ
ートアレイにより実現できるが、これに限るものではな
い。記憶手段としては、ＳＲＡＭやＤＲＡＭが考えられ
るが、これに限るものではない。
【００１１】また、請求項２に記載した発明の画像処理
装置は、請求項１に記載の画像処理装置であって、高画
質読取処理手段とスムージング手段とは、ＬＳＩ化され
た共通のゲートアレイにより構成されている。
装置は、請求項１に記載の画像処理装置であって、高画
質読取処理手段とスムージング手段とは、ＬＳＩ化され
た共通のゲートアレイにより構成されている。
【００１２】
【発明の実施の形態】以下、本発明の好ましい実施の形
態を、図面を参照しつつ具体的に説明する。
態を、図面を参照しつつ具体的に説明する。
【００１３】図１は、本発明に係る画像処理装置の一例
としてのファクシミリ装置の要部の回路ブロック図であ
る。このファクシミリ装置は、ＣＰＵ１、ＮＣＵ２、Ｒ
ＡＭ３、モデム４、ＲＯＭ５、ＥＥＰＲＯＭ６、ゲート
アレイ７、コーデック８、ＤＭＡＣ９、バッファメモリ
１０、読取部１１、記録部１２、操作部１３、および表
示部１４などを備えている。ＣＰＵ１、ＮＣＵ２、ＲＡ
Ｍ３、モデム４、ＲＯＭ５、ＥＥＰＲＯＭ６、ゲートア
レイ７、コーデック８、ＤＭＡＣ９、およびバッファメ
モリ１０は、バス線により相互に接続されている。この
バス線には、データバス、アドレスバス、および制御信
号線が含まれる。ゲートアレイ７には、読取部１１、記
録部１２、操作部１３、および表示部１４が接続されて
いる。ＮＣＵ２は、モデム４および電話回線２１に接続
されている。
としてのファクシミリ装置の要部の回路ブロック図であ
る。このファクシミリ装置は、ＣＰＵ１、ＮＣＵ２、Ｒ
ＡＭ３、モデム４、ＲＯＭ５、ＥＥＰＲＯＭ６、ゲート
アレイ７、コーデック８、ＤＭＡＣ９、バッファメモリ
１０、読取部１１、記録部１２、操作部１３、および表
示部１４などを備えている。ＣＰＵ１、ＮＣＵ２、ＲＡ
Ｍ３、モデム４、ＲＯＭ５、ＥＥＰＲＯＭ６、ゲートア
レイ７、コーデック８、ＤＭＡＣ９、およびバッファメ
モリ１０は、バス線により相互に接続されている。この
バス線には、データバス、アドレスバス、および制御信
号線が含まれる。ゲートアレイ７には、読取部１１、記
録部１２、操作部１３、および表示部１４が接続されて
いる。ＮＣＵ２は、モデム４および電話回線２１に接続
されている。
【００１４】ＣＰＵ１は、ファクシミリ装置全体を制御
する。ＮＣＵ２は、電話回線２１に接続されて網制御を
行う。ＲＡＭ３は、画像情報などの各種のディジタルデ
ータを記憶する。モデム４は、送信符号の変調や受信符
号の復調などを行う。ＲＯＭ５は、各種のプログラムな
どを記憶している。ＥＥＰＲＯＭ６は、いわゆるワンタ
ッチダイヤルや短縮ダイヤルなどの登録データやフラグ
などを記憶している。ゲートアレイ７は、ＬＳＩ化され
ており、ＣＰＵ１の入出力インターフェイスなどとして
機能するとともに、高画質読取処理およびスムージング
処理を行う。コーデック８は、送信画像データの符号
化、および受信符号の復号化を行う。ＤＭＡＣ９は、Ｒ
ＡＭ３などへのメモリアクセスを制御する。バッファメ
モリ１０は、高画質読取処理およびスムージング処理の
ために画像データを記憶する。読取部１１は、光源やＣ
ＣＤセンサや原稿送りモータなどを備えており、原稿を
読み取って画像信号を出力する。記録部１２は、熱転写
プリンタなどを備えており、画像データに基づいて、記
録用紙上に画像を記録する。操作部１３は、キースイッ
チ群などからなり、使用者の操作に応じた操作信号を出
力する。表示部１４は、ＬＣＤなどからなり、ＣＰＵ１
により制御されて各種の表示を行う。
する。ＮＣＵ２は、電話回線２１に接続されて網制御を
行う。ＲＡＭ３は、画像情報などの各種のディジタルデ
ータを記憶する。モデム４は、送信符号の変調や受信符
号の復調などを行う。ＲＯＭ５は、各種のプログラムな
どを記憶している。ＥＥＰＲＯＭ６は、いわゆるワンタ
ッチダイヤルや短縮ダイヤルなどの登録データやフラグ
などを記憶している。ゲートアレイ７は、ＬＳＩ化され
ており、ＣＰＵ１の入出力インターフェイスなどとして
機能するとともに、高画質読取処理およびスムージング
処理を行う。コーデック８は、送信画像データの符号
化、および受信符号の復号化を行う。ＤＭＡＣ９は、Ｒ
ＡＭ３などへのメモリアクセスを制御する。バッファメ
モリ１０は、高画質読取処理およびスムージング処理の
ために画像データを記憶する。読取部１１は、光源やＣ
ＣＤセンサや原稿送りモータなどを備えており、原稿を
読み取って画像信号を出力する。記録部１２は、熱転写
プリンタなどを備えており、画像データに基づいて、記
録用紙上に画像を記録する。操作部１３は、キースイッ
チ群などからなり、使用者の操作に応じた操作信号を出
力する。表示部１４は、ＬＣＤなどからなり、ＣＰＵ１
により制御されて各種の表示を行う。
【００１５】すなわち、ゲートアレイ７は、中間調画像
を読み取るための高画質読取処理を行う高画質読取処理
手段と、記録画像の外縁を滑らかにするためのスムージ
ング処理を行うスムージング手段とを構成している。バ
ッファメモリ１０は、高画質読取処理手段とスムージン
グ手段とにより前ラインデータとして共通に参照される
少なくとも１ライン分の画像データ記憶領域を有する記
憶手段を構成している。
を読み取るための高画質読取処理を行う高画質読取処理
手段と、記録画像の外縁を滑らかにするためのスムージ
ング処理を行うスムージング手段とを構成している。バ
ッファメモリ１０は、高画質読取処理手段とスムージン
グ手段とにより前ラインデータとして共通に参照される
少なくとも１ライン分の画像データ記憶領域を有する記
憶手段を構成している。
【００１６】図２はバッファメモリ１０の１画素分の構
成を説明する説明図である。バッファメモリ１０は、３
個のＳＲＡＭ３１〜ＳＲＡＭ３３からなり、これらＳＲ
ＡＭ３１〜ＳＲＡＭ３３は、それぞれ６ビットを１アド
レス単位として２０４８アドレス分設けられている。す
なわちバッファメモリ１０は、Ｂ４サイズの原稿の１ラ
イン分に相当する２０４８画素の処理が可能なようにな
されており、ＳＲＡＭ３１とＳＲＡＭ３２とが高画質読
取処理における２次元フィルタ処理に使用され、ＳＲＡ
Ｍ３３が高画質読取処理における中間調処理に使用され
る。高画質読取処理においては、６ビットすなわち６４
階調の画像データを参照データとして用いる。スムージ
ング処理において、ＳＲＡＭ３１〜ＳＲＡＭ３３のうち
のいずれを使用するか、またそのいずれのビットを使用
するかは任意であり、本実施形態では、ＳＲＡＭ３１〜
ＳＲＡＭ３３を使用して３ライン分の画像データを参照
データとしている。
成を説明する説明図である。バッファメモリ１０は、３
個のＳＲＡＭ３１〜ＳＲＡＭ３３からなり、これらＳＲ
ＡＭ３１〜ＳＲＡＭ３３は、それぞれ６ビットを１アド
レス単位として２０４８アドレス分設けられている。す
なわちバッファメモリ１０は、Ｂ４サイズの原稿の１ラ
イン分に相当する２０４８画素の処理が可能なようにな
されており、ＳＲＡＭ３１とＳＲＡＭ３２とが高画質読
取処理における２次元フィルタ処理に使用され、ＳＲＡ
Ｍ３３が高画質読取処理における中間調処理に使用され
る。高画質読取処理においては、６ビットすなわち６４
階調の画像データを参照データとして用いる。スムージ
ング処理において、ＳＲＡＭ３１〜ＳＲＡＭ３３のうち
のいずれを使用するか、またそのいずれのビットを使用
するかは任意であり、本実施形態では、ＳＲＡＭ３１〜
ＳＲＡＭ３３を使用して３ライン分の画像データを参照
データとしている。
【００１７】次に、このように構成されたファクシミリ
装置の動作について説明する。
装置の動作について説明する。
【００１８】送信時には、読取部１１が、送信原稿の画
像に応じたアナログの画像信号をシリアルに出力する。
この画像信号は、ゲートアレイ７により高画質読取処理
が施され、コーデック８により符号化されて、モデム４
を介して電話回線２１に送出される。
像に応じたアナログの画像信号をシリアルに出力する。
この画像信号は、ゲートアレイ７により高画質読取処理
が施され、コーデック８により符号化されて、モデム４
を介して電話回線２１に送出される。
【００１９】ゲートアレイ７による高画質読取処理にお
いては、先ず、読取部１１からの画像信号をＡ／Ｄ変換
して各画素毎に６４階調すなわち６ビットの画像データ
に変換する。そして、この画像データに対して、シェー
ディング処理すなわち歪み補正処理を施し、さらに、２
次元フィルタ処理を施す。この２次元フィルタ処理のた
めに、現在処理中のラインよりも１ライン前の画像デー
タをＳＲＡＭ３１に格納し、現在処理中のラインよりも
１ライン後の画像データをＳＲＡＭ３２に格納する。さ
らに、２次元フィルタ処理を施した画像データに対し
て、中間調処理を施す。この中間調処理のために、現在
処理中のラインよりも１ライン前の画像データをＳＲＡ
Ｍ３３に格納する。さらに、中間調処理を施した画像デ
ータに対して、２値化処理を施す。かくして得られた２
値の画像データは、コーデック８により符号化され、送
信符号としてモデム４に出力される。これによりモデム
４は、送信符号により搬送波を変調し、その搬送波をＮ
ＣＵ２を介して電話回線２１に送出する。
いては、先ず、読取部１１からの画像信号をＡ／Ｄ変換
して各画素毎に６４階調すなわち６ビットの画像データ
に変換する。そして、この画像データに対して、シェー
ディング処理すなわち歪み補正処理を施し、さらに、２
次元フィルタ処理を施す。この２次元フィルタ処理のた
めに、現在処理中のラインよりも１ライン前の画像デー
タをＳＲＡＭ３１に格納し、現在処理中のラインよりも
１ライン後の画像データをＳＲＡＭ３２に格納する。さ
らに、２次元フィルタ処理を施した画像データに対し
て、中間調処理を施す。この中間調処理のために、現在
処理中のラインよりも１ライン前の画像データをＳＲＡ
Ｍ３３に格納する。さらに、中間調処理を施した画像デ
ータに対して、２値化処理を施す。かくして得られた２
値の画像データは、コーデック８により符号化され、送
信符号としてモデム４に出力される。これによりモデム
４は、送信符号により搬送波を変調し、その搬送波をＮ
ＣＵ２を介して電話回線２１に送出する。
【００２０】受信時には、モデム４が、電話回線２１お
よびＮＣＵ２を介して入力された搬送波を復調して受信
符号を取り出す。そしてコーデック８が、モデム４から
の受信符号を復号化して２値の画像データに変換する。
そしてゲートアレイ７が、画像データにスムージング処
理を施して記録部１２に出力する。この処理のために、
現在処理中のラインよりも２ライン前の画像データをＳ
ＲＡＭ３１の予め決められた所定の位置に格納し、現在
処理中のラインよりも１ライン前の画像データをＳＲＡ
Ｍ３２の予め決められた所定の位置に格納し、現在処理
中のラインよりも１ライン後の画像データをＳＲＡＭ３
３の予め決められた所定の位置に格納する。この画像デ
ータは２値データであるので、ＳＲＡＭ３１〜ＳＲＡＭ
３３の各アドレス単位毎に１ビット使用すればよい。ゲ
ートアレイ７によりスムージング処理された画像データ
を受け取った記録部１２は、その画像データに基づいて
受信画像を記録用紙上に記録する。
よびＮＣＵ２を介して入力された搬送波を復調して受信
符号を取り出す。そしてコーデック８が、モデム４から
の受信符号を復号化して２値の画像データに変換する。
そしてゲートアレイ７が、画像データにスムージング処
理を施して記録部１２に出力する。この処理のために、
現在処理中のラインよりも２ライン前の画像データをＳ
ＲＡＭ３１の予め決められた所定の位置に格納し、現在
処理中のラインよりも１ライン前の画像データをＳＲＡ
Ｍ３２の予め決められた所定の位置に格納し、現在処理
中のラインよりも１ライン後の画像データをＳＲＡＭ３
３の予め決められた所定の位置に格納する。この画像デ
ータは２値データであるので、ＳＲＡＭ３１〜ＳＲＡＭ
３３の各アドレス単位毎に１ビット使用すればよい。ゲ
ートアレイ７によりスムージング処理された画像データ
を受け取った記録部１２は、その画像データに基づいて
受信画像を記録用紙上に記録する。
【００２１】なお、上記実施形態においては、１ライン
当たりの画素数が２０４８個であるＢ４サイズの原稿の
画像データを高画質読取処理するときには、ＳＲＡＭ３
１〜ＳＲＡＭ３３の全ビットを使用するので、同時にス
ムージング処理を行えないが、Ａ４サイズの原稿の画像
データを高画質読取処理するときには、高画質読取処理
とスムージング処理とを同期させることにより、高画質
読取処理と同時にスムージング処理を行うことが可能で
あり、コピー時に高画質読取処理とスムージング処理と
の双方を同時に実行できる。世界的に見ればＡ４サイズ
の原稿が主流である今日、このようにしても特に不都合
は生じない。
当たりの画素数が２０４８個であるＢ４サイズの原稿の
画像データを高画質読取処理するときには、ＳＲＡＭ３
１〜ＳＲＡＭ３３の全ビットを使用するので、同時にス
ムージング処理を行えないが、Ａ４サイズの原稿の画像
データを高画質読取処理するときには、高画質読取処理
とスムージング処理とを同期させることにより、高画質
読取処理と同時にスムージング処理を行うことが可能で
あり、コピー時に高画質読取処理とスムージング処理と
の双方を同時に実行できる。世界的に見ればＡ４サイズ
の原稿が主流である今日、このようにしても特に不都合
は生じない。
【００２２】もちろん、ＳＲＡＭ３１〜ＳＲＡＭ３３の
ビット数を各アドレス単位毎に７ビットにすることによ
り、Ｂ４サイズの原稿であってもコピー時に高画質読取
処理とスムージング処理との双方を同時に実行できる。
このようにＳＲＡＭ３１〜ＳＲＡＭ３３のビット数を増
やしても、高画質読取処理とスムージング処理とで個別
にバッファメモリを設けるよりはコストを低減できる。
ビット数を各アドレス単位毎に７ビットにすることによ
り、Ｂ４サイズの原稿であってもコピー時に高画質読取
処理とスムージング処理との双方を同時に実行できる。
このようにＳＲＡＭ３１〜ＳＲＡＭ３３のビット数を増
やしても、高画質読取処理とスムージング処理とで個別
にバッファメモリを設けるよりはコストを低減できる。
【００２３】
【発明の効果】以上説明したように請求項１に記載した
発明の画像処理装置によれば、記憶手段の少なくとも１
ライン分の画像データ記憶領域を高画質読取処理とスム
ージング処理とで共用するので、画像データ記憶領域の
無駄が省け、製造コストを低減できる。しかも、高画質
読取処理に必要な画像データ記憶領域の容量は、通常の
スムージング処理に必要な画像データ記憶領域の容量と
比較して格段に大きいので、高画質読取処理に必要な画
像データ記憶領域を用いてスムージング処理を行えば、
複数ラインの画像データを参照できることから、高性能
なスムージング処理が可能になる。
発明の画像処理装置によれば、記憶手段の少なくとも１
ライン分の画像データ記憶領域を高画質読取処理とスム
ージング処理とで共用するので、画像データ記憶領域の
無駄が省け、製造コストを低減できる。しかも、高画質
読取処理に必要な画像データ記憶領域の容量は、通常の
スムージング処理に必要な画像データ記憶領域の容量と
比較して格段に大きいので、高画質読取処理に必要な画
像データ記憶領域を用いてスムージング処理を行えば、
複数ラインの画像データを参照できることから、高性能
なスムージング処理が可能になる。
【図１】本発明に係る画像処理装置の一例としてのファ
クシミリ装置の要部の回路ブロック図である。
クシミリ装置の要部の回路ブロック図である。
【図２】図１に示すファクシミリ装置に備えられたバッ
ファメモリの１画素分の構成を説明する説明図である。
ファメモリの１画素分の構成を説明する説明図である。
１ ＣＰＵ ２ ＮＣＵ ３ ＲＡＭ ４ モデム ５ ＲＯＭ ６ ＥＥＰＲＯＭ ７ ゲートアレイ ８ コーデック ９ ＤＭＡＣ １０ バッファメモリ １１ 読取部 １２ 記録部
Claims (2)
- 【請求項１】 中間調画像を読み取るための高画質読取
処理を行う高画質読取処理手段と、記録画像の外縁を滑
らかにするためのスムージング処理を行うスムージング
手段とを有する画像処理装置であって、 前記高画質読取処理手段と前記スムージング手段とによ
り前ラインデータとして共通に参照される少なくとも１
ライン分の画像データ記憶領域を有する記憶手段を備え
たことを特徴とする画像処理装置。 - 【請求項２】 前記高画質読取処理手段と前記スムージ
ング手段とは、ＬＳＩ化された共通のゲートアレイによ
り構成されている請求項１に記載の画像処理装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8084900A JPH09275497A (ja) | 1996-04-08 | 1996-04-08 | 画像処理装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8084900A JPH09275497A (ja) | 1996-04-08 | 1996-04-08 | 画像処理装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH09275497A true JPH09275497A (ja) | 1997-10-21 |
Family
ID=13843620
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8084900A Pending JPH09275497A (ja) | 1996-04-08 | 1996-04-08 | 画像処理装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH09275497A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6274721B1 (en) | 1996-07-01 | 2001-08-14 | Mycogen Corporation | Toxins active against pests |
| US6369213B1 (en) | 1996-07-01 | 2002-04-09 | Mycogen Corporation | Toxins active against pests |
-
1996
- 1996-04-08 JP JP8084900A patent/JPH09275497A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6274721B1 (en) | 1996-07-01 | 2001-08-14 | Mycogen Corporation | Toxins active against pests |
| US6369213B1 (en) | 1996-07-01 | 2002-04-09 | Mycogen Corporation | Toxins active against pests |
| US6752992B2 (en) | 1996-07-01 | 2004-06-22 | Mycogen Corporation | Toxins active against pests |
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