JPH098222A - 半導体装置を搭載した電子部品装置 - Google Patents
半導体装置を搭載した電子部品装置Info
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- JPH098222A JPH098222A JP7147536A JP14753695A JPH098222A JP H098222 A JPH098222 A JP H098222A JP 7147536 A JP7147536 A JP 7147536A JP 14753695 A JP14753695 A JP 14753695A JP H098222 A JPH098222 A JP H098222A
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- JP
- Japan
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- semiconductor device
- electronic component
- semiconductor
- circuit board
- printed circuit
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-
- H—ELECTRICITY
- H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
- H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
- H10W90/00—Package configurations
- H10W90/701—Package configurations characterised by the relative positions of pads or connectors relative to package parts
- H10W90/751—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
- H10W90/754—Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked insulating package substrate, interposer or RDL
Landscapes
- Production Of Multi-Layered Print Wiring Board (AREA)
Abstract
(57)【要約】
【目的】 高機能化と小型化を実現した半導体装置を搭
載した電子部品装置を提供する。 【構成】 絶縁層4毎に上に広がった階段状に設けられ
た窪み5を有する多層プリント基板3、上記窪み5の底
6に搭載された第1の半導体装置1、及び、上記底6を
囲む一の踏み板7に着設し、上記窪み5の底6を架橋す
る第2の半導体装置2を備える。第1の半導体装置1の
上方に第2の半導体装置2が立体的に設置しているた
め、多層プリント基板3面の半導体装置1、2を搭載す
る個所の面積が少ない。
載した電子部品装置を提供する。 【構成】 絶縁層4毎に上に広がった階段状に設けられ
た窪み5を有する多層プリント基板3、上記窪み5の底
6に搭載された第1の半導体装置1、及び、上記底6を
囲む一の踏み板7に着設し、上記窪み5の底6を架橋す
る第2の半導体装置2を備える。第1の半導体装置1の
上方に第2の半導体装置2が立体的に設置しているた
め、多層プリント基板3面の半導体装置1、2を搭載す
る個所の面積が少ない。
Description
【0001】
【産業上の利用分野】本発明は半導体装置を搭載した電
子部品装置に関するものである。
子部品装置に関するものである。
【0002】
【従来の技術】従来から半導体チップ等の半導体装置を
多層プリント基板に搭載したPGA(ピングリッドアレ
イ)、BGA(ボールグリッドアレイ)等の電子部品装
置が知られている。上記電子部品装置はさらにマザーボ
ードに実装され電子装置として用いられる。近年の電子
装置は高機能化と小型化が要求されている。この高機能
化から半導体装置は多数搭載する必要が生まれ、これら
半導体装置を搭載する面積を確保するために広い多層プ
リント基板が必要であった。そのため電子部品装置が大
型化する問題を生じている。
多層プリント基板に搭載したPGA(ピングリッドアレ
イ)、BGA(ボールグリッドアレイ)等の電子部品装
置が知られている。上記電子部品装置はさらにマザーボ
ードに実装され電子装置として用いられる。近年の電子
装置は高機能化と小型化が要求されている。この高機能
化から半導体装置は多数搭載する必要が生まれ、これら
半導体装置を搭載する面積を確保するために広い多層プ
リント基板が必要であった。そのため電子部品装置が大
型化する問題を生じている。
【0003】
【発明が解決しようとする課題】本発明は上述の事実に
鑑みてなされたもので、その目的とするところは、高機
能化と小型化を実現した半導体装置を搭載した電子部品
装置を提供することにある。
鑑みてなされたもので、その目的とするところは、高機
能化と小型化を実現した半導体装置を搭載した電子部品
装置を提供することにある。
【0004】
【課題を解決するための手段】本発明の請求項1に係る
半導体装置を搭載した電子部品装置は、絶縁層4毎に上
に広がった階段状に設けられた窪み5を有する多層プリ
ント基板3、上記窪み5の底6に搭載された第1の半導
体装置1、及び、上記底6を囲む一の踏み板7に着設
し、上記窪み5の底6を架橋する第2の半導体装置2を
備えることを特徴とする。
半導体装置を搭載した電子部品装置は、絶縁層4毎に上
に広がった階段状に設けられた窪み5を有する多層プリ
ント基板3、上記窪み5の底6に搭載された第1の半導
体装置1、及び、上記底6を囲む一の踏み板7に着設
し、上記窪み5の底6を架橋する第2の半導体装置2を
備えることを特徴とする。
【0005】本発明の請求項2に係る半導体装置を搭載
した電子部品装置は、請求項1記載の半導体装置を搭載
した電子部品装置において、第1、及び、第2の半導体
装置1、2が半導体チップ、QFP(クウァドフラット
パッケジ)、PLCC(プラスチックリードチップキャ
リアー)のいずれかであることを特徴とする。
した電子部品装置は、請求項1記載の半導体装置を搭載
した電子部品装置において、第1、及び、第2の半導体
装置1、2が半導体チップ、QFP(クウァドフラット
パッケジ)、PLCC(プラスチックリードチップキャ
リアー)のいずれかであることを特徴とする。
【0006】
【作用】本発明の請求項1又は請求項2に係る半導体装
置を搭載した電子部品装置は、階段状に設けられた窪み
5に第1の半導体装置1と、第1の半導体装置1が搭載
された窪み5の底6を囲む一の踏み板7に上記窪み5の
底6を架橋する第2の半導体装置2とを備えるので、第
1の半導体装置1の上方に第2の半導体装置2を立体的
に設置するため、多層プリント基板3面の搭載個所の面
積が少なくてよい。
置を搭載した電子部品装置は、階段状に設けられた窪み
5に第1の半導体装置1と、第1の半導体装置1が搭載
された窪み5の底6を囲む一の踏み板7に上記窪み5の
底6を架橋する第2の半導体装置2とを備えるので、第
1の半導体装置1の上方に第2の半導体装置2を立体的
に設置するため、多層プリント基板3面の搭載個所の面
積が少なくてよい。
【0007】
【実施例】以下、本発明を図面を参照しながら説明す
る。
る。
【0008】図1は本発明の一実施例に係る半導体装置
を搭載した電子部品装置の要部を拡大した断面図であ
り、図2は図1の電子部品装置に用いられる多層プリン
ト基板の要部を拡大した断面図であり、図3は本発明の
他の実施例に係る半導体装置を搭載した電子部品装置の
要部を拡大した断面図である。
を搭載した電子部品装置の要部を拡大した断面図であ
り、図2は図1の電子部品装置に用いられる多層プリン
ト基板の要部を拡大した断面図であり、図3は本発明の
他の実施例に係る半導体装置を搭載した電子部品装置の
要部を拡大した断面図である。
【0009】本発明を構成する多層プリント基板3は、
図2に示す如く、複数の絶縁層4を有し、絶縁層4毎に
上に広がった階段状に設けられた窪み5を備える。上記
絶縁層4は、基材に樹脂を含浸乾燥して得られるプリプ
レグの樹脂を硬化させた基板が用いられる。上記樹脂と
してはエポキシ樹脂、ポリイミド樹脂、フッソ樹脂、フ
ェノール樹脂、不飽和ポリエステル樹脂、PPO樹脂等
の単独、変性物、混合物等が用いられる。上記基材とし
ては、特に限定するものではないが、ガラス繊維等の無
機材料の方が耐熱性、耐湿性等に優れて好ましい。ま
た、耐熱性に優れる有機繊維布基材及びこれらの混合物
を用いることもできる。上記絶縁層4の表面は導体回路
8が形成されている。上記導体回路8の形成は多層プリ
ント基板3で汎用されるエッチング、メッキ等により作
製すればよい。
図2に示す如く、複数の絶縁層4を有し、絶縁層4毎に
上に広がった階段状に設けられた窪み5を備える。上記
絶縁層4は、基材に樹脂を含浸乾燥して得られるプリプ
レグの樹脂を硬化させた基板が用いられる。上記樹脂と
してはエポキシ樹脂、ポリイミド樹脂、フッソ樹脂、フ
ェノール樹脂、不飽和ポリエステル樹脂、PPO樹脂等
の単独、変性物、混合物等が用いられる。上記基材とし
ては、特に限定するものではないが、ガラス繊維等の無
機材料の方が耐熱性、耐湿性等に優れて好ましい。ま
た、耐熱性に優れる有機繊維布基材及びこれらの混合物
を用いることもできる。上記絶縁層4の表面は導体回路
8が形成されている。上記導体回路8の形成は多層プリ
ント基板3で汎用されるエッチング、メッキ等により作
製すればよい。
【0010】本発明の電子部品装置は、図1に示す如
く、半導体チップ9aからなる第1の半導体装置1を上
記多層プリント基板3の窪み5の底6に備える。上記半
導体チップ9aはワイヤー10aを介して、絶縁層4上
に形成された導体回路8aに接続される。さらに、エポ
キシ樹脂組成物等の封止材11で封止される。
く、半導体チップ9aからなる第1の半導体装置1を上
記多層プリント基板3の窪み5の底6に備える。上記半
導体チップ9aはワイヤー10aを介して、絶縁層4上
に形成された導体回路8aに接続される。さらに、エポ
キシ樹脂組成物等の封止材11で封止される。
【0011】さらに、本発明の電子部品装置は、上記底
6を囲む一の踏み板7上に着設した半導体チップ9bか
らなる第2の半導体装置2を備える。この第2の半導体
装置2は上記窪み5の底6を架橋し、上記第1の半導体
装置1の上方に位置する。上記第2の半導体装置2であ
る半導体チップ9bはワイヤー10bを介して、絶縁層
4上に形成された導体回路8bと接続される。さらに、
エポキシ樹脂組成物等の封止材11で封止される。
6を囲む一の踏み板7上に着設した半導体チップ9bか
らなる第2の半導体装置2を備える。この第2の半導体
装置2は上記窪み5の底6を架橋し、上記第1の半導体
装置1の上方に位置する。上記第2の半導体装置2であ
る半導体チップ9bはワイヤー10bを介して、絶縁層
4上に形成された導体回路8bと接続される。さらに、
エポキシ樹脂組成物等の封止材11で封止される。
【0012】本発明においては、階段状に設けられた窪
み5に、第1の半導体装置1と、第1の半導体装置1が
搭載された窪み5の底6を囲む一の踏み板7に着設し、
上記窪み5の底6を架橋する第2の半導体装置2とを備
えるので、第1の半導体装置1の上方に第2の半導体装
置2が立体的に設置している。従って、本発明の電子部
品装置は多層プリント基板3面に半導体装置1、2を複
数搭載する個所の面積が少ないので、高機能化と小型化
を実現できる。
み5に、第1の半導体装置1と、第1の半導体装置1が
搭載された窪み5の底6を囲む一の踏み板7に着設し、
上記窪み5の底6を架橋する第2の半導体装置2とを備
えるので、第1の半導体装置1の上方に第2の半導体装
置2が立体的に設置している。従って、本発明の電子部
品装置は多層プリント基板3面に半導体装置1、2を複
数搭載する個所の面積が少ないので、高機能化と小型化
を実現できる。
【0013】なお、本発明の電子部品装置を構成する第
1、及び、第2の半導体装置1、2は半導体チップ9
a、9bに限定されず、QFP(クウァドフラットパッ
ケジ)、PLCC(プラスチックリードチップキャリア
ー)等でもよい。図3に第1の半導体装置1に半導体チ
ップ9aを、第2の半導体装置2にQFP(クウァドフ
ラットパッケジ)9cを備えた電子部品装置を示す。Q
FP(クウァドフラットパッケジ)9cは半田を介し
て、踏み板7上に形成した導体回路8cと接続してい
る。
1、及び、第2の半導体装置1、2は半導体チップ9
a、9bに限定されず、QFP(クウァドフラットパッ
ケジ)、PLCC(プラスチックリードチップキャリア
ー)等でもよい。図3に第1の半導体装置1に半導体チ
ップ9aを、第2の半導体装置2にQFP(クウァドフ
ラットパッケジ)9cを備えた電子部品装置を示す。Q
FP(クウァドフラットパッケジ)9cは半田を介し
て、踏み板7上に形成した導体回路8cと接続してい
る。
【0014】さらに、本発明の電子部品装置は上記実施
例に限定されず、例えば、階段状に設けられた絶縁層4
をより多数有し、第2の半導体装置2を複数備えること
により、多層プリント基板3面に3個以上の半導体装置
1、2を立体的に搭載したものでもよいし、多層プリン
ト基板3に形成された窪み5を基板の両面に備え、多層
プリント基板3の両面に第1の半導体装置1と第2の半
導体装置2を搭載したものでもよい。
例に限定されず、例えば、階段状に設けられた絶縁層4
をより多数有し、第2の半導体装置2を複数備えること
により、多層プリント基板3面に3個以上の半導体装置
1、2を立体的に搭載したものでもよいし、多層プリン
ト基板3に形成された窪み5を基板の両面に備え、多層
プリント基板3の両面に第1の半導体装置1と第2の半
導体装置2を搭載したものでもよい。
【0015】本発明の電子部品装置は、ピンを用いたP
GA(ピングリッドアレイ)、リードフレイムを用いた
QFP(クウァドフラットパッケジ)、TAB(テープ
オートメイテッドボンディング)、多層プリント配線板
の端面に外部接続端子を有するLCC(リードレスチッ
プキャリアー)、半田ボールを有するBGA(ボールグ
リッドアレイ)等として用いることができる。上記電子
部品装置はマザーボードに実装され電子装置として使用
される。本発明の電子部品装置を用いた電子装置も高機
能化と小型化が可能になる。
GA(ピングリッドアレイ)、リードフレイムを用いた
QFP(クウァドフラットパッケジ)、TAB(テープ
オートメイテッドボンディング)、多層プリント配線板
の端面に外部接続端子を有するLCC(リードレスチッ
プキャリアー)、半田ボールを有するBGA(ボールグ
リッドアレイ)等として用いることができる。上記電子
部品装置はマザーボードに実装され電子装置として使用
される。本発明の電子部品装置を用いた電子装置も高機
能化と小型化が可能になる。
【0016】
【発明の効果】本発明の請求項1又は請求項2に係る半
導体装置を搭載した電子部品装置は、階段状に設けられ
た窪み5に第1の半導体装置1と、第1の半導体装置1
が搭載された窪み5の底6を囲む一の踏み板7に上記窪
み5の底6を架橋する第2の半導体装置2とを備えるの
で、第1の半導体装置1の上方に第2の半導体装置2が
立体的に設置している。従って、多層プリント基板3面
の半導体装置1、2を複数搭載する個所の面積が少なく
いので、高機能化と小型化を実現できる。本発明の電子
部品装置を実装した電子装置は高機能化と小型化が可能
になる。
導体装置を搭載した電子部品装置は、階段状に設けられ
た窪み5に第1の半導体装置1と、第1の半導体装置1
が搭載された窪み5の底6を囲む一の踏み板7に上記窪
み5の底6を架橋する第2の半導体装置2とを備えるの
で、第1の半導体装置1の上方に第2の半導体装置2が
立体的に設置している。従って、多層プリント基板3面
の半導体装置1、2を複数搭載する個所の面積が少なく
いので、高機能化と小型化を実現できる。本発明の電子
部品装置を実装した電子装置は高機能化と小型化が可能
になる。
【図1】本発明の一実施例に係る半導体装置を搭載した
電子部品装置の要部を拡大した断面図である。
電子部品装置の要部を拡大した断面図である。
【図2】図1の電子部品装置に用いられる多層プリント
基板の要部を拡大した断面図である。
基板の要部を拡大した断面図である。
【図3】本発明の他の実施例に係る半導体装置を搭載し
た電子部品装置の要部を拡大した断面図である。
た電子部品装置の要部を拡大した断面図である。
1 第1の半導体装置 2 第2の半導体装置 3 多層プリント基板 4 絶縁層 5 窪み 6 底 7 踏み板 8,8a,8b,8c 導体回路 9a,9b 半導体チップ 9c QFP(クウァドフラットパッケジ) 10a,10b ワイヤー 11 封止剤
Claims (2)
- 【請求項1】 絶縁層(4)毎に上に広がった階段状に
設けられた窪み(5)を有する多層プリント基板
(3)、上記窪み(5)の底(6)に搭載された第1の
半導体装置(1)、及び、上記底(6)を囲む一の踏み
板(7)に着設し、上記窪み(5)の底(6)を架橋す
る第2の半導体装置(2)を備えることを特徴とする半
導体装置を搭載した電子部品装置。 - 【請求項2】 上記第1、及び、第2の半導体装置
(1)、(2)が半導体チップ、QFP(クウァドフラ
ットパッケジ)、PLCC(プラスチックリードチップ
キャリアー)のいずれかであることを特徴とする請求項
1記載の半導体装置を搭載した電子部品装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7147536A JPH098222A (ja) | 1995-06-14 | 1995-06-14 | 半導体装置を搭載した電子部品装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP7147536A JPH098222A (ja) | 1995-06-14 | 1995-06-14 | 半導体装置を搭載した電子部品装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH098222A true JPH098222A (ja) | 1997-01-10 |
Family
ID=15432540
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP7147536A Withdrawn JPH098222A (ja) | 1995-06-14 | 1995-06-14 | 半導体装置を搭載した電子部品装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH098222A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006278401A (ja) * | 2005-03-28 | 2006-10-12 | Denso Corp | 半導体装置 |
| JP2008204462A (ja) * | 2007-02-21 | 2008-09-04 | Samsung Electronics Co Ltd | 半導体パッケージ、半導体パッケージを備える集積回路カード及びその製造方法 |
| WO2009147036A1 (de) * | 2008-06-03 | 2009-12-10 | Siemens Aktiengesellschaft | Led-beleuchtungsanordnung |
| JP2011228521A (ja) * | 2010-04-21 | 2011-11-10 | Fujitsu Ltd | 半導体装置の製造方法 |
| JP4946872B2 (ja) * | 2006-02-02 | 2012-06-06 | パナソニック株式会社 | メモリカードの製造方法 |
-
1995
- 1995-06-14 JP JP7147536A patent/JPH098222A/ja not_active Withdrawn
Cited By (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2006278401A (ja) * | 2005-03-28 | 2006-10-12 | Denso Corp | 半導体装置 |
| JP4946872B2 (ja) * | 2006-02-02 | 2012-06-06 | パナソニック株式会社 | メモリカードの製造方法 |
| JP2008204462A (ja) * | 2007-02-21 | 2008-09-04 | Samsung Electronics Co Ltd | 半導体パッケージ、半導体パッケージを備える集積回路カード及びその製造方法 |
| US8329507B2 (en) | 2007-02-21 | 2012-12-11 | Samsung Electronics Co., Ltd. | Semiconductor package, integrated circuit cards incorporating the semiconductor package, and method of manufacturing the same |
| WO2009147036A1 (de) * | 2008-06-03 | 2009-12-10 | Siemens Aktiengesellschaft | Led-beleuchtungsanordnung |
| JP2011228521A (ja) * | 2010-04-21 | 2011-11-10 | Fujitsu Ltd | 半導体装置の製造方法 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A300 | Application deemed to be withdrawn because no request for examination was validly filed |
Free format text: JAPANESE INTERMEDIATE CODE: A300 Effective date: 20020903 |