JPH10177434A - メモリ増設検出回路 - Google Patents
メモリ増設検出回路Info
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- JPH10177434A JPH10177434A JP8352871A JP35287196A JPH10177434A JP H10177434 A JPH10177434 A JP H10177434A JP 8352871 A JP8352871 A JP 8352871A JP 35287196 A JP35287196 A JP 35287196A JP H10177434 A JPH10177434 A JP H10177434A
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- 238000001514 detection method Methods 0.000 claims description 24
- 238000000034 method Methods 0.000 claims description 4
- 230000006378 damage Effects 0.000 abstract description 4
- 238000010586 diagram Methods 0.000 description 8
- 230000002093 peripheral effect Effects 0.000 description 4
- 230000000694 effects Effects 0.000 description 3
- 238000007796 conventional method Methods 0.000 description 2
- 230000005669 field effect Effects 0.000 description 1
- 230000010365 information processing Effects 0.000 description 1
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Abstract
(57)【要約】
【課題】メモリ増設時にコンピュータ使用者にメモリ通
電中であることを通知、あるいはメモリの電源断を実行
し、通電中のメモリ増設によるメモリ破壊及びコンピュ
ータ本体の破壊を確実に防止するメモリ増設検出回路を
提供することにある。 【解決手段】コンピュータ本体の筐体に備えられたメモ
リ増設用筐体カバーの開閉に伴いオンオフ制御されるス
イッチ２と、スイッチ２の出力を受け、メモリの電源及
びコンピュータ本体のシステム電源の供給をオンオフ制
御する電源制御回路７を備え、システム電源オフ時にお
いて、且つメモリ電源オンとされるサスペンド状態の場
合、スイッチによりメモリ増設用筐体カバーが開けられ
たことが検出された際、メモリ増設操作と検知し、シス
テム電源を供給してレジュームを行い、メモリ電源オン
状態の旨を警告する。
電中であることを通知、あるいはメモリの電源断を実行
し、通電中のメモリ増設によるメモリ破壊及びコンピュ
ータ本体の破壊を確実に防止するメモリ増設検出回路を
提供することにある。 【解決手段】コンピュータ本体の筐体に備えられたメモ
リ増設用筐体カバーの開閉に伴いオンオフ制御されるス
イッチ２と、スイッチ２の出力を受け、メモリの電源及
びコンピュータ本体のシステム電源の供給をオンオフ制
御する電源制御回路７を備え、システム電源オフ時にお
いて、且つメモリ電源オンとされるサスペンド状態の場
合、スイッチによりメモリ増設用筐体カバーが開けられ
たことが検出された際、メモリ増設操作と検知し、シス
テム電源を供給してレジュームを行い、メモリ電源オン
状態の旨を警告する。
Description
【０００１】
【発明の属する技術分野】本発明は、メモリ保護回路に
関し、特にコンピュータ等情報処理装置のメモリ保護回
路に関する。
関し、特にコンピュータ等情報処理装置のメモリ保護回
路に関する。
【０００２】
【従来の技術】この種の従来のメモリ増設検出回路とし
て、例えば特開平３−２６９６３５号公報には、レジュ
ームモードをサポートし、かつ、増設メモリをオプショ
ンとして持つパーソナルコンピュータとして、例えば図
４に示すように、増設メモリが抜かれたことを検出し、
ＮＭＩ（ノンマスカブルインタラプト）割り込みを発す
る割り込み発生手段４３と、このＮＭＩ割り込みを受信
することにより、システム情報を記憶装置へ保存し電源
信号を出力する割り込み処理手段４１と、電源信号（パ
ワーオフコマンド）を受信することにより電源を遮断す
る電源装置４４と、電源再投入時にシステム保存フラグ
を参照してシステム情報の保存を確認し、システム復元
させるシステムブートのための処理手段４２と、システ
ムデータとシステム保存フラグが格納される記憶手段４
６と、を具備し、増設メモリを抜いたときにレジューム
モードで電源断にし、増設メモリを挿入して電源再投入
時に、増設メモリを抜く直前の状態に復帰する、ように
したパーソナルコンピュータが提案されている。
て、例えば特開平３−２６９６３５号公報には、レジュ
ームモードをサポートし、かつ、増設メモリをオプショ
ンとして持つパーソナルコンピュータとして、例えば図
４に示すように、増設メモリが抜かれたことを検出し、
ＮＭＩ（ノンマスカブルインタラプト）割り込みを発す
る割り込み発生手段４３と、このＮＭＩ割り込みを受信
することにより、システム情報を記憶装置へ保存し電源
信号を出力する割り込み処理手段４１と、電源信号（パ
ワーオフコマンド）を受信することにより電源を遮断す
る電源装置４４と、電源再投入時にシステム保存フラグ
を参照してシステム情報の保存を確認し、システム復元
させるシステムブートのための処理手段４２と、システ
ムデータとシステム保存フラグが格納される記憶手段４
６と、を具備し、増設メモリを抜いたときにレジューム
モードで電源断にし、増設メモリを挿入して電源再投入
時に、増設メモリを抜く直前の状態に復帰する、ように
したパーソナルコンピュータが提案されている。
【０００３】また、別の従来技術例として、例えば実開
平６−１１０４２号公報には、ユーザが拡張メモリの増
設または交換を行う際に、拡張メモリの電源及びリフレ
ッシュ信号を自動的に切断することにより信頼性の向上
を図ったパーソナルコンピュータとして、図５に示すよ
うに、センサ５７にてユーザによる拡張メモリ５１の増
設または交換意志を検出することにより、電源制御回路
５４、インタフェース制御回路５６を介して、メモリカ
ードの脱着前に、メモリカードに供給すべき電源、及び
フレッシュ信号を切断し、システム側の拡張メモリイン
タフェース回路５５や拡張メモリ自体の故障を未然に防
ぐようにした構成が提案されている。
平６−１１０４２号公報には、ユーザが拡張メモリの増
設または交換を行う際に、拡張メモリの電源及びリフレ
ッシュ信号を自動的に切断することにより信頼性の向上
を図ったパーソナルコンピュータとして、図５に示すよ
うに、センサ５７にてユーザによる拡張メモリ５１の増
設または交換意志を検出することにより、電源制御回路
５４、インタフェース制御回路５６を介して、メモリカ
ードの脱着前に、メモリカードに供給すべき電源、及び
フレッシュ信号を切断し、システム側の拡張メモリイン
タフェース回路５５や拡張メモリ自体の故障を未然に防
ぐようにした構成が提案されている。
【０００４】
【発明が解決しようとする課題】しかしながら、上記し
た従来技術は、メモリ通電中にメモリ増設を行い、メモ
リの破壊を招く可能性がある、という問題点を有してい
る。
た従来技術は、メモリ通電中にメモリ増設を行い、メモ
リの破壊を招く可能性がある、という問題点を有してい
る。
【０００５】その理由は、メモリ増設時に、メモリ通電
中であることを使用者に認識させる手段を具備していな
い、ことによる。また、メモリ増設時に自動で電源断を
実行する回路を持たない、ことによる。
中であることを使用者に認識させる手段を具備していな
い、ことによる。また、メモリ増設時に自動で電源断を
実行する回路を持たない、ことによる。
【０００６】したがって、本発明は、上記問題点に鑑み
てなされたものであって、その目的は、メモリ増設時に
コンピュータ使用者にメモリ通電中であることを通知、
あるいはメモリの電源断を実行し、通電中のメモリ増設
によるメモリ破壊及びコンピュータ本体の破壊を確実に
防止するメモリ増設検出回路を提供することにある。
てなされたものであって、その目的は、メモリ増設時に
コンピュータ使用者にメモリ通電中であることを通知、
あるいはメモリの電源断を実行し、通電中のメモリ増設
によるメモリ破壊及びコンピュータ本体の破壊を確実に
防止するメモリ増設検出回路を提供することにある。
【０００７】
【課題を解決するための手段】前記目的を達成するた
め、本発明のメモリ増設検出回路は、コンピュータ本体
に、メモリ増設のために事前に行われる予備動作を検出
した際にメモリ増設検出信号を出力する手段を備え、前
記コンピュータ本体がサスペンド状態にある時、前記検
出手段からのメモリ増設検出信号が一定時間アクティブ
の時、コンピュータシステムの電源をオンとしてレジュ
ーム処理を行わせる、ことを特徴とする。
め、本発明のメモリ増設検出回路は、コンピュータ本体
に、メモリ増設のために事前に行われる予備動作を検出
した際にメモリ増設検出信号を出力する手段を備え、前
記コンピュータ本体がサスペンド状態にある時、前記検
出手段からのメモリ増設検出信号が一定時間アクティブ
の時、コンピュータシステムの電源をオンとしてレジュ
ーム処理を行わせる、ことを特徴とする。
【０００８】また、本発明は、レジューム処理実行後、
所定の記憶装置に、電源断される回路の情報を退避し、
その後電源断することを特徴とする。
所定の記憶装置に、電源断される回路の情報を退避し、
その後電源断することを特徴とする。
【０００９】
【発明の実施の形態】本発明の実施の形態について以下
に説明する。コンピュータ本体の筐体に備えられたメモ
リ増設用筐体カバー（図１の４）の開閉に伴いオン／オ
フ制御されるスイッチ（図１の２）と、このスイッチの
出力を受け、メモリの電源及びコンピュータ本体のシス
テム電源の供給をオン／オフ制御する電源制御回路（図
２の７）を備え、例えばシステム電源オフ時において、
メモリ電源オン時の場合、スイッチ（図１の２）によ
り、メモリ増設用筐体カバー（図１の４）が開けられた
ことを検出された際に、メモリ増設操作と検知し、シス
テム電源を供給して、レジュームを行い、警告する。
に説明する。コンピュータ本体の筐体に備えられたメモ
リ増設用筐体カバー（図１の４）の開閉に伴いオン／オ
フ制御されるスイッチ（図１の２）と、このスイッチの
出力を受け、メモリの電源及びコンピュータ本体のシス
テム電源の供給をオン／オフ制御する電源制御回路（図
２の７）を備え、例えばシステム電源オフ時において、
メモリ電源オン時の場合、スイッチ（図１の２）によ
り、メモリ増設用筐体カバー（図１の４）が開けられた
ことを検出された際に、メモリ増設操作と検知し、シス
テム電源を供給して、レジュームを行い、警告する。
【００１０】また本発明の実施の形態においては、レジ
ューム処理実行後、磁気記憶装置等所定の記憶装置（図
３の１８）に、メモリ増設等に際して、電源断されるメ
モリ（図１の１４）及びコンピュータの各種レジスタの
情報を退避し、その後、メモリ電源を断する。
ューム処理実行後、磁気記憶装置等所定の記憶装置（図
３の１８）に、メモリ増設等に際して、電源断されるメ
モリ（図１の１４）及びコンピュータの各種レジスタの
情報を退避し、その後、メモリ電源を断する。
【００１１】このように、本発明の実施の形態において
は、メモリの通電の有無を、メモリを増設するための動
作、すなわち、メモリ増設用筐体カバー（図１の４）の
開閉により検出している。
は、メモリの通電の有無を、メモリを増設するための動
作、すなわち、メモリ増設用筐体カバー（図１の４）の
開閉により検出している。
【００１２】このため、コンピュータ使用者は、メモリ
通電中にあっては、メモリ増設時に警告（例えば図１の
警告ＬＥＤ６を介して）を受けるため、容易に通電中か
否か判断することができる。
通電中にあっては、メモリ増設時に警告（例えば図１の
警告ＬＥＤ６を介して）を受けるため、容易に通電中か
否か判断することができる。
【００１３】また、メモリ増設用筐体カバー（図１の
４）の開閉により、電源の制御を行うことにより、メモ
リ増設時に通電中であるという事態を確実に回避するこ
とができる。
４）の開閉により、電源の制御を行うことにより、メモ
リ増設時に通電中であるという事態を確実に回避するこ
とができる。
【００１４】
【実施例】上記した本発明の実施の形態について更に詳
細に説明すべく、本発明の実施例を図面を参照して以下
に説明する。
細に説明すべく、本発明の実施例を図面を参照して以下
に説明する。
【００１５】図１（Ａ）は、本発明の一実施例の構成を
示す平面図（背面図）であり、及び図１（Ｂ）は、図１
（Ａ）のＸ−Ｘ′線の側断面図である。
示す平面図（背面図）であり、及び図１（Ｂ）は、図１
（Ａ）のＸ−Ｘ′線の側断面図である。
【００１６】図１を参照すると、本実施例においては、
ノートパソコン本体１に内蔵されるメインボード５上に
増設メモリボード３を増設する構造とされており、増設
メモリボード３を増設する場合、ノートパソコン本体１
の増設メモリ用筐体カバー４を開ける。スイッチ２は、
この増設メモリ用筐体カバー４の開閉に伴いオン、オフ
する。また本体背面には警告用のＬＥＤ６が設けられて
いる。
ノートパソコン本体１に内蔵されるメインボード５上に
増設メモリボード３を増設する構造とされており、増設
メモリボード３を増設する場合、ノートパソコン本体１
の増設メモリ用筐体カバー４を開ける。スイッチ２は、
この増設メモリ用筐体カバー４の開閉に伴いオン、オフ
する。また本体背面には警告用のＬＥＤ６が設けられて
いる。
【００１７】図２は、本実施例における、スイッチ及び
電源制御回路の構成を示した図である。図２を参照する
と、スイッチ２のオン、オフによりメモリ増設検出信号
８が変化する。メモリ増設検出信号８は、プルアップ抵
抗９を介して電源ＶＣＣ側にプルアップされて電源制御
回路７に入力されており、スイッチ２がオン時には低電
位（“Ｌ”レベル）、スイッチ２がオフ時には高電位
（“Ｈ”レベル）となる。
電源制御回路の構成を示した図である。図２を参照する
と、スイッチ２のオン、オフによりメモリ増設検出信号
８が変化する。メモリ増設検出信号８は、プルアップ抵
抗９を介して電源ＶＣＣ側にプルアップされて電源制御
回路７に入力されており、スイッチ２がオン時には低電
位（“Ｌ”レベル）、スイッチ２がオフ時には高電位
（“Ｈ”レベル）となる。
【００１８】システム用電源ＦＥＴ（電界効果トランジ
スタ）１２は、システム全体に電源供給を行い、電源制
御回路７より出力されたシステム用電源ＦＥＴ制御信号
１０によりオン／オフ制御される。また、メモリ用電源
ＦＥＴ１３はメモリ１４に電源供給を行い電源制御回路
７より出力されたメモリ用電源ＦＥＴ制御信号１１によ
りオン／オフ制御される。
スタ）１２は、システム全体に電源供給を行い、電源制
御回路７より出力されたシステム用電源ＦＥＴ制御信号
１０によりオン／オフ制御される。また、メモリ用電源
ＦＥＴ１３はメモリ１４に電源供給を行い電源制御回路
７より出力されたメモリ用電源ＦＥＴ制御信号１１によ
りオン／オフ制御される。
【００１９】次に、本発明の実施例について、図１及び
図２を参照して詳細に説明する。
図２を参照して詳細に説明する。
【００２０】スイッチ２は、増設メモリ用筐体カバー４
が閉じている時は常にオンとなり、一方、増設メモリ用
筐体カバー４が開いている時はオフとなる。
が閉じている時は常にオンとなり、一方、増設メモリ用
筐体カバー４が開いている時はオフとなる。
【００２１】上記したように、スイッチ２がオンの場合
メモリ増設検出信号８は“Ｌ”レベルとなり、反対にス
イッチ２がオフの場合にはメモリ増設検出信号８は
“Ｈ”レベルとなる。
メモリ増設検出信号８は“Ｌ”レベルとなり、反対にス
イッチ２がオフの場合にはメモリ増設検出信号８は
“Ｈ”レベルとなる。
【００２２】またサスペンド状態の場合、メモリ用電源
ＦＥＴ１３はオンとされ、メモリ１４には、電源供給さ
れ、一方、システム用電源ＦＥＴ１２はオフとされ、シ
ステムは電源断状態である。
ＦＥＴ１３はオンとされ、メモリ１４には、電源供給さ
れ、一方、システム用電源ＦＥＴ１２はオフとされ、シ
ステムは電源断状態である。
【００２３】電源制御回路７は、メモリ増設検出信号８
として“Ｈ”レベル（スイッチ２がオフ；増設メモリ用
筐体カバー４が開状態）を一定時間以上継続することを
検出すると、システム用電源ＦＥＴ１２をオン状態（導
通状態）にする。これに伴って、システム電源が供給さ
れてコンピュータシステムがブートし、ソフトウェアが
レジューム処理を開始する。なお、メモリ増設検出信号
８が一定時間“Ｈ”レベルである場合にシステム用電源
ＦＥＴ１２をオン状態とするのは、ノイズ等の影響を回
避しカバー４の開状態を確実に検知するためでもある。
として“Ｈ”レベル（スイッチ２がオフ；増設メモリ用
筐体カバー４が開状態）を一定時間以上継続することを
検出すると、システム用電源ＦＥＴ１２をオン状態（導
通状態）にする。これに伴って、システム電源が供給さ
れてコンピュータシステムがブートし、ソフトウェアが
レジューム処理を開始する。なお、メモリ増設検出信号
８が一定時間“Ｈ”レベルである場合にシステム用電源
ＦＥＴ１２をオン状態とするのは、ノイズ等の影響を回
避しカバー４の開状態を確実に検知するためでもある。
【００２４】上記の通り、本実施例においては、コンピ
ュータ使用者が増設メモリ用筐体カバー４の開閉を行う
ことでレジューム処理が行われるため、コンピュータ使
用者に対して警告を与えることが可能となる。
ュータ使用者が増設メモリ用筐体カバー４の開閉を行う
ことでレジューム処理が行われるため、コンピュータ使
用者に対して警告を与えることが可能となる。
【００２５】次に、本発明の第２の実施例について図面
を参照して説明する。図３は、本発明の第２の実施例の
構成を示す図である。
を参照して説明する。図３は、本発明の第２の実施例の
構成を示す図である。
【００２６】図３を参照すると、本実施例において、ス
イッチ２、プルアップ抵抗９、電源制御回路７、システ
ム用電源ＦＥＴ制御信号１０、メモリ用電源ＦＥＴ制御
信号１１、システム用電源ＦＥＴ１２、メモリ用電源Ｆ
ＥＴ１３は、前記第１の実施例と同様に接続されてい
る。
イッチ２、プルアップ抵抗９、電源制御回路７、システ
ム用電源ＦＥＴ制御信号１０、メモリ用電源ＦＥＴ制御
信号１１、システム用電源ＦＥＴ１２、メモリ用電源Ｆ
ＥＴ１３は、前記第１の実施例と同様に接続されてい
る。
【００２７】システム用電源ＦＥＴ１２は、ＣＰＵ１
６、周辺制御部１７、磁気記憶装置１８用のシステム電
源としてシステム電源プレーン１５に接続されている。
６、周辺制御部１７、磁気記憶装置１８用のシステム電
源としてシステム電源プレーン１５に接続されている。
【００２８】ＣＰＵ１６は周辺制御部１７を通して磁気
記憶装置１８、メモリ１４を制御している。
記憶装置１８、メモリ１４を制御している。
【００２９】前記実施例と同様、コンピュータ使用者が
増設メモリ用筐体カバー４の開閉を行うことでレジュー
ム処理が行われる。
増設メモリ用筐体カバー４の開閉を行うことでレジュー
ム処理が行われる。
【００３０】レジューム処理において、ソフトウェア
は、増設メモリ用筐体カバー４の開閉の要因であるか否
かを判別し、増設メモリ用筐体カバー４の開閉が要因で
あれば、ＣＰＵ１６、周辺制御部１７を通して、メモリ
１４の内容を、磁気記憶装置１８へ転送する。
は、増設メモリ用筐体カバー４の開閉の要因であるか否
かを判別し、増設メモリ用筐体カバー４の開閉が要因で
あれば、ＣＰＵ１６、周辺制御部１７を通して、メモリ
１４の内容を、磁気記憶装置１８へ転送する。
【００３１】その後、システム電源プレーン１５とメモ
リ１４への電源を電源制御回路７が切断する。
リ１４への電源を電源制御回路７が切断する。
【００３２】本実施例においては、上記の通り、コンピ
ュータ使用者が増設メモリ用筐体カバー４の開閉を行う
ことで、自動的にメモリ１４の内容を磁気記憶装置に退
避しシステムメモリ１４の電源断を行いコンピュータ使
用者が特別な対応なしにメモリ増設を行うことが可能と
なる。なお、磁気記憶装置１８の代わりに、書き込み可
能な不揮発性メモリとしてもよいことは勿論である。
ュータ使用者が増設メモリ用筐体カバー４の開閉を行う
ことで、自動的にメモリ１４の内容を磁気記憶装置に退
避しシステムメモリ１４の電源断を行いコンピュータ使
用者が特別な対応なしにメモリ増設を行うことが可能と
なる。なお、磁気記憶装置１８の代わりに、書き込み可
能な不揮発性メモリとしてもよいことは勿論である。
【００３３】
【発明の効果】以上説明したように、本発明によれば、
下記記載の効果を奏する。
下記記載の効果を奏する。
【００３４】本発明の第１の効果は、コンピュータ使用
者がメモリ増設時に、メモリ通電状態を認識することが
できる、ということである。これにより、メモリ通電中
にメモリ増設することを防止し、またメモリ通電中に人
為的にメモリ増設を行うことはできなくなる。
者がメモリ増設時に、メモリ通電状態を認識することが
できる、ということである。これにより、メモリ通電中
にメモリ増設することを防止し、またメモリ通電中に人
為的にメモリ増設を行うことはできなくなる。
【００３５】その理由は、本発明においては、メモリ通
電時においてメモリ増設を行おうとした際、レジューム
を行い、メモリ通電であることを警告する、からであ
る。
電時においてメモリ増設を行おうとした際、レジューム
を行い、メモリ通電であることを警告する、からであ
る。
【００３６】本発明の第２の効果は、コンピュータ使用
者がメモリ増設時に、メモリ通電状態であっても、電源
を断し、これにより、いつでもメモリ増設が可能とな
る。
者がメモリ増設時に、メモリ通電状態であっても、電源
を断し、これにより、いつでもメモリ増設が可能とな
る。
【００３７】その理由は、本発明においては、メモリ増
設用筐体カバーを開くことによりメモリの内容を他の記
憶装置に移し、メモリの電源断を実行するからである。
設用筐体カバーを開くことによりメモリの内容を他の記
憶装置に移し、メモリの電源断を実行するからである。
【図１】本発明の一実施例の構成を示す図である。
【図２】本発明のメモリ増設検出回路の一実施例の回路
構成を示す図である。
構成を示す図である。
【図３】本発明のメモリ増設検出回路の他の実施例の回
路構成を示す図である。
路構成を示す図である。
【図４】従来技術の構成を示す図である。
【図５】従来技術の構成を示す図である。
１ ノートパソコン本体 ２ スイッチ ３ 増設メモリボード ４ 増設メモリ用筐体カバー ５ メインボード ６ 警告ＬＥＤ ７ 電源制御回路 ８ メモリ増設検出信号 ９ プルアップル抵抗 １０ システム用電源ＦＥＴ制御信号 １１ メモリ用電源ＦＥＴ制御信号 １２ システム用電源ＦＥＴ １３ メモリ用電源ＦＥＴ １４ メモリ １５ システム電源プレーン １６ ＣＰＵ １７ 周辺制御部 １８ 磁気記憶装置
Claims (5)
- 【請求項１】サスペンド状態のコンピュータ本体にメモ
リ増設のための予備動作を検出した際にメモリ増設検出
信号を発生させ、 前記メモリ増設検出信号が一定時間以上経過する場合、
電源制御回路から電力を供給してレジュームを行う、こ
とを特徴とするメモリ増設検出回路。 - 【請求項２】コンピュータ本体に、メモリ増設のために
事前に行われる予備動作を検出した際にメモリ増設検出
信号を出力する手段を備え、 前記コンピュータ本体がサスペンド状態にある時、前記
検出手段からのメモリ増設検出信号が一定時間アクティ
ブの時、コンピュータシステムの電源をオンとしてレジ
ューム処理を行わせる、ことを特徴とするメモリ増設検
出回路。 - 【請求項３】レジューム処理実行後、所定の記憶装置
に、電源断される回路の情報を退避し、その後電源断す
ることを特徴とする請求項１又は２記載のメモリ増設検
出回路。 - 【請求項４】コンピュータ本体の筐体に備えられたメモ
リ増設用筐体カバーの開閉に伴いオン／オフ制御される
スイッチと、 前記スイッチの出力を受け、メモリの電源及びコンピュ
ータ本体のシステム電源の供給をオン／オフ制御する電
源制御回路と、を備え、 前記システム電源がオフとされており、且つ前記メモリ
電源オンとされる場合において、前記スイッチにより前
記メモリ増設用筐体カバーが開けられたことが検出され
た際、メモリ増設操作と検知し、前記電源制御回路から
前記システム電源を供給してレジュームを行わせ、メモ
リ電源がオン状態の旨を操作者に警告する、ことを特徴
とするメモリ増設検出回路。 - 【請求項５】レジューム処理実行後、磁気記憶装置等の
不揮発型の書き込み可能記憶装置に、メモリ増設に際し
て電源断される前記メモリ、及び前記コンピュータのレ
ジスタの情報を退避し、その後、電源断する、ことを特
徴とする請求項４記載のメモリ増設検出回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8352871A JP2985808B2 (ja) | 1996-12-13 | 1996-12-13 | メモリ増設検出回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8352871A JP2985808B2 (ja) | 1996-12-13 | 1996-12-13 | メモリ増設検出回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH10177434A true JPH10177434A (ja) | 1998-06-30 |
| JP2985808B2 JP2985808B2 (ja) | 1999-12-06 |
Family
ID=18427023
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8352871A Expired - Fee Related JP2985808B2 (ja) | 1996-12-13 | 1996-12-13 | メモリ増設検出回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2985808B2 (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2012226605A (ja) * | 2011-04-20 | 2012-11-15 | Canon Inc | 情報処理装置、その制御方法、及びプログラム |
| JP2014160365A (ja) * | 2013-02-20 | 2014-09-04 | Lenovo Singapore Pte Ltd | 通電範囲の制御方法および携帯式電子機器 |
-
1996
- 1996-12-13 JP JP8352871A patent/JP2985808B2/ja not_active Expired - Fee Related
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