JPH10319924A - デジタル方式の液晶表示パネル駆動回路 - Google Patents
デジタル方式の液晶表示パネル駆動回路Info
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Abstract
(57)【要約】
【課題】 本発明は、デジタル映像信号により液晶表示
パネルを駆動し、画像が液晶表示パネルに表示されるよ
うにするデジタル方式の液晶表示パネル駆動回路に関す
る。 【解決手段】 このデジタル方式の液晶表示パネル駆動
回路は、ｎ個のデジタル画素データからｋ個のデジタル
画素データを選択するためのマルチプレクサアレーと、
前記のマルチプレクサアレーからのｋ個のデジタル画素
データをｋ個のアナログ画素信号に変換するためのデジ
タル−アナログ変換器アレーと、ｎ個のデータライン等
に接続され、前記ｎ個のデータラインの中からｋ個を選
択すると共に、前記のデジタル−アナログ変換器アレー
からのｋ個のアナログ画素信号を、前記の選択されたｋ
個のデータライン等に転送するためのディマルチプレク
サアレーとを備える。前記の構成により、デジタル方式
の液晶表示パネル駆動回路は回路構成の簡素化は勿論、
瞬間の電力消費量を減少させることができる利点を提供
する。
パネルを駆動し、画像が液晶表示パネルに表示されるよ
うにするデジタル方式の液晶表示パネル駆動回路に関す
る。 【解決手段】 このデジタル方式の液晶表示パネル駆動
回路は、ｎ個のデジタル画素データからｋ個のデジタル
画素データを選択するためのマルチプレクサアレーと、
前記のマルチプレクサアレーからのｋ個のデジタル画素
データをｋ個のアナログ画素信号に変換するためのデジ
タル−アナログ変換器アレーと、ｎ個のデータライン等
に接続され、前記ｎ個のデータラインの中からｋ個を選
択すると共に、前記のデジタル−アナログ変換器アレー
からのｋ個のアナログ画素信号を、前記の選択されたｋ
個のデータライン等に転送するためのディマルチプレク
サアレーとを備える。前記の構成により、デジタル方式
の液晶表示パネル駆動回路は回路構成の簡素化は勿論、
瞬間の電力消費量を減少させることができる利点を提供
する。
Description
【０００１】
【発明の属する技術分野】本発明は、液晶表示パネルを
利用する表示装置に関するもので、特に液晶表示パネル
をデジタル映像信号により駆動するデジタル方式の液晶
表示パネル駆動回路に関する。
利用する表示装置に関するもので、特に液晶表示パネル
をデジタル映像信号により駆動するデジタル方式の液晶
表示パネル駆動回路に関する。
【０００２】
【従来の技術】最近、映像媒体で視聴者に高解像度の画
像を提供するための方法として、既存のアナログ映像信
号の代わりに、情報の圧縮が容易なデジタル映像信号で
転送する方式に転換されつつある趨勢である。それによ
り、映像表示装置の一つの種類の液晶表示パネルも、既
存のアナログ映像信号の代わりにデジタル映像信号によ
り駆動されなければならないようになった。そのため
に、液晶表示パネル用の駆動回路は、アナログ信号を要
求する液晶表示パネルの画素等を駆動することに適合す
るように新たに構成されている。その結果、液晶表示パ
ネル駆動回路には、既存のアナログ方式の液晶表示パネ
ル駆動回路とデジタル方式の液晶表示パネル駆動回路と
が併存している。
像を提供するための方法として、既存のアナログ映像信
号の代わりに、情報の圧縮が容易なデジタル映像信号で
転送する方式に転換されつつある趨勢である。それによ
り、映像表示装置の一つの種類の液晶表示パネルも、既
存のアナログ映像信号の代わりにデジタル映像信号によ
り駆動されなければならないようになった。そのため
に、液晶表示パネル用の駆動回路は、アナログ信号を要
求する液晶表示パネルの画素等を駆動することに適合す
るように新たに構成されている。その結果、液晶表示パ
ネル駆動回路には、既存のアナログ方式の液晶表示パネ
ル駆動回路とデジタル方式の液晶表示パネル駆動回路と
が併存している。
【０００３】このような液晶表示パネル駆動回路は、液
晶表示パネル上の画素等のそれぞれに、映像信号に該当
する電圧を正確に印加することができる十分な信号供給
時間を確保しなければならない。それを解決するため
に、アナログ方式の液晶表示パネル駆動回路としては、
１水平走査ライン上の画素等を２個以上の一定個数づつ
順次的に駆動する方案が、日本国公開特許公報第１９９
５（平成７年）−１８１９３３号に開示された。この日
本国公開特許公報第１９９５−１８１９３３号による
と、アナログ方式の液晶表示パネル駆動回路は、遅延素
子を利用して映像信号を遅延させ、遅延された映像信号
は、水平ライン上の中間部分から右側先端に至る画素等
に、そして遅延されない映像信号は、左側先端から中央
部分に至る画素等に順次的に印加した。このようなアナ
ログ方式の液晶表示パネル駆動回路は、アナログ映像信
号を画素の駆動電圧としてそのまま利用しているので、
水平ライン上の画素等を２個づつ順次的に駆動しても、
画素別に十分な信号供給時間を確保することができた。
晶表示パネル上の画素等のそれぞれに、映像信号に該当
する電圧を正確に印加することができる十分な信号供給
時間を確保しなければならない。それを解決するため
に、アナログ方式の液晶表示パネル駆動回路としては、
１水平走査ライン上の画素等を２個以上の一定個数づつ
順次的に駆動する方案が、日本国公開特許公報第１９９
５（平成７年）−１８１９３３号に開示された。この日
本国公開特許公報第１９９５−１８１９３３号による
と、アナログ方式の液晶表示パネル駆動回路は、遅延素
子を利用して映像信号を遅延させ、遅延された映像信号
は、水平ライン上の中間部分から右側先端に至る画素等
に、そして遅延されない映像信号は、左側先端から中央
部分に至る画素等に順次的に印加した。このようなアナ
ログ方式の液晶表示パネル駆動回路は、アナログ映像信
号を画素の駆動電圧としてそのまま利用しているので、
水平ライン上の画素等を２個づつ順次的に駆動しても、
画素別に十分な信号供給時間を確保することができた。
【０００４】それとは異なって、デジタル方式の液晶表
示パネル駆動回路は、デジタル映像信号をアナログ映像
信号に変換する信号変換時間を必要とするので、前記の
日本国公開特許公報第１９９５−１８１９３３号のよう
なアナログ方式の液晶表示パネル駆動方法によっては、
画素別の信号供給時間を十分に確保することができなか
った。それにより、デジタル方式の液晶表示パネル駆動
回路は、１水平ライン上の画素等を同時に駆動するよう
に、図１に示されるように構成された。
示パネル駆動回路は、デジタル映像信号をアナログ映像
信号に変換する信号変換時間を必要とするので、前記の
日本国公開特許公報第１９９５−１８１９３３号のよう
なアナログ方式の液晶表示パネル駆動方法によっては、
画素別の信号供給時間を十分に確保することができなか
った。それにより、デジタル方式の液晶表示パネル駆動
回路は、１水平ライン上の画素等を同時に駆動するよう
に、図１に示されるように構成された。
【０００５】図１を参照すると、液晶表示パネル（１
０）は、それぞれ垂直方向に配列された６００個の画素
等に接続された２４００個のデータライン（ＤＬ１乃至
ＤＬ２４００）を備える。そして、液晶表示パネル（１
０）上の６００×２４００個の画素等を駆動するための
駆動回路（２０）は、第１乃至第３データバス(Data Bu
s；ＤＢ１乃至ＤＢ３）に接続された第１ラッチアレー
（２２）と、この第１ラッチアレー（２２）に縦属接続
された第２ラッチアレー（２４）、デジタル−アナログ
変換器アレー（２６）及び出力増幅器アレー（２８）か
ら構成される。第１及び第２ラッチアレー（２２，２
４）は、それぞれ２４００個のラッチ等から構成され
る。第１ラッチアレー（２２）に含まれた２４００個の
ラッチ等は、８００個つづ区分され、第１乃至第３デー
タバス（ＤＢ１乃至ＤＢ３）に分散接続される。併せ
て、第１ラッチアレー（２２）に含まれた２４００個の
ラッチ等は、３個づつ順次的に駆動され、第１乃至第３
データバス（ＤＢ１乃至ＤＢ３）から１水平ライン分の
赤色（以下“Ｒ”という）、緑色（以下“Ｇ”という）
及び青色（以下“Ｂ”という）画素データを入力する。
そして、第２ラッチアレー（２４）に含まれた２４００
個のラッチ等は、それぞれ第１ラッチアレー（２２）の
２４００個のラッチ等からの画素データを同時に入力し
て、Ｄ−Ａ変換器アレー（２６）側に転送する。そうす
ると、Ｄ−Ａ変換器アレー（２６）は、第２ラッチアレ
ー（２４）からの２４００個の画素データの全てを画素
信号に変換し、その変換された２４００個の画素信号を
出力増幅器アレー（２８）に供給する。
０）は、それぞれ垂直方向に配列された６００個の画素
等に接続された２４００個のデータライン（ＤＬ１乃至
ＤＬ２４００）を備える。そして、液晶表示パネル（１
０）上の６００×２４００個の画素等を駆動するための
駆動回路（２０）は、第１乃至第３データバス(Data Bu
s；ＤＢ１乃至ＤＢ３）に接続された第１ラッチアレー
（２２）と、この第１ラッチアレー（２２）に縦属接続
された第２ラッチアレー（２４）、デジタル−アナログ
変換器アレー（２６）及び出力増幅器アレー（２８）か
ら構成される。第１及び第２ラッチアレー（２２，２
４）は、それぞれ２４００個のラッチ等から構成され
る。第１ラッチアレー（２２）に含まれた２４００個の
ラッチ等は、８００個つづ区分され、第１乃至第３デー
タバス（ＤＢ１乃至ＤＢ３）に分散接続される。併せ
て、第１ラッチアレー（２２）に含まれた２４００個の
ラッチ等は、３個づつ順次的に駆動され、第１乃至第３
データバス（ＤＢ１乃至ＤＢ３）から１水平ライン分の
赤色（以下“Ｒ”という）、緑色（以下“Ｇ”という）
及び青色（以下“Ｂ”という）画素データを入力する。
そして、第２ラッチアレー（２４）に含まれた２４００
個のラッチ等は、それぞれ第１ラッチアレー（２２）の
２４００個のラッチ等からの画素データを同時に入力し
て、Ｄ−Ａ変換器アレー（２６）側に転送する。そうす
ると、Ｄ−Ａ変換器アレー（２６）は、第２ラッチアレ
ー（２４）からの２４００個の画素データの全てを画素
信号に変換し、その変換された２４００個の画素信号を
出力増幅器アレー（２８）に供給する。
【０００６】そのために、Ｄ−Ａ変換器アレー（２６）
は、図示されていないガンマ補正部からの一定個数（例
えば５個）の変換ソース信号等を共通的に入力する２４
００個のＤ−Ａ変換器等から構成される。この２４００
個のＤ−Ａ変換器等は、それぞれ第２ラッチアレー（２
４）の該当ラッチからの画素データの論理値に従って、
変換ソース信号等の一部または全部を加算することによ
って画素信号を発生するようになる。最後に、出力増幅
器アレー（２８）は、Ｄ−Ａ変換器アレー（２６）から
の２４００個の画素信号等を一定の増幅率で増幅し、そ
の増幅された２４００個の画素信号等を液晶表示パネル
（１０）の２４００個のデータライン（ＤＬ１乃至ＤＬ
２４００）に分散供給する。そのために、出力増幅器ア
レー（２８）も、Ｄ−Ａ変換器アレー（２６）の２４０
０個のＤ−Ａ変換器等に分散接続された２４００個の出
力増幅器等を備える。
は、図示されていないガンマ補正部からの一定個数（例
えば５個）の変換ソース信号等を共通的に入力する２４
００個のＤ−Ａ変換器等から構成される。この２４００
個のＤ−Ａ変換器等は、それぞれ第２ラッチアレー（２
４）の該当ラッチからの画素データの論理値に従って、
変換ソース信号等の一部または全部を加算することによ
って画素信号を発生するようになる。最後に、出力増幅
器アレー（２８）は、Ｄ−Ａ変換器アレー（２６）から
の２４００個の画素信号等を一定の増幅率で増幅し、そ
の増幅された２４００個の画素信号等を液晶表示パネル
（１０）の２４００個のデータライン（ＤＬ１乃至ＤＬ
２４００）に分散供給する。そのために、出力増幅器ア
レー（２８）も、Ｄ−Ａ変換器アレー（２６）の２４０
０個のＤ−Ａ変換器等に分散接続された２４００個の出
力増幅器等を備える。
【０００７】以上のごとく、従来のデジタル方式の液晶
表示パネル駆動回路は、液晶表示パネル上の１水平ライ
ン分の画素等を同時に駆動し、画素別の信号供給時間を
十分に確保することができた。しかし、従来のデジタル
方式の液晶表示パネル駆動回路では、液晶表示パネルの
水平ラインに含まれた画素数に該当するＤ−Ａ変換器等
と出力増幅器等が使用されなければならないので、その
回路構成が複雑となることは言うまでもなく、その嵩も
大きくなる。併せて、従来のデジタル方式の液晶表示パ
ネル駆動回路では、多数のＤ−Ａ変換器等と出力増幅器
等とが同時に駆動されなければならなかったので、瞬間
の電力消費が非常に大きくなる。
表示パネル駆動回路は、液晶表示パネル上の１水平ライ
ン分の画素等を同時に駆動し、画素別の信号供給時間を
十分に確保することができた。しかし、従来のデジタル
方式の液晶表示パネル駆動回路では、液晶表示パネルの
水平ラインに含まれた画素数に該当するＤ−Ａ変換器等
と出力増幅器等が使用されなければならないので、その
回路構成が複雑となることは言うまでもなく、その嵩も
大きくなる。併せて、従来のデジタル方式の液晶表示パ
ネル駆動回路では、多数のＤ−Ａ変換器等と出力増幅器
等とが同時に駆動されなければならなかったので、瞬間
の電力消費が非常に大きくなる。
【０００８】
【発明が解決しようとする課題】従って、本発明の目的
は、回路構成を簡素化することができ、瞬間の電力消費
を減少させることができるデジタル方式の液晶表示パネ
ル駆動回路を提供することにある。
は、回路構成を簡素化することができ、瞬間の電力消費
を減少させることができるデジタル方式の液晶表示パネ
ル駆動回路を提供することにある。
【０００９】本発明の他の目的は、液晶表示パネルの引
出ラインの数を減少させることができる、デジタル方式
の液晶表示パネル駆動回路を提供することにある。
出ラインの数を減少させることができる、デジタル方式
の液晶表示パネル駆動回路を提供することにある。
【００１０】
【課題を解決するための手段】前記の目的を達成するた
めに、本発明によるデジタル方式の液晶表示パネル駆動
回路は、ｎ個のデジタル画素データからｋ個のデジタル
画素データを選択するためのマルチプレクサアレーと、
前記マルチプレクサアレーからのｋ個のデジタル画素デ
ータをｋ個のアナログ画素信号に変換するためのデジタ
ル−アナログ変換器アレーと、ｎ個のデータラインに接
続され、前記ｎ個のデータラインの中からｋ個を選択す
ると同時に、前記のデジタル−アナログ変換器アレーか
らのｋ個のアナログ画素信号を、前記選択されたｋ個の
データラインに転送するためのディマルチプレクサアレ
ーとを備える。
めに、本発明によるデジタル方式の液晶表示パネル駆動
回路は、ｎ個のデジタル画素データからｋ個のデジタル
画素データを選択するためのマルチプレクサアレーと、
前記マルチプレクサアレーからのｋ個のデジタル画素デ
ータをｋ個のアナログ画素信号に変換するためのデジタ
ル−アナログ変換器アレーと、ｎ個のデータラインに接
続され、前記ｎ個のデータラインの中からｋ個を選択す
ると同時に、前記のデジタル−アナログ変換器アレーか
らのｋ個のアナログ画素信号を、前記選択されたｋ個の
データラインに転送するためのディマルチプレクサアレ
ーとを備える。
【００１１】本発明によるデジタル方式の液晶表示パネ
ルの駆動方法は、ｎ個のデジタル画素データからｋ個の
デジタル画素データを選択する段階と、マルチプレクサ
アレーからの前記ｋ個のデジタル画素データをｋ個のア
ナログ画素信号に変換する段階と、ｎ個のデータライン
の中からｋ個を選択する段階と、デジタル−アナログ変
換器からの前記ｋ個のアナログ画素信号を、前記選択さ
れたｋ個のデータラインに転送する段階とを含む。
ルの駆動方法は、ｎ個のデジタル画素データからｋ個の
デジタル画素データを選択する段階と、マルチプレクサ
アレーからの前記ｋ個のデジタル画素データをｋ個のア
ナログ画素信号に変換する段階と、ｎ個のデータライン
の中からｋ個を選択する段階と、デジタル−アナログ変
換器からの前記ｋ個のアナログ画素信号を、前記選択さ
れたｋ個のデータラインに転送する段階とを含む。
【００１２】本発明によるデジタル方式の液晶表示パネ
ル駆動回路では、マルチプレクサアレーが液晶表示パネ
ルに搭載されるようにして、液晶表示パネルの引出ライ
ン数を最少化する。本発明によるデジタル方式の液晶表
示パネル駆動回路は、１ライン分の画素データを一時的
に保管するラッチアレーと、画素データを画素信号に変
換するＤ−A変換器アレーとの間にディマルチプレクサ
アレーを、そして出力増幅器アレーと液晶表示パネルの
データライン等との間にマルチプレクサを設置すること
によって、Ｄ−Ａ変換器と出力増幅器の個数をデータラ
イン数の半分、３分の１またはその以下に減少させるこ
とができる。これによって、本発明によるデジタル方式
の液晶表示パネル駆動回路は、回路構成の簡素化を達成
することは勿論、瞬間の電力消費量を減少させることも
できる。併せて、本発明によるデジタル方式の液晶表示
パネル駆動回路は、マルチプレクサを液晶表示パネルに
搭載させ、液晶表示パネルの引出ラインの数量を減少さ
せることができる。
ル駆動回路では、マルチプレクサアレーが液晶表示パネ
ルに搭載されるようにして、液晶表示パネルの引出ライ
ン数を最少化する。本発明によるデジタル方式の液晶表
示パネル駆動回路は、１ライン分の画素データを一時的
に保管するラッチアレーと、画素データを画素信号に変
換するＤ−A変換器アレーとの間にディマルチプレクサ
アレーを、そして出力増幅器アレーと液晶表示パネルの
データライン等との間にマルチプレクサを設置すること
によって、Ｄ−Ａ変換器と出力増幅器の個数をデータラ
イン数の半分、３分の１またはその以下に減少させるこ
とができる。これによって、本発明によるデジタル方式
の液晶表示パネル駆動回路は、回路構成の簡素化を達成
することは勿論、瞬間の電力消費量を減少させることも
できる。併せて、本発明によるデジタル方式の液晶表示
パネル駆動回路は、マルチプレクサを液晶表示パネルに
搭載させ、液晶表示パネルの引出ラインの数量を減少さ
せることができる。
【００１３】
【発明の実施の形態】前記の目的以外に本発明の他の目
的及び利点等は、添付図面を参照した下記の好ましい実
施の形態に対する詳細な説明を通して明らかになる。
的及び利点等は、添付図面を参照した下記の好ましい実
施の形態に対する詳細な説明を通して明らかになる。
【００１４】図２を参照すると、本発明の実施の形態に
よるデジタル方式の液晶表示パネル駆動回路を含む液晶
表示装置が図示されている。図２において、液晶表示装
置は、液晶表示パネル（３０）に接続された液晶表示パ
ネル駆動回路（４０）を備える。液晶表示パネル（３
０）は、それぞれ垂直方向に配列された６００個の画素
等に共通的に接続された２４００個のデータライン（Ｄ
Ｌ１乃至ＤＬ２４００）を備える。
よるデジタル方式の液晶表示パネル駆動回路を含む液晶
表示装置が図示されている。図２において、液晶表示装
置は、液晶表示パネル（３０）に接続された液晶表示パ
ネル駆動回路（４０）を備える。液晶表示パネル（３
０）は、それぞれ垂直方向に配列された６００個の画素
等に共通的に接続された２４００個のデータライン（Ｄ
Ｌ１乃至ＤＬ２４００）を備える。
【００１５】一方、液晶表示パネル（３０）上の６００
×２４００個の画素等を駆動するための駆動回路（４
０）は、第１乃至第３データバス（ＤＢ１乃至ＤＢ３）
に接続された第１ラッチアレー（４２）と、この第１ラ
ッチアレー（４２）に縦属接続された第２ラッチアレー
（４４）、マルチプレクサアレー（４６）及びＤ−Ａ変
換器アレー（４８）とを備える。第１及び第２ラッチア
レー（４２，４４）は、それぞれ２４００個のラッチ等
から構成される。第１ラッチアレー（４２）に含まれた
２４００個のラッチ等は８００個づつ区分され、第１乃
至第３データバス（ＤＢ１乃至ＤＢ３）に分散接続され
る。併せて、第１ラッチアレー（４２）に含まれた２４
００個のラッチ等は３個づつ順次的に駆動され、第１乃
至第３データバス（ＤＢ１乃至ＤＢ３）から１水平ライ
ン分のＲ、Ｇ及びＢ画素データを入力する。そして、第
２ラッチアレー（４４）に含まれた２４００個のラッチ
等は、それぞれ第１ラッチアレー（４２）の２４００個
のラッチ等からの画素データを同時に入力してマルチプ
レクサアレー（４６）側に転送する。
×２４００個の画素等を駆動するための駆動回路（４
０）は、第１乃至第３データバス（ＤＢ１乃至ＤＢ３）
に接続された第１ラッチアレー（４２）と、この第１ラ
ッチアレー（４２）に縦属接続された第２ラッチアレー
（４４）、マルチプレクサアレー（４６）及びＤ−Ａ変
換器アレー（４８）とを備える。第１及び第２ラッチア
レー（４２，４４）は、それぞれ２４００個のラッチ等
から構成される。第１ラッチアレー（４２）に含まれた
２４００個のラッチ等は８００個づつ区分され、第１乃
至第３データバス（ＤＢ１乃至ＤＢ３）に分散接続され
る。併せて、第１ラッチアレー（４２）に含まれた２４
００個のラッチ等は３個づつ順次的に駆動され、第１乃
至第３データバス（ＤＢ１乃至ＤＢ３）から１水平ライ
ン分のＲ、Ｇ及びＢ画素データを入力する。そして、第
２ラッチアレー（４４）に含まれた２４００個のラッチ
等は、それぞれ第１ラッチアレー（４２）の２４００個
のラッチ等からの画素データを同時に入力してマルチプ
レクサアレー（４６）側に転送する。
【００１６】マルチプレクサアレー（４６）は、第２ラ
ッチアレー（４４）からの２４００個の画素データを８
００個づつ区分して、３回にかけてＤ−Ａ変換器アレー
（４８）側に転送する。そのために、マルチプレクサア
レー（４６）は、それぞれ第１乃至第３制御ライン（Ｓ
Ｌ１乃至ＳＬ３）からの第１乃至第３切換制御信号（Ｓ
ＷＳ１乃至ＳＷＳ３）を入力する８００個のマルチプレ
クサ等（ＭＰ１乃至ＭＰ８００）から構成される。この
８００個のマルチプレクサのそれぞれは、図３でのよう
に１水平周期の間順次的に“１”の論理値を有するよう
になる前記の第１乃至第３切換制御信号（ＳＷＳ１乃至
ＳＷＳ３）により、第２ラッチアレー（４４）の３個の
ラッチ等からの３個の画素データを順次的にＤ−Ａ変換
器アレー（４８）側に転送する。そのために、８００個
のマルチプレクサ等（ＭＰ１乃至ＭＰ８００）のそれぞ
れは、第１乃至第３切換制御信号（ＳＷＳ１乃至ＳＷＳ
３）をゲート側にそれぞれ受ける３組のＭＯＳトランジ
スタ（ＭＦ）から構成される。ここにおいて、３組のＭ
ＯＳトランジスタ（ＭＦ）は、画素データが５ビットの
場合１５個でなければならないが、便宜上３個に表現さ
れている。１つのマルチプレクサ（ＭＰ）に含まれた３
組のＭＯＳトランジスタ（ＭＦ）のソース等は、第２ラ
ッチアレー（４４）に含まれた３個のラッチにそれぞれ
接続され、そしてこの３組のＭＯＳトランジスタ（Ｍ
Ｆ）のドレーン等は、画素データのビット別に共通的に
接続される。併せて、１つのマルチプレクサ（ＭＰ）に
含まれた３組のＭＯＳトランジスタ（ＭＦ）は、第１乃
至第３切換制御信号（ＳＷＳ１乃至ＳＷＳ３）により１
水平期間の間互いに順次的にターンオンされ、第２ラッ
チアレー（４４）の該当ラッチからの画素データをＤ−
Ａ変換器アレー（４６）側に転送する。そうすると、Ｄ
−Ａ変換器アレー（４８）は、マルチプレクサアレー
（４６）からの８００個の画素データの全てを画素信号
に変換する。そのために、Ｄ−Ａ変換器アレー（４８）
は、ガンマ補正部（５０）からの少なくとも一定個数
（例えば５個）の変換ソース信号を共通的に受ける８０
０個のＤ−Ａ変換器から構成される。この８００個のＤ
−Ａ変換器等のそれぞれは、該当マルチプレクサ（Ｍ
Ｐ）からの画素データの論理値に対し、ガンマ補正部
（５０）からの一定個数の変換ソース信号の全てまたは
一部を選択的に加算することによって、画素データをア
ナログ画素信号に変換する。結果的に、８００個のＤ−
Ａ変換器等のそれぞれは、１水平走査期間に３個の画素
データをアナログ画素信号に変換するようになる。
ッチアレー（４４）からの２４００個の画素データを８
００個づつ区分して、３回にかけてＤ−Ａ変換器アレー
（４８）側に転送する。そのために、マルチプレクサア
レー（４６）は、それぞれ第１乃至第３制御ライン（Ｓ
Ｌ１乃至ＳＬ３）からの第１乃至第３切換制御信号（Ｓ
ＷＳ１乃至ＳＷＳ３）を入力する８００個のマルチプレ
クサ等（ＭＰ１乃至ＭＰ８００）から構成される。この
８００個のマルチプレクサのそれぞれは、図３でのよう
に１水平周期の間順次的に“１”の論理値を有するよう
になる前記の第１乃至第３切換制御信号（ＳＷＳ１乃至
ＳＷＳ３）により、第２ラッチアレー（４４）の３個の
ラッチ等からの３個の画素データを順次的にＤ−Ａ変換
器アレー（４８）側に転送する。そのために、８００個
のマルチプレクサ等（ＭＰ１乃至ＭＰ８００）のそれぞ
れは、第１乃至第３切換制御信号（ＳＷＳ１乃至ＳＷＳ
３）をゲート側にそれぞれ受ける３組のＭＯＳトランジ
スタ（ＭＦ）から構成される。ここにおいて、３組のＭ
ＯＳトランジスタ（ＭＦ）は、画素データが５ビットの
場合１５個でなければならないが、便宜上３個に表現さ
れている。１つのマルチプレクサ（ＭＰ）に含まれた３
組のＭＯＳトランジスタ（ＭＦ）のソース等は、第２ラ
ッチアレー（４４）に含まれた３個のラッチにそれぞれ
接続され、そしてこの３組のＭＯＳトランジスタ（Ｍ
Ｆ）のドレーン等は、画素データのビット別に共通的に
接続される。併せて、１つのマルチプレクサ（ＭＰ）に
含まれた３組のＭＯＳトランジスタ（ＭＦ）は、第１乃
至第３切換制御信号（ＳＷＳ１乃至ＳＷＳ３）により１
水平期間の間互いに順次的にターンオンされ、第２ラッ
チアレー（４４）の該当ラッチからの画素データをＤ−
Ａ変換器アレー（４６）側に転送する。そうすると、Ｄ
−Ａ変換器アレー（４８）は、マルチプレクサアレー
（４６）からの８００個の画素データの全てを画素信号
に変換する。そのために、Ｄ−Ａ変換器アレー（４８）
は、ガンマ補正部（５０）からの少なくとも一定個数
（例えば５個）の変換ソース信号を共通的に受ける８０
０個のＤ−Ａ変換器から構成される。この８００個のＤ
−Ａ変換器等のそれぞれは、該当マルチプレクサ（Ｍ
Ｐ）からの画素データの論理値に対し、ガンマ補正部
（５０）からの一定個数の変換ソース信号の全てまたは
一部を選択的に加算することによって、画素データをア
ナログ画素信号に変換する。結果的に、８００個のＤ−
Ａ変換器等のそれぞれは、１水平走査期間に３個の画素
データをアナログ画素信号に変換するようになる。
【００１７】また、駆動回路（４０）はＤ−Ａ変換器ア
レー（４８）と液晶表示パネル（３０）のデータライン
等（ＤＬ１乃至ＤＬ２４００）の間に直列接続された出
力増幅器アレー（５２）とディマルチプレクサアレー
（５４）とを備える。出力増幅器アレー（５２）は、Ｄ
−Ａ変換器アレー（４８）からの８００個の画素信号等
を一定の増幅率で増幅し、その増幅された８００個の画
素信号等をディマルチプレクサアレー（５４）側に出力
する。そのために、出力増幅器アレー（５２）もＤ−Ａ
変換器アレー（４８）の８００個のＤ−Ａ変換器等に分
散接続された８００個の出力増幅器等から構成される。
最後に、ディマルチプレクサアレー（５４）は、出力増
幅器アレー（５２）からの８００個の増幅された画素信
号を、２４００個のデータライン（ＤＬ１乃至ＤＬ２４
００）に、８００個のデータラインづつ３回にかけて順
次的に転送する。そのために、ディマルチプレクサアレ
ー（５４）は、それぞれ第１乃至第３制御ライン（ＳＬ
１乃至ＳＬ３）からの第１乃至第３切換制御信号（ＳＷ
Ｓ１乃至ＳＷＳ３）を受ける８００個のディマルチプレ
クサ等（ＤＭＰ１乃至ＤＭＰ８００）から構成される。
この８００個のディマルチプレクサ（ＤＭＰ１乃至ＤＭ
Ｐ８００）のそれぞれは、図３のように１水平周期の間
順次的に“１”の論理値を有するようになる前記の第１
乃至第３切換制御信号（ＳＷＳ１乃至ＳＷＳ３）によ
り、出力増幅器アレー（５２）からの画素信号を３個の
データライン（ＤＬ）に順次的に転送する。そのため
に、８００個のディマルチプレクサ等（ＤＭＰ１乃至Ｄ
ＭＰ８００）のそれぞれは、第１乃至第３切換制御信号
（ＳＷＳ１乃至ＳＷＳ３）をゲート側にそれぞれ受ける
３個のＭＯＳトランジスタ（ＭＳ）から構成される。１
つのディマルチプレクサ（ＤＭＰ）に含まれた３個のＭ
ＯＳトランジスタ（ＭＳ）のソース等は、出力増幅器ア
レー（５２）に含まれた１つの出力増幅器の出力端子に
共通的に接続され、このドレーン等は３個のデータライ
ン（ＤＬ）に分散接続される。併せて、１つのディマル
チプレクサ（ＤＭＰ）に含まれた３個のＭＯＳトランジ
スタ（ＭＳ）は、第１乃至第３切換制御信号（ＳＷＳ１
乃至ＳＷＳ３）により１水平期間の間互いに順次的にタ
ーンオンされ、出力増幅器アレー（５２）に含まれた該
当出力増幅器からの画素信号等を３個のデータライン
（ＤＬ）に分散供給する。
レー（４８）と液晶表示パネル（３０）のデータライン
等（ＤＬ１乃至ＤＬ２４００）の間に直列接続された出
力増幅器アレー（５２）とディマルチプレクサアレー
（５４）とを備える。出力増幅器アレー（５２）は、Ｄ
−Ａ変換器アレー（４８）からの８００個の画素信号等
を一定の増幅率で増幅し、その増幅された８００個の画
素信号等をディマルチプレクサアレー（５４）側に出力
する。そのために、出力増幅器アレー（５２）もＤ−Ａ
変換器アレー（４８）の８００個のＤ−Ａ変換器等に分
散接続された８００個の出力増幅器等から構成される。
最後に、ディマルチプレクサアレー（５４）は、出力増
幅器アレー（５２）からの８００個の増幅された画素信
号を、２４００個のデータライン（ＤＬ１乃至ＤＬ２４
００）に、８００個のデータラインづつ３回にかけて順
次的に転送する。そのために、ディマルチプレクサアレ
ー（５４）は、それぞれ第１乃至第３制御ライン（ＳＬ
１乃至ＳＬ３）からの第１乃至第３切換制御信号（ＳＷ
Ｓ１乃至ＳＷＳ３）を受ける８００個のディマルチプレ
クサ等（ＤＭＰ１乃至ＤＭＰ８００）から構成される。
この８００個のディマルチプレクサ（ＤＭＰ１乃至ＤＭ
Ｐ８００）のそれぞれは、図３のように１水平周期の間
順次的に“１”の論理値を有するようになる前記の第１
乃至第３切換制御信号（ＳＷＳ１乃至ＳＷＳ３）によ
り、出力増幅器アレー（５２）からの画素信号を３個の
データライン（ＤＬ）に順次的に転送する。そのため
に、８００個のディマルチプレクサ等（ＤＭＰ１乃至Ｄ
ＭＰ８００）のそれぞれは、第１乃至第３切換制御信号
（ＳＷＳ１乃至ＳＷＳ３）をゲート側にそれぞれ受ける
３個のＭＯＳトランジスタ（ＭＳ）から構成される。１
つのディマルチプレクサ（ＤＭＰ）に含まれた３個のＭ
ＯＳトランジスタ（ＭＳ）のソース等は、出力増幅器ア
レー（５２）に含まれた１つの出力増幅器の出力端子に
共通的に接続され、このドレーン等は３個のデータライ
ン（ＤＬ）に分散接続される。併せて、１つのディマル
チプレクサ（ＤＭＰ）に含まれた３個のＭＯＳトランジ
スタ（ＭＳ）は、第１乃至第３切換制御信号（ＳＷＳ１
乃至ＳＷＳ３）により１水平期間の間互いに順次的にタ
ーンオンされ、出力増幅器アレー（５２）に含まれた該
当出力増幅器からの画素信号等を３個のデータライン
（ＤＬ）に分散供給する。
【００１８】
【発明の効果】上述のごとく、本発明によるデジタル方
式の液晶表示パネル駆動回路は、１ライン分の画素デー
タを一時的に保管するラッチアレーと、画素データを画
素信号に変換するＤ−Ａ変換器アレーとの間にマルチプ
レクサアレーを、そして出力増幅器アレーと液晶表示パ
ネルのデータライン等との間にディマルチプレクサを設
置することによって、Ｄ−Ａ変換器と出力増幅器の個数
をデータライン数の半分、３分の１またはそれ以下に減
少させることができる。それによって、本発明によるデ
ジタル方式の液晶表示パネル駆動回路は、回路構成の簡
素化を達成することは勿論、瞬間の電力消費量を減少さ
せることもできる。併せて、本発明によるデジタル方式
の液晶表示パネル駆動回路はマルチプレクサを液晶表示
パネルに搭載させ、液晶表示パネルの引出ラインの数量
を減少させることができる。
式の液晶表示パネル駆動回路は、１ライン分の画素デー
タを一時的に保管するラッチアレーと、画素データを画
素信号に変換するＤ−Ａ変換器アレーとの間にマルチプ
レクサアレーを、そして出力増幅器アレーと液晶表示パ
ネルのデータライン等との間にディマルチプレクサを設
置することによって、Ｄ−Ａ変換器と出力増幅器の個数
をデータライン数の半分、３分の１またはそれ以下に減
少させることができる。それによって、本発明によるデ
ジタル方式の液晶表示パネル駆動回路は、回路構成の簡
素化を達成することは勿論、瞬間の電力消費量を減少さ
せることもできる。併せて、本発明によるデジタル方式
の液晶表示パネル駆動回路はマルチプレクサを液晶表示
パネルに搭載させ、液晶表示パネルの引出ラインの数量
を減少させることができる。
【００１９】以上において説明した内容を通して、当業
者であれば本発明の技術思想から逸脱しない範囲内で多
様な変更及び修正が可能であることが分かる。従って、
本発明の技術的範囲は、明細書の詳細な説明に記載され
た内容に限定されるものでなく、特許請求の範囲により
定めなければならない。
者であれば本発明の技術思想から逸脱しない範囲内で多
様な変更及び修正が可能であることが分かる。従って、
本発明の技術的範囲は、明細書の詳細な説明に記載され
た内容に限定されるものでなく、特許請求の範囲により
定めなければならない。
【図１】従来のデジタル映像信号用の液晶表示パネル駆
動回路が適用された液晶表示装置を図示する図面であ
る。
動回路が適用された液晶表示装置を図示する図面であ
る。
【図２】本発明の実施の形態によるデジタル方式の液晶
表示パネル駆動回路が適用された液晶表示装置を図示す
る図面である。
表示パネル駆動回路が適用された液晶表示装置を図示す
る図面である。
【図３】図２に示された駆動回路の各部分の動作タイミ
ング図である。
ング図である。
１０，３０：液晶表示パネル ２０，４０：液晶表示パネル駆動回路 ２２，４２：第１ラッチアレー ２４，４４：第２ラッチアレー ２６，４８：Ｄ−Ａ変換器アレー ２８，５２：出力増幅器アレー ４６：マルチプレクサアレー ５０：ガンマ補正部 ５４：ディマルチプレクサアレー
Claims (11)
- 【請求項１】 ｎ個のデジタル画素データからｋ個のデ
ジタル画素データを選択するためのマルチプレクサアレ
ーと、前記マルチプレクサアレーからのｋ個のデジタル
画素データを、ｋ個のアナログ画素信号に変換するため
のデジタル−アナログ変換器アレーと、ｎ個のデータラ
インに接続され、前記ｎ個のデータラインの中からｋ個
を選択するとともに、前記デジタル−アナログ変換器ア
レーからのｋ個のアナログ画素信号を、前記選択された
ｋ個のデータラインに転送するためのディマルチプレク
サアレーとを備えるデジタル方式の液晶表示パネル駆動
回路。 - 【請求項２】 水平方向に並んで配列され、垂直方向に
配列されたｍ個の画素に共通に接続されたｎ個のデータ
ラインを備えることを特徴とする請求項１記載のデジタ
ル方式の液晶表示パネル駆動回路。 - 【請求項３】 前記ディマルチプレクサアレーは、液晶
表示パネルに搭載されたことを特徴とする請求項２記載
のデジタル方式の液晶表示パネル駆動回路。 - 【請求項４】 入力されたｎ個のデジタル画素データを
一時的に貯蔵するとともに、前記ｎ個のデジタル画素デ
ータを、前記のマルチプレクサアレーに入力するための
記憶手段を備えることを特徴とする請求項１記載のデジ
タル方式の液晶表示パネル駆動回路。 - 【請求項５】 前記のデジタル−アナログ変換器アレー
と、前記のディマルチプレクサアレーとの間に備えられ
た出力増幅器アレーを備えることを特徴とする請求項１
記載のデジタル方式の液晶表示パネル駆動回路。 - 【請求項６】 前記のマルチプレクサアレーと前記のデ
ィマルチプレクサアレーがＭＯＳトランジスタから構成
されることを特徴とする請求項１記載のデジタル方式の
液晶表示パネル駆動回路。 - 【請求項７】 前記ディマルチプレクサの選択時間がｋ
／ｎに該当することを特徴とする請求項１記載のデジタ
ル方式の液晶表示パネル駆動回路。 - 【請求項８】 ｎ個のデジタル画素データからｋ個のデ
ジタル画素データを選択する段階と、選択された前記ｋ
個のデジタル画素データをｋ個のアナログ画素信号に変
換する段階と、ｎ個のデータラインの中からｋ個を選択
する段階と、変換された前記ｋ個のアナログ画素信号
を、前記選択されたｋ個のデータラインに転送する段階
とを含むデジタル方式の液晶表示パネル駆動方法。 - 【請求項９】 ｎ個のデジタル画素データを一時的に貯
蔵する段階とを備え、前記貯蔵されたデータを前記ｎ個
のデジタル画素データとすることを特徴とする請求項８
記載のデジタル方式の液晶表示パネル駆動方法。 - 【請求項１０】 変換された前記ｋ個のアナログ画素信
号を増幅する段階を含むことを特徴とする請求項８記載
のデジタル方式の液晶表示パネル駆動方法。 - 【請求項１１】 前記ｎ個のデータラインの中からｋ個
を選択する段階が、ｋ／ｎに該当する時間の間、ｎ個の
データラインの中からｋ個を選択することを特徴とする
請求項８記載のデジタル方式の液晶表示パネル駆動方
法。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019970019142A KR100229380B1 (ko) | 1997-05-17 | 1997-05-17 | 디지탈방식의 액정표시판넬 구동회로 |
| KR1997-19142 | 1997-05-17 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10319924A true JPH10319924A (ja) | 1998-12-04 |
Family
ID=19506177
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP12838698A Pending JPH10319924A (ja) | 1997-05-17 | 1998-05-12 | デジタル方式の液晶表示パネル駆動回路 |
Country Status (5)
| Country | Link |
|---|---|
| JP (1) | JPH10319924A (ja) |
| KR (1) | KR100229380B1 (ja) |
| DE (1) | DE19821914A1 (ja) |
| FR (1) | FR2763416A1 (ja) |
| GB (1) | GB2325329A (ja) |
Cited By (30)
| Publication number | Priority date | Publication date | Assignee | Title |
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