JPH11111734A - 表面保護膜の形成方法 - Google Patents

表面保護膜の形成方法

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JPH11111734A
JPH11111734A JP9268273A JP26827397A JPH11111734A JP H11111734 A JPH11111734 A JP H11111734A JP 9268273 A JP9268273 A JP 9268273A JP 26827397 A JP26827397 A JP 26827397A JP H11111734 A JPH11111734 A JP H11111734A
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JP
Japan
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film
insulating film
etching
junction
protective film
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JP9268273A
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English (en)
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Hajime Sudo
元 須藤
Kenji Arinaga
健児 有永
Koji Fujiwara
康治 藤原
Tetsuya Miyatake
哲也 宮武
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Fujitsu Ltd
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Fujitsu Ltd
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Abstract

(57)【要約】 【課題】 表面保護膜の形成方法に関し、表面保護膜を
形成する際に、レジスト残渣やエッチングダメージが発
生しないようにする。 【解決手段】 HgCdTe半導体1にpn接合2を形
成したのち、HgCdTe半導体1上に第1の絶縁膜
3、及び、第1の絶縁膜3と組成の異なる第2の絶縁膜
4を堆積させ、pn接合2近傍に位置する第2の絶縁膜
4をドライ・エッチングで除去したのち、第2の絶縁膜
4をマスクとして第1の絶縁膜3をウェット・エッチン
グにより選択的に除去してpn接合2を露出させ、次い
で、露出面に保護膜6を選択的に形成する。

Description

【発明の詳細な説明】
【0001】
【発明の属する技術分野】本発明は表面保護膜の形成方
法に関するものであり、特に、赤外線センサに用いるH
gCdTeフォトダイオードアレイの製造工程における
レジスト残渣の発生を防止するための構成に特徴のある
表面保護膜の形成方法に関するものである。
【0002】
【従来の技術】従来、10μm帯近傍の赤外線を検知す
る赤外線検知装置としては、Cd組成比が0.2近傍、
例えば、Cd組成比が0.22のHgCdTe層に形成
したpn接合ダイオードをフォトダイオードとしたもの
を用い、このフォトダイオードを一次元アレイ状或いは
二次元アレイ状に配置すると共に、読出回路との電気的
なコンタクトをとるために、赤外線フォトダイオードア
レイ基板及びSi信号処理回路基板を、双方に形成した
In等の金属のバンプで貼り合わせる構造が採用されて
いる。
【0003】ここで、図4及び図5を参照して従来のH
gCdTeフォトダイオードの製造工程を説明する。 図4(a)参照 まず、閉管チッピング法を用いて、Teリッチの融液中
でCdZnTe基板(図示せず)上にHg空孔濃度が1
17cm-3程度のノン・ドープのp型HgCdTe層2
1を液相エピタキシャル成長させたのち、Hg蒸気中に
おける200〜400℃の温度での熱処理により、Hg
空孔をHg原子で埋めることによって、p型HgCdT
e層21の正孔濃度を1016cm-3オーダーに制御す
る。
【0004】次いで、表面平坦化、及び、厚みの均一化
のために、アルミナ研磨を行なって、p型HgCdTe
層21の厚さを15〜25μmに制御したのち、Bイオ
ンを選択的にイオン注入してn+ 型領域22を形成して
フォトダイオードとする。
【0005】次いで、全面にZnS膜23を設けたの
ち、全面にネガ型レジスト(東京応化製商品名:OMR
83)を塗布し、pn接合がp型HgCdTe層21の
表面に露出している部分の近傍の領域が開口部となるよ
うに露光・現像することによってネガ型レジストマスク
24を形成する。
【0006】図4(b)参照 次いで、ネガ型レジストマスク24をマスクとして、硫
酸+水からなるエッチング液を用いてZnS膜23を選
択的にエッチングして、p型HgCdTe層21を露出
させる。
【0007】図4(c)参照 次いで、レジスト剥離液(東京応化製商品名:502
A)を用いてネガ型レジストマスク24を除去したの
ち、プラズマCVD法により、全面にpn接合を保護す
る保護膜となるSiN膜25を堆積させる。
【0008】図5(d)参照 次いで、全面にポジ型レジスト(東京応化製商品名:O
FPR800)を塗布したのち、開口部を覆うようなパ
ターンが形成されるように露光・現像することによって
ポジ型レジストマスク27を形成する。
【0009】図5(e)参照 次いで、ポジ型レジストマスク27をマスクとして、フ
ロン14+酸素からなるガスを用いたドライ・エッチン
グを施すことによって、SiN膜25を選択的にエッチ
ングする。
【0010】次いで、ポジ型レジストマスク27をレジ
スト剥離液(シプレイ社製商品名:1112A)を用い
て除去したのち、通常のフォトエッチング工程によりコ
ンタクトホールを形成してn側電極となるIn電極2
8、及び、p側電極となるAu電極29を形成し、次い
で、図示しないもの、リフトオフ法によってInバンプ
を形成していた。
【0011】
【発明が解決しようとする課題】
再び、図4(c)参照 しかし、この様な表面保護膜の形成工程においては、図
4(c)におけるネガ型レジストマスク24の剥離工程
において、レジスト残渣26が露出したp型HgCdT
e層21の表面或いはZnS膜23の表面に付着し、S
iN膜25/p型HgCdTe層21の界面が汚染され
るという問題がある。
【0012】そして、SiN膜25/p型HgCdTe
層21の界面が汚染されると、この界面に固定電荷が発
生して、pn接合部のフラットバンド状態が蓄積状態や
反転状態に変化して、トンネル電流によるリーク電流が
増大する原因となる。
【0013】この様なレジスト残渣26が発生するの
は、ネガ型レジスト(東京応化製商品名:OMR83)
が、硫酸+水からなるエッチング液で侵され、専用のレ
ジスト剥離液でも溶けない物質に変質するためである。
【0014】なお、ネガ型レジスト(東京応化製商品
名:OMR83)に替わる、硫酸に溶けず、また、侵さ
れず、且つ、専用のレジスト剥離液で完全除去が可能な
ネガ型レジストは存在していない。
【0015】また、ポジ型レジストを用いてウェット・
エッチングを行った場合には、ZnS膜のエッチング液
となる硫酸にポジ型レジストも溶けてしまうので、使用
できないものである。
【0016】一方、ポジ型レジストを用いてドライ・エ
ッチングを行った場合には、レジスト残渣は発生しない
ものの、pn接合面がプラズマに晒されるためにダメー
ジが入る危険があり、信頼性の高いフォトダイオードア
レイを製造することは困難であった。なお、ネガ型レジ
ストを用いてドライ・エッチングを行った場合には、ネ
ガ型レジストはエッチングガスと反応してレジスト残渣
が発生することになる。
【0017】したがって、本発明は、表面保護膜を形成
する際に、レジスト残渣やエッチングダメージが発生し
ないようにすることを目的とする。
【0018】
【課題を解決するための手段】図1は本発明の原理的構
成の説明図であり、この図1を参照して本発明における
課題を解決するための手段を説明する。なお、図1にお
ける符号7,8は、電極を表す。 図1(a)乃至(c)参照 (1)本発明は、表面保護膜6の形成方法において、H
gCdTe半導体1にpn接合2を形成したのち、Hg
CdTe半導体1上に第1の絶縁膜3、及び、第1の絶
縁膜3と組成の異なる第2の絶縁膜4を堆積させ、pn
接合2近傍に位置する第2の絶縁膜4をドライ・エッチ
ングで除去したのち、第2の絶縁膜4をマスクとして第
1の絶縁膜3をウェット・エッチングにより選択的に除
去してpn接合2を露出させ、次いで、露出面に保護膜
6を選択的に形成することを特徴とする。
【0019】この様に、HgCdTe半導体1上に互い
に組成の異なる第1の絶縁膜3及び第2の絶縁膜4から
なる2層構造膜を堆積させているので、第2の絶縁膜4
をパターニングする際にドライ・エッチングを用いて
も、pn接合2の近傍にエッチングダメージが入ること
がない。
【0020】また、第2の絶縁膜4をマスクとして第1
の絶縁膜3をウェット・エッチングしているので、pn
接合2の近傍にエッチングダメージが入ることがなく、
且つ、レジストをマスクとして用いていないので、レジ
スト残渣が発生することがなく、pn接合2の近傍が汚
染されることがない。
【0021】なお、本発明におけるHgCdTe半導体
1とは、CdTe基板等の成長基板上に成長させたHg
CdTeエピタキシャル層でも良いし、或いは、HgC
dTeバルク結晶であっても良い。
【0022】(2)また、本発明は、上記(1)におい
て、第1の絶縁膜3がZnS膜からなり、第2の絶縁膜
4がCdTe膜からなり、また、保護膜6がSiN膜か
らなることを特徴とする。
【0023】この様に、HgCdTe半導体1に接する
第1の絶縁膜3としてはZnS膜が好適であり、また、
第2の絶縁膜4としては、ZnS膜のエッチャントであ
る硫酸系エッチング液に対する耐性が大きく、且つ、Z
nS膜と密着性の良好なCdTe膜が好適であり、さら
に、pn接合2の露出面を覆う保護膜6としてSiN膜
が好適である。
【0024】(3)また、本発明は、上記(2)におい
て、第2の絶縁膜4をドライ・エッチングする工程が、
水素+アルゴン、メタン+アルゴン、或いは、水素+メ
タン+アルゴンのいずれかのガスを用いたプラズマエッ
チング工程であることを特徴とする。
【0025】この様に、第2の絶縁膜4であるCdTe
膜に対するエッチングガスとして、水素+アルゴン、メ
タン+アルゴン、或いは、水素+メタン+アルゴンのい
ずれかが好適であるが、メタンを含んだガスを用いた場
合にはC(炭素)の付着に留意する必要がある。
【0026】(4)また、本発明は、上記(2)におい
て、第1の絶縁膜3をウェット・エッチングする工程
が、硫酸+水、硫酸+酢酸、或いは、硫酸+過塩素酸の
いずれかのエッチング液を用いたウェット・エッチング
工程であることを特徴とする。
【0027】この様に、第1の絶縁膜3であるZnS膜
に対するエッチャントとしては、硫酸+水、硫酸+酢
酸、或いは、硫酸+過塩素酸のいずれかが好適であり、
制御性の面ではエッチングレートの小さな硫酸+酢酸が
優れている。
【0028】(5)また、本発明は、上記(2)におい
て、保護膜6を選択的に形成する工程が、保護膜6を堆
積させたのち、フロン14+酸素を反応ガスとしたドラ
イ・エッチングにより選択的に除去する工程であること
を特徴とする。
【0029】本発明の構成の場合にも、保護膜6となる
SiN膜に対するエッチングガスとしては、従来と同様
にフロン14+酸素が好適である。
【0030】(6)また、本発明は、上記(1)乃至
(5)のいずれかにおいて、pn接合2がフォトダイオ
ードアレイのダイオードを構成することを特徴とする。
【0031】上記の様な工程は、半導体装置の種類は問
わないものの、特に、HgCdTe半導体1を用いて赤
外線フォトダイオードアレイを製造する工程として好適
である。
【0032】
【発明の実施の形態】ここで、本発明の実施の形態を図
2及び図3を参照して説明する。なお、説明を簡単にす
るために、1個のフォトダイオードの形成工程として説
明する。 図2(a)参照 まず、従来と同様に、閉管チッピング法を用いて、Te
リッチの融液中でCdZnTe基板(図示せず)上にH
g空孔濃度が1017cm-3程度のノン・ドープのp型H
gCdTe層11(Cd比0.22)を液相エピタキシ
ャル成長させたのち、Hg蒸気中における200〜40
0℃の温度での熱処理により、Hg空孔をHg原子で埋
めることによって、p型HgCdTe層11の正孔濃度
を1016cm-3オーダーに制御する。
【0033】次いで、表面平坦化、及び、厚みの均一化
のために、アルミナ研磨を行なって、p型HgCdTe
層11の厚さを15〜25μmに制御したのち、Bイオ
ンを選択的にイオン注入してn+ 型領域12を形成して
フォトダイオードとする。
【0034】次いで、加熱蒸着法を用いて全面に厚さ1
00〜500nm、例えば、200nmのZnS膜13
を設けたのち、ZnS膜13上にスパッタリング法を用
いて厚さ100〜500nm、例えば、200nmのC
dTe膜14を堆積させる。
【0035】次いで、全面にポジ型レジスト(東京応化
製商品名:OFPR800)を塗布し、pn接合がp型
HgCdTe層11の表面に露出している部分の近傍の
領域が開口部となるように露光・現像することによって
ポジ型レジストマスク15を形成する。
【0036】図2(b)参照 次いで、ポジ型レジストマスク15をマスクとして、水
素+アルゴンからなるガスを用いたプラズマエッチング
を施すことによってCdTe膜14を選択的に除去して
ZnS膜13を露出させる。
【0037】この場合、CdTe膜14のエッチング速
度は、ZnS膜13のエッチング速度より1桁近く大き
いのでオーバーエッチングのマージンを大きく取ること
ができる。なお、この場合、水素ガスの量が多ければ反
応性エッチング的になり、アルゴンガスの量が多くなれ
ばイオンミリング的になる。
【0038】図2(c)参照 次いで、レジスト剥離液(シプレイ社製商品名:111
2A)を用いてポジ型レジストマスク15を除去したの
ち、CdTe膜14をマスクとして、硫酸+水からなる
エッチング液を用いてZnS膜13を選択的にエッチン
グすることによって、p型HgCdTe層11とn+
領域12との間に形成されたpn接合を露出させる。
【0039】なお、ポジ型レジストマスク15の剥離工
程の後、レジスト残渣の発生を完全に防止するために、
念のために酸素プラズマを用いてプラズマアッシングを
行っても良い。また、このウェット・エッチング工程に
おいて、CdTe膜14が溶解することはなく、且つ、
CdTe膜14とZnS膜13とは密着性が良好である
ので、これらの界面で剥離が生ずることもない。
【0040】図3(d)参照 次いで、プラズマCVD法を用いて、全面にpn接合を
保護する保護膜となる厚さ100〜500nm、例え
ば、200nmのSiN膜16を堆積させたのち、全面
にポジ型レジスト(東京応化製商品名:OFPR80
0)を塗布し、ZnS膜13に設けた開口部を覆うよう
なパターンが形成されるように露光・現像することによ
ってポジ型レジストマスク17を形成する。
【0041】図3(e)参照 次いで、ポジ型レジストマスク17をマスクとして、フ
ロン14+酸素を原料ガスとするドライ・エッチングを
施すことによって、SiN膜16を選択的にエッチング
する。
【0042】図3(f)参照 次いで、ポジ型レジストマスク17をレジスト剥離液
(シプレイ社製商品名:1112A)を用いて除去した
のち、全面に厚さ約500nmのZnS膜18を蒸着
し、次いで、通常のフォトエッチング工程によりコンタ
クトホールを形成してn側電極となるIn電極19、及
び、p側電極となるAu電極20を形成し、次いで、図
示しないもの、リフトオフ法によってInバンプを形成
することにより、赤外線フォトダイオードアレイが完成
する。
【0043】この様に、本発明の実施の形態において
は、ZnS膜13上にCdTe膜14を設けているの
で、CdTe膜14のエッチング工程においてポジ型レ
ジストをマスクとしたドライ・エッチングを行っても、
p型HgCdTe層11の表面はZnS膜13で覆われ
ているので、pn接合の近傍にプラズマによるエッチン
グダメージが入ることがない。
【0044】また、ZnS膜13のエッチング工程にお
いては、CdTe膜14をマスクとしたウェット・エッ
チングを行っているので、p型HgCdTe層11の表
面にレジスト残渣が付着することがなく、且つ、ドライ
・エッチングを用いていないので、pn接合の近傍にプ
ラズマによるエッチングダメージが入ることもない。
【0045】なお、上記の実施の形態の説明において
は、CdTe膜14のドライ・エッチング工程におい
て、水素+アルゴンからなるガスを用いているが、メタ
ン+アルゴンからなるガス、或いは、水素+メタン+ア
ルゴンからなるガスを用いても良好なエッチングを行う
ことができる。但し、メタンを含んだガスを用いる場合
には、C(炭素)の付着に留意する必要がある。
【0046】また、上記の実施の形態の説明において
は、ZnS膜13のウェット・エッチング工程におい
て、硫酸+水からなるエッチャントを用いているが、硫
酸+酢酸、或いは、硫酸+過塩素酸を用いても良く、硫
酸+酢酸を用いた場合には、エッチング速度が小さいの
で、エッチングの制御性が高まる。
【0047】また、上記の実施の形態においては、フォ
トダイオードアレイを形成するための半導体はHg0.78
Cd0.22Teを用いて説明しているが、Hg0.78Cd
0.22Teに限られるものではなく、他の組成比のHgC
dTeでも良く、また、アレイではなくディスクリート
素子でも良く、例えば、Cd比を0.60程度にするこ
とによってAPD(アバランシェ・フォトダイオード)
を形成しても良いものである。
【0048】
【発明の効果】本発明によれば、表面保護膜を選択的に
形成するためにZnS膜を選択エッチングする工程にお
いて、CdTe膜をマスクとしたウェット・エッチング
を用いているので、レジスト残渣による汚染が発生する
ことがなく、且つ、ドライ・エッチングを用いていない
のでpn接合の近傍にプラズマによるエッチングダメー
ジが入ることがないので、信頼性の高い赤外線フォトダ
イオードアレイを再現性良く形成することができ、高解
像度の赤外線センサの実用化に寄与するところが大き
い。
【図面の簡単な説明】
【図1】本発明の原理的構成の説明図である。
【図2】本発明の実施の形態の途中までの製造工程の説
明図である。
【図3】本発明の実施の形態の図2以降の製造工程の説
明図である。
【図4】従来のHgCdTeフォトダイオードの途中ま
での製造工程の説明図である。
【図5】従来のHgCdTeフォトダイオードの図4以
降の製造工程の説明図である。
【符号の説明】
1 HgCdTe半導体 2 pn接合 3 第1の絶縁膜 4 第2の絶縁膜 5 ポジ型レジストマスク 6 保護膜 7 電極 8 電極 11 p型HgCdTe層 12 n+ 型領域 13 ZnS膜 14 CdTe膜 15 ポジ型レジストマスク 16 SiN膜 17 ポジ型レジストマスク 18 ZnS膜 19 In電極 20 Au電極 21 p型HgCdTe層 22 n+ 型領域 23 ZnS膜 24 ネガ型レジストマスク 25 SiN膜 26 レジスト残渣 27 ポジ型レジストマスク 28 In電極 29 Au電極
───────────────────────────────────────────────────── フロントページの続き (72)発明者 藤原 康治 神奈川県川崎市中原区上小田中4丁目1番 1号 富士通株式会社内 (72)発明者 宮武 哲也 神奈川県川崎市中原区上小田中4丁目1番 1号 富士通株式会社内

Claims (6)

    【特許請求の範囲】
  1. 【請求項1】 HgCdTe半導体にpn接合を形成し
    たのち、前記HgCdTe半導体上に第1の絶縁膜、及
    び、前記第1の絶縁膜と異なる第2の絶縁膜を堆積さ
    せ、前記pn接合近傍に位置する第2の絶縁膜をドライ
    ・エッチングで除去したのち、前記第2の絶縁膜をマス
    クとして前記第1の絶縁膜をウェット・エッチングによ
    り選択的に除去して前記pn接合を露出させ、次いで、
    露出面に保護膜を選択的に形成することを特徴とする表
    面保護膜の形成方法。
  2. 【請求項2】 上記第1の絶縁膜がZnS膜からなり、
    上記第2の絶縁膜がCdTe膜からなり、また、上記保
    護膜がSiN膜からなることを特徴とする請求項1記載
    の表面保護膜の形成方法。
  3. 【請求項3】 上記第2の絶縁膜をドライ・エッチング
    する工程が、水素+アルゴン、メタン+アルゴン、或い
    は、水素+メタン+アルゴンのいずれかのガスを用いた
    プラズマエッチング工程であることを特徴とする請求項
    2記載の表面保護膜の形成方法。
  4. 【請求項4】 上記第1の絶縁膜をウェット・エッチン
    グする工程が、硫酸+水、硫酸+酢酸、或いは、硫酸+
    過塩素酸のいずれかのエッチング液を用いたウェット・
    エッチング工程であることを特徴とする請求項2記載の
    表面保護膜の形成方法。
  5. 【請求項5】 上記保護膜を選択的に形成する工程が、
    前記保護膜を堆積させたのち、フロン14+酸素を反応
    ガスとしたドライ・エッチングにより選択的に除去する
    工程であることを特徴とする請求項2記載の表面保護膜
    の形成方法。
  6. 【請求項6】 上記pn接合が、フォトダイオードアレ
    イのダイオードを構成することを特徴とする請求項1乃
    至5のいずれか1項に記載の表面保護膜の形成方法。
JP9268273A 1997-10-01 1997-10-01 表面保護膜の形成方法 Withdrawn JPH11111734A (ja)

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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
CN102420270A (zh) * 2011-11-10 2012-04-18 中国科学院上海技术物理研究所 一种用于光伏型碲镉汞探测器的延展电极及制备方法
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