JPH11259184A - 外部インタフェース回路 - Google Patents
外部インタフェース回路Info
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- JPH11259184A JPH11259184A JP10058727A JP5872798A JPH11259184A JP H11259184 A JPH11259184 A JP H11259184A JP 10058727 A JP10058727 A JP 10058727A JP 5872798 A JP5872798 A JP 5872798A JP H11259184 A JPH11259184 A JP H11259184A
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- JP
- Japan
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- power supply
- control circuit
- external interface
- control
- interface circuit
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- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F1/00—Details not covered by groups G06F3/00 - G06F13/00 and G06F21/00
- G06F1/26—Power supply means, e.g. regulation thereof
- G06F1/263—Arrangements for using multiple switchable power supplies, e.g. battery and AC
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- Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Power Engineering (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Power Sources (AREA)
- Information Transfer Systems (AREA)
Abstract
(57)【要約】
【課題】 本体電源が切断されても、自機器を通した他
の電子機器間のデータ通信が継続可能な外部インタフェ
ース回路を提供する。 【解決手段】 電源コントロール部４の電源検出部４１
は本体電源２の入力を検出した時に本体電源２をＩＥＥ
Ｅ１３９４コントロール部６に供給するようスイッチ４
２を制御する。電源検出部４１は本体電源２の入力を検
出しなかった時にＩＥＥＥ１３９４インタフェース３に
接続されかつＩＥＥＥ１３９４インタフェースを有する
機器７，８からの電源をＩＥＥＥ１３９４コントロール
部６に供給するスイッチ４２を制御する。
の電子機器間のデータ通信が継続可能な外部インタフェ
ース回路を提供する。 【解決手段】 電源コントロール部４の電源検出部４１
は本体電源２の入力を検出した時に本体電源２をＩＥＥ
Ｅ１３９４コントロール部６に供給するようスイッチ４
２を制御する。電源検出部４１は本体電源２の入力を検
出しなかった時にＩＥＥＥ１３９４インタフェース３に
接続されかつＩＥＥＥ１３９４インタフェースを有する
機器７，８からの電源をＩＥＥＥ１３９４コントロール
部６に供給するスイッチ４２を制御する。
Description
【０００１】
【発明の属する技術分野】本発明は外部インタフェース
回路に関し、特にＩＥＥＥ−１３９４に準拠したインタ
フェース回路に関する。
回路に関し、特にＩＥＥＥ−１３９４に準拠したインタ
フェース回路に関する。
【０００２】
【従来の技術】従来、この種のインタフェース回路にお
いては、ＩＥＥＥ−１３９４に準拠した通信制御バスに
よって複数の電子機器を接続し、その通信制御バスを用
いて電子機器間で情報信号や制御信号をやり取りするシ
ステムが考えられている。
いては、ＩＥＥＥ−１３９４に準拠した通信制御バスに
よって複数の電子機器を接続し、その通信制御バスを用
いて電子機器間で情報信号や制御信号をやり取りするシ
ステムが考えられている。
【０００３】上記のシステム内の各電子機器における信
号の伝送は所定の通信サイクル毎に時分割多重によって
行われる。この信号の伝送は、サイクルマスタと呼ばれ
る電子機器が通信サイクルの開始時であることを示すサ
イクルスタートパケットを通信制御バス上に送出するこ
とで開始される。尚、サイクルマスタは各電子機器を通
信制御バスのケーブルで接続する際に、ＩＥＥＥ−１３
９４で規定する手順によって自動的に決定される。
号の伝送は所定の通信サイクル毎に時分割多重によって
行われる。この信号の伝送は、サイクルマスタと呼ばれ
る電子機器が通信サイクルの開始時であることを示すサ
イクルスタートパケットを通信制御バス上に送出するこ
とで開始される。尚、サイクルマスタは各電子機器を通
信制御バスのケーブルで接続する際に、ＩＥＥＥ−１３
９４で規定する手順によって自動的に決定される。
【０００４】上記のシステムにおいて１通信サイクル中
における通信の形態は、ビデオ信号やオーディオ信号等
の情報信号をＩｓｏ（Ｉｓｏｃｈｒｏｎｏｕｓ）伝送す
るＩｓｏ通信と、Ａｓｙｎｃ（Ａｓｙｎｃｈｒｏｎｏｕ
ｓ）伝送するＡｓｙｎｃ通信との２種類がある。
における通信の形態は、ビデオ信号やオーディオ信号等
の情報信号をＩｓｏ（Ｉｓｏｃｈｒｏｎｏｕｓ）伝送す
るＩｓｏ通信と、Ａｓｙｎｃ（Ａｓｙｎｃｈｒｏｎｏｕ
ｓ）伝送するＡｓｙｎｃ通信との２種類がある。
【０００５】この場合、ＩｓｏパケットがＡｓｙｎｃパ
ケットよりも先に伝送される。Ｉｓｏパケットは夫々チ
ャネル番号を付けることで、複数のＩｓｏデータを区別
することができる。Ｉｓｏパケットの送信が終了した
後、次のサイクルスタートパケットまでの期間がＡｓｙ
ｎｃパケットの伝送に使用される。
ケットよりも先に伝送される。Ｉｓｏパケットは夫々チ
ャネル番号を付けることで、複数のＩｓｏデータを区別
することができる。Ｉｓｏパケットの送信が終了した
後、次のサイクルスタートパケットまでの期間がＡｓｙ
ｎｃパケットの伝送に使用される。
【０００６】また、上記のシステムでは各電子機器を通
信制御バスのケーブルで接続すると、その接続形態に応
じて自動的にノードＩＤ（物理アドレス）が付与され
る。このノードＩＤは新たに電子機器をシステムに追加
したり、あるいは電子機器をシステムから抜き出したり
する場合にも、新たな接続形態に応じて再度自動的に付
与される。このＩＥＥＥ−１３９４に準拠する通信制御
バスについては、特開平９−２８２２６３号公報に開示
されている。
信制御バスのケーブルで接続すると、その接続形態に応
じて自動的にノードＩＤ（物理アドレス）が付与され
る。このノードＩＤは新たに電子機器をシステムに追加
したり、あるいは電子機器をシステムから抜き出したり
する場合にも、新たな接続形態に応じて再度自動的に付
与される。このＩＥＥＥ−１３９４に準拠する通信制御
バスについては、特開平９−２８２２６３号公報に開示
されている。
【０００７】上述したようなＩＥＥＥ−１３９４に準拠
するインタフェース回路を備えた電子機器では、そのイ
ンタフェース回路を通してデイジーチェーン接続される
他の電子機器間のデータ通信を自機器を通して行うため
のコントロール部を、自機器の本体電源で駆動してい
る。
するインタフェース回路を備えた電子機器では、そのイ
ンタフェース回路を通してデイジーチェーン接続される
他の電子機器間のデータ通信を自機器を通して行うため
のコントロール部を、自機器の本体電源で駆動してい
る。
【０００８】ＩＥＥＥ−１３９４に準拠するインタフェ
ースの仕様についてはＩＥＥＥ−１３９４−１９９５と
して標準化されているので、その詳細な内容についての
説明に省略する。
ースの仕様についてはＩＥＥＥ−１３９４−１９９５と
して標準化されているので、その詳細な内容についての
説明に省略する。
【０００９】
【発明が解決しようとする課題】上述した従来のＩＥＥ
Ｅ−１３９４に準拠するインタフェースを備える電子機
器では、他の電子機器間のデータ通信を自機器を通して
行うためのコントロール部を自機器の本体電源で駆動し
ているので、本体電源がオフ（ＯＦＦ）された時にコン
トロール部の電源も切断される。
Ｅ−１３９４に準拠するインタフェースを備える電子機
器では、他の電子機器間のデータ通信を自機器を通して
行うためのコントロール部を自機器の本体電源で駆動し
ているので、本体電源がオフ（ＯＦＦ）された時にコン
トロール部の電源も切断される。
【００１０】そのため、自機器に上記のインタフェース
を介してデイジーチェーン接続される他の電子機器間の
データ通信が自機器を通して行われていると、そのデー
タ通信が切断されてしまうという問題がある。
を介してデイジーチェーン接続される他の電子機器間の
データ通信が自機器を通して行われていると、そのデー
タ通信が切断されてしまうという問題がある。
【００１１】そこで、本発明の目的は上記の問題点を解
消し、他の電子機器間のデータ通信が自機器を通して行
われている場合に本体電源が切断されてもそのデータ通
信を継続することができる外部インタフェース回路を提
供することにある。
消し、他の電子機器間のデータ通信が自機器を通して行
われている場合に本体電源が切断されてもそのデータ通
信を継続することができる外部インタフェース回路を提
供することにある。
【００１２】
【課題を解決するための手段】本発明による外部インタ
フェース回路は、自機器に通信制御バスを通して接続さ
れる他の電子機器間においてデータ通信を行うためコン
トロール回路を含む外部インタフェース回路であって、
自機器から前記コントロール回路に供給される電源が断
となった時に前記他の電子機器からの電源を前記コント
ロール回路に供給するよう切替える電源コントロール手
段を備えている。
フェース回路は、自機器に通信制御バスを通して接続さ
れる他の電子機器間においてデータ通信を行うためコン
トロール回路を含む外部インタフェース回路であって、
自機器から前記コントロール回路に供給される電源が断
となった時に前記他の電子機器からの電源を前記コント
ロール回路に供給するよう切替える電源コントロール手
段を備えている。
【００１３】本発明による他の外部インタフェース回路
は、自機器に通信制御バスを通してデイジーチェーン接
続される他の電子機器間におけるデータ通信を自機器を
通して行うためコントロール回路を含む外部インタフェ
ース回路であって、自機器から前記コントロール回路に
供給される電源が断となった時に前記他の電子機器から
の電源を前記コントロール回路に供給するよう切替える
電源コントロール手段を備えている。
は、自機器に通信制御バスを通してデイジーチェーン接
続される他の電子機器間におけるデータ通信を自機器を
通して行うためコントロール回路を含む外部インタフェ
ース回路であって、自機器から前記コントロール回路に
供給される電源が断となった時に前記他の電子機器から
の電源を前記コントロール回路に供給するよう切替える
電源コントロール手段を備えている。
【００１４】すなわち、本発明の外部インタフェース回
路は、本体電源が切断された時に、自機器に接続されて
いる他の電子機器からの電源をコンロール部に供給する
よう切替える電源コントロール部を備えている。
路は、本体電源が切断された時に、自機器に接続されて
いる他の電子機器からの電源をコンロール部に供給する
よう切替える電源コントロール部を備えている。
【００１５】より詳細に説明すると、ＩＥＥＥ−１３９
４に準拠するインタフェースに、コントロール部を駆動
させるために供給する電源を本体電源あるいは接続され
ている他の電子機器からの電源に切替える制御を行う電
源コントロール部を備えている。
４に準拠するインタフェースに、コントロール部を駆動
させるために供給する電源を本体電源あるいは接続され
ている他の電子機器からの電源に切替える制御を行う電
源コントロール部を備えている。
【００１６】したがって、コンピュータ本体の電源がオ
フされても、ＩＥＥＥ−１３９４に準拠するインタフェ
ースを備えた他の電子機器が接続されていれば、他の電
子機器からの電源によってコントロール部を駆動するこ
とができるので、自機器を通して行われる他の電子機器
間のデータ通信の継続が可能となる。
フされても、ＩＥＥＥ−１３９４に準拠するインタフェ
ースを備えた他の電子機器が接続されていれば、他の電
子機器からの電源によってコントロール部を駆動するこ
とができるので、自機器を通して行われる他の電子機器
間のデータ通信の継続が可能となる。
【００１７】
【発明の実施の形態】次に、本発明の一実施例について
図面を参照して説明する。図１は本発明の一実施例によ
る外部インタフェース回路を備えたコンピュータシステ
ムの構成を示すブロック図である。図において、コンピ
ュータ本体１には本体電源２と、ＩＥＥＥ１３９４イン
タフェース（以下、インタフェースとする）３とが配設
され、このインタフェース３を通してＩＥＥＥ１３９４
インタフェース（図示せず）を有する機器（以下、外部
機器とする）７，８が接続されている。尚、図示してい
ないが、コンピュータ本体１にはＣＰＵ（中央処理装
置）やＲＯＭ（リードオンリメモリ）、及びＲＡＭ（ラ
ンダムアクセスメモリ）等が配設されている。
図面を参照して説明する。図１は本発明の一実施例によ
る外部インタフェース回路を備えたコンピュータシステ
ムの構成を示すブロック図である。図において、コンピ
ュータ本体１には本体電源２と、ＩＥＥＥ１３９４イン
タフェース（以下、インタフェースとする）３とが配設
され、このインタフェース３を通してＩＥＥＥ１３９４
インタフェース（図示せず）を有する機器（以下、外部
機器とする）７，８が接続されている。尚、図示してい
ないが、コンピュータ本体１にはＣＰＵ（中央処理装
置）やＲＯＭ（リードオンリメモリ）、及びＲＡＭ（ラ
ンダムアクセスメモリ）等が配設されている。
【００１８】インタフェース３は電源コントロール部４
と、インタフェースコントロール部５と、ＩＥＥＥ１３
９４コントロール部６とを備えており、インタフェース
コンロール部４には電源検出部４１とスイッチ４２とが
配設されている。
と、インタフェースコントロール部５と、ＩＥＥＥ１３
９４コントロール部６とを備えており、インタフェース
コンロール部４には電源検出部４１とスイッチ４２とが
配設されている。
【００１９】ここで、インタフェース３は外部機器７，
８の間にデイジーチェーン接続、つまり外部機器７→イ
ンタフェース３→外部機器８の順番に接続されている。
これらインタフェース３と外部機器７，８との間におい
て、インタフェース３と外部機器７との間は信号線１１
１でデータ通信が行われ、インタフェース３と外部機器
８との間は信号線１１２でデータ通信が行われ、外部機
器７，８の間は信号線１１３でデータ通信が行われてい
る。
８の間にデイジーチェーン接続、つまり外部機器７→イ
ンタフェース３→外部機器８の順番に接続されている。
これらインタフェース３と外部機器７，８との間におい
て、インタフェース３と外部機器７との間は信号線１１
１でデータ通信が行われ、インタフェース３と外部機器
８との間は信号線１１２でデータ通信が行われ、外部機
器７，８の間は信号線１１３でデータ通信が行われてい
る。
【００２０】インタフェースコントロール部５はＩＥＥ
Ｅ１３９４コントロール部６を制御する役割を持ち、Ｉ
ＥＥＥ１３９４コントロール部６はデータをＩＥＥＥ１
３９４インタフェース規格データに変調する役割を持
つ。電源コントロール部４は電源検出部４１で本体電源
２の入力が検出された時に本体電源２をＩＥＥＥ１３９
４コントロール部６に供給し、電源検出部４１で本体電
源２の入力が検出されなかった時に外部機器７，８から
の電源をＩＥＥＥ１３９４コントロール部６に供給する
役割を持つ。
Ｅ１３９４コントロール部６を制御する役割を持ち、Ｉ
ＥＥＥ１３９４コントロール部６はデータをＩＥＥＥ１
３９４インタフェース規格データに変調する役割を持
つ。電源コントロール部４は電源検出部４１で本体電源
２の入力が検出された時に本体電源２をＩＥＥＥ１３９
４コントロール部６に供給し、電源検出部４１で本体電
源２の入力が検出されなかった時に外部機器７，８から
の電源をＩＥＥＥ１３９４コントロール部６に供給する
役割を持つ。
【００２１】図２は図１の本体電源２がオフになった時
の各部の接続状態を示すブロック図である。これら図１
及び図２を参照して本発明の一実施例によるコンピュー
タシステムの電源供給動作について説明する。
の各部の接続状態を示すブロック図である。これら図１
及び図２を参照して本発明の一実施例によるコンピュー
タシステムの電源供給動作について説明する。
【００２２】まず、図１に示すように、本体電源２がオ
ン（ＯＮ）している時、本体電源２はインタフェースコ
ントロール部５を駆動している。また、電源コントロー
ル部４の電源検出部４１は本体電源２の入力を検出して
いるので、本体電源２をＩＥＥＥ１３９４コントロール
部６に供給するようにスイッチ４２を制御している。
ン（ＯＮ）している時、本体電源２はインタフェースコ
ントロール部５を駆動している。また、電源コントロー
ル部４の電源検出部４１は本体電源２の入力を検出して
いるので、本体電源２をＩＥＥＥ１３９４コントロール
部６に供給するようにスイッチ４２を制御している。
【００２３】このため、インタフェース３ではＩＥＥＥ
１３９４コントロール部６及び信号線１１１，１１２を
通して外部機器７，８との間でデータ通信を行うことが
できる。また、インタフェース３の仕様によって信号線
１１３を通して外部機器７，８間のデータ通信をも行う
ことができる。
１３９４コントロール部６及び信号線１１１，１１２を
通して外部機器７，８との間でデータ通信を行うことが
できる。また、インタフェース３の仕様によって信号線
１１３を通して外部機器７，８間のデータ通信をも行う
ことができる。
【００２４】一方、図２に示すように、本体電源２がオ
フ（ＯＦＦ）した時、インタフェースコントロール部５
は駆動されない。しかしながら、電源検出部４１は本体
電源２が入力されてないことを検出すると、インタフェ
ース３に接続されている外部機器７，８のいずれかの電
源をＩＥＥＥ１３９４コントロール部６に供給するよう
にスイッチ４２を制御する。
フ（ＯＦＦ）した時、インタフェースコントロール部５
は駆動されない。しかしながら、電源検出部４１は本体
電源２が入力されてないことを検出すると、インタフェ
ース３に接続されている外部機器７，８のいずれかの電
源をＩＥＥＥ１３９４コントロール部６に供給するよう
にスイッチ４２を制御する。
【００２５】このため、インタフェース３では外部機器
７，８との間のデータ通信が切断されるが、信号線１１
３による外部機器７，８の間のデータ通信が切断される
ことなく継続される。
７，８との間のデータ通信が切断されるが、信号線１１
３による外部機器７，８の間のデータ通信が切断される
ことなく継続される。
【００２６】尚、上記の例ではコンピュータ本体１内に
配設されたインタフェース３にのみ、電源コントロール
部４とインタフェースコントロール部５とＩＥＥＥ１３
９４コントロール部６とが配設された例について述べた
が、外部機器７，８に配設されたＩＥＥＥ１３９４イン
タフェースの構成をインタフェース３の構成と同じにす
ることも可能である。その場合、コンピュータ本体１が
外部機器７，８の間に設置されないような場合にも、本
発明の一実施例を適用することができる。
配設されたインタフェース３にのみ、電源コントロール
部４とインタフェースコントロール部５とＩＥＥＥ１３
９４コントロール部６とが配設された例について述べた
が、外部機器７，８に配設されたＩＥＥＥ１３９４イン
タフェースの構成をインタフェース３の構成と同じにす
ることも可能である。その場合、コンピュータ本体１が
外部機器７，８の間に設置されないような場合にも、本
発明の一実施例を適用することができる。
【００２７】このように、電源コントロール部４が電源
検出部４１で検出される本体電源２の供給状態に応じて
本体電源２とインタフェース３に接続されている外部機
器７，８からの電源とを切替えるので、ＩＥＥＥ１３９
４コントロール部６の駆動が継続され、インタフェース
３を通した外部機器７，８間のデータ通信が切断される
ことなく継続されることとなる。
検出部４１で検出される本体電源２の供給状態に応じて
本体電源２とインタフェース３に接続されている外部機
器７，８からの電源とを切替えるので、ＩＥＥＥ１３９
４コントロール部６の駆動が継続され、インタフェース
３を通した外部機器７，８間のデータ通信が切断される
ことなく継続されることとなる。
【００２８】
【発明の効果】以上説明したように本発明によれば、自
機器に通信制御バスを通して接続される他の電子機器間
においてデータ通信を行うためコントロール回路を含む
外部インタフェース回路において、自機器からコントロ
ール回路に供給される電源が断となった時に他の電子機
器からの電源をコントロール回路に供給するよう切替え
ることによって、本体電源が切断されても自機器を通し
た他の電子機器間のデータ通信を継続することができる
という効果がある。
機器に通信制御バスを通して接続される他の電子機器間
においてデータ通信を行うためコントロール回路を含む
外部インタフェース回路において、自機器からコントロ
ール回路に供給される電源が断となった時に他の電子機
器からの電源をコントロール回路に供給するよう切替え
ることによって、本体電源が切断されても自機器を通し
た他の電子機器間のデータ通信を継続することができる
という効果がある。
【図１】本発明の一実施例による外部インタフェース回
路を備えたコンピュータシステムの構成を示すブロック
図である。
路を備えたコンピュータシステムの構成を示すブロック
図である。
【図２】図１の本体電源がオフになった時の各部の接続
状態を示すブロック図である。
状態を示すブロック図である。
１ コンピュータ本体 ２ 本体電源 ３ ＩＥＥＥ１３９４インタフェース ４ 電源コントロール部 ５ インタフェースコントロール部 ６ ＩＥＥＥ１３９４コントロール部 ７，８ ＩＥＥＥ１３９４インタフェースを有する機器 ４１ 電源検出部 ４２ スイッチ
─────────────────────────────────────────────────────
【手続補正書】
【提出日】平成１１年５月３１日
【手続補正１】
【補正対象書類名】明細書
【補正対象項目名】特許請求の範囲
【補正方法】変更
【補正内容】
【特許請求の範囲】
【手続補正２】
【補正対象書類名】明細書
【補正対象項目名】００１２
【補正方法】変更
【補正内容】
【００１２】
【課題を解決するための手段】本発明による外部インタ
フェース回路は、自機器に１経路の通信制御バスを通し
て接続される複数の電子機器間において前記通信制御バ
スを通してデータ通信を行うためのコントロール回路を
含む外部インタフェース回路であって、自機器から前記
コントロール回路に供給される電源が断となった時に前
記複数の電子機器のうちのいずれかの電源を前記コント
ロール回路に供給するよう切替える電源コントロール手
段を備えている。
フェース回路は、自機器に１経路の通信制御バスを通し
て接続される複数の電子機器間において前記通信制御バ
スを通してデータ通信を行うためのコントロール回路を
含む外部インタフェース回路であって、自機器から前記
コントロール回路に供給される電源が断となった時に前
記複数の電子機器のうちのいずれかの電源を前記コント
ロール回路に供給するよう切替える電源コントロール手
段を備えている。
【手続補正３】
【補正対象書類名】明細書
【補正対象項目名】００１３
【補正方法】変更
【補正内容】
【００１３】本発明による他の外部インタフェース回路
は、自機器に１経路の通信制御バスを通してデイジーチ
ェーン接続される複数の電子機器間におけるデータ通信
を自機器及び前記通信制御バスを通して行うためのコン
トロール回路を含む外部インタフェース回路であって、
自機器から前記コントロール回路に供給される電源が断
となった時に前記複数の電子機器のうちのいずれかの電
源を前記コントロール回路に供給するよう切替える電源
コントロール手段を備えている。
は、自機器に１経路の通信制御バスを通してデイジーチ
ェーン接続される複数の電子機器間におけるデータ通信
を自機器及び前記通信制御バスを通して行うためのコン
トロール回路を含む外部インタフェース回路であって、
自機器から前記コントロール回路に供給される電源が断
となった時に前記複数の電子機器のうちのいずれかの電
源を前記コントロール回路に供給するよう切替える電源
コントロール手段を備えている。
Claims (8)
- 【請求項１】 自機器に通信制御バスを通して接続され
る他の電子機器間においてデータ通信を行うためのコン
トロール回路を含む外部インタフェース回路であって、
自機器から前記コントロール回路に供給される電源が断
となった時に前記他の電子機器からの電源を前記コント
ロール回路に供給するよう切替える電源コントロール手
段を有することを特徴とする外部インタフェース回路。 - 【請求項２】 前記電源コントロール手段は、自機器か
ら前記コントロール回路に供給される電源が断となった
ことを検出する検出手段と、自機器から前記コントロー
ル回路への電源供給と前記他の電子機器から前記コント
ロール回路への電源供給とを切替える切替手段と、前記
検出手段の検出結果に応じて前記切替手段による電源供
給の切替動作を制御する手段とを含むことを特徴とする
請求項１記載の外部インタフェース回路。 - 【請求項３】 前記コントロール回路は、前記他の電子
機器間で伝送されるデータを予め設定されたインタフェ
ース規格のデータに変調するよう構成したことを特徴と
する請求項１または請求項２記載の外部インタフェース
回路。 - 【請求項４】 前記通信制御バスは、ＩＥＥＥ１３９４
に準拠したものであることを特徴とする請求項１から請
求項３のいずれか記載の外部インタフェース回路。 - 【請求項５】 自機器に通信制御バスを通してデイジー
チェーン接続される他の電子機器間におけるデータ通信
を自機器を通して行うためのコントロール回路を含む外
部インタフェース回路であって、自機器から前記コント
ロール回路に供給される電源が断となった時に前記他の
電子機器からの電源を前記コントロール回路に供給する
よう切替える電源コントロール手段を有することを特徴
とする外部インタフェース回路。 - 【請求項６】 前記電源コントロール手段は、自機器か
ら前記コントロール回路に供給される電源が断となった
ことを検出する検出手段と、自機器から前記コントロー
ル回路への電源供給と前記他の電子機器から前記コント
ロール回路への電源供給とを切替える切替手段と、前記
検出手段の検出結果に応じて前記切替手段による電源供
給の切替動作を制御する手段とを含むことを特徴とする
請求項５記載の外部インタフェース回路。 - 【請求項７】 前記コントロール回路は、前記他の電子
機器間で伝送されるデータを予め設定されたインタフェ
ース規格のデータに変調するよう構成したことを特徴と
する請求項５または請求項６記載の外部インタフェース
回路。 - 【請求項８】 前記通信制御バスは、ＩＥＥＥ１３９４
に準拠したものであることを特徴とする請求項５から請
求項７のいずれか記載の外部インタフェース回路。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10058727A JPH11259184A (ja) | 1998-03-11 | 1998-03-11 | 外部インタフェース回路 |
| US09/264,443 US6351818B1 (en) | 1998-03-11 | 1999-03-08 | External interface circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10058727A JPH11259184A (ja) | 1998-03-11 | 1998-03-11 | 外部インタフェース回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH11259184A true JPH11259184A (ja) | 1999-09-24 |
Family
ID=13092547
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
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