JPS58100506A - 周波数可変形信号発生器 - Google Patents

周波数可変形信号発生器

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Publication number
JPS58100506A
JPS58100506A JP19913781A JP19913781A JPS58100506A JP S58100506 A JPS58100506 A JP S58100506A JP 19913781 A JP19913781 A JP 19913781A JP 19913781 A JP19913781 A JP 19913781A JP S58100506 A JPS58100506 A JP S58100506A
Authority
JP
Japan
Prior art keywords
data
signal
counter
output
frequency
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP19913781A
Other languages
English (en)
Inventor
Yoshiki Otsuki
大槻 善樹
Yoshiaki Tanaka
美昭 田中
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Victor Company of Japan Ltd
Nippon Victor KK
Original Assignee
Victor Company of Japan Ltd
Nippon Victor KK
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Victor Company of Japan Ltd, Nippon Victor KK filed Critical Victor Company of Japan Ltd
Priority to JP19913781A priority Critical patent/JPS58100506A/ja
Publication of JPS58100506A publication Critical patent/JPS58100506A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03LAUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00Automatic control of frequency or phase; Synchronisation

Landscapes

  • Inverter Devices (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は周波数可変形信号発生器に係り、クロックパル
スを分周するカウンタの分周比を可変制御して交流信号
の周波数を適宜可変し得る周波数可変形信号発生器を提
供することを目的とする。
第1図は本発明になる周波数可変形信号発生器の第11
!施例のブロック系統図を示す。同図において、クロッ
ク信号発生器1からとり出された敷用のクロック信号は
カウンタ2,3にて分周された後カウンタ4に供給され
、ここで例えば8ビツトのアドレス信号とされ、リード
・オンリ・メモリ(R,OM)5に供給される。カウン
タ2.3は中央処理制御装置((3PU)9からの制御
信号によりその夫々の分局比を可変される構成とされて
いる。これにより、カウンタ4からのアドレス信号の出
力速度はこの分局比に比例する。
ROM5には求めるオーディオ帯域の正弦波信号(数1
0th〜数10 kHz )の細分化された夫々異なる
レベルに対応して設定された第2図に示す如き例えば8
ビツトのデータD0. Dl、 甲、 DNが1周期分
子めメモリされている。このデータは、正弦波信号の振
幅の中心値に応じたデータで始まり(電圧” Vcc 
) 、電圧+VCC方向に増加した後減少して零Vを経
て振幅の中心値に応じたデータで終るデータにて構成さ
れており、カウンタ4からのアドレス信号に夫々対応し
ている。ROM 5からのデータはカウンタ4からのア
ドレス信号の出力速度に比例して順次時分割的にとり出
される。
ROM5からとり出された8ビツトのデータはD/A変
換器6に供給されてここでD/A変換され、第2図に示
す如く、データD。、Dl、・・、DNに夫々対応した
電圧値とされる。この電圧はDO成vCC+ −2vC
Cに最大振幅をもつ正弦波信号とされ、出力端子8より
とり出される。端子8よりとり出された信号は、その時
間軸方向に対するレベルの変化はカウンタ2,3の分周
比で決定され、従って、0PU9による制御により出力
信号の周波数が可変される。
なお、ROM5のデータは第2図に示す構成の他、第3
図tこ示す如く、正弦波信号の振幅の中心値に応じたデ
ータで始まり、零■方向に減少した後増加して電圧+V
CCを経て振幅の中心に応じたデータで終るデータで構
成してもよい。
次に第2実施例を説明するに、第1図ROM 5は、第
3図に示す如き1周期分のデータと、更に第4図に示す
如き例えば2周期分のデータとを独立にとり出し得る構
成とされており、0PU9からの信号によりいずれか一
方を選択されるよう制御される。
このように構成すれば、通常は第1実施例と同様に第3
図のデータにより所定の周波数の正弦波を発生させ、第
4図のデータに切かえて更に例えば2倍の周波数の交流
信!を発生させ仝ことができる。このようにして、限ら
れたクロック信号周波数を用いて周波数の可変範囲を2
倍等に更に拡張することができる。仁の場合、周波数を
2倍等にするに伴い例えば2周期分のデータを同じクロ
ックで読み14すため歪が増加するが、この歪は例えば
15 kHz以上の高周波数であるため歪の増加は、こ
の信号を鈴音するテープレコーダ等の装置自体の歪の増
加と比べて、十分低くおさえられるので無視できる◎ なお、上記実施例は正弦波を以て説明したが、他の波形
、たとえば三角波、ピンクノイズ(所定狭帯域に限定さ
れたピンクノイズ)など任意の形状の交流信号に適用で
き、また、ROM5はl(、AMまたは電気的に消去制
御できるROMに置換えることも可能であり、この場合
、OPUから波形を指定できる。
また、上記第2実施例において述べた複数の交流信号と
しては正弦波とピンクノイズなど異なる種類の交流信号
を選択できるROM内容としてもよく、第2実施例に述
べた如き、周波数のみが異なる例に限定されない。
上述の如く、本発明になる周波数可変形イδ号発生器は
、クロックパルスを゛箋生する回路と、制御信号に応じ
た分局比にてクロックパルスを分周する第1のカラン″
りと、第1のカウンタの出力を供給されその分局比に応
じた速度でアドレス信号を出力する第2のカウンタと、
正弦波信号の各レベルに応じた所定周期分のデータをア
ドレス信号に対応してメモリされており、アドレス信号
の出力速度に応じた速度でデータを時分割的に繰返しと
り出すメモリ回路と、メモリ回路からのデータをD/A
 置換して交流信号を得る回路とよりなるため、例えば
マイクロコンピュータのCPU等のデジタル制御装置か
らのデジタル制御信号によりカウンタの分局比を可変す
るだけでメモリからのデ−タの読出し速度を可変して交
流信号の周波数を種々可変でき、更に、異なる周波数の
データを選択的に取り出すようにしたため周波数の可変
範囲を更に広げることができ、この場合、データのビッ
ト数を多く設定する程高精度即ち低歪率のアナログ信号
を得ることができるため、例えばオーディオ機器の歪を
測定するためのテスト用信号として使用でき、マイクロ
コンピュータ等の簡単な制御で信号処理できるため、正
確な発成周波数が瞬時に得られる等の特長を有する。
【図面の簡単な説明】
第1図は本発明信号発生器の第1実施例のブロック系統
図、第2図乃至第4図は正弦波信号とデータとの関係を
示す図である。 1・・・クロック信号発生器、2〜4・・・カウンタ、
5・・・リード・オンリ・・メモリ、6・・・D/人変
換器、7・−・Do成分除去回路、8・・・出力端子、
9・・・中央処理制御装置。

Claims (4)

    【特許請求の範囲】
  1. (1)  クロックパルスを発生する回路と、該クロッ
    クパルスを供給され、外部からの制御信号にて分局比を
    可変されて該制御信号に応じた分局比にて該クロックパ
    ルスを分局する第1のカウンタと。 該第1のカウンタの出力を供給され骸分局比に応じた速
    度でアドレス信号を出力する第2のカウンタと、求める
    交、波信号の時間軸方向に対する各レベルに夫々応じた
    所定周期分のデータを該アドレス信号に対応してメモリ
    されており、該アドレス信号の出力速度に応じた速度で
    該データを時分割的に繰返しとり出すメモリ回路と、該
    メモリ回路からのデータをD/A変換して交流信号を得
    る回路とよりなることを特徴とする周波数可変形信号発
    生器。
  2. (2)該データは、該交流信号の振幅の中心値に応じた
    データから始まり、1周期後の中心値に応じたデータで
    終る配置であることを特徴とする特許請求の範囲第1項
    記載の周波数可変形信号発生器。
  3. (3)誼データは、複数の交流信号の夫々の少くとも1
    711期分のデータを含み、該外部からの制御信号によ
    り選択できるよう構成したことを特徴とする特許請求の
    範囲第1項又は第2項記載の周波、  数回変形信号発
    生器。
  4. (4)  該複数の交流信号は、異なる周波数の同一種
    の交流信号であることを特徴とする特許請求の範囲第3
    項記載の周波数可変形信号発生器。
JP19913781A 1981-12-10 1981-12-10 周波数可変形信号発生器 Pending JPS58100506A (ja)

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JP19913781A JPS58100506A (ja) 1981-12-10 1981-12-10 周波数可変形信号発生器

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Publications (1)

Publication Number Publication Date
JPS58100506A true JPS58100506A (ja) 1983-06-15

Family

ID=16402753

Family Applications (1)

Application Number Title Priority Date Filing Date
JP19913781A Pending JPS58100506A (ja) 1981-12-10 1981-12-10 周波数可変形信号発生器

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JP (1) JPS58100506A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH02262704A (ja) * 1988-11-21 1990-10-25 Seiko Instr Inc 粘弾性測定用正弦波発生回路

Cited By (1)

* Cited by examiner, † Cited by third party
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