JPS58112172A - キャラクタ情報記憶装置 - Google Patents

キャラクタ情報記憶装置

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JPS58112172A
JPS58112172A JP56212064A JP21206481A JPS58112172A JP S58112172 A JPS58112172 A JP S58112172A JP 56212064 A JP56212064 A JP 56212064A JP 21206481 A JP21206481 A JP 21206481A JP S58112172 A JPS58112172 A JP S58112172A
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JP
Japan
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code
character
circuit
register
characters
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JP56212064A
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English (en)
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JPH041372B2 (ja
Inventor
Toshifumi Hoshii
星井 敏文
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Casio Computer Co Ltd
Original Assignee
Casio Computer Co Ltd
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Publication date
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    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F40/00—Handling natural language data
    • G06F40/40—Processing or translation of natural language

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Health & Medical Sciences (AREA)
  • Artificial Intelligence (AREA)
  • Audiology, Speech & Language Pathology (AREA)
  • Computational Linguistics (AREA)
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  • General Physics & Mathematics (AREA)
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  • Memory System (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 この発明紘電子式翻訳機などのキャラクタ情報記憶装置
に関する。
近年、電子式翻訳機などのキャラクタ情報記憶装置が開
発されているが、この装置には日本語中英語などの単語
を記憶するROM(リードオンリメモリ)が設けられて
いる。そして例えば英単語の場合、各単語は26文字の
アルファべy)にょシ表わされるが、従来では各アルフ
ァベット(キャラクタ)紘夫々1つのコードと対応付け
られ、ま九日本語の場合も各カナが夫々1つのコードと
対応付けられておシこのため夫々が8ビツトからなる内
容の互いに異なるコードがアルファベットやカナに対し
設定されている。即ち、各単語はlキャラクタにつき8
ビツトの容量、をもっデータとしてROMK起憶さ記憶
いる。
ところで例えば英単語ではCA、LE、BYなど、しば
しば用いられる複数キャラクタの組合せがあシ、このよ
うな組合せキャラクタを1キヤラクタずつ:1六ド化し
てROMに記憶し九のではROMの記憶容量を徒らに増
大させるものである。
この発明は上述し九事情に着目してなされたもので、そ
の目的とするところは、上述した複数中ヤラクタからな
る組合せキャラクタに対してlキャラクタに対するコー
ドと同一ビット数のコードを対応付け、上記コードの特
定ビットの数値を特定キャラクタに対応付けることによ
シ、少ない記憶容量で多くのキャラクタ情報を記憶でき
るようにしたキャラクタ情報記憶装置を提供することで
ある。
以下、図面を参照してこの発明の詳細な説明する。第1
図ないし第6図はこの発明“を英語と日本語の翻訳機能
を持った電子式翻訳機に適用した実施例を示している。
第1図において、キー人力部IKは、日本語入力モード
指示キー、英語入力モード指示キー、翻訳指示キー、更
には英語または日本語を入力するためのアルファベット
キーまたはカナキー等、各種キーが設けられている。そ
してキー人力部1の各キーのキー操作信号は制御部2に
与えられて翻訳に必要な各種制御動作を実行させると共
に1キ一人力部1から出力される英語または日本語の入
力データはレジスタ3に入力され、一時記憶される。そ
してこのレジスタ3に記憶され九データはアドレス指定
回路4、比較回路5、表示部6に夫々与えられる。上記
アドレス指定回路4はレジスタ3内に入力されたデータ
をMK ROM 7のアドレスを指定する回路である。
ここで、ROM7の構成を説明すると、ROM7内は大
別して英語エリアと日本語エリアとより成って員る。そ
して英語エリアには英単語と、この英単語の訳語が記憶
されている日本語エリア内のアドレスデータとが一対の
データとして記憶され、他方、日本語エリアには、日本
語と、この日本語の訳語が記憶されている英語エリア内
のアドレスデータとが一対のデータとして記憶されてい
る。そして英単語の場合、第2図に示すようにキャラク
タコードはlキャラクタまたは2キヤラクタと対応付け
られている。即ち、各キャラクタコードは8ビツトデー
タにょシ表わされ、また上位4ビツトと下位4ビツトの
数値は夫々、第2図に示すように規則性をもって各キャ
ラクタと対応付けられている。図示するように、キャラ
クタコードの上位4ビツトがrooooJ(10進数の
0)、rooolJ(10進数の1)のキャラクタコー
ド紘1コードが1キヤラクタに対応し、また上位4ビツ
トがrooloJ (10進数の2)〜「01ll」(
10進数の7)のキャラクタ情報、ドは1:1lF−)
”;6(2キヤラクタに対応する。モして2キヤラクタ
のキャラクタコードの場合、上位4ピツ)、#(roo
loJ 〜rolllJのキャラクタコードは夫々、B
A−TA、BI〜TI、BU〜TU% BE 〜TE、
BO〜TO,BY 〜TY−1’あシ、2番目の文字カ
夫々、A、I、U、E、01YIC対応する2キヤラク
タである。また下位4ビツトがro 000J〜r11
11J(10進数の15)のキャラクタコードは夫々、
BA〜BY、CA〜CY、DA、DY%FA−FY、a
A−Gy、HA−HY、JA〜JY、KA〜KY、LA
〜LY。
MA〜MY、NA〜NY、PA〜PY、QA〜QY、R
A〜RY、5A−8Y、TA〜TYであシ、1番目の文
字が夫々、B、C,、D、F、G、)l。
J、KXLXM、N、P、Q、R,S、Tに対応する2
キヤラクタである。
日本語の単語のカナの場合も上記英単語の場合同様に1
キヤラクタと2キヤラクタが共に8ビツトのキャラクタ
コードによシ表現され、規則性を4b″)て対応付けら
れているが、その詳細については説明を省略する。
ROM7から読出される各単語は変換回路8に入力され
る。この変換回路8の詳細は後述するが、1’−CAJ
のように2キヤラクタの組合せで1つのコードr001
00001 (33)Jに対応しているキャラクタを「
C」、「A」、すなわちコードr00000010(2
)J、ro o o o o 。
00(0)Jのように1キヤラクタ毎のコードに変換し
て、スタティックシフトレジスタで構成されるレジスタ
9へ供給する回路である。レジスタ9に入力され九デー
タは比較回路5に与えられ、この比較回路5によってレ
ジスタ3内のデータとの一致、不ム致が比較検出される
。その検出信号は制御部2に与えられ、これにより制御
部2はアドレス指定回路4に対する制御命令を出力する
。
この制御部2はシステム全体を制御するもので、タイミ
ング信号91.91 をはじめ各種制御信号を出力する
が、これら制御信号の図示は省略してある。
レジスタ3.9内の各データは表示部6に送られて表示
される。この表示部6は例えば20桁の5X7液晶ドツ
トマトリクス表示装置から成っている。
次に1第3図を参照して変換回路8の具体的構成を説明
する。ROM7から読出された単語はスタティックシフ
トレジスタによ多構成されるレジスタ11に入力される
。このレジスタ11はアントゲ−)12.13を夫々介
し入力されるクロック9t 、(Jz により駆動され
、クロックgl の出力時にデータを読込み、クロック
92 の出力時に読込んだデータを次段に出力する。レ
ジスタ11から出力されるデータはlキク222分の容
量をもち、且つクロック91 、 (Jz によシ駆動
されるバッファ14に入力される。このバッファ14内
のデータは検出回路15、アンドゲート16に夫夫与え
られている。上記検出回路15は第2図に示す32以上
のコード、すなわち、2キヤラクタを1キヤラクタに圧
縮し九コードを検出する回路でアシ、その検出信号はイ
ンバータ17を介しアンドゲート16およびワンシ曹ッ
ト回路18に与えられるほか、バッファ20、アンドゲ
ート21、遅延回路22に夫々直接与えられている。ワ
ンシ■ット回路18は上記検出回路15からの検出出力
°l″が得られた時1tcにis 、 にIs の1サ
イクルタイムの関“θ″出力発生する回路でアシ、その
出力は上記アンドゲート12.13に夫々ゲート制御信
号として与えられている。
デコーダ19は検出回路15によシ検出された32以上
のコードを入力し、1文字ずつに分解したコードを2キ
ャラクタ分発生し、バッファ20に与える回路で、例え
ば[cAJのコード「33」が入力された場合には、「
C」のコード「2」をバッファ20の上位桁20Aに、
rAJのコードrOJを下位桁20Bに出力する。バッ
ファ20は上記検出回路15からの検出信号によシデコ
ーダ19からのコードを読込み、クロックg1  によ
シ読出し動作を実行する。ま九遅延回路22はクロック
g2 によシ駆動され、lキク222分の遅延動作を実
行する。そしてその遅延出力はアンドゲート23のゲー
ト制御信号とされる。
一方、バッファ20の上位桁20A1下位桁20Bから
読出されたコードは夫々、アントゲ−)21,23を介
しレジスタ9に入力される。また上記アントゲ−)16
から出力されるコードもレジスタ9に入力される。なお
、レジスタ9はクロック91、Ω2によシ駆動されるス
タティックシフトレジスタである。
第4図は上記デコーダ19の具体的構成を示している。
即ち、第2図について説明したように、2キヤラクタに
対するキャラクタコードの下位4ビツトが10進数の0
〜15(即ち、ro000J〜rllllJ)のコード
は夫々、1番目の文字がB−Tに対応付けられている。
したがって下位4ビツトのデータが文字B−Tを表わす
か否かが下位4ビツトに対するデコーダ19Aによって
検出される構成となっている。即ち、デコーダ19Aは
キャラクタコードの下位4ビツトのデータを入力し、そ
のデコード出力を上記バッファ20の上位桁20AK4
える。一方、キャラクタコードの上位4ビツトがlθ進
数の2〜7(即ち、「0010・」〜「0111」)の
コードは夫々、2番目の文字がA〜Yに対応付けられて
いる。したがって、このコードは上位4ビツトに対する
デコーダ19Bによって検出される。即ち、デコーダ1
9Bはキャラクタコードの上位4ビツトのデータを入力
し、そのデコード出力をバッファ20の下位桁20Bに
与える。なお、デコーダ19中に示す各マトリクス19
ム1119ム2.19B1.19 BM  のうち、マ
トリクス19ム1.19B1は多入力(横方向)・1出
力(縦方向)のアンドゲート群であシ、マトリクス19
ムz、1gitgは1入力(縦方向)・多出力(横方向
)のオアゲート群である。
次に上記実施例の動作を説明する。例えば英単語rA 
RE AJを入力してその和訳「チイキ」を得るものと
する。この場合、キー人力部1の英語入力モード指示キ
ーを操作し、次いでアルファベットキーによ)上記英単
語「A RE AJを入力し、次いで翻訳指示キーを操
作する。上記キー操作により英単語「AREAJがコー
ドrO,17,4,0」からなる入力データとしてレジ
スタ3に入力され、アドレス指定回路4、比較回路5、
表示部6に夫々与えられる。このためアドレス指定回路
4はROM7の英語エリアの先頭アドレスから順次アド
レス指定動作を実行開始する。また表示部6に紘英単語
1’−AREAJが表示される。ROM7からは上記ア
ドレス指定動作にしたがってその先頭アドレスの英単語
から順次読出され、変換回路8を介してレジスタ9に書
込まれ、比較回路5に供給される。このため比較回路5
はレジスタ3内の英単1irAREAJとレジスタ9内
の英単語を順次比較し、一致が検出されるまで2値論理
レベルの0”の検出信号を出力しつづけて制御部2に与
え、このため制御部2はこれに応じてアドレス指定回路
4に対しアドレス1指定動作を続行させる。
ROM7の英単語[A RE AJの記憶されているア
ドレスが指定されると、レジスタ11に「AJ「REJ
、rAJの各コードr00000000J、ro 10
11101J、ro 0000000J力裟この順序に
て入力される。そして先ずrAJ2>!レジスタ11か
ら出力され、)くツ7ア14にクロック出 のタイミン
グで読込まれ、次いでクロックののタイミングで続出さ
れて検出回路15、アンドゲート16に与えられる。検
出回路15はrAJが32以上のコードでないため検出
信号は“Omである。このためインノ(−夕17の出力
は“1″であシ、アンドゲート16を開成し、上−rA
Jがアンドゲート16を介してレジスタ9に読込まれる
、次に14EJを示すコー)”r93Jがバッファ14
に読込まれると、検出回路15.11「RE」が32以
上のコードであることを検出し、検出信号1゛1”を出
力する。このためインノ(−タ17の出力が“O”に反
転し、アンドゲート16が閉成されると尼もに、ワンシ
曹ット回路18力!この状態を検出し、lキャラクタ分
のシフト動作期間、“θ″の信号を出力してアントゲ−
)12.13を閉成し、lキャラクタ分だけのシフト動
作を停止させる。ま九検出回路15はコード「0101
1101Jをデコーダ19に与え、これ′に応じてデコ
ーダ19からrRJ、IUJの各コードr000100
01J、rooooolooJが並列して出力され、バ
ッファ20の上位桁20A。
下位桁20Bに夫々与えられる。而してクロックQx 
のタイミングで上位桁20Aからコード「000100
01Jが読出されると、いま検出回路15の検出信号“
l”Kよシ開成中のアンドゲート21を介し骸コードr
0001000’lJすなわちキャラクタrRJがレジ
スタ9に与えられ読込まれる。次いでクロックg2 の
タイミングにて上記検出信号“11が遅延回路22から
“1″として出力され、チントゲート23を開成させる
。
このためバッファ20の下位桁20B内のコードr00
000100JすなわちキャラクタrEJがアンドゲー
ト23を介しレジスタ9に与えられ読込まれる。またこ
のクロックg2 のタイミング直後からアンドゲート1
2.13が再び開成され、レジスタ11がクロック91
 により駆動されてrAJがバッファ14に入力される
。而してこのrAJはコード「32以上」に該当しない
から検出回路15の検出信号が0”として出力され、こ
れに応じてアントゲ−)16が再び開成され、上記rA
Jがアンドゲート16を介しレジスタ9に入力される。
上述のようにしてレジスタ9に英単語1’−AREA」
の4つのコードが夫々入力されると、比較回路5はレジ
スタ3、レジスタ9内の各英単語のコードの一致を検出
し、検出信号“1″を出力して制御部2に与える。この
ためアドレス指定動作が停止し、また検索された英単語
「A RE Ajのコードと共に読出された訳語「チイ
キ」のアドレスデータにもとづくアドレス指定動作が開
始され、日本語「チイキ」をレジスタ9に読込み、表示
部6にて表示する。
以上の如く構成することによシ、例−えば1’−CAL
ENDARJという単語を例にとると、lキャラクタを
8ビツトコードで表わす従来の記憶装置では、第5図(
A)に示すだけの容量を必要としたが、本実施例のよう
に1キヤラクタを8ビツトコードで表わし、且つ所定組
合せのキャラクタを1つのコードに対応させた記憶装置
では、同図(B)に示す通シ斜線部分の容量を節約する
ことができる。また第6図は、ROM7内に配憶されて
いる単語の一部を示したものであるが、わずか10語を
比較しただけでも30文字分(240ビツト)の容量を
節約することができるものである。
第7図は第2図に示したキャラクタコードの変形例を示
している。即ち、2キヤラクタに対応するキャラクタコ
ードにおいて、第7図のキャラクタコードは第2図のキ
ャラクタコードに対応する2キヤラクタの1文字目と2
文字目を相互に交換し九もので、この場合にはデコータ
19の構成を対応して変形すればよく、即ち、第4図に
示すデコーダ19の19Aと19Bを交換した構成にす
ればよい。したがって第7図のようなキャラクタコード
の構成の場合もこの発明を同様に実施できるものである
。
いるROMからデータを続出して通常型に変換し丸後、
入力された単語゛との比較を行なうようKしたが、入力
された単語を圧縮型に変換してからROMに記憶されて
いる圧縮型の単語と比較しても良い。
また2キヤラクタに限らず、例えばrWSTJ、rIL
YJなど、3語以上のものを1つのキャラクタコードと
してもよい。また日本語、英語に限らず他の言語であっ
てもよいことは勿論であり、また翻訳機ではなく、電子
メモのように人力した単語を単に記憶する記憶装置にも
採用することができる。またキャラクタコードの対応付
けの規則性のもたせがたについては、他の方法であって
もよい。
以上説明したように、この発明によれば、効率良くキャ
ラクタ情報を記憶することができるから、メモリ容量を
節約することができ、従っテ多くノ単語を記憶装置内に
収容することができる。
加えて、キャラクタコードの対応付けに規則性をもたせ
たから、コート°変換回路(例えばデコーダ)の構成が
簡略になシ、処理も簡単になる。という効果を奏するも
のである。
【図面の簡単な説明】
jI1図はこの発明を電子式翻訳機に適用した一実施例
の回路ブロック図、第2図は英語のキャラクタコードを
示す図、第3図は変換回路8の具体的な回路構成図、第
4図はデコーダ19の詳細構成図、第5図(A)、(B
)は夫々、従来および本実施例における単語のコード化
の一例を示す図、第6図は従来および本実施例における
単語をコード化した場合のキャラクタ数を比較した図、
第7図はキャラクタコードの変形例を示す図である。 1・・・キー人力部、2・・・制御部、3・・・レジス
タ、4・・・アドレス指定回路、5・・・比較回路、6
・・・表示部、7・・・ROM、8・・・変換回路、9
・・・レジスタ、1’l・・・レジスタ、14・・・バ
ッファ、15・・・検出回路、19・・・デコーダ、2
0・・・バッファ、22・・・遅延回路。 %軒出願人

Claims (1)

    【特許請求の範囲】
  1. 1つのコードに1キヤラシタを対応付けると共に、この
    コードと同一ビット数からなる1つのコードに複数キャ
    ラクタを対応付け、これら各コードにより表わされるキ
    ャラクタ情報を記憶するメモリと、このメモリのアドレ
    スを指定する手段と、この手段によ〕指定され九上記メ
    モリのアドレスに記憶されている中ヤラクタ情報を読出
    す手段との数値が特定キャラクタに対応付けられている
    ことを特倣とするキャラクタ情報記憶装置。
JP56212064A 1981-12-25 1981-12-25 キャラクタ情報記憶装置 Granted JPS58112172A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP56212064A JPS58112172A (ja) 1981-12-25 1981-12-25 キャラクタ情報記憶装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP56212064A JPS58112172A (ja) 1981-12-25 1981-12-25 キャラクタ情報記憶装置

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Publication Number Publication Date
JPS58112172A true JPS58112172A (ja) 1983-07-04
JPH041372B2 JPH041372B2 (ja) 1992-01-10

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ID=16616264

Family Applications (1)

Application Number Title Priority Date Filing Date
JP56212064A Granted JPS58112172A (ja) 1981-12-25 1981-12-25 キャラクタ情報記憶装置

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS56149667A (en) * 1980-04-21 1981-11-19 Sharp Corp Electronic interpreter

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS56149667A (en) * 1980-04-21 1981-11-19 Sharp Corp Electronic interpreter

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JPH041372B2 (ja) 1992-01-10

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