JPS58159103A - 二重化アナログ信号出力装置 - Google Patents
二重化アナログ信号出力装置Info
- Publication number
- JPS58159103A JPS58159103A JP4350582A JP4350582A JPS58159103A JP S58159103 A JPS58159103 A JP S58159103A JP 4350582 A JP4350582 A JP 4350582A JP 4350582 A JP4350582 A JP 4350582A JP S58159103 A JPS58159103 A JP S58159103A
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- JP
- Japan
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- output
- circuit
- analog signal
- signal
- circuits
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B9/00—Safety arrangements
- G05B9/02—Safety arrangements electric
- G05B9/03—Safety arrangements electric with multiple-channel loop, i.e. redundant control systems
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Safety Devices In Control Systems (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、二重化されたアナログ信号出力装置の改良に
関するものである。
関するものである。
アナログ信号の出力ＩＩの信頼性を高めるために、出力
回路を二重化して、一方を実働側とし、他方を待機側と
して、実働側が故障したとき、待機側に切り換えること
が行なわれる。
回路を二重化して、一方を実働側とし、他方を待機側と
して、実働側が故障したとき、待機側に切り換えること
が行なわれる。
二重化されたアナログ信号出力装置の従来例としては、
第１図のようなものが一般的である。すなわち、２つの
アナログ信号出力回路１，２の出力端子を、切り換え機
能を持った突き合せ回路３を通じて共通の出力線路４に
接続するようにしたものであって、突き合せ回路３を制
御回路５によって制御して、２つの出力回路のうちどち
らか一方の出力信号を出力線路４に供給するようになっ
ている。そして制御回路５は実働側の動作状態を監視し
、その故障を検出したとき、突き合せ回路３を操作して
出力信号の供給源を待機側に切り換えるようになってい
る。
第１図のようなものが一般的である。すなわち、２つの
アナログ信号出力回路１，２の出力端子を、切り換え機
能を持った突き合せ回路３を通じて共通の出力線路４に
接続するようにしたものであって、突き合せ回路３を制
御回路５によって制御して、２つの出力回路のうちどち
らか一方の出力信号を出力線路４に供給するようになっ
ている。そして制御回路５は実働側の動作状態を監視し
、その故障を検出したとき、突き合せ回路３を操作して
出力信号の供給源を待機側に切り換えるようになってい
る。
このような従来の装置においては、切り換え機能を持つ
突き合せ回路３とその制御回路５Ｊ５よびそれらの間の
信号線が必要とされる。これらの回路はアクティブ素子
を含むものであるが、二重化装置全体の信頼性を高める
ためには、アクティブ素子を含む回路はできるだけ少な
いことが望ましく、また信号線の数もできるだけ少いこ
とが望ましい。また、アナログ信号出力装置がプロセス
制御装置の出力部などであるとき、そのメンテナンスは
、運転を止めることなく行なえること、すなわちオンラ
イン・メンテナンスができることが望ましい。しかしこ
の従来例においては、突き合せ回路３とその制御回路５
については、それらのオンライン・メンテナンスは不可
能ないしはきわめて困難なことである。また、待機側の
出力回路は常に正常状態で待機して、実働側が故障した
とき直にそれにとって代らなければならないが、この従
来例においては、待機側が正常状態を保って待機してい
るかどうかを確認することは困難であった。
突き合せ回路３とその制御回路５Ｊ５よびそれらの間の
信号線が必要とされる。これらの回路はアクティブ素子
を含むものであるが、二重化装置全体の信頼性を高める
ためには、アクティブ素子を含む回路はできるだけ少な
いことが望ましく、また信号線の数もできるだけ少いこ
とが望ましい。また、アナログ信号出力装置がプロセス
制御装置の出力部などであるとき、そのメンテナンスは
、運転を止めることなく行なえること、すなわちオンラ
イン・メンテナンスができることが望ましい。しかしこ
の従来例においては、突き合せ回路３とその制御回路５
については、それらのオンライン・メンテナンスは不可
能ないしはきわめて困難なことである。また、待機側の
出力回路は常に正常状態で待機して、実働側が故障した
とき直にそれにとって代らなければならないが、この従
来例においては、待機側が正常状態を保って待機してい
るかどうかを確認することは困難であった。
本発明の目的は、２つの出力の突き合せ回内にアクティ
ブ素子を必要とせず、そのための制御信号線を必要とせ
ず、２つの出力回路の出力信号を切り換えるのに、出力
回路とは別な制御回路を必要とせず、オンライン・メン
テナンスが可能で、かつ待機側の出力回路の正常性を常
に確認できる二重化アナログ信号出力回路を提供するこ
とにある。
ブ素子を必要とせず、そのための制御信号線を必要とせ
ず、２つの出力回路の出力信号を切り換えるのに、出力
回路とは別な制御回路を必要とせず、オンライン・メン
テナンスが可能で、かつ待機側の出力回路の正常性を常
に確認できる二重化アナログ信号出力回路を提供するこ
とにある。
本発明は、それぞれの上位の装置によって制御される２
つのアナログ信号出力回路の出力端子を共通の出力線に
並列接続してなる二重化アナログ信号出力装置であって
、各アナログ信号出力回路は、可変出力のアナログ信号
源と、このアナログ信号源の出力値を上位の装置から与
えられる出力設定値に従って操作する操作器と、出力設
定値とアナログ信号源の出力の検出値とを比較してその
差が零になるように操作器の操作を補正するとともに補
正操作出力を異常検出用信号として上位の装置に伝える
比較器と、前記アナログ信号源から共通の出力線への出
力供給の有効無効を制御するスイッチと、出力信号によ
ってこのスイッチの投入状態を制御するゲートであって
他方のアナログ出力回路における同様なゲートとの組み
合せによって７リツプ・７０ツブ回路を構成し上位の装
置からの出力許可信号を入力として動作するゲートとを
具備することを特徴とする二重化アナログ信号出力装置
によって上記の目的を達成したものである。
つのアナログ信号出力回路の出力端子を共通の出力線に
並列接続してなる二重化アナログ信号出力装置であって
、各アナログ信号出力回路は、可変出力のアナログ信号
源と、このアナログ信号源の出力値を上位の装置から与
えられる出力設定値に従って操作する操作器と、出力設
定値とアナログ信号源の出力の検出値とを比較してその
差が零になるように操作器の操作を補正するとともに補
正操作出力を異常検出用信号として上位の装置に伝える
比較器と、前記アナログ信号源から共通の出力線への出
力供給の有効無効を制御するスイッチと、出力信号によ
ってこのスイッチの投入状態を制御するゲートであって
他方のアナログ出力回路における同様なゲートとの組み
合せによって７リツプ・７０ツブ回路を構成し上位の装
置からの出力許可信号を入力として動作するゲートとを
具備することを特徴とする二重化アナログ信号出力装置
によって上記の目的を達成したものである。
以下、実施例によって本発明の詳細な説明する。
第２図は、本発明実施例の概念的構成図である。
第２図において、１および２は二重化されたアナログ電
流の出力回路であって、それぞれプリント板などの上に
形成され、コネクタに抜き差しでさるものである。これ
ら出力回路１．２の出力端子は突き合せ回路３において
共通の出力線４に並列に接続される。突き合せ回路３の
上流において、各出力回路１．２の出力端子には逆流防
止用ダイオードを必要に応じて挿入してもよい。
流の出力回路であって、それぞれプリント板などの上に
形成され、コネクタに抜き差しでさるものである。これ
ら出力回路１．２の出力端子は突き合せ回路３において
共通の出力線４に並列に接続される。突き合せ回路３の
上流において、各出力回路１．２の出力端子には逆流防
止用ダイオードを必要に応じて挿入してもよい。
出力回路１において、Ｃ８１は可変出力の電流源、ＤＴ
ｌは電流検出器１、ＳＷｌは切り換えスイッチである。
ｌは電流検出器１、ＳＷｌは切り換えスイッチである。
これらは直列に接続されて電、流の経路を形成する。ス
イッチＳＷ１の切り換えに応じて電流＃ｌＡＣ３１の出
力電流は出力線に流れるかあるいは直接コモンにバイパ
スする。
イッチＳＷ１の切り換えに応じて電流＃ｌＡＣ３１の出
力電流は出力線に流れるかあるいは直接コモンにバイパ
スする。
Ｍｌは操作器、Ｈｌは比較器である。電流源Ｃ８１は操
作器Ｍ１によってその出力値が操作される。操作器Ｍ１
は上位の装置から与えられる出力設定値に従って電流源
Ｃ８１を操作する。出力設定値と実際の出力値との差が
比較器Ｈ１によって比較されて、その差が零になるよう
に操作器Ｍ１の操作が補正される。比較器Ｈ１の補正操
作信号は上位の装置に異常検出用の信号として伝えられ
る。
作器Ｍ１によってその出力値が操作される。操作器Ｍ１
は上位の装置から与えられる出力設定値に従って電流源
Ｃ８１を操作する。出力設定値と実際の出力値との差が
比較器Ｈ１によって比較されて、その差が零になるよう
に操作器Ｍ１の操作が補正される。比較器Ｈ１の補正操
作信号は上位の装置に異常検出用の信号として伝えられ
る。
Ｇ１はナントゲートであり、その出力信号によってスイ
ッチＳＷ１の切り替えを制御するものであって、上位の
装置からの出力許可信号が１つの入力信号として与えら
れる。
ッチＳＷ１の切り替えを制御するものであって、上位の
装置からの出力許可信号が１つの入力信号として与えら
れる。
出力回路２においても全く同様な構成になっている。そ
して出力回路１と２の間において、ナンドゲートＧ１と
０２は、それらの出力信号が互いに相手の他方の入力信
号になるように接続されている。これらナントゲートは
いずれもオープン・コレクタ・り、イブのも°のであっ
て・、その出力端子は互に相手の回路において抵抗を通
じてプルアップされている。このようなナントゲートＧ
ｌ、Ｇ２の接続により、フリップ・７０ツブ回路が形成
され、これらナントゲートは一方の出力が「′Ｈ」のと
きは他方の出力がｒＬＪとなる関係で出力信号を生じる
。したがって、スイッチＳＷＩ、ＳＷ２は一方が接点Ａ
側に投入されているとき、他方は接点Ｂ側に投入されて
いる。すなわち、出力回路１゜２の出力電流は、一方が
出力線４に供給されているとき、他方は直接コモンにバ
イパスされている。
して出力回路１と２の間において、ナンドゲートＧ１と
０２は、それらの出力信号が互いに相手の他方の入力信
号になるように接続されている。これらナントゲートは
いずれもオープン・コレクタ・り、イブのも°のであっ
て・、その出力端子は互に相手の回路において抵抗を通
じてプルアップされている。このようなナントゲートＧ
ｌ、Ｇ２の接続により、フリップ・７０ツブ回路が形成
され、これらナントゲートは一方の出力が「′Ｈ」のと
きは他方の出力がｒＬＪとなる関係で出力信号を生じる
。したがって、スイッチＳＷＩ、ＳＷ２は一方が接点Ａ
側に投入されているとき、他方は接点Ｂ側に投入されて
いる。すなわち、出力回路１゜２の出力電流は、一方が
出力線４に供給されているとき、他方は直接コモンにバ
イパスされている。
このため出力回路１．２の出力端子の突き合せ回路３に
はなんらの切り換え機構も不要となり、かつ切り換え制
御のための信号線も不要となるのである。なお、逆流阻
止ダイオードを用いるときは、スイッチＳＷ１．８Ｗ２
のＡ側の接点は共通接点に直結とし、Ｂ側の接点だけを
交互にオンオフするようにしてもよい。
はなんらの切り換え機構も不要となり、かつ切り換え制
御のための信号線も不要となるのである。なお、逆流阻
止ダイオードを用いるときは、スイッチＳＷ１．８Ｗ２
のＡ側の接点は共通接点に直結とし、Ｂ側の接点だけを
交互にオンオフするようにしてもよい。
比較器１−１１．Ｈ２の出力信号に基づく異常検出信号
は、それぞれの上位の装置において監視され、異常の有
無が判定される。異常が検出されたときは出力許可信号
が取り消される。
は、それぞれの上位の装置において監視され、異常の有
無が判定される。異常が検出されたときは出力許可信号
が取り消される。
このように構成された装装置の動作は次のとおりである
。いまナントゲートＧ１．Ｇ２の出力信号がそれぞれｒ
ＬＪおよびｒＨＪであり、それによって、スイッチＳＷ
ＩがＡ側に投入され、ＳＷ２がＢ側に投入されていると
すると、出力回路１が実働側となり、出力回路２が待機
側となっている。
。いまナントゲートＧ１．Ｇ２の出力信号がそれぞれｒ
ＬＪおよびｒＨＪであり、それによって、スイッチＳＷ
ＩがＡ側に投入され、ＳＷ２がＢ側に投入されていると
すると、出力回路１が実働側となり、出力回路２が待機
側となっている。
実働側、待機側いずれにおいても、比較器Ｈ１，Ｈ２の
出力信号に基づいて、それぞれの上位の装置により異常
の有無の監視が行なわれている。出力回路１，２はいず
れも正常状態にあり、それによってどちらのゲートにも
上位の装置からｒＨＪレベルの出力許可信号が与えられ
ている。
出力信号に基づいて、それぞれの上位の装置により異常
の有無の監視が行なわれている。出力回路１，２はいず
れも正常状態にあり、それによってどちらのゲートにも
上位の装置からｒＨＪレベルの出力許可信号が与えられ
ている。
この状態で実働側の出力回路１が故障したとすると、異
常検出信号に応じて、その上位の回路は出力許可信号を
ｒＬＪにする。そうすると、それによって７リツプ・７
０ツブ回路の状態が切り換わり、それにともなつＬスイ
ッチＳＷ１．ＳＷ２が切り換わって、出力回路２が実働
側となり、出力回路１が待機側となる。このようにして
、実働側が自己の異常検出結果に基づいて自己の出力許
可信号を取り消すことにより、自動的に実働側と待機側
の交代が行なわれる。待機側についてはその上位の装置
によって常に異常の有無が監視されているので、異常が
検出された場合は直に修理を行なうことができ、出力の
交代はｉＥ常牲が確認されたものによって行うことがで
きる。
常検出信号に応じて、その上位の回路は出力許可信号を
ｒＬＪにする。そうすると、それによって７リツプ・７
０ツブ回路の状態が切り換わり、それにともなつＬスイ
ッチＳＷ１．ＳＷ２が切り換わって、出力回路２が実働
側となり、出力回路１が待機側となる。このようにして
、実働側が自己の異常検出結果に基づいて自己の出力許
可信号を取り消すことにより、自動的に実働側と待機側
の交代が行なわれる。待機側についてはその上位の装置
によって常に異常の有無が監視されているので、異常が
検出された場合は直に修理を行なうことができ、出力の
交代はｉＥ常牲が確認されたものによって行うことがで
きる。
オンライン・メンテナンスを行なうときは次のようにな
る。いま実働側にある出力回路１をメンテナンスのため
にコネクタから引き抜いたとすると、この引き抜きによ
って、ナントゲートＧ１からナントゲートＧ２の入力端
子に与えられていたｒＬＪレベルの信号がなくなり、そ
の代りにプルアップ電源の電旺が与えられるので、ナン
トゲートＧ２の出力信号は「Ｌ」に反転してスイッチＳ
Ｗ２をＡ側に投入する。これによって出力回路２が出力
電流の供給を受は持つようになるので、その間に出力回
路１をメンテナンスをすることができる。２つの出力回
路の出力端子の突き合せ回路は、受動素子だけからなる
重なる集合接続部であるので、とくにメンテナンスを必
要とせず、また制御回路を出力回路とは別に持たないの
で、そのメンテナンスも必要でない。
る。いま実働側にある出力回路１をメンテナンスのため
にコネクタから引き抜いたとすると、この引き抜きによ
って、ナントゲートＧ１からナントゲートＧ２の入力端
子に与えられていたｒＬＪレベルの信号がなくなり、そ
の代りにプルアップ電源の電旺が与えられるので、ナン
トゲートＧ２の出力信号は「Ｌ」に反転してスイッチＳ
Ｗ２をＡ側に投入する。これによって出力回路２が出力
電流の供給を受は持つようになるので、その間に出力回
路１をメンテナンスをすることができる。２つの出力回
路の出力端子の突き合せ回路は、受動素子だけからなる
重なる集合接続部であるので、とくにメンテナンスを必
要とせず、また制御回路を出力回路とは別に持たないの
で、そのメンテナンスも必要でない。
本発明の他の実施例を第３図に示す。第３図は、出力信
号が電圧である場合の構成例であって、出力信号源が可
変電圧源になっており、そのために待機状態の場合にも
出力信号のバイパス経路が設けられない他は第２図に場
合と同様である。この装置も前記の装置と同様な特徴を
有する。
号が電圧である場合の構成例であって、出力信号源が可
変電圧源になっており、そのために待機状態の場合にも
出力信号のバイパス経路が設けられない他は第２図に場
合と同様である。この装置も前記の装置と同様な特徴を
有する。
以上、本発明を好ましい実施例によって説明したが、本
発明は上記のような実施例に限らず、特許請求の範囲内
において種々の実施の態様がありうる。
発明は上記のような実施例に限らず、特許請求の範囲内
において種々の実施の態様がありうる。
第１図は、従来例の概念的な構成図、
第２図および第３図は、本発明実施例の概念的な構成図
である。 １，２・・・出力回路、３・・・突き合せ回路、４・・
・出力線路、Ｃ８１，Ｃ８２・・・可変電流源、ＤＴｌ
、ＤＴ２・・・出力検出器、ＳＷｌ、ＳＷ２・・・スイ
ッチ、Ｍ １．Ｍ ２・・・操作器、Ｈｌ、Ｈ２・・・
比較器、（３１，（３２・・・ナントゲート。 オ ／ｆｆｉ オ ２ 図 オ ３１！］
である。 １，２・・・出力回路、３・・・突き合せ回路、４・・
・出力線路、Ｃ８１，Ｃ８２・・・可変電流源、ＤＴｌ
、ＤＴ２・・・出力検出器、ＳＷｌ、ＳＷ２・・・スイ
ッチ、Ｍ １．Ｍ ２・・・操作器、Ｈｌ、Ｈ２・・・
比較器、（３１，（３２・・・ナントゲート。 オ ／ｆｆｉ オ ２ 図 オ ３１！］
Claims (1)
- それぞれの上位の装置によってＩＪ ｌされる２つのア
ナログ信号出力回路の出力端子を共通の出力線に並列接
続してなる二重化アナログ信号出力装置であって、各ア
ナログ信号出力回路は、可変出力のアナログ信号源と、
このアナログ信号源の出力値を上位の装置から与えられ
る出力設定値に従って操作する操作器と、出力設定値と
アナログ信号源の出力の検出値とを比較してその差が零
になるように操作器の操作を補正するとともに補正操作
出力を異常検出用信号として上位の装置に伝える比較器
と、前記アナログ信号源から共通の出力線への出力供給
の有効無効を制御するスイッチと、出力信号によってこ
のスイッチの投入状態を制御するゲートであって他方の
アナログ出力回路における同様なゲートとの組み合せに
よって７リツプ・７０ツブ回路を構成し上位の装置から
の出力許可信号を入力として動作するゲートとを具備す
ることを特徴とする二重化アナログ信号出力装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4350582A JPS58159103A (ja) | 1982-03-18 | 1982-03-18 | 二重化アナログ信号出力装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4350582A JPS58159103A (ja) | 1982-03-18 | 1982-03-18 | 二重化アナログ信号出力装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS58159103A true JPS58159103A (ja) | 1983-09-21 |
| JPH0368403B2 JPH0368403B2 (ja) | 1991-10-28 |
Family
ID=12665579
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4350582A Granted JPS58159103A (ja) | 1982-03-18 | 1982-03-18 | 二重化アナログ信号出力装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58159103A (ja) |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5029981A (ja) * | 1973-07-16 | 1975-03-26 | ||
| JPS5730427A (en) * | 1980-07-31 | 1982-02-18 | Fujitsu Ltd | Signal automatic switching circuit |
-
1982
- 1982-03-18 JP JP4350582A patent/JPS58159103A/ja active Granted
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5029981A (ja) * | 1973-07-16 | 1975-03-26 | ||
| JPS5730427A (en) * | 1980-07-31 | 1982-02-18 | Fujitsu Ltd | Signal automatic switching circuit |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0368403B2 (ja) | 1991-10-28 |
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