JPS58199497A - メモリチエツク方式 - Google Patents

メモリチエツク方式

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Publication number
JPS58199497A
JPS58199497A JP57081482A JP8148282A JPS58199497A JP S58199497 A JPS58199497 A JP S58199497A JP 57081482 A JP57081482 A JP 57081482A JP 8148282 A JP8148282 A JP 8148282A JP S58199497 A JPS58199497 A JP S58199497A
Authority
JP
Japan
Prior art keywords
data
memory
stored
area
check code
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP57081482A
Other languages
English (en)
Inventor
Hiroshi Hishida
菱田 洋至
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Ricoh Co Ltd
Original Assignee
Ricoh Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Ricoh Co Ltd filed Critical Ricoh Co Ltd
Priority to JP57081482A priority Critical patent/JPS58199497A/ja
Publication of JPS58199497A publication Critical patent/JPS58199497A/ja
Pending legal-status Critical Current

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Classifications

    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06F—ELECTRIC DIGITAL DATA PROCESSING
    • G06F11/00—Error detection; Error correction; Monitoring
    • G06F11/07—Responding to the occurrence of a fault, e.g. fault tolerance
    • G06F11/0703—Error or fault processing not based on redundancy, i.e. by taking additional measures to deal with the error or fault not making use of redundancy in operation, in hardware, or in data representation
    • G06F11/0751—Error or fault detection not based on redundancy
    • G06F11/0763—Error or fault detection not based on redundancy by bit configuration check, e.g. of formats or tags

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Quality & Reliability (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Detection And Correction Of Errors (AREA)
  • Techniques For Improving Reliability Of Storages (AREA)
  • Storing Facsimile Image Data (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 本発明は、ファクシミリ装置等において、管理情報やダ
イヤル番号等の重要なデータが記憶されるメモリ領域の
データを使用する場合に、使用前にこれらのデータをチ
ェックして使用するようにし、もって、ファクシミリ装
置等における管理の信頼性を保証するようにしたもので
ある。
一般に、ファクシミリ装置等においては、待機電源又は
バックアップ電源で管理情報やダイヤル番号等の信頼性
の必要とされる重要なデータをC(1) MOS−RAMに書き込み保持しているが、ノイズ等に
よるデータの変化に対するチェックがなく、管理の信頼
性に対して必ずしも満足のいくものではなかった。
本発明は、上述のごとき従来技術の欠点を解決するため
になされたもので、特に、管理情報やダイヤル番号等の
重要データが記憶されているメモリ領域のデータに対し
てSUMチェックコード又はCRCチェック等のチェッ
クコードを付加しておき、前記重要データをこのチェッ
クコードによってチェックして使用するようにし、もっ
て、ファクシミリ装置等における管理の信頼性の向上を
図ったものである。
第1図は、本発明が適用されたメモリの一例を示す図で
、全体はメモリ領域を示し、そのうちの領域Aに管理情
報やダイヤル番号等ファクシミリ装置等の管理上信頼性
が要求されるデータが記憶され、この重要なメモリ領域
Aの情報に対して、SUMチェックコード或いはCRC
チェックコード等のチェックコードが領域Bに記憶され
ており(2) 領域Aに記憶されているデータを使用する場合、この領
域Bに記憶されているチェックコードによってチェ′ッ
して使用する゛ようにしている。 ゛、第2図は、上述
のメモリの一使一用例を示す図で、図中、10はcpu
、20はROM、30は前述のごとき重要データ及びチ
ェックコードが記憶されている0MO8−RAMで該C
MO8−RAM3Qは待機電源或いはバックアップ電源
によって書き込み保持されているが、該待機電源或いは
バックアップ電源の低減又゛はノイズ等によって前記C
!MO8−RA M、30に書き込まれているデータが
変化してしまう。このような記憶内iの変化に対して従
来はこの変化をチェックする機能を有しておらず、ノイ
ズに強いデバイスを用いるようにしていたが、本発明に
おいては、前述のように、管理情報やダイヤル番号等の
領域Aに記憶されている重要データに対して、SUMチ
ェック7コード或いはCRCチェックコード等のチェッ
クコードが領域Bに記憶されており、領域Aに記憶され
ている重要データを使用する時は、領域Blこ記憶され
ているチェ(3) 10・ CPU、20・ROM、30−CM、O8,−
RAM。
ッ?コードでチェックし、データエラーを検出した1時
は、記憶内容をクリアしてデータを無効にす゛る。□な
お、第3図に、0MO8−RAMにデータを書き込む時
゛のフローチャート、第4図に、(1!MO8−”’R
A Mからデータを読み取る時のフローチャートを示す
。
以上の説明から明らかなように、本発明によると、ファ
クシミリ装置等において、管理情報やダイヤ)し番゛号
等の重要なデータに対してチェックコードを付しておき
、使用時、この重要データをチェックして使用す、るよ
うに檗たので、ファクシミリ装置等の管脚をより信頼度
の高いものにすることができる。
【図面の簡単な説明】
第1図は、本発明の実施に使用されるメモリの一例を示
す図、第2図は、本発明の一使用例を示す図、第3図は
、本発明によるメモリチェック方式が適用されたデータ
書き込みのフローチャートを示す図、第4図は、データ
読み取りのフローチャートを示す図である。 (4) (5) 第  1 第2 0 第3図 アータ書法 CMOS RAMI: データ書1と 土?″′−9Q艷戚・  〈 チェックコード計算 図 チェックコードと CMOS RAMP::書誌 ND

Claims (1)

    【特許請求の範囲】
  1. 重要なメモリ領域のデータに対してSUMチェックコー
    ド又はCRCチェックコードを付加しておき、このメモ
    リ領域のデータを使用する時は、使用に先立って、前記
    チェックコードによりデータエラーを検出するようにし
    たことを特徴とするメモリチェック方式。
JP57081482A 1982-05-17 1982-05-17 メモリチエツク方式 Pending JPS58199497A (ja)

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JP57081482A JPS58199497A (ja) 1982-05-17 1982-05-17 メモリチエツク方式

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JP57081482A JPS58199497A (ja) 1982-05-17 1982-05-17 メモリチエツク方式

Publications (1)

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JPS58199497A true JPS58199497A (ja) 1983-11-19

Family

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JP57081482A Pending JPS58199497A (ja) 1982-05-17 1982-05-17 メモリチエツク方式

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JP (1) JPS58199497A (ja)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO1986005898A1 (fr) * 1985-03-29 1986-10-09 Winderlich, Gregor (Heir Of Winderlich, Hans-Georg Systeme et appareil a dispositif de traitement de donnees
JPS62286141A (ja) * 1986-06-05 1987-12-12 Oki Electric Ind Co Ltd 電話番号記憶方法
JPH01274247A (ja) * 1988-04-26 1989-11-02 Fujitsu Ltd 保存データ監視方式

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO1986005898A1 (fr) * 1985-03-29 1986-10-09 Winderlich, Gregor (Heir Of Winderlich, Hans-Georg Systeme et appareil a dispositif de traitement de donnees
JPS62286141A (ja) * 1986-06-05 1987-12-12 Oki Electric Ind Co Ltd 電話番号記憶方法
JPH01274247A (ja) * 1988-04-26 1989-11-02 Fujitsu Ltd 保存データ監視方式

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