JPS58201409A - 増幅器 - Google Patents
増幅器Info
- Publication number
- JPS58201409A JPS58201409A JP57085833A JP8583382A JPS58201409A JP S58201409 A JPS58201409 A JP S58201409A JP 57085833 A JP57085833 A JP 57085833A JP 8583382 A JP8583382 A JP 8583382A JP S58201409 A JPS58201409 A JP S58201409A
- Authority
- JP
- Japan
- Prior art keywords
- complementary
- stage
- amplifier
- noise
- transistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03F—AMPLIFIERS
- H03F1/00—Details of amplifiers with only discharge tubes, only semiconductor devices or only unspecified devices as amplifying elements
- H03F1/34—Negative-feedback-circuit arrangements with or without positive feedback
- H03F1/342—Negative-feedback-circuit arrangements with or without positive feedback in field-effect transistor amplifiers
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はオーディオのフォノイコライザ用ヘッドアンプ
等に適する増幅器に関し、イ氏歪率を実現しつつ、電源
雑音、熱雑音等の外部雑音を効果的に低減するようにし
たものであ、る。
等に適する増幅器に関し、イ氏歪率を実現しつつ、電源
雑音、熱雑音等の外部雑音を効果的に低減するようにし
たものであ、る。
一般に使われる増幅器の代表的なものに、初段に差動素
子を使い、その出力端にそれぞれカスコードトランジス
タを接続して、カスコードトランジスタの出力を後段増
幅器で増幅するものがある０これを第１図に示す。
子を使い、その出力端にそれぞれカスコードトランジス
タを接続して、カスコードトランジスタの出力を後段増
幅器で増幅するものがある０これを第１図に示す。
第１図において、１は入力端、２は入力抵抗、３．４は
差動構成の電界効果トランジスタ（以下ＦＥＴという）
、６，６はＦＥＴ３，４にカスコード接続されたトラン
ジスタ、了、８はそのコレクタ抵抗、９，１０はＦＥＴ
５．４のソースと力ｘ＝ｆｆ−１’）ランジスタ５，６
のベースにプートストラップをかけるための抵抗、１１
はＦＥＴ３゜４のソース電流を決めるためのバイアス抵
抗、１２は後段増幅器、１３．１４は帰還回路を構成す
る受動素子、１６は出力端、１６．１７はそれぞれ正負
電源端である。
差動構成の電界効果トランジスタ（以下ＦＥＴという）
、６，６はＦＥＴ３，４にカスコード接続されたトラン
ジスタ、了、８はそのコレクタ抵抗、９，１０はＦＥＴ
５．４のソースと力ｘ＝ｆｆ−１’）ランジスタ５，６
のベースにプートストラップをかけるための抵抗、１１
はＦＥＴ３゜４のソース電流を決めるためのバイアス抵
抗、１２は後段増幅器、１３．１４は帰還回路を構成す
る受動素子、１６は出力端、１６．１７はそれぞれ正負
電源端である。
第１図の増幅器は、抵抗９．．１０（Ｃよってバイアス
およびＦＥＴ３．４のドレイン−ソース電圧が常に一定
になるため、低歪率の増幅器を実現することができる。
およびＦＥＴ３．４のドレイン−ソース電圧が常に一定
になるため、低歪率の増幅器を実現することができる。
しかしながら、第１図の増幅器では、正負電源端１６．
１７から混入する電源雑音や、抵抗９゜１０．１１で発
生する抵抗体のもつ熱雑音源が、出力端１５に発生する
という問題がある。もちろんこの雑音は、初段差動ＦＥ
Ｔ３，４に対して常にコモンモードで発生するから、コ
モンモードリジェクションの良い初段差動増幅器ではほ
とんど発生しない。しかし実際にはコモンモードリジェ
クションを良くすることはむつかしく、電源雑音や熱雑
音が発生することは避けにくい。
１７から混入する電源雑音や、抵抗９゜１０．１１で発
生する抵抗体のもつ熱雑音源が、出力端１５に発生する
という問題がある。もちろんこの雑音は、初段差動ＦＥ
Ｔ３，４に対して常にコモンモードで発生するから、コ
モンモードリジェクションの良い初段差動増幅器ではほ
とんど発生しない。しかし実際にはコモンモードリジェ
クションを良くすることはむつかしく、電源雑音や熱雑
音が発生することは避けにくい。
本発明はこのような従来の問題に鑑み、初段を対になっ
たコンプリメンタリトランジスタで構成し、しかもそれ
ぞれにカスコードトランジスタを接続し、ブートストラ
ップをかけて低歪率の増幅器を実現するとともに、電源
雑音や抵抗の熱雑音をも出力端に発生しに〈〈シた増幅
器を提供するものである。
たコンプリメンタリトランジスタで構成し、しかもそれ
ぞれにカスコードトランジスタを接続し、ブートストラ
ップをかけて低歪率の増幅器を実現するとともに、電源
雑音や抵抗の熱雑音をも出力端に発生しに〈〈シた増幅
器を提供するものである。
すなわち、本発明は初段をコンプリメンタリトランジス
タで構成し、しかもそれぞれの出力にカスコードトラン
ジスタを接続し、さらに初段のトランジスタとカスコー
ドトランジスタの間にプートストラップ回路を形成する
抵抗とコンデンサ結合することにより、低歪率を実現す
ると同時に、電源の低域雑音や抵抗の電流雑音や熱雑音
を効果的に低減するようにしたものである。
タで構成し、しかもそれぞれの出力にカスコードトラン
ジスタを接続し、さらに初段のトランジスタとカスコー
ドトランジスタの間にプートストラップ回路を形成する
抵抗とコンデンサ結合することにより、低歪率を実現す
ると同時に、電源の低域雑音や抵抗の電流雑音や熱雑音
を効果的に低減するようにしたものである。
第２図に本発明の一実施例を示す。第２図において、１
８は入力端、１９は入力抵抗、２０゜２１は初段を構成
する一対のコンプリメンタリ（すなわちＮチャンネル、
Ｐチャンネルの）ＦＥＴ、２２．２３は一対のカスコー
ドトランジスタ、２４．２５はカスコードトランジスタ
２２ 、２３の出力抵抗、２６，２７．２８．２９はカ
スコードトランジスタ２２．２３のベースにバイアスを
与える抵抗、３ｏは後段増幅器、３１．３２は帰還回路
を構成する受動素子、３３は出力端、３４゜３６はそれ
ぞれ正負電源端である。そして３６は初段ＦＥＴ２０，
２１のソースとカスコード）７ンジスタ２２，２３のベ
ースバイアス回路を交流的に結合するだめのコンデンサ
である。
８は入力端、１９は入力抵抗、２０゜２１は初段を構成
する一対のコンプリメンタリ（すなわちＮチャンネル、
Ｐチャンネルの）ＦＥＴ、２２．２３は一対のカスコー
ドトランジスタ、２４．２５はカスコードトランジスタ
２２ 、２３の出力抵抗、２６，２７．２８．２９はカ
スコードトランジスタ２２．２３のベースにバイアスを
与える抵抗、３ｏは後段増幅器、３１．３２は帰還回路
を構成する受動素子、３３は出力端、３４゜３６はそれ
ぞれ正負電源端である。そして３６は初段ＦＥＴ２０，
２１のソースとカスコード）７ンジスタ２２，２３のベ
ースバイアス回路を交流的に結合するだめのコンデンサ
である。
このコンデンサ３６は、入力端１からの信号に対して、
コンデンサ３６のインピーダンスをベースバイアス抵抗
２６，２７，２８，２９の抵抗値で分圧された分だけブ
ートストラップ針がけるものである。すなわちこのコン
デンサ３６により一種のバイパスフィルタが形成される
から、高域になるほどブートストラップ量が増加する。
コンデンサ３６のインピーダンスをベースバイアス抵抗
２６，２７，２８，２９の抵抗値で分圧された分だけブ
ートストラップ針がけるものである。すなわちこのコン
デンサ３６により一種のバイパスフィルタが形成される
から、高域になるほどブートストラップ量が増加する。
一方電源雑音やベースバイアス抵抗２６ 、２７ 、２
８ 。
８ 。
２９の熱雑音による雑音電流はコンデンサ３６のインピ
ーダンスとＦＥＴ２０．２１のソースを見込んだインピ
ーダンスの比でＦＥＴ２０，２１のソースに注入される
。そ＾故、この雑音成分は上記バイパスフィルタを通っ
て出力端３３に現われることになる。そして一般に電源
雑音、熱雑音等の外部雑音は、低域成分のスペクトルが
大きいため、上記バイパスフィルタを通る際に上記コン
デンサ３６の働きによってこれらの外部雑音が効果的に
低減されることになる。
ーダンスとＦＥＴ２０．２１のソースを見込んだインピ
ーダンスの比でＦＥＴ２０，２１のソースに注入される
。そ＾故、この雑音成分は上記バイパスフィルタを通っ
て出力端３３に現われることになる。そして一般に電源
雑音、熱雑音等の外部雑音は、低域成分のスペクトルが
大きいため、上記バイパスフィルタを通る際に上記コン
デンサ３６の働きによってこれらの外部雑音が効果的に
低減されることになる。
第３図に本発明の第２の実施例を示す。第３図において
、１８〜３６は第２図の同一番号に対応する。３７は、
コンデンサ３６とともに初段コンプリメンタリＦＥＴ２
０，２１のソースとカスコードトランジスタ２２．２３
のベースを交流的に接続するコンデンサである。すなわ
ち、本実施例はコンデンサを２個用いて交流的にブート
ストラップをかけるようにしたものである。
、１８〜３６は第２図の同一番号に対応する。３７は、
コンデンサ３６とともに初段コンプリメンタリＦＥＴ２
０，２１のソースとカスコードトランジスタ２２．２３
のベースを交流的に接続するコンデンサである。すなわ
ち、本実施例はコンデンサを２個用いて交流的にブート
ストラップをかけるようにしたものである。
第４図に本発明の第３の実施例を示す。第４図において
、１８〜３６までは第２図の同一番号に対応する。３８
．３９は帰還電圧を初段コンプリメンタ１ＪＦＥＴ２０
．２１のソースに交流的に結合するコンデンサである。
、１８〜３６までは第２図の同一番号に対応する。３８
．３９は帰還電圧を初段コンプリメンタ１ＪＦＥＴ２０
．２１のソースに交流的に結合するコンデンサである。
４０．４１は初段コンプリメンタリＦＥＴ２０，２１の
リーン電流状めるバイアス抵抗である。第４図からも明
らかなように、本発明は初段コンプリメンタリＦＥＴ２
０゜２１のソースが交流的に結合されている場合も有効
である。
リーン電流状めるバイアス抵抗である。第４図からも明
らかなように、本発明は初段コンプリメンタリＦＥＴ２
０゜２１のソースが交流的に結合されている場合も有効
である。
なお、上記実施例では、いずれも初段コンプリメンタリ
トランジスタとしてＦＥＴを用いたが、バイポーラトラ
ンジスタであってもよい。
トランジスタとしてＦＥＴを用いたが、バイポーラトラ
ンジスタであってもよい。
以上のように、本発明によれば、初段を構成する第１の
コンプリメンタリトランジスタと、上記第１のコンプリ
メンタリトランジスタにカスコード接続された第２のコ
ンプリメンタリトランジスタのベースとの間に、基本的
に１個のコンデンサを接続するだけで、低歪率を実現し
つつ、電源雑音、熱雑音等の外部雑音を効果的に低減す
ることができる。
コンプリメンタリトランジスタと、上記第１のコンプリ
メンタリトランジスタにカスコード接続された第２のコ
ンプリメンタリトランジスタのベースとの間に、基本的
に１個のコンデンサを接続するだけで、低歪率を実現し
つつ、電源雑音、熱雑音等の外部雑音を効果的に低減す
ることができる。
第１図は従来の増幅器の回路図、第２図、第３図、第４
図は本発明の第１．第２．第３の実施例の回路図である
。 １８・・・・・・入力端、２０．２１・・・・・・初段
コンプリメンタリＦＥＴ、２２．２３・・・・・・カス
コードトランジスタ、２６〜２９・・・・・・ベースバ
イアス抵抗、３０・・・・・・後段増幅器、３１，３２
・・・・・・帰還回路、３３・・・・・・出力端、３４
．３５・・・・・・正負電源端、３６．３７・・・・・
コンデンサ。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第１
図 ６ ／ 第２図 ４ ／ 第３図
図は本発明の第１．第２．第３の実施例の回路図である
。 １８・・・・・・入力端、２０．２１・・・・・・初段
コンプリメンタリＦＥＴ、２２．２３・・・・・・カス
コードトランジスタ、２６〜２９・・・・・・ベースバ
イアス抵抗、３０・・・・・・後段増幅器、３１，３２
・・・・・・帰還回路、３３・・・・・・出力端、３４
．３５・・・・・・正負電源端、３６．３７・・・・・
コンデンサ。 代理人の氏名 弁理士 中 尾 敏 男 ほか１名第１
図 ６ ／ 第２図 ４ ／ 第３図
Claims (1)
- 対になった第１のコンプリメンタリトランジスタで構成
される初段と、上記第１のコンプリメンタリトランジス
タのそれぞれの出力端にエミッタが接続された対になっ
たベース接地型の第２のコンプリメンタリトランジスタ
と、上記第２のコンプリメンタリトランジスタの出力を
互いに合成して出力する後段゛増幅器と、上記後段増幅
器の出力を上記第１のコンプリメンタリトランジスタに
帰還する帰還回路と、上記第１のコンブ１ノメンタリト
ランジスタの帰還点と上記第２のコンプリメンタリトラ
ンジスタのベースとの間に接続されたコンデンサとを備
えた増幅器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57085833A JPS58201409A (ja) | 1982-05-20 | 1982-05-20 | 増幅器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57085833A JPS58201409A (ja) | 1982-05-20 | 1982-05-20 | 増幅器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58201409A true JPS58201409A (ja) | 1983-11-24 |
Family
ID=13869849
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57085833A Pending JPS58201409A (ja) | 1982-05-20 | 1982-05-20 | 増幅器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58201409A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4634996A (en) * | 1984-02-17 | 1987-01-06 | Zdzislaw Gulczynski | Operational amplifier |
-
1982
- 1982-05-20 JP JP57085833A patent/JPS58201409A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4634996A (en) * | 1984-02-17 | 1987-01-06 | Zdzislaw Gulczynski | Operational amplifier |
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