JPS5829010A - 自由にプログラム可能な制御体におけるプログラム制御方法及び装置 - Google Patents
自由にプログラム可能な制御体におけるプログラム制御方法及び装置Info
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- JPS5829010A JPS5829010A JP57135281A JP13528182A JPS5829010A JP S5829010 A JPS5829010 A JP S5829010A JP 57135281 A JP57135281 A JP 57135281A JP 13528182 A JP13528182 A JP 13528182A JP S5829010 A JPS5829010 A JP S5829010A
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- Japan
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- computer
- bit
- memory
- processing
- program
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-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Program-control systems
- G05B19/02—Program-control systems electric
- G05B19/04—Program control other than numerical control, i.e. in sequence controllers or logic controllers
- G05B19/05—Programmable logic controllers, e.g. simulating logic interconnections of signals according to ladder diagrams or function charts
- G05B19/052—Linking several PLC's
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B2219/00—Program-control systems
- G05B2219/10—Plc systems
- G05B2219/15—Plc structure of the system
- G05B2219/15127—Bit and word, byte oriented instructions, boolean and arithmetic operations
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- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Programmable Controllers (AREA)
- Numerical Control (AREA)
- Executing Machine-Instructions (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、データメモリ及びプログラムメモリを有する
コンピュータ並びに単一ビットメモリを有する単一ビッ
ト処理用のプログラム制御可能な論理ネットワークが設
けられている自由プログラム可能な制御体におけるプロ
グラム制御方法及びその方法の実施装置に関するもので
ある。
コンピュータ並びに単一ビットメモリを有する単一ビッ
ト処理用のプログラム制御可能な論理ネットワークが設
けられている自由プログラム可能な制御体におけるプロ
グラム制御方法及びその方法の実施装置に関するもので
ある。
ディジタルコンピュータを有する自由にプログラム可能
な制御部（ワードプロセッサによる制御）並びにディジ
タルコンピュータを有しない自由にプログラム可能な制
御部（ビットプロセッサによる制御）は、工作機械の通
常のリレー制御用の代りとして周知である。この応用領
域で紘、特に単一とットデータが入力、出力、メモリさ
れそして論理的な動作により実行される。ビット処理に
よる制御の処理速度は１論理動作ごとに１μ８のオーダ
にある。自由プログラム可能な制御部に詔けるディジタ
ルコンピュータは、主に計数の処理及び算術機能の実行
を行う。単一 ビットから論理機能を形成するには、し
かしながら論理動作当り１０μｓ〜２０μＢのオークの
ゆっくりした処理速度であるために、利用が限定される
。
な制御部（ワードプロセッサによる制御）並びにディジ
タルコンピュータを有しない自由にプログラム可能な制
御部（ビットプロセッサによる制御）は、工作機械の通
常のリレー制御用の代りとして周知である。この応用領
域で紘、特に単一とットデータが入力、出力、メモリさ
れそして論理的な動作により実行される。ビット処理に
よる制御の処理速度は１論理動作ごとに１μ８のオーダ
にある。自由プログラム可能な制御部に詔けるディジタ
ルコンピュータは、主に計数の処理及び算術機能の実行
を行う。単一 ビットから論理機能を形成するには、し
かしながら論理動作当り１０μｓ〜２０μＢのオークの
ゆっくりした処理速度であるために、利用が限定される
。
このゆっくりした処理速度は、単一ビット処理用の命令
の欠点に起因している。ディジタルコンピュータは単一
ビット論理動作のために一連の命令を実行せねばならな
い。
の欠点に起因している。ディジタルコンピュータは単一
ビット論理動作のために一連の命令を実行せねばならな
い。
本発明は、冒頭のプログラム制御を行う方法において単
一ビット論理動作用の自由プログラムメモリな制御及び
数値的な位置制御の利点を一体化することを課題にする
。
一ビット論理動作用の自由プログラムメモリな制御及び
数値的な位置制御の利点を一体化することを課題にする
。
本発明により得られる利点は、算術及び論理機能の形成
が高い処理速度で行われそして両制御方式の要素が共通
に利用され、僅かなコストで高効率のプログラム制御が
生れるように成った工作機械の制御を可能にすることに
特にある。
が高い処理速度で行われそして両制御方式の要素が共通
に利用され、僅かなコストで高効率のプログラム制御が
生れるように成った工作機械の制御を可能にすることに
特にある。
以下に本発明を添付図を基に説明する。
図において１は簡単のために移動方向Ｘだけを示すｓ軸
のフライス盤を示す。ベッド２には、工具５及びスピン
ドルボックス６を有するスピンドルヘッドストック４を
担持するサドル３がＸ一方向にスライド可能に案内され
ている。工Ａ５の駆動は、スピンドルボックス６におけ
る―示しない切換ギヤを介してスピンドルモータ７によ
り行われる。ベッド２には、処理さるべき工作物９を受
容するためのテーブル８がＸ一方向と交差方向にスライ
ド可能に案内されている。Ｘ一方向の工具５の位置付け
のために、サドル３はこの方向に駆動ユニット１０によ
り変位可能である。
のフライス盤を示す。ベッド２には、工具５及びスピン
ドルボックス６を有するスピンドルヘッドストック４を
担持するサドル３がＸ一方向にスライド可能に案内され
ている。工Ａ５の駆動は、スピンドルボックス６におけ
る―示しない切換ギヤを介してスピンドルモータ７によ
り行われる。ベッド２には、処理さるべき工作物９を受
容するためのテーブル８がＸ一方向と交差方向にスライ
ド可能に案内されている。Ｘ一方向の工具５の位置付け
のために、サドル３はこの方向に駆動ユニット１０によ
り変位可能である。
サドル６の変位に際して工具５の切断縁の位置の実際値
を検出するために、ベッド２にはサドル３に固定された
走査ユニット１２により走査されるスグールを有する位
置綱定装置１１が固定されている。即ち、検出された実
際値は導！１１５を介して評価／表示ユニット１４へそ
してさらに目標値／実際値比較のためにコンピュータ１
７０入力端１７ａに導びかれ、これはム沖コンバータ１
５を介して駆動ユニット１０用の駆動制御器１６を制御
する。工具５の位置用のプログラムされた目標値はデー
タメモリ１８から墳出される。Ｘ一方向における工具５
の位置付けのために、Ｖム変換器１５のアナログ出力端
にはプログラムされた位置−目標値及び工具５のそれぞ
れの位置実際値間の差に比例する電圧が出力される。
を検出するために、ベッド２にはサドル３に固定された
走査ユニット１２により走査されるスグールを有する位
置綱定装置１１が固定されている。即ち、検出された実
際値は導！１１５を介して評価／表示ユニット１４へそ
してさらに目標値／実際値比較のためにコンピュータ１
７０入力端１７ａに導びかれ、これはム沖コンバータ１
５を介して駆動ユニット１０用の駆動制御器１６を制御
する。工具５の位置用のプログラムされた目標値はデー
タメモリ１８から墳出される。Ｘ一方向における工具５
の位置付けのために、Ｖム変換器１５のアナログ出力端
にはプログラムされた位置−目標値及び工具５のそれぞ
れの位置実際値間の差に比例する電圧が出力される。
ディジタルコンピュータ１７は、さらに本発明によりス
イッチング手段１９を介してプログラムメモリ２０及び
単一ビット処理用のプログラム制御可能な論理ネットワ
ーク２１へ接続し、これは論理的なネットワーク２１に
詔いて論理的な機能を形成するために単一ビットデータ
を受容する単一ビットメモリ２２＆ｃ結合している。
イッチング手段１９を介してプログラムメモリ２０及び
単一ビット処理用のプログラム制御可能な論理ネットワ
ーク２１へ接続し、これは論理的なネットワーク２１に
詔いて論理的な機能を形成するために単一ビットデータ
を受容する単一ビットメモリ２２＆ｃ結合している。
コンピュータ１７のプログラムメモリ２０では、算術機
能又は動作を形成するためのコンピュータ１７用の命令
の外に、論理ネットワーク２１−こおける単一ビット論
理動作用の特別の命令か用意されている。単一ビット処
理中、単一ビット動作用の命令はコンピュータ１７によ
りプログラムメモリ２０から単一ビット処理用の論理的
なネットワーク２１へ転送されそこで実行される。コン
ピュータ１７の命令続出し時間は単一ビット処理の命令
用にも保持され、その際単一ビット動作用の命令はスイ
ッチング手段１９によりコンピュータ１７から隔離され
そしてその代りにコンピュータ１７ヘプログラムカウン
タを１プログラムステツプだけ高める結果になる命令が
導びかれる。単一ビットメモリ２２は、単一ビット処理
の行われている間は論理ネットワーク２１にそして単一
ビット処理の行われていない間はディジタルコンピュー
タ１７に接続している。
能又は動作を形成するためのコンピュータ１７用の命令
の外に、論理ネットワーク２１−こおける単一ビット論
理動作用の特別の命令か用意されている。単一ビット処
理中、単一ビット動作用の命令はコンピュータ１７によ
りプログラムメモリ２０から単一ビット処理用の論理的
なネットワーク２１へ転送されそこで実行される。コン
ピュータ１７の命令続出し時間は単一ビット処理の命令
用にも保持され、その際単一ビット動作用の命令はスイ
ッチング手段１９によりコンピュータ１７から隔離され
そしてその代りにコンピュータ１７ヘプログラムカウン
タを１プログラムステツプだけ高める結果になる命令が
導びかれる。単一ビットメモリ２２は、単一ビット処理
の行われている間は論理ネットワーク２１にそして単一
ビット処理の行われていない間はディジタルコンピュー
タ１７に接続している。
コンピュータ動作から単一ビット処理への切換え紘、デ
ィジタルコンピュータ１７用の命令を基にディジタルコ
ンピュータ１７０嶽求により行われ、コンピュータ動作
への復帰は単一ビット処理用の命令を基に論理ネットワ
ーク２１の要求により行われる。コンピュータ動作及び
単一ビット処理間のこの切換えは、プログラムメモリ２
０の選択された命令アドレスに依存しても行われる。
ィジタルコンピュータ１７用の命令を基にディジタルコ
ンピュータ１７０嶽求により行われ、コンピュータ動作
への復帰は単一ビット処理用の命令を基に論理ネットワ
ーク２１の要求により行われる。コンピュータ動作及び
単一ビット処理間のこの切換えは、プログラムメモリ２
０の選択された命令アドレスに依存しても行われる。
単一ビット処理用の人カニニット２６及び出カニニット
２４は、特にディジタルコンピュータ１７を介して論理
ネットワーク２１に接続しでいる。出カニニット２４は
５つの出力導線で切換ギヤの種々の変換を選択するため
にスピンドルボックス６に詔ける図示しない調節要素を
制御する。それぞれの変換比はスピンドルボックス６に
おける図示しないセンサにより検出され、人力導線２６
を介して入カニニット２３へ導入される。入カニニット
２３の出力信号に比例しＣ１−環ネットワーク２１に詔
いて単一ビット処理はプログラムメモリ２０に含まれる
プログラムに対応して実行されそして切換ギヤの制御の
ために出カニニット２４へ出力される。
２４は、特にディジタルコンピュータ１７を介して論理
ネットワーク２１に接続しでいる。出カニニット２４は
５つの出力導線で切換ギヤの種々の変換を選択するため
にスピンドルボックス６に詔ける図示しない調節要素を
制御する。それぞれの変換比はスピンドルボックス６に
おける図示しないセンサにより検出され、人力導線２６
を介して入カニニット２３へ導入される。入カニニット
２３の出力信号に比例しＣ１−環ネットワーク２１に詔
いて単一ビット処理はプログラムメモリ２０に含まれる
プログラムに対応して実行されそして切換ギヤの制御の
ために出カニニット２４へ出力される。
人カニニット２３及び出カニニット２４は単一ビットメ
モリ２２０所定のメモリ領域へ作用する。人カニニット
２５及び出カニニット２４の操作は周期的にコンピュー
タ１７により行われる。入カニニット２３及び出カニニ
ット２４は論理ネットワーク２１に直！！接続すること
もできる。データメモリ１８における数値データ、プロ
グラムメモリ２０におけるプログラム命令、単一ビット
メモリ２２における単一ビットデータの入力は、ディジ
タルコンピュータ１７番ζ結合している入力装置２７を
介して行われる。切換ギヤの説明した制御の外に、スピ
ンドル回転方向、冷却媒体操作等のような別の機械機能
も対応のプログラムされた論理動作によって生れる。
モリ２２０所定のメモリ領域へ作用する。人カニニット
２５及び出カニニット２４の操作は周期的にコンピュー
タ１７により行われる。入カニニット２３及び出カニニ
ット２４は論理ネットワーク２１に直！！接続すること
もできる。データメモリ１８における数値データ、プロ
グラムメモリ２０におけるプログラム命令、単一ビット
メモリ２２における単一ビットデータの入力は、ディジ
タルコンピュータ１７番ζ結合している入力装置２７を
介して行われる。切換ギヤの説明した制御の外に、スピ
ンドル回転方向、冷却媒体操作等のような別の機械機能
も対応のプログラムされた論理動作によって生れる。
図は本発明による方法を実施する回路装置のブロック図
である。 １・・・フライス盤 ３・０．サドル ４・・・スピンドルストック ５・・・工具 １０・・・駆動ユニット １１・・・位を測定装置 １２・・・走査ユニット １７・・・コンピュータ １８・・・データメモリ １９・・・スイッチング手段 ２０・・・プログラムメモリ ２１・・・論理ネットワーク ２２・・・単一ビットメモリ ２３・・・入カニニット ２４・・・出力ユニット
である。 １・・・フライス盤 ３・０．サドル ４・・・スピンドルストック ５・・・工具 １０・・・駆動ユニット １１・・・位を測定装置 １２・・・走査ユニット １７・・・コンピュータ １８・・・データメモリ １９・・・スイッチング手段 ２０・・・プログラムメモリ ２１・・・論理ネットワーク ２２・・・単一ビットメモリ ２３・・・入カニニット ２４・・・出力ユニット
Claims (6)
- （１） データメモリ及びプログラムメモリを有する
コンピュータ並びに単一ビットメモリを有する単一ビッ
ト処理用のプログラム制御可能な論理ネットワークが設
けられている自由プログラム可能な制御体におけるプロ
グラム制御方法において、 コンピュータ（１１）用の命令の外に、コンピュータ（
１７）のプログラムメモリ（２０ＨＣ単一ビツト処鳳用
の特別の命令が用意され、単一ビット処塩中に単一ビッ
ト論理動作用の命令がコンピュータ（１０によりプログ
ラムメモリ（２のから単一ビット処理用の論理ネットワ
ーク（２１）へ転送されそしてそこで実行されることを
特徴とする方法。 - （２）単一ビットＩＩＩ＆通用の命令がスイッチング手
段（１９）Ｋよりコンピュータ（１わから隔離され、代
りにコンピュータ（１７）ｋプログラムカウンタを高め
るのに適当な命令が導入され、コンピュータ（１乃の命
令続出し時間が単−処理用□にも保持されたままに留ま
る、特許饋求Ｏ範８第１項記載の方法。 - （３） コンピュータ（１７）用の命令を１にコンピ
ュータ（１７）０動作によりコンピュータ動作から単一
ビット処理への切換えそして単−処ｍ動作用の命令を基
に論理ネットワーク（２１）の動作によりコンピュータ
動作への復帰が行われる、特許請求の範囲第２項記載の
方法。 - （４）単一ビット処理及びコンピュータ動作間Ｏ切換え
が、プログラムメモリ（２０）の選択された命令アドレ
スに依存して行われる、特許請求の範１１ＪＩＩＥ２項
記載の方法。 - （５）入カニニット（２３）及び出力ユニツ）（２４）
が単一ビットメモリ（２２）の所定のメモリ領域におけ
る単一ビット処理のために有効になり、前記両ユニット
（２５，２４）の操作が周期的にフンビュータ（１１）
により行われる、特許請求の範囲第１項記載の方法。 - （６）データメモリ及びプログラムメモリを有する演算
器並びに単一ビットメモリを有する単一ビット処理用の
プログラム制御可能な論理ネットワークが設けられてい
る自由プログラム可能な制御体に招けるプログラム制御
方法であって、コンピュータ用の命令の外に、コンピュ
ータのプログラムメモリでの単一ビット処理用の特別の
命令が用意され、単一ビット処理中に単一ビット結合用
の命令がコンピュータによりプログラムメモリから単一
ビット処理用の論理ネットワークへ転送されそし−Ｃそ
こで実行されるプログラム制御方法を実施するための回
路装置において、単一ビット処理用の単一ビットメモ！
Ｊ（２２）が、単一ビット処理が行われている間は単一
ビット処理用の論理ネットワーク（２１）へそして単一
ビット処理の行われていない間はコンピュータ（１７）
へ接続していることを特徴とする回路装置。
Applications Claiming Priority (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| DE31307469 | 1981-08-04 | ||
| DE3130746A DE3130746C2 (de) | 1981-08-04 | 1981-08-04 | Verfahren zur Programmsteuerung bei einer freiprogrammierbaren Steuerung und Anordnung zur Durchführung des Verfahrens |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5829010A true JPS5829010A (ja) | 1983-02-21 |
Family
ID=6138508
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57135281A Pending JPS5829010A (ja) | 1981-08-04 | 1982-08-04 | 自由にプログラム可能な制御体におけるプログラム制御方法及び装置 |
Country Status (5)
| Country | Link |
|---|---|
| US (1) | US4517657A (ja) |
| EP (1) | EP0071703B1 (ja) |
| JP (1) | JPS5829010A (ja) |
| AT (1) | ATE36763T1 (ja) |
| DE (1) | DE3130746C2 (ja) |
Cited By (5)
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| JPS59214906A (ja) * | 1983-05-20 | 1984-12-04 | Meidensha Electric Mfg Co Ltd | 計装制御用ブログラマブル．コントロ−ラ |
| JPS6075904A (ja) * | 1983-09-30 | 1985-04-30 | Shin Meiwa Ind Co Ltd | 多関節ロボットの制御のための座標変換方法，演算方法，座標変換装置および演算装置 |
| JPS6093513A (ja) * | 1983-10-27 | 1985-05-25 | Fanuc Ltd | 数値制御装置におけるアプリケ−シヨンシステムのデ−タ入出力器 |
| JPS62152007A (ja) * | 1985-12-26 | 1987-07-07 | Fanuc Ltd | 高速加工用数値制御装置 |
| JPS62154114A (ja) * | 1985-12-27 | 1987-07-09 | Mitsubishi Electric Corp | 数値制御装置の命令解読処理方法 |
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| DE3302929A1 (de) * | 1983-01-28 | 1984-08-02 | Siemens AG, 1000 Berlin und 8000 München | Speicherprogrammierbare steuerung |
| DE3323824A1 (de) * | 1983-07-01 | 1985-01-03 | Siemens AG, 1000 Berlin und 8000 München | Speicherprogrammierbare steuerung |
| DD266719A3 (de) * | 1983-08-02 | 1989-04-12 | Numerik Karl Marx Veb | Programmsteueranordnung zur steuerung von maschinen und prozessen |
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| US4298908A (en) * | 1979-06-08 | 1981-11-03 | Gte Products Corporation | Flashlamp disk containing internal reflectors |
-
1981
- 1981-08-04 DE DE3130746A patent/DE3130746C2/de not_active Expired
-
1982
- 1982-05-14 EP EP82104227A patent/EP0071703B1/de not_active Expired
- 1982-05-14 AT AT82104227T patent/ATE36763T1/de not_active IP Right Cessation
- 1982-07-13 US US06/397,839 patent/US4517657A/en not_active Expired - Fee Related
- 1982-08-04 JP JP57135281A patent/JPS5829010A/ja active Pending
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Also Published As
| Publication number | Publication date |
|---|---|
| DE3130746A1 (de) | 1983-03-17 |
| US4517657A (en) | 1985-05-14 |
| EP0071703A3 (en) | 1985-06-12 |
| DE3130746C2 (de) | 1985-01-31 |
| EP0071703A2 (de) | 1983-02-16 |
| EP0071703B1 (de) | 1988-08-24 |
| ATE36763T1 (de) | 1988-09-15 |
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