JPS5849061B2 - 障害検出方式 - Google Patents
障害検出方式Info
- Publication number
- JPS5849061B2 JPS5849061B2 JP53080511A JP8051178A JPS5849061B2 JP S5849061 B2 JPS5849061 B2 JP S5849061B2 JP 53080511 A JP53080511 A JP 53080511A JP 8051178 A JP8051178 A JP 8051178A JP S5849061 B2 JPS5849061 B2 JP S5849061B2
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- JP
- Japan
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- ccp
- processor
- pcp
- mcp
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04M—TELEPHONIC COMMUNICATION
- H04M3/00—Automatic or semi-automatic exchanges
- H04M3/22—Arrangements for supervision, monitoring or testing
- H04M3/24—Arrangements for supervision, monitoring or testing with provision for checking the normal operation
- H04M3/241—Arrangements for supervision, monitoring or testing with provision for checking the normal operation for stored program controlled exchanges
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Debugging And Monitoring (AREA)
- Monitoring And Testing Of Exchanges (AREA)
- Exchange Systems With Centralized Control (AREA)
Description
【発明の詳細な説明】
本発明はシステムの管理を行なうプロセサをもつ電子交
換システムの障害検出方法に関するものである、、 昨今、データ処理の技術分野ｉこ於では、マルチプロセ
ッサ方式による処理系構成が広く実用化されている。
換システムの障害検出方法に関するものである、、 昨今、データ処理の技術分野ｉこ於では、マルチプロセ
ッサ方式による処理系構成が広く実用化されている。
このマルチプロセッサ方式の処理系は、複数のプロセッ
サを用いて複数の作業を独立的、かつ同時に処理するも
のであって、次の様な利点を有するものである。
サを用いて複数の作業を独立的、かつ同時に処理するも
のであって、次の様な利点を有するものである。
即ち、１つのプロセッサに障害が発生した場合でもシス
テム全体が完全に停止してしまうことがないフエール・
ソフト（ｆａｉｌｓｏｆｔ）性、および処理作業の増大
にあわせて系の規模の拡大が順次行えるビルディング・
ブロック（ｂｕｉｌｄｉｎｇ ｂｌｏｃｋ）性を有す
るとともに、ＬＳＩへの親和性も高いものである。
テム全体が完全に停止してしまうことがないフエール・
ソフト（ｆａｉｌｓｏｆｔ）性、および処理作業の増大
にあわせて系の規模の拡大が順次行えるビルディング・
ブロック（ｂｕｉｌｄｉｎｇ ｂｌｏｃｋ）性を有す
るとともに、ＬＳＩへの親和性も高いものである。
電話交換の技術分野に於でも、これらの利点に着目して
マルチプロセッサ方式による電子交換機の開発が始めら
れている。
マルチプロセッサ方式による電子交換機の開発が始めら
れている。
第１図はこのマルチプロセッサ方式を時分割交換装置に
適用した場合の一例を示すブロック図である。
適用した場合の一例を示すブロック図である。
同図に於て、ＳＵ１〜ＳＵｎは入トランクＩＣＴ、出ト
ランクＯＧＴ、入レジスタトランクＩＲＴ、出センター
トランクＯＳＴ等の各種トランク類、時分割ネットワー
クＮＷを含む通話路サブユニットであり、局間の中継線
あるいは加入者回線等が接続収容されている。
ランクＯＧＴ、入レジスタトランクＩＲＴ、出センター
トランクＯＳＴ等の各種トランク類、時分割ネットワー
クＮＷを含む通話路サブユニットであり、局間の中継線
あるいは加入者回線等が接続収容されている。
ＴＤＪは時分割ジャンクタであり、各通話路サブユニッ
トＳＵ一間の相互接続、あるいは各通話路サブユニット
ＳＵ一内の折返し接続を行うものである。
トＳＵ一間の相互接続、あるいは各通話路サブユニット
ＳＵ一内の折返し接続を行うものである。
また、ＰＣＰ，〜ＰＣＰｎは前記通話路サブユニットＳ
Ｕ一の各々（こ１対１対応で用意された周辺制御装置で
あり、付属するローカルメモリＬＭに格納された処理プ
ログラムを用いて、通話路ネットワークＮＷの駆動、各
トランク類のリレーの，駆動、さらにはトランクあるい
は加入者の走査を自律的Ｏこ行うものである。
Ｕ一の各々（こ１対１対応で用意された周辺制御装置で
あり、付属するローカルメモリＬＭに格納された処理プ
ログラムを用いて、通話路ネットワークＮＷの駆動、各
トランク類のリレーの，駆動、さらにはトランクあるい
は加入者の走査を自律的Ｏこ行うものである。
ＣＣＰは系全体の制御を司るために複数個用意され、そ
の各々に付属するローカルメモＩＪＬＭに格納された処
理プログラムに基いて処理を実行する中央制御装置、Ｃ
Ｍは呼対応の各種データ、受信数字情報と出トランクＯ
ＧＴのルートとの対応等を示す翻訳テーブル等が格納さ
れた複数個の共通メモリである。
の各々に付属するローカルメモＩＪＬＭに格納された処
理プログラムに基いて処理を実行する中央制御装置、Ｃ
Ｍは呼対応の各種データ、受信数字情報と出トランクＯ
ＧＴのルートとの対応等を示す翻訳テーブル等が格納さ
れた複数個の共通メモリである。
そして、前記中央制御装置ＣＣＰは夫々その一方でメモ
リバスＭＢＵＳを介して共通メモＩＪｃＭへ接続されて
おり、その他方では周辺バスＰＢＵＳを介して周辺制御
装置ＰＣＰ一に接続されている。
リバスＭＢＵＳを介して共通メモＩＪｃＭへ接続されて
おり、その他方では周辺バスＰＢＵＳを介して周辺制御
装置ＰＣＰ一に接続されている。
さらＯこ、ＩＯはタイプライタ、プリンタ等の入出力装
置テ、マン・マシーン・コミュニケーション等のために
用意されたものであり、ＤＣＨｏ，ＤＣＨ１は前記入出
力装置ＩＯと中央制御装置ＣＣＰとのインタフェースを
とるためのデータチャネル装置である。
置テ、マン・マシーン・コミュニケーション等のために
用意されたものであり、ＤＣＨｏ，ＤＣＨ１は前記入出
力装置ＩＯと中央制御装置ＣＣＰとのインタフェースを
とるためのデータチャネル装置である。
ここで、両データチャネル装置ＤＣＨｏ，ＤＣＨ１に接
続されている入出力装置ＩＯは代表的に１個づつ図示し
てあるが、通常種種の装置が複数個接続されており、ま
た、両データチャネル装置ＤＣＨｏ，ＤＣＨ，の各々は
複数個の中央制御装置ＣＣＰの夫々（こ接続されている
。
続されている入出力装置ＩＯは代表的に１個づつ図示し
てあるが、通常種種の装置が複数個接続されており、ま
た、両データチャネル装置ＤＣＨｏ，ＤＣＨ，の各々は
複数個の中央制御装置ＣＣＰの夫々（こ接続されている
。
この様に構成されたマルチプロセッサ方式の電子交換機
は次の様に動作する。
は次の様に動作する。
即ち、周辺制御装置ＰＣＰ−はトランク走査等で状態変
化が生じたことを検出すると、その情報を当該周辺制御
装置ＰＣＰ一に割当てられたキュウ（ Ｑｕｅｕｅ ）
につなぐ。
化が生じたことを検出すると、その情報を当該周辺制御
装置ＰＣＰ一に割当てられたキュウ（ Ｑｕｅｕｅ ）
につなぐ。
各中央制御装置ＣＣＰは実行中の処理が完了すると、各
周辺制御装置ＰＣＰ一に割当てられたキュウを見にゆき
そこにつながれている情報を取り出して、これに対応し
た所定の処理の実行を開始する。
周辺制御装置ＰＣＰ一に割当てられたキュウを見にゆき
そこにつながれている情報を取り出して、これに対応し
た所定の処理の実行を開始する。
処理が完了すると、当該中央制御装置ＣＣＰはその処理
の結果得られた呼対応の情報を共通メモＩＪｃＭ中の所
定のアドレスに格納しておく。
の結果得られた呼対応の情報を共通メモＩＪｃＭ中の所
定のアドレスに格納しておく。
次にその呼について状態変化が起った場合、該当の周辺
制御装置ＰＣＰ−がキュウにつないだその情報をとって
来た中央制御装置ＣＣＰは、共通メモＩＪｃＭ内のその
呼対応の情報を使って処理を実行し、その結果をあらた
めて共通メモＩＪｃＭ内｛こ格納する。
制御装置ＰＣＰ−がキュウにつないだその情報をとって
来た中央制御装置ＣＣＰは、共通メモＩＪｃＭ内のその
呼対応の情報を使って処理を実行し、その結果をあらた
めて共通メモＩＪｃＭ内｛こ格納する。
各処理の実行段階で中央制御装置ＣＣＰは必要に応じて
周辺制御装置ＰＣＰ−へ情報を転送して所望の制御処理
を行わせる。
周辺制御装置ＰＣＰ−へ情報を転送して所望の制御処理
を行わせる。
以下順次この様な処理を繰返すことで交換処理動作が進
行する。
行する。
以下具体例について説明する。例えば、通話路サブユニ
ットＳ Ｕ，の入トランクＩＣＴが前位局より起動され
たとする。
ットＳ Ｕ，の入トランクＩＣＴが前位局より起動され
たとする。
周辺制御装置ＰＣＰ，はトランク走査によって入トラン
クＩＣＴが起動されたことを検知すると、その情報をト
ランク番号情報と共ｋこ割当てられたキュウにつなぐ。
クＩＣＴが起動されたことを検知すると、その情報をト
ランク番号情報と共ｋこ割当てられたキュウにつなぐ。
実行中の処理が完了した中央制御装置ＣＣＰが周辺制御
装置ＰＣＰ，のキュウからその情報を得ると空入レジス
タトランクＩＲＴの選択を行い、この入レジスタトラン
クＩＲＴと前記入トランクＩＣＴとの間のパスハンティ
ングを行う。
装置ＰＣＰ，のキュウからその情報を得ると空入レジス
タトランクＩＲＴの選択を行い、この入レジスタトラン
クＩＲＴと前記入トランクＩＣＴとの間のパスハンティ
ングを行う。
この一連の処理結果によって共通メモ’ＪＣＭ内のこ（
７Ｊ’ｆ’に対応するアドレスの内容を書替えるととも
に、パス情報を周辺制御装置ＰＣＰ，へ転送する。
７Ｊ’ｆ’に対応するアドレスの内容を書替えるととも
に、パス情報を周辺制御装置ＰＣＰ，へ転送する。
周辺制御装置ＰＣＰ，はこのパス情報に基いて時分割ネ
ットワークＮＷ上に通話路を設定し前記入トランクＩＣ
Ｔと入レジスタトランクＩＲＴとの接続を行う。
ットワークＮＷ上に通話路を設定し前記入トランクＩＣ
Ｔと入レジスタトランクＩＲＴとの接続を行う。
以下順次この様な手順で処理が進行して、前位局からの
番号情報の受信、出トランクＯＧＴ、出センタートラン
クＯＳＴの選択接続、後位局への情報の送出等が行われ
、前記入トランクＩＣＴと出トランクＯＧＴとが接続さ
れる。
番号情報の受信、出トランクＯＧＴ、出センタートラン
クＯＳＴの選択接続、後位局への情報の送出等が行われ
、前記入トランクＩＣＴと出トランクＯＧＴとが接続さ
れる。
マルチプロセサ方式の電子交換システムにおいては、シ
ステムの管理すなわちシステムの障害の管理、装置のオ
ンライン化の管理、保守運用作業マンマシンインタフェ
ース制御（Ｉ／Ｏ制御を含む）などを特定のプロセサに
行なわせることが多い。
ステムの管理すなわちシステムの障害の管理、装置のオ
ンライン化の管理、保守運用作業マンマシンインタフェ
ース制御（Ｉ／Ｏ制御を含む）などを特定のプロセサに
行なわせることが多い。
この様な処理を行なうプロセサをシステム管理プロセサ
（ ＭＣ Ｐ ）と呼ぶ。
（ ＭＣ Ｐ ）と呼ぶ。
このＭＣＰは金物構成上は他ＣＣＰと異なることはなく
、外部の制御回路などからＣＣＰ内に設けられたＭＣＰ
表示をたてるなどにより機能上、上記のような機能をも
つように各ＣＣＰのＬＭ上のプログラムで処理上区別さ
れたものであることが多い。
、外部の制御回路などからＣＣＰ内に設けられたＭＣＰ
表示をたてるなどにより機能上、上記のような機能をも
つように各ＣＣＰのＬＭ上のプログラムで処理上区別さ
れたものであることが多い。
すなわちＣＣＰ内のＭＣＰ表示をたてられたＣＣＰがＭ
ＣＰとなり、ＣＣＰ内のＭＣＰ表示の消されているＣＣ
Ｐは一般のＣＣＰとして動作する。
ＣＰとなり、ＣＣＰ内のＭＣＰ表示の消されているＣＣ
Ｐは一般のＣＣＰとして動作する。
システム内の各装置（ＣＣＰ ，ＰＣＰ，その他）の障
害は、ＭＣＰに通知されＭＣＰからＩ／Ｏを経由して、
保守者に知らされる。
害は、ＭＣＰに通知されＭＣＰからＩ／Ｏを経由して、
保守者に知らされる。
第１図のようなマルチプロセサ方式の電子交換システム
ｔこおいては、上述のように各ＣＣＰはＰＣＰのキュウ
につながれた情報をとりだして処理する仕事、必要に応
じてＰＣＰに情報を転送する仕事、呼情報をＣＭ上に格
納する仕事などを分担して行なっている、いわゆる負荷
分担形式をとっている。
ｔこおいては、上述のように各ＣＣＰはＰＣＰのキュウ
につながれた情報をとりだして処理する仕事、必要に応
じてＰＣＰに情報を転送する仕事、呼情報をＣＭ上に格
納する仕事などを分担して行なっている、いわゆる負荷
分担形式をとっている。
すなわち、各ＣＣＰは、システム全体として処理すべき
負荷を分担しあって処理している。
負荷を分担しあって処理している。
このような負荷分担形式をとる場合、ある１つのＣＣＰ
が呼の処理を停止しても、システム全体としてさほど大
きな影響を受けない（フエイルソフト性）利点がある反
面、１つのＣＣＰが障害になり機能を停止しても、外部
からは全くそれが検出できないことがあるという欠点も
有する。
が呼の処理を停止しても、システム全体としてさほど大
きな影響を受けない（フエイルソフト性）利点がある反
面、１つのＣＣＰが障害になり機能を停止しても、外部
からは全くそれが検出できないことがあるという欠点も
有する。
すなわち、たとえば、あるＣＣＰがそのハードウエアに
障害を起こした場合、それを自らがＭＣＰに通知するこ
とができれば、ＭＣＰが障害になったＣＣＰをオフライ
ンにしたり、保守者に障害発生をしらせたりすることが
できるが、ハードウエアに障害が記きたことによってプ
ログラムが暴走したり、プログラムに虫があったりした
場合などでＣＣＰが機能を停止したことをＭＣＰに通知
することができないような障害の場合には、その障害発
生を検出することも保守者に通知することもできない。
障害を起こした場合、それを自らがＭＣＰに通知するこ
とができれば、ＭＣＰが障害になったＣＣＰをオフライ
ンにしたり、保守者に障害発生をしらせたりすることが
できるが、ハードウエアに障害が記きたことによってプ
ログラムが暴走したり、プログラムに虫があったりした
場合などでＣＣＰが機能を停止したことをＭＣＰに通知
することができないような障害の場合には、その障害発
生を検出することも保守者に通知することもできない。
さらに、その障害の発生したＣＣＰが暴走などによって
ＣＭなど他ＣＣＰと共通に使われているメモリを破壊す
ることも考えられ、１つのＣＣＰで発生した異常がシス
テム全体に広がる場合もありうる。
ＣＭなど他ＣＣＰと共通に使われているメモリを破壊す
ることも考えられ、１つのＣＣＰで発生した異常がシス
テム全体に広がる場合もありうる。
従来でも電子交換システムｌこおいて中央制御装置の障
害により、プログラムが暴走したり、プログラムの虫に
より、中央制御装置がその機能を停止したりした場合で
、それを中央制御装置自身で検出できない場合には、外
部監視装置を設けて、それを通話路端子に接続し、そこ
から定期的に発呼を行ない、ダイヤルトーンが返ってく
ることを確認することで、中央制御装置の正常性を確認
する手段をとっていた。
害により、プログラムが暴走したり、プログラムの虫に
より、中央制御装置がその機能を停止したりした場合で
、それを中央制御装置自身で検出できない場合には、外
部監視装置を設けて、それを通話路端子に接続し、そこ
から定期的に発呼を行ない、ダイヤルトーンが返ってく
ることを確認することで、中央制御装置の正常性を確認
する手段をとっていた。
しかし、負荷分担形式のマルチプロセサ方式の電子交換
システムでは、プロセサ（ＣＣＰ）が複数個あるため、
１つのＣＣＰが障害を起こしても、他のＣＣＰが正常に
動作していれば上記の様な外部監視装置では、そのＣＣ
Ｐの異常を検出できない。
システムでは、プロセサ（ＣＣＰ）が複数個あるため、
１つのＣＣＰが障害を起こしても、他のＣＣＰが正常に
動作していれば上記の様な外部監視装置では、そのＣＣ
Ｐの異常を検出できない。
本発明はこのような欠点を除去するため、呼の処理を行
なうプロセサ間の通信手段｛こプロセサから出される情
報の頻度がある定められた頻度以下の場合、そのプロセ
サを障害とみなす手段を設け該手段がプロセサを障害と
みなしたとき、システム管理を行なうプロセサ（こそれ
を通知することを特徴とするものであり、その目的はシ
ステムの安定度や稼動率を向上させるものであり以下詳
細に説明する。
なうプロセサ間の通信手段｛こプロセサから出される情
報の頻度がある定められた頻度以下の場合、そのプロセ
サを障害とみなす手段を設け該手段がプロセサを障害と
みなしたとき、システム管理を行なうプロセサ（こそれ
を通知することを特徴とするものであり、その目的はシ
ステムの安定度や稼動率を向上させるものであり以下詳
細に説明する。
マルチプロセサ方式の電子交換システムｌこおいては呼
の処理を行なう場合、各ＣＣＰは実行中の処理が完了す
ると、ＰＣＰのキュウを見をこ行き、またＰＣＰに対し
て制御命令を出すなど、システムできまるある頻度の範
囲でＰＣＰ＆こ命令を出している。
の処理を行なう場合、各ＣＣＰは実行中の処理が完了す
ると、ＰＣＰのキュウを見をこ行き、またＰＣＰに対し
て制御命令を出すなど、システムできまるある頻度の範
囲でＰＣＰ＆こ命令を出している。
電子交換システムにかかるトラフイツクの大小によって
、この頻度は変動し、一般にトラフイツク量が太きいと
頻度も大きく、トラック量が少ないと頻度も小さいが、
全くトラフイツクがかかつていないときでもＣＣＰはＰ
ＣＰのキュウを見に行く処理を行なうので、ＣＣＰが障
害でない限り、必ず一定の頻度以上でＣＣＰはＰＣＰに
命令を出している。
、この頻度は変動し、一般にトラフイツク量が太きいと
頻度も大きく、トラック量が少ないと頻度も小さいが、
全くトラフイツクがかかつていないときでもＣＣＰはＰ
ＣＰのキュウを見に行く処理を行なうので、ＣＣＰが障
害でない限り、必ず一定の頻度以上でＣＣＰはＰＣＰに
命令を出している。
本発明はこの点に注目してなされたものである。
第２図は本発明による障害ＣＣＰ検出方法の一例を示す
図である。
図である。
図においてＦＤＣはＣＣＰ障害検出回路であり、ＭＣＰ
はシステム管理を行なうプロセサである。
はシステム管理を行なうプロセサである。
ＦＤＣはすべてのＣＣＰのＰＢＵＳへの出力部ｔこ接続
されており、ＣＣＰからＰＣＰｌこ対して命令が出され
ているか否かをチェックする。
されており、ＣＣＰからＰＣＰｌこ対して命令が出され
ているか否かをチェックする。
ＣＣＰのＰＣＰへの命令としては、すでにのべたように
、ＰＣＰのキュウにつながれた情報をとり出す命令やＰ
ＣＰで接続すべきパス情報を伝達する命令などがある。
、ＰＣＰのキュウにつながれた情報をとり出す命令やＰ
ＣＰで接続すべきパス情報を伝達する命令などがある。
ＦＤＣでは全てのＣＣＰの夫々について、ＰＣＰへの命
令がある定められた頻度より多く出されているか否かを
チェックし、定められた頻度よりもＰＣＰへの命令の出
される頻度が少ないＣＣＰを障害とみなし、ＭＣＰにそ
の旨通知する。
令がある定められた頻度より多く出されているか否かを
チェックし、定められた頻度よりもＰＣＰへの命令の出
される頻度が少ないＣＣＰを障害とみなし、ＭＣＰにそ
の旨通知する。
ＭＣＰはその通知を受けて、とのＣＣＰが障害かを判定
し、そのＣＣＰをオフラインｌこすると共ｌこ保守者ｌ
こそのＣＣＰが障害であることを知らせる。
し、そのＣＣＰをオフラインｌこすると共ｌこ保守者ｌ
こそのＣＣＰが障害であることを知らせる。
第３図はＦＤＣの機能ブロック図である。
各ＣＣＰのＰＢＵＳへの出力部からひきこまれた信号線
は夫々検出回路（ＤＥＴ１〜Ｄ Ｅ Ｔｍ ）に接続さ
れ、各ＣＣＰからＰＢＵＳに命令が出されたかどうかチ
ェックされ、ＰＢＵＳに命令が出されたことを検出した
ＤＥＴは、計数回路（ ＣＮＴ ） Ｇこ出力信号を出
す。
は夫々検出回路（ＤＥＴ１〜Ｄ Ｅ Ｔｍ ）に接続さ
れ、各ＣＣＰからＰＢＵＳに命令が出されたかどうかチ
ェックされ、ＰＢＵＳに命令が出されたことを検出した
ＤＥＴは、計数回路（ ＣＮＴ ） Ｇこ出力信号を出
す。
タイミング回路（ＴＣ）はすべてのＣＮＴＩこ一定周期
でタイミング信号を出す。
でタイミング信号を出す。
ＣＮＴはＴＣから受取ったタイミング信号の間隔の間に
ＤＥＴから一定数以上出力信号がきていれはそのＣＣＰ
は正常と判定し、一定数以上出力信号がきていないとそ
のＣＣＰは障害と判定してＭＣＰへの割込線Ｏこ信号を
出し、ＭＣＰに割込むことにより、ＣＣＰの障害をＭＣ
Ｐｉこ知らせる。
ＤＥＴから一定数以上出力信号がきていれはそのＣＣＰ
は正常と判定し、一定数以上出力信号がきていないとそ
のＣＣＰは障害と判定してＭＣＰへの割込線Ｏこ信号を
出し、ＭＣＰに割込むことにより、ＣＣＰの障害をＭＣ
Ｐｉこ知らせる。
第３図では、ＭＣＰへの通信は割込み線による割込みに
より行なう場合｛こついて説明したが、割込みによる通
信方法ではなく、ＭＣＰが定期的にＦＤＣをルツクイン
する方法でもよいことはもちろんである。
より行なう場合｛こついて説明したが、割込みによる通
信方法ではなく、ＭＣＰが定期的にＦＤＣをルツクイン
する方法でもよいことはもちろんである。
また、ここで示した例では、ＭＣＰがハードウエア上Ｃ
ＣＰと異なる場合について説明したが、すて（このべた
ように、ＭＣＰはハードウエア上ＣＣＰと異ならない構
成にすることも可能であり、その場合でも本発明の障害
検出方法に関する各装置の動作は、上述と同様である。
ＣＰと異なる場合について説明したが、すて（このべた
ように、ＭＣＰはハードウエア上ＣＣＰと異ならない構
成にすることも可能であり、その場合でも本発明の障害
検出方法に関する各装置の動作は、上述と同様である。
以上では第２図の構成の電子交換システムについて説明
したが、本発明はこれのみに限定されるものではなく、
一般（こ呼の処理を行なうプロセサが複数個設けられ、
システムを管理するプロセサが設けられている電子交換
システムに適弔できるものである。
したが、本発明はこれのみに限定されるものではなく、
一般（こ呼の処理を行なうプロセサが複数個設けられ、
システムを管理するプロセサが設けられている電子交換
システムに適弔できるものである。
すなわち呼の処理のための情報が呼の処理を行なうプロ
セサ間を常時伝達されているようなシステムでは、ある
プロセサから他のプロセサへ行く通信の頻度がある定め
られた値より小さい場合には、そのプロセサが障害であ
るとみなすことができる。
セサ間を常時伝達されているようなシステムでは、ある
プロセサから他のプロセサへ行く通信の頻度がある定め
られた値より小さい場合には、そのプロセサが障害であ
るとみなすことができる。
以上説明したようにＣＣＰが障害になり自分からＭＣＰ
にそれを通知できない場合でも、ＦＤＣによりＰＣＰに
ＣＣＰから命令が出されていないことを検出してＭＣＰ
に知らせることにより、ＭＣＰは障害ＣＣＰを知り、そ
のＣＣＰを系から切離すと共に保守者にその旨通知する
ことができ、障害発生を迅速に保守者に知らせて処理可
能とすることにより、電子交換システムの安定度や稼動
率を向上させることができる。
にそれを通知できない場合でも、ＦＤＣによりＰＣＰに
ＣＣＰから命令が出されていないことを検出してＭＣＰ
に知らせることにより、ＭＣＰは障害ＣＣＰを知り、そ
のＣＣＰを系から切離すと共に保守者にその旨通知する
ことができ、障害発生を迅速に保守者に知らせて処理可
能とすることにより、電子交換システムの安定度や稼動
率を向上させることができる。
本発明は電話を扱う電子交換システムだけでなく、デー
タ交換システム、テレックス交換システムにも適中可能
である。
タ交換システム、テレックス交換システムにも適中可能
である。
また時分割電子交換システムのみでなく、空間分割電子
交換システムにも適用できる。
交換システムにも適用できる。
すなわち通話路の方式に無関係に電子交換システムに応
弔できる。
弔できる。
第１図はマルチプロセサ方式の時分割電子交換システム
の本発明に関係の深い部分を示すブ冶ツク図、第２図は
本発明による電子交換システムの構成の実施例。 第３図は、本発明によるＣＣＰ障害検出回路の機能ブロ
ック図の一例である。 ＣＣＰ・・・中央匍脚装置、ＭＣＰ・・・システム管理
プロセサ、ＦＤＣ・・・ＣＣＰ障害検出回路。
の本発明に関係の深い部分を示すブ冶ツク図、第２図は
本発明による電子交換システムの構成の実施例。 第３図は、本発明によるＣＣＰ障害検出回路の機能ブロ
ック図の一例である。 ＣＣＰ・・・中央匍脚装置、ＭＣＰ・・・システム管理
プロセサ、ＦＤＣ・・・ＣＣＰ障害検出回路。
Claims (1)
- １ システム管理を行なうプロセサをもつ電子交換シス
テムにおいて、呼の処理を行なうプロセサ間に呼処理情
報を伝達する通信手段を設け、該通信手段｛こプロセサ
から出される情報の頻度がある定められた頻度以下の場
合、そのプロセサを障害とみなす検出手段と情報頻度計
数手段とを持つ障害検出手段を設け、該障害検出手段が
プロセサを障害とみなしたとき、システム管理を行なう
プロセサにそれを通知することを特徴とする障害検出方
式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53080511A JPS5849061B2 (ja) | 1978-07-04 | 1978-07-04 | 障害検出方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP53080511A JPS5849061B2 (ja) | 1978-07-04 | 1978-07-04 | 障害検出方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS558133A JPS558133A (en) | 1980-01-21 |
| JPS5849061B2 true JPS5849061B2 (ja) | 1983-11-01 |
Family
ID=13720331
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP53080511A Expired JPS5849061B2 (ja) | 1978-07-04 | 1978-07-04 | 障害検出方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5849061B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57147393A (en) * | 1981-03-07 | 1982-09-11 | Oki Electric Ind Co Ltd | Time division switchboard system |
-
1978
- 1978-07-04 JP JP53080511A patent/JPS5849061B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS558133A (en) | 1980-01-21 |
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