JPS58528U - フエ−ルセ−フ形アンド回路 - Google Patents

フエ−ルセ−フ形アンド回路

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Publication number
JPS58528U
JPS58528U JP9347781U JP9347781U JPS58528U JP S58528 U JPS58528 U JP S58528U JP 9347781 U JP9347781 U JP 9347781U JP 9347781 U JP9347781 U JP 9347781U JP S58528 U JPS58528 U JP S58528U
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JP
Japan
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circuit
fail
stage
output
safe type
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Pending
Application number
JP9347781U
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English (en)
Inventor
山本　正宣
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Nippon Signal Co Ltd
Original Assignee
Nippon Signal Co Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は従来のアンド回路の構成例を示すブロック図、
第２図はこの考案の一実施例を示すブロック図、第３図
は第２図の具体例を示す回路図である。　　　′ １、　　ＩＡ、　　２・・・・・・増幅回路、３．４・
・開塾流回路、ＲＹｌ、　ＲＹ２．　ＲＹ・・曲リレー
、ＴＲ１〜ＴＲ３・・曲トランジスタ、Ｒｃｍ、　ＲＣ
２・・開塾流器。

Claims (1)

    【実用新案登録請求の範囲】
  1. −ｎ個のアナログ信号からフェールセーフに論理積信号
    を得る回路において、前記ｎ個のアナログ信号をそれぞ
    れ与えられるｎ個の第１回路と、各第１回路の出力をそ
    れぞれ整流して直流信号に変換するｎ個の第２回路とを
    設け、ｍ（ｍは２からｎまで）段目の第２回路の出力を
    ｍ−１段目の第１回路の一部電源にするとともに、当該
    第１回路の主電源と逆極性になるように接続し、前記ｎ
    個のアナログ信号の論理積を初段の第２回路の出力で得
    るようにしたことを特徴とするフェールセーフ形アンド
    回路。
JP9347781U 1981-06-24 1981-06-24 フエ−ルセ−フ形アンド回路 Pending JPS58528U (ja)

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JPS58528U true JPS58528U (ja) 1983-01-05

Family

ID=29888443

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JP9347781U Pending JPS58528U (ja) 1981-06-24 1981-06-24 フエ−ルセ−フ形アンド回路

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Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5152254A (ja) * 1974-11-01 1976-05-08 Japan National Railway Fueeruseefuandoronrikairo

Patent Citations (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5152254A (ja) * 1974-11-01 1976-05-08 Japan National Railway Fueeruseefuandoronrikairo

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