JPS5856103A - Programmable controller - Google Patents
Programmable controllerInfo
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- JPS5856103A JPS5856103A JP56155972A JP15597281A JPS5856103A JP S5856103 A JPS5856103 A JP S5856103A JP 56155972 A JP56155972 A JP 56155972A JP 15597281 A JP15597281 A JP 15597281A JP S5856103 A JPS5856103 A JP S5856103A
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- Japan
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- program memory
- control program
- serial data
- memory
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-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B19/00—Program-control systems
- G05B19/02—Program-control systems electric
- G05B19/18—Numerical control [NC], i.e. automatically operating machines, in particular machine tools, e.g. in a manufacturing environment, so as to execute positioning, movement or co-ordinated operations by means of program data in numerical form
- G05B19/4093—Numerical control [NC], i.e. automatically operating machines, in particular machine tools, e.g. in a manufacturing environment, so as to execute positioning, movement or co-ordinated operations by means of program data in numerical form characterised by part programming, e.g. entry of geometrical information as taken from a technical drawing, combining this with machining and material information to obtain control information, named part program, for the NC machine
-
- Y—GENERAL TAGGING OF NEW TECHNOLOGICAL DEVELOPMENTS; GENERAL TAGGING OF CROSS-SECTIONAL TECHNOLOGIES SPANNING OVER SEVERAL SECTIONS OF THE IPC; TECHNICAL SUBJECTS COVERED BY FORMER USPC CROSS-REFERENCE ART COLLECTIONS [XRACs] AND DIGESTS
- Y02—TECHNOLOGIES OR APPLICATIONS FOR MITIGATION OR ADAPTATION AGAINST CLIMATE CHANGE
- Y02P—CLIMATE CHANGE MITIGATION TECHNOLOGIES IN THE PRODUCTION OR PROCESSING OF GOODS
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Abstract
Description
【発明の詳細な説明】
この発明はプログラマブル・コントローラ、特にメモリ
に記憶されたプログラムに基づいて制御動作を行なうも
のに関する。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a programmable controller, and particularly to one that performs control operations based on a program stored in a memory.
一般ニプログラマブル・コントローラ（以下ＰＣと略す
）Ｖｉ、第１図に示すように、マイクロプロセッサなど
により構成される中央処理装置（以下ＣＰｔＪと略す）
１０１ このＣＰＵｌ０にシーケ／スプログラム′５ｒ
実行させるためのマイクロプログラムを記憶するシステ
ム制御プログラムメモリ１２Ａ１シーケンスプログラム
メモリ１４、一時記憶メモリ１６、プロセス入力部１８
、プロセス出力部２０およびシステム内での信号の授受
を行なうための信号バス２２より構成される。上記ＣＰ
Ｕ Ｉ Ｑおよび上記システム制御プログラムメモリ１
２Ａは専用の論理回路で構成されること屯ある。上記プ
ロセス入力部１８およびプロセス出力部２０は入出力装
置（以下Ｉ１０と略す）と呼ばれるものである。このｌ
１０＝ｉ介して出力機器とｐｃが接続される。General programmable controller (hereinafter abbreviated as PC) Vi, as shown in Figure 1, central processing unit (hereinafter abbreviated as CPtJ) consisting of a microprocessor, etc.
101 Sequence program '5r on this CPU10
System control program memory 12A1 that stores microprograms to be executed; sequence program memory 14; temporary storage memory 16; process input unit 18
, a process output section 20, and a signal bus 22 for exchanging signals within the system. The above CP
U I Q and the above system control program memory 1
2A is often composed of a dedicated logic circuit. The process input section 18 and process output section 20 are called input/output devices (hereinafter abbreviated as I10). This l
10=The output device and the PC are connected via i.
ところで、そのＩｌｏと出力機器の間では各制御ポイン
ト毎に配線が行なわれるため、その間の総記線数は非常
に多くなる。従って、出力機器がＰＣに極〈近接して設
置される場合は良いが、出力機器がＰＣから離れて設置
される場合には、その間における配線作業が非常に面倒
となり、また配線コストも高くなるといった問題が生じ
る。このような場合、従来においては、上記Ｉ１０だけ
を別個に構成し、これを出力機器に近接して配置する一
方、このＩｌｏとＰＣ本体とを直列データ伝送線によシ
結合させることが行なわれていた。By the way, since wiring is performed for each control point between Ilo and the output device, the total number of lines between them becomes very large. Therefore, it is fine if the output device is installed very close to the PC, but if the output device is installed far away from the PC, the wiring work between them becomes very troublesome and the wiring cost increases. Problems such as this arise. In such a case, conventionally, only I10 is configured separately and placed close to the output device, while Ilo and the PC main body are coupled via a serial data transmission line. was.
このようにＰＣ本体とは別個に構成された独立のＩｌｏ
はリモートＩ１０装置と呼ばれている。この装置は、第
２図にその一般的な構成を示すように、ＣＰＵＩＱ、伝
送制御プログラムメモリ１２Ｂ。In this way, an independent Ilo configured separately from the PC body
is called a remote I10 device. As shown in FIG. 2, the general configuration of this device includes a CPU IQ and a transmission control program memory 12B.
一時記憶メモリ１６Ｂ１プロセス入力部１８、プロセス
出力部２０、直列データインターフェース用ポート（以
下８ＩＯと略す）２４および内部信号バス２２ＫｊＤ構
成される。そして、上記５ＩＯ２４が直列データ伝送線
２８を介してＰＣ本体２６に接続する。The temporary storage memory 16B1 includes a process input section 18, a process output section 20, a serial data interface port (hereinafter abbreviated as 8IO) 24, and an internal signal bus 22KjD. The 5IO 24 is connected to the PC main body 26 via a serial data transmission line 28.
以上のように従来においては、ＰＣを実際に使用する場
合に、そのＰＣと出力機器の配置状態に応じて、Ｉｌｏ
付のＰＣｌまたは別個に構成された独立のリモー）Ｉ１
０装置およびこのリモートＩ１０装置に接続するＰＣ本
体の計３種類の装置を予め取揃えておき、これら３種類
の装置をＰＣと出力機器の配置状態に応じて使い分けな
ければならなかった。しかしながら、それら３種類の装
置を過不足なきように予め取揃えておくことは、ユーザ
ー側において大きな負担であった。また、メーカー側に
おいても、３種類の装置をそれぞれ別個に供給すること
は、単一機種のものを供給する場合に比べて甚だ不利な
ことである。As described above, in the past, when a PC is actually used, the Ilo
with PCl or separately configured independent remote) I1
A total of three types of devices, the 0 device and the PC main unit connected to the remote I10 device, had to be prepared in advance, and these three types of devices had to be used depending on the arrangement of the PC and the output device. However, it is a heavy burden on the user to prepare the three types of devices in advance so as not to have too much or too little. Furthermore, on the manufacturer's side, supplying three types of devices separately is extremely disadvantageous compared to supplying a single model.
この発明は以上のような従来の課題に鑑みてなされたも
ので、その目的は、従来のように何種類かの装置を取揃
えずとも、一種類だけでもって種々の使用条件に簡単に
対応できるようにし、これによりユーザー側の負担を軽
減し、かつメーカー側においても小品種多量生産の利点
を得られるようにしたプログラマブル・コントローラ（
ＰＣ）を提供することにある。This invention was made in view of the above-mentioned conventional problems, and its purpose is to easily accommodate various usage conditions with only one type of device, instead of having to prepare several types of devices as in the past. A programmable controller (
PC).
上記目的を達成するために、この発明は、先ず、ＣＰＵ
、シーケンスプログラムメモリ、上記ＣＰＵにシーケン
スプログラムメモリに記憶されたプログラムを実行させ
るためのプログラムを記憶するシステム制御プログラム
メモリ、上記ＣＰＵと外部との間で授受されるデータを
７時記憶する一時記憶メモリ、プロセス入力部およびプ
ロセス出力部を有するとともに、他装置と直列データの
授受を行なうためのＳＩＯ′ｆ！：有する。さらに上記
シーケンスプログシムメモリおよび上記システム制御プ
ログラムメモリと、上記伝送制御プログラムメモリおよ
び上記８■０′を取付は取外し可能な構造とする。そし
て、上記シーケンスプログラムメモリおよび上記システ
ム制御プログラムメモリを取付ける一方上記伝送制御プ
ログラムメモリおよ６゛上記８ＩＯを取外すことによシ
単独ＰＣとして機能させ、″１次上記伝送制御プログラ
ムメモリおよび上記５ＩＯｔ取付ける一方上記シーケン
スプロプログラムメモリ、上記、Ａ Ｉ Ｏの全てを取
付けることによりＯ／Ｉおよび直列データインターフェ
ース付ＰＣとしても機能させられるようにしたことを特
徴とする。In order to achieve the above object, this invention first
, a sequence program memory, a system control program memory that stores a program for causing the CPU to execute the program stored in the sequence program memory, and a temporary storage memory that stores data exchanged between the CPU and the outside. , a process input section and a process output section, and SIO'f! for exchanging serial data with other devices. :Have. Further, the sequence program memory, the system control program memory, the transmission control program memory, and 8.0' are designed to be removable. Then, while installing the sequence program memory and the system control program memory, remove the transmission control program memory and the 6 and 8 IOs to function as an independent PC, and install the ``primary transmission control program memory'' and the 5 IOs. On the other hand, it is characterized in that by attaching all of the sequence program memory and the AIO, it can also function as a PC with an O/I and serial data interface.
以下、図面に基づいてこの発明の好適な実施例を示す。Hereinafter, preferred embodiments of the present invention will be shown based on the drawings.
第３図はこの発明によるＰＣの一実施例を示す。FIG. 3 shows an embodiment of a PC according to the present invention.
同図に示すＰＣは、マイクロプロセッサ等により構成さ
れるＣＰＵＩＱ、システム制御プルグラムメモリ１２Ａ
１伝送制御プログラムメモリ１２Ｂ１シーケンスプログ
ラムメーモリ１４、一時記憶メモリ１６、プロセス入力
部１８、プロセス出力部２０゜内部信号バス２２および
５ＩＯ２４’（＋−有する。 ＰＣとしての基本的構成
は前述した従来のものと同様である。また、同符号で示
す各部の構成および機能も前述のものと同様である。こ
こで、第１図に示した従来のＰＣと異なるところ祉、第
２図に示した８Ｉ０２４を有するとともに、この８ Ｉ
０２４および上記システム制御プログラムメモリ１２
Ａ１伝送制御プログラムメモリ１２Ｂ１シーケンスプロ
グラムメモリ１４が、第４図に示すように、ユニット化
されて取付は取外しが可能な構造となっていることであ
る。このように構成したことにより、先ず、単独ＰＣと
して使用する場合には、上記システム制御プログラムメ
モリ１２Ａと上記シーケンスプログラムメモリ１４を取
付ける一方、上記伝送制御プ四グラムメ蚤り１２Ｂと上
記８１０２４を敗外せばよい６次に、上記伝送制御プロ
グラムメモリ１２Ｂと上記８ＩＯを取付ける一方、上記
システム制御プログラムメモリ１２Ａと上記シーケンス
プログ２ムメモリ１４を取外すと、今度は独立したリモ
ートＩ１０装置として使用できるようになる。そして、
システ＾制紳プログラムメモリ１２Ａ１シーケンスプロ
グラムメモリ１４、伝送制御プログラムメモリ１２Ｂお
よび５ｉｏ２４の全てを取付けると、第３図に示すよう
に、Ｉｌｏおよび直列データインターフェース付ＰＣ，
！：［、て使用でき、さらにこの場合は他の直列データ
インターフェース付ｐｃ２６と直列データ伝送！！２８
を介して接続することにより並列運転も可能になる。つ
まシ、単一機種の装置が出力機器の制御に必要な３種類
の機能を兼ねることができ、これＫより従来のように３
種類の装置を取揃えずとも、種々の使用状態に対応する
ことができる。そしてここで注目すべきこと祉、そのよ
うな３種類の機能を有するにもかかわらず、その構造に
ついては、従来のＰＣと基本的に同じように構成でき、
かつそこに若干の付加構成を施すだけでよいということ
である。また、何れの機能で使用される場合も、共通し
て使用される部分が多く、従って単独ＰＣとして使用し
ても、また独立のリモートＩ１０装置として使用しても
構成上の無駄は少ない。The PC shown in the figure has a CPU IQ configured by a microprocessor, and a system control program memory 12A.
1 transmission control program memory 12B 1 sequence program memory 14, temporary storage memory 16, process input section 18, process output section 20° internal signal bus 22 and 5 IO 24' (+-) The basic configuration of the PC is the same as the conventional one described above. The structure and function of each part indicated by the same reference numerals are also the same as those described above. and this 8 I
024 and the system control program memory 12
As shown in FIG. 4, the A1 transmission control program memory 12 and the B1 sequence program memory 14 are unitized and have a structure that can be installed and removed. With this configuration, when used as a standalone PC, the system control program memory 12A and the sequence program memory 14 can be installed, while the transmission control programmer 12B and the 81024 can be removed. Next, by installing the transmission control program memory 12B and the 8IO, and removing the system control program memory 12A and the sequence program memory 14, it can now be used as an independent remote I10 device. and,
When all of the system control program memory 12A1 sequence program memory 14, transmission control program memory 12B and 5io24 are installed, as shown in FIG.
! : [, can be used, and in this case, serial data transmission with other PC26 with serial data interface! ! 28
Parallel operation is also possible by connecting via. Tsumashi: A single model of device can serve the three types of functions required to control the output device, and this allows for
It is possible to respond to various usage conditions without having to prepare different types of devices. What should be noted here is that although it has these three types of functions, its structure can basically be configured in the same way as a conventional PC.
Moreover, it is only necessary to add some additional configurations. Moreover, no matter which function it is used for, there are many parts that are used in common, so there is little waste in terms of configuration whether it is used as a standalone PC or as an independent remote I10 device.
以上のようにこの発明によるＰＣＦｉ、単一の機種でも
って、単独ＰＣ、リモートＩ１０装置、Ｉｌｏおよび直
列データインターフェース付ＰＣの３つの機能が簡単に
実現でき、これによりユーザー側は多種類の装置を取揃
える面倒から解放され、またメーカー側も単一種類だけ
の装置を供給すればよいので量産効果を得ることができ
るといった利点が得られる。As described above, with the PCFi according to the present invention, the three functions of a single PC, a remote I10 device, and a PC with an Ilo and serial data interface can be easily realized with a single model, and this allows the user to operate many types of devices. This frees the manufacturer from the trouble of arranging equipment, and the manufacturer only needs to supply a single type of equipment, which has the advantage of being able to benefit from mass production.
第１図は従来のＰＣの一般的な構成を示すブロック図、
第２図は従来のリモー）Ｉ１０装置の一般的な構成含水
すブロック図、第３図はこの発明によるＰＣの一実施例
含水すブロック図、第４図はその外観の一実施例を示す
斜視図である。
各図中同一部材には同一符号を付し、１０は中央処理装
置（ＣＰＵ）、１２Ａはシステム制御プＩダラムメモリ
、１ｚＢＦ１伝送制御プログラムメモリ、１４はシーケ
ンスプログラムメモ！Ｊ、１６は一時記憶メモリ、１８
はプロセス入力部、２０はプロセス出力部、２２＃ｉ信
号バス、２４は直列データインターフェース用ボート（
８ＩＯ）、２８は直列データ伝送線である。
代理人 弁理士 葛 野 信 −（＃！Ｅか１
名）
第１図
■−」
第３図
［−」
第４図FIG. 1 is a block diagram showing the general configuration of a conventional PC.
Fig. 2 is a block diagram of the general configuration of a conventional remote I10 device, Fig. 3 is a block diagram of an embodiment of a PC according to the present invention, and Fig. 4 is a perspective view showing an embodiment of its external appearance. It is a diagram. The same parts in each figure are given the same reference numerals, 10 is a central processing unit (CPU), 12A is a system control module memory, 1zBF1 transmission control program memory, and 14 is a sequence program memo! J, 16 is temporary storage memory, 18
20 is a process input section, 20 is a process output section, 22#i signal bus, 24 is a serial data interface port (
8IO), 28 is a serial data transmission line. Agent Patent Attorney Shin Kuzuno - (#!E or 1
name) Fig. 1 ■-” Fig. 3 [-” Fig. 4
Claims (1)
、上記中央処理装置にシーケンスプログラムメモリに記
憶されたプログラムを実行させるためのプログラムを記
憶するシステム制御プログラムメモリ、上記中央処理装
置と外部との間で授受されるデータを一時記憶する一時
記憶メモリ、プロセス入力部およびプロセス出力部を有
するとともに、他装置と直列データの授受を行なうため
の伝送制御プログラムメモリおよび直列データインター
フェース用ボートを有し、さらに上記シーケンスプログ
ラムメモリおよび上記システム制御プログラムメモリと
、上記伝送制御プログラムメモリおよび上記直列データ
インターフェース用ボー）ｔ−取付社取外し可能な構造
とし、上記シーケンスプログラムメモリおよび上記シス
テム制御グログラムメモリを取付ける一方上記伝送制御
プログ２ムメモリおよび上記直列データインターフェー
ス用ボートを取外すことによシ単独プログラマブル・コ
ントローラとして機能させ、ｔた上記伝送制御プログラ
ムメモリおよび上記直列データインターフェース用ボー
トを取付ける一方上記シーケンスプログラムメモリおよ
び上記システム制御プログラムメモリを取外すことによ
りリモート入出力装置として機能させ、上記シーケンス
プログラムメモリ、上記システム制御プログラム、上記
伝送制御プログラムメモリ、上記直列データインターフ
ェース用ボートの全てを取付けることにより入出力装置
および直列データイ゛ンターフェース付プログラマブル
・コントローラとしても機能させられるようにしたこと
を特徴とするプログラマブル・コントローラ。(1) A central processing unit, a sequence program memory, a system control program memory that stores a program for causing the central processing unit to execute a program stored in the sequence program memory, and a system control program memory that is exchanged between the central processing unit and the outside. It has a temporary storage memory for temporarily storing data, a process input section, and a process output section, and also has a transmission control program memory and a serial data interface port for exchanging serial data with other devices, and further includes a serial data interface port for exchanging serial data with other devices. memory and said system control program memory, said transmission control program memory and said serial data interface board) T-mounting company has a removable structure, and said sequence program memory and said system control program memory are attached while said transmission control program By removing the 2-frame memory and the serial data interface boat, the system functions as a standalone programmable controller, and while the transmission control program memory and the serial data interface boat are installed, the sequence program memory and the system control program memory are installed. By removing the above, it functions as a remote input/output device, and by attaching all of the above sequence program memory, the above system control program, the above transmission control program memory, and the above serial data interface boat, it can be equipped with an input/output device and a serial data interface. A programmable controller characterized in that it can also function as a programmable controller.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56155972A JPS5856103A (en) | 1981-09-30 | 1981-09-30 | Programmable controller |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56155972A JPS5856103A (en) | 1981-09-30 | 1981-09-30 | Programmable controller |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5856103A true JPS5856103A (en) | 1983-04-02 |
Family
ID=15617552
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56155972A Pending JPS5856103A (en) | 1981-09-30 | 1981-09-30 | Programmable controller |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5856103A (en) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6065805U (en) * | 1983-10-13 | 1985-05-10 | 松下電工株式会社 | Sequence control device |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS554638A (en) * | 1978-06-28 | 1980-01-14 | Hitachi Ltd | Input/output device base for sequence controller |
-
1981
- 1981-09-30 JP JP56155972A patent/JPS5856103A/en active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS554638A (en) * | 1978-06-28 | 1980-01-14 | Hitachi Ltd | Input/output device base for sequence controller |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6065805U (en) * | 1983-10-13 | 1985-05-10 | 松下電工株式会社 | Sequence control device |
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