JPS589292A - 読出専用記憶装置読出し方式 - Google Patents
読出専用記憶装置読出し方式Info
- Publication number
- JPS589292A JPS589292A JP56107764A JP10776481A JPS589292A JP S589292 A JPS589292 A JP S589292A JP 56107764 A JP56107764 A JP 56107764A JP 10776481 A JP10776481 A JP 10776481A JP S589292 A JPS589292 A JP S589292A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発胸は続出専用記憶装置１（以下ＲＯＭと称す）の絞
出し方式に係り同一データを豊込んだ同一種類の３偽以
上の欠陥μＯＭを使用し、多数決勢の論理処理により出
力値を決定し、各ＲＯＭの欠陥を補正１１個の完全なＲ
ＯＭと吟価にするＲＡＭ絞出し方式に関する。、 最近漢字を計算機の出力に用いることか多くなってきた
０漢字を記憶するのにはアルファベットとか仮名に比し
字数が多いのでメモリセルが多く必要である。このため
漢字を多数記憶するＲＯＭ勢は大容量になり例えばウェ
ハより１個しか製作出来ないような大形となる。この為
歩留りが悪く、従来は２つの欠陥ＲＯＭを用いその出力
の論理をとることにより出力を決定し相補効果を利用し
て１個の完全なＲＯＭとし歩留りを向上していた。
出し方式に係り同一データを豊込んだ同一種類の３偽以
上の欠陥μＯＭを使用し、多数決勢の論理処理により出
力値を決定し、各ＲＯＭの欠陥を補正１１個の完全なＲ
ＯＭと吟価にするＲＡＭ絞出し方式に関する。、 最近漢字を計算機の出力に用いることか多くなってきた
０漢字を記憶するのにはアルファベットとか仮名に比し
字数が多いのでメモリセルが多く必要である。このため
漢字を多数記憶するＲＯＭ勢は大容量になり例えばウェ
ハより１個しか製作出来ないような大形となる。この為
歩留りが悪く、従来は２つの欠陥ＲＯＭを用いその出力
の論理をとることにより出力を決定し相補効果を利用し
て１個の完全なＲＯＭとし歩留りを向上していた。
第１図は漢字ＲＯＭ回路の構成原理を示す図で山を出力
している図である。第２図はセル欠陥による誤りを示す
図、第３図は従来例の２個の欠ＷＩｌｂＲＯＭで補正を
行う場合のブロック図である。
している図である。第２図はセル欠陥による誤りを示す
図、第３図は従来例の２個の欠ＷＩｌｂＲＯＭで補正を
行う場合のブロック図である。
図中１．．２１，３はＲＯＭ１４はオア（ロ）路、λ１
〜Ａ１・は文字内のドツト位置アドレス、ＡＩ、〜Ａ１
１は文字別のアドレス、第１図０の１１！は白、′Ｏ′
は黒を示す。今第１図囚のＲＯＭ１に文字別のアドレス
人、、１％−ＡＭを与へ（例へば山）文字内のドツトの
アドレス人１〜人、。を与へると＠０に示す如く対応す
る文字に必要なデータが読出される。第１図＠０では文
字は１０ｘｌＯ−１００個の９１ ＃ ％ Ｑ ＃で表
わされ合計１００個のアドレスで１文字分になる。しか
しＲＯＭＩのセルのある位置に欠陥があると正しい出力
が得られない。このため欠陥があるＲＯＭは不実にして
いた。この歩留り１向上策を以下観測Ｔる。第２ＷＡ（
ｓ）点は１０”（黒）であるべき所が１１′（白）に←
）点はその逆に誤りをおこした場合を示す・この場合第
３図の如き（ロ）路を用いるとｆｔ０Ｍ２、ＲＯＭ３の
出力をオア回路４で論理和をとっているので第２１１（
Ｃｆ）に示す如く一方のＲＯＭのセルに欠陥があり％
Ｑ ｌになっても他方のＲＯＭが１１＃ならば出力は％
１′になるので−）に示す欠陥はなくなる。しかし０）
のような欠陥はなくならない。たが実際の大容ｆｉＲＯ
Ｍは欠陥セルは１０′又は１１′のどちらかの出力にな
りやすい傾向に回路上工夫することが出来るので、この
傾向に応じて１０′になり易い場合は第３図に示す如く
オア回路４を用い１１１になり易い場合はアンド回路を
用いる。ことにより欠陥ＲＯＭを２個用いて補正して歩
留才りを或程に向上出来る。しかしこの方式ではオア回
路を使用するかアンド回路を使用するかはＲＯＭによっ
て足まるのでオア回路を使用すれば第２図（ハ）の如き
欠陥は除去出来ず、アンド回路を使用すれば第２図（ロ
）の如き欠陥は除去出来ず、この場合はこのＲＯＭは不
良とするしかなく或程度以上歩雷まりを向上出来ない欠
点がある。
〜Ａ１・は文字内のドツト位置アドレス、ＡＩ、〜Ａ１
１は文字別のアドレス、第１図０の１１！は白、′Ｏ′
は黒を示す。今第１図囚のＲＯＭ１に文字別のアドレス
人、、１％−ＡＭを与へ（例へば山）文字内のドツトの
アドレス人１〜人、。を与へると＠０に示す如く対応す
る文字に必要なデータが読出される。第１図＠０では文
字は１０ｘｌＯ−１００個の９１ ＃ ％ Ｑ ＃で表
わされ合計１００個のアドレスで１文字分になる。しか
しＲＯＭＩのセルのある位置に欠陥があると正しい出力
が得られない。このため欠陥があるＲＯＭは不実にして
いた。この歩留り１向上策を以下観測Ｔる。第２ＷＡ（
ｓ）点は１０”（黒）であるべき所が１１′（白）に←
）点はその逆に誤りをおこした場合を示す・この場合第
３図の如き（ロ）路を用いるとｆｔ０Ｍ２、ＲＯＭ３の
出力をオア回路４で論理和をとっているので第２１１（
Ｃｆ）に示す如く一方のＲＯＭのセルに欠陥があり％
Ｑ ｌになっても他方のＲＯＭが１１＃ならば出力は％
１′になるので−）に示す欠陥はなくなる。しかし０）
のような欠陥はなくならない。たが実際の大容ｆｉＲＯ
Ｍは欠陥セルは１０′又は１１′のどちらかの出力にな
りやすい傾向に回路上工夫することが出来るので、この
傾向に応じて１０′になり易い場合は第３図に示す如く
オア回路４を用い１１１になり易い場合はアンド回路を
用いる。ことにより欠陥ＲＯＭを２個用いて補正して歩
留才りを或程に向上出来る。しかしこの方式ではオア回
路を使用するかアンド回路を使用するかはＲＯＭによっ
て足まるのでオア回路を使用すれば第２図（ハ）の如き
欠陥は除去出来ず、アンド回路を使用すれば第２図（ロ
）の如き欠陥は除去出来ず、この場合はこのＲＯＭは不
良とするしかなく或程度以上歩雷まりを向上出来ない欠
点がある。
本発明の目的は上記の欠点をなくするために３個以上の
欠陥ＲＯＭを用いることによりＲＯＭ内の欠陥セルを殆
んど完全に補正し１個の完全なＲＯＭとして使用出来る
歩留のよいＲ０Ｍ［出し方式の提供にある。
欠陥ＲＯＭを用いることによりＲＯＭ内の欠陥セルを殆
んど完全に補正し１個の完全なＲＯＭとして使用出来る
歩留のよいＲ０Ｍ［出し方式の提供にある。
本発明は上記の目的を達成するために同一内容のデータ
を記憶した同一種類の３個以上の続出専用記憶装置に、
同一読出しセル指定のアドレスを与え、各続出専用記憶
装置よりの出力情報を比較し、違いがあれば、どちらか
にする判断基準をもうけ、出力値を決定し、その値を読
出専用記憶装置の読出し情報とすることを特徴とする読
出専用記憶装置読出し方式である。
を記憶した同一種類の３個以上の続出専用記憶装置に、
同一読出しセル指定のアドレスを与え、各続出専用記憶
装置よりの出力情報を比較し、違いがあれば、どちらか
にする判断基準をもうけ、出力値を決定し、その値を読
出専用記憶装置の読出し情報とすることを特徴とする読
出専用記憶装置読出し方式である。
以下本発明の１実施例につき図に従って説明する。第４
図は本発明の実施例の欠陥ＲＯＭを３個用いて補正を行
う場合のブロック図である。
図は本発明の実施例の欠陥ＲＯＭを３個用いて補正を行
う場合のブロック図である。
図中第１図と同一機能のものは同一記号で示もｓ、２ｇ
、７はＲＯＭ、８は多数決回路である。
、７はＲＯＭ、８は多数決回路である。
）ｔ＋ＯＭｓ、、６ｅ、７は同一内容のデータを配憶し
た同一種類のＲＯＭでアドレスの内容も同一である。
た同一種類のＲＯＭでアドレスの内容も同一である。
従ってＲＯＭ５．．６１，７に文字別アドレスＡｌｌ
Ｓ−ＡＭを与へ文字内のドツトのアドレスＡ、〜Ａ、。
Ｓ−ＡＭを与へ文字内のドツトのアドレスＡ、〜Ａ、。
を与えると同じ内容の出力ＪＩ又は１１′が出力され多
数決回路８にて多数決をとり１個のＲＯＭの出力として
出力される。令弟２図ｆＯに）に示す如き欠陥がありて
も１０′又は１１＃の多い方を多数決回路８にて選択す
るので欠陥は補正される。従ってこの場合は２個のＲＯ
Ｍが同じ位置に欠陥セルをもたなければ第２図句に）い
づれのタイプの欠陥も除去出来る。故にこの場合には欠
陥セルが１０＃用いづれかに固定されやすいような回路
上の工夫も必要なく、又２個のＲＯＭが同じ位置に欠陥
セルを持つことはまずないので欠陥のあるＲＯＭを３個
用いることで完全なＲＯＭ１個として使用出米歩留まり
を向上出来る。本実施例は３ｓの欠陥ＲＯＭを使用する
ことで観、明したがこれは４個以上でもよく又多数決回
路は例えば４個の欠陥ＲＯＭを使用し１個以下の違いを
補正するような歩留りを考慮した判断方法をとってもよ
い。
数決回路８にて多数決をとり１個のＲＯＭの出力として
出力される。令弟２図ｆＯに）に示す如き欠陥がありて
も１０′又は１１＃の多い方を多数決回路８にて選択す
るので欠陥は補正される。従ってこの場合は２個のＲＯ
Ｍが同じ位置に欠陥セルをもたなければ第２図句に）い
づれのタイプの欠陥も除去出来る。故にこの場合には欠
陥セルが１０＃用いづれかに固定されやすいような回路
上の工夫も必要なく、又２個のＲＯＭが同じ位置に欠陥
セルを持つことはまずないので欠陥のあるＲＯＭを３個
用いることで完全なＲＯＭ１個として使用出米歩留まり
を向上出来る。本実施例は３ｓの欠陥ＲＯＭを使用する
ことで観、明したがこれは４個以上でもよく又多数決回
路は例えば４個の欠陥ＲＯＭを使用し１個以下の違いを
補正するような歩留りを考慮した判断方法をとってもよ
い。
以上詳細に説明した如く本発明によれば３個以上の欠陥
ＲＯＭを用いて１個の完全なＲ，ＯＭとして使用出来る
ので大容量ＲＯＭの歩留を向上出来る効果がある。
ＲＯＭを用いて１個の完全なＲ，ＯＭとして使用出来る
ので大容量ＲＯＭの歩留を向上出来る効果がある。
第１図は漢字ＲＯＭ回路の構成原理を示す図で山を出力
している図、第２図はセル欠陥による誤りを示す図、第
３図は従来例の２個の欠陥ＲＯＭで補正を行う場合のブ
ロック図、館４図は本発明の実施例の欠−ＲＯＭを３個
用いて補正を行う場合のブロック図である。図中１す２
□３．．５ｈ、 ６．、 ’１はＲＯＭ、４はオア回路
、８は多数決回路、鳥〜Ａｌ１１は文字内のドツト位置
アドレス、Ａ□〜Ａｘは文字別アドレス、第１図０の１
１＃は白、′０＃は黒を示す。 代理人１−理士 松 −宏四−ン憬 第１図 （Ｂン １１／／ｌθ／／ｌｌ １ｌｌｌｌθ／／／１ １１１１／ｌｌｌｌＩ
している図、第２図はセル欠陥による誤りを示す図、第
３図は従来例の２個の欠陥ＲＯＭで補正を行う場合のブ
ロック図、館４図は本発明の実施例の欠−ＲＯＭを３個
用いて補正を行う場合のブロック図である。図中１す２
□３．．５ｈ、 ６．、 ’１はＲＯＭ、４はオア回路
、８は多数決回路、鳥〜Ａｌ１１は文字内のドツト位置
アドレス、Ａ□〜Ａｘは文字別アドレス、第１図０の１
１＃は白、′０＃は黒を示す。 代理人１−理士 松 −宏四−ン憬 第１図 （Ｂン １１／／ｌθ／／ｌｌ １ｌｌｌｌθ／／／１ １１１１／ｌｌｌｌＩ
Claims (1)
- 同−自答のデータを記憶した同−麺類の３個以上の＊ａ
＋専用記憶懺置装、同−妖出しセル指定のアドレスを与
え、各訳出専用記憶妓歓よりの出力情報を比較し、違い
があれば、どちらかにする判断基準をもうけ、出力値を
決定し、その値を欽出専用記憶装置の読出し情報とする
ことを特徴とする続出専用記憶装置ｉＩＬ続出し方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56107764A JPS589292A (ja) | 1981-07-10 | 1981-07-10 | 読出専用記憶装置読出し方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56107764A JPS589292A (ja) | 1981-07-10 | 1981-07-10 | 読出専用記憶装置読出し方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS589292A true JPS589292A (ja) | 1983-01-19 |
Family
ID=14467397
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56107764A Pending JPS589292A (ja) | 1981-07-10 | 1981-07-10 | 読出専用記憶装置読出し方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS589292A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60173800A (ja) * | 1983-10-28 | 1985-09-07 | シ−ク テクノロジ− インコ−ポレ−テツド | 故障許容メモリアレイ |
| JPH0730435A (ja) * | 1993-07-14 | 1995-01-31 | Nec Corp | 誤り訂正回路 |
-
1981
- 1981-07-10 JP JP56107764A patent/JPS589292A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60173800A (ja) * | 1983-10-28 | 1985-09-07 | シ−ク テクノロジ− インコ−ポレ−テツド | 故障許容メモリアレイ |
| JPH0730435A (ja) * | 1993-07-14 | 1995-01-31 | Nec Corp | 誤り訂正回路 |
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