JPS589468A - 画像処理方法 - Google Patents
画像処理方法Info
- Publication number
- JPS589468A JPS589468A JP10778581A JP10778581A JPS589468A JP S589468 A JPS589468 A JP S589468A JP 10778581 A JP10778581 A JP 10778581A JP 10778581 A JP10778581 A JP 10778581A JP S589468 A JPS589468 A JP S589468A
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- Pending
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N1/00—Scanning, transmission or reproduction of documents or the like, e.g. facsimile transmission; Details thereof
- H04N1/40—Picture signal circuits
- H04N1/409—Edge or detail enhancement; Noise or error suppression
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Facsimile Image Signal Circuits (AREA)
- Manipulation Of Pulses (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は画像処理方法に関し、とくに、不規則に発生す
る画像ノイズ全除去した２値化画像を得る画像処理方法
に関する。
る画像ノイズ全除去した２値化画像を得る画像処理方法
に関する。
原映像から２値化処理された画像を得る操作中に外部照
明処理装置の入力電源、外部磁界等により生ずる画像ノ
イズの他、原映像の画素の明度が２値化処理時のスレッ
ショルドレベルとｉ近し？いるために生じるちらつきが
２値化画像の品質を劣化せしめている。
明処理装置の入力電源、外部磁界等により生ずる画像ノ
イズの他、原映像の画素の明度が２値化処理時のスレッ
ショルドレベルとｉ近し？いるために生じるちらつきが
２値化画像の品質を劣化せしめている。
本発明はかかる点に鑑みなされたもので、簡単な構成で
不規則ノイズのない品質のすぐれた２値化画像を得るこ
とのできる画像処理方法全提供することにある。
不規則ノイズのない品質のすぐれた２値化画像を得るこ
とのできる画像処理方法全提供することにある。
以下図面を参照し々から本発明の好ましい実施例につい
て詳細に説明する。
て詳細に説明する。
図１は本発明の一実施例構成図であっＴ、ＭＩ〜Ｍ３は
２値化画像データ全収納するメモリ、Ｒ３−Ｒ３はメモ
リＭ１〜Ｍ３の所定画素（例えば４ピツト）データを収
納するレジスタ、Ａ、〜Ａ３はＡＮＤ回路であって、レ
ジスタＲ３〜Ｒ８の内の２つのレジスタの出力に対して
ＡＮＤ演算を行う。ＲはＡＮＤ回路回路−１〜Ａ出力を
受けるＯＲ回路、Ｒ４はＯＲ回路Ｐの出力データを収納
するレジスタ、Ｍ４は２値化画像データを収納するメモ
リ、Ｓげ制御部である。
２値化画像データ全収納するメモリ、Ｒ３−Ｒ３はメモ
リＭ１〜Ｍ３の所定画素（例えば４ピツト）データを収
納するレジスタ、Ａ、〜Ａ３はＡＮＤ回路であって、レ
ジスタＲ３〜Ｒ８の内の２つのレジスタの出力に対して
ＡＮＤ演算を行う。ＲはＡＮＤ回路回路−１〜Ａ出力を
受けるＯＲ回路、Ｒ４はＯＲ回路Ｐの出力データを収納
するレジスタ、Ｍ４は２値化画像データを収納するメモ
リ、Ｓげ制御部である。
次にこの装置の動作會欣明する。
まず２値化処理を施すべき画像対象パターンを異なる時
間に撮像した画像に対して２値化処理を施し７た２値化
画像３組を各々メモＩＪＭ、〜Ｍ、に入力する。
間に撮像した画像に対して２値化処理を施し７た２値化
画像３組を各々メモＩＪＭ、〜Ｍ、に入力する。
次に、制御部Ｓの制御によ、す、これらメモ’ｌ Ｍｌ
〜Ｍ、の同一アドレスの記憶領域にある所定量の画素（
例えば４ビツト）情報をそれぞれのメモリＭ、〜Ｍ３に
対応して設けられたレジスタＲ１〜Ｒ，に入力する。
〜Ｍ、の同一アドレスの記憶領域にある所定量の画素（
例えば４ビツト）情報をそれぞれのメモリＭ、〜Ｍ３に
対応して設けられたレジスタＲ１〜Ｒ，に入力する。
これらレジスタＲ１〜Ｒ３に収納された画素情報を順次
１画素ずつ出力し、ＡＮＤ回路回路−１〜Ａ３力する。
１画素ずつ出力し、ＡＮＤ回路回路−１〜Ａ３力する。
ＡＮＤ回ＭＡ、ではレジスタＲ０とＲ２の出力のＡＮＤ
演算を行い、ＡＮＤ回路Ａ２ではレジスタＲ１，とＲ５
の出力のＡ−ＮＤ演算を行い、ＡＮＤ回路回路室はレジ
スタＲ１とＲ３の出力のＡＮＤ演算を行う。
演算を行い、ＡＮＤ回路Ａ２ではレジスタＲ１，とＲ５
の出力のＡ−ＮＤ演算を行い、ＡＮＤ回路回路室はレジ
スタＲ１とＲ３の出力のＡＮＤ演算を行う。
これらＡＮＤ回路回路−２〜Ａ出力ｆｌＯＲ回路Ｐに入
力ざｔｌ、ＯＲ演算が行われた後、レジスタＲ１に入力
される。
力ざｔｌ、ＯＲ演算が行われた後、レジスタＲ１に入力
される。
この結果、各レジスタＲ１〜Ｒ１の対応する領域に収納
されている画素情報の多数決諒１理演算が行われ、例え
ば図示の如く、レジスタＲ０に（１゜１．１．０）、レ
ジスタＲ１に（１，１，０，０）。
されている画素情報の多数決諒１理演算が行われ、例え
ば図示の如く、レジスタＲ０に（１゜１．１．０）、レ
ジスタＲ１に（１，１，０，０）。
レジスタＲ８に（１，０，０，０）が収納されている場
合、多数決論理演算の結果レジスｆｉＲ，Ｋに（１，１
，０，０）なる情報が収納されることになる。
合、多数決論理演算の結果レジスｆｉＲ，Ｋに（１，１
，０，０）なる情報が収納されることになる。
レジスタＲ４に蓄えられているこれらの情報は制御部Ｓ
の制御により、メモリＭ、−Ｍ、からレジスタＲ１〜Ｒ
３へ読出された画素情報が蓄えられていたメモＩＪＭＩ
〜Ｍ、の記憶領域と同一のアドレスを有するメモリＭ
４の記憶領域に収納される。
の制御により、メモリＭ、−Ｍ、からレジスタＲ１〜Ｒ
３へ読出された画素情報が蓄えられていたメモＩＪＭＩ
〜Ｍ、の記憶領域と同一のアドレスを有するメモリＭ
４の記憶領域に収納される。
このように、メモリＭ１〜Ｍ、の対応する記憶領域の画
素情報が比較され、そう内多数會占める画素情報が真の
画素情報として、扱われるため、不規則に発生するノイ
ズが例えばメモυＭ、に画素情報″′１”とじて含まれ
ていても、このノイズの発生が不規則であれば、メモＩ
ＪＭ、、Ｍ、に記憶される画素情報としてこのノイズ情
報は表われず従って、本来の画素情報が１０”であるな
らば、メモリＭ４ には画素情報“０″として記憶され
る。
素情報が比較され、そう内多数會占める画素情報が真の
画素情報として、扱われるため、不規則に発生するノイ
ズが例えばメモυＭ、に画素情報″′１”とじて含まれ
ていても、このノイズの発生が不規則であれば、メモＩ
ＪＭ、、Ｍ、に記憶される画素情報としてこのノイズ情
報は表われず従って、本来の画素情報が１０”であるな
らば、メモリＭ４ には画素情報“０″として記憶され
る。
メモリＭ、〜Ｍ３の他の全１のアドレスの記憶領域に記
憶されている画素情報に対しても同様の多数決論理演算
により得られた画素情報がメモリＭ４３− に蓄えられる。
憶されている画素情報に対しても同様の多数決論理演算
により得られた画素情報がメモリＭ４３− に蓄えられる。
このようにしてメモリＭ４に得られた画素情報は不規則
に発生するノイズの影響の少い高品質の画素情報であり
、この画素情報により得られる再生像はノイズの少い鮮
明な画像である。
に発生するノイズの影響の少い高品質の画素情報であり
、この画素情報により得られる再生像はノイズの少い鮮
明な画像である。
以上の説明から明らかなように本発明に係る画像処理方
法は、異なる時間に得られた原画像の２値化画像情報を
複数組用意し、これら複数組の２値化画像の相対応する
画素情報に多数決論理演算を施し、原画像に含まれる不
規則性ノイズを除去し−ｆｃため、品質の優れた再生像
が得られる利点がある。
法は、異なる時間に得られた原画像の２値化画像情報を
複数組用意し、これら複数組の２値化画像の相対応する
画素情報に多数決論理演算を施し、原画像に含まれる不
規則性ノイズを除去し−ｆｃため、品質の優れた再生像
が得られる利点がある。
図面に本発明の一実施構成図である。
Ｍ、−Ｍ、：メモリ、Ｒ８へＲ４：レジスタ、Ａ、〜Ａ
Ｍ ：ＡＮＤ回路１．Ｐ：ＯＲ回路、Ｓ二制制部。 ４−
Ｍ ：ＡＮＤ回路１．Ｐ：ＯＲ回路、Ｓ二制制部。 ４−
Claims (1)
- 同一対象物に対して異なるタイミングで少くとも３回以
上の２値画像サンプリング全行い、該サンプリング画像
の同一画素情報に対して多数決論理演算をし、該演算に
より得られる論理出力を有効画素情報とすること全特徴
とする画像処理方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10778581A JPS589468A (ja) | 1981-07-10 | 1981-07-10 | 画像処理方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10778581A JPS589468A (ja) | 1981-07-10 | 1981-07-10 | 画像処理方法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS589468A true JPS589468A (ja) | 1983-01-19 |
Family
ID=14467955
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10778581A Pending JPS589468A (ja) | 1981-07-10 | 1981-07-10 | 画像処理方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS589468A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60139013A (ja) * | 1983-12-27 | 1985-07-23 | Toshiba Corp | ノイズ軽減回路 |
| WO1990007244A1 (en) * | 1988-12-22 | 1990-06-28 | Rank Cintel Limited | Image processing system |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS53102620A (en) * | 1977-02-19 | 1978-09-07 | Nec Corp | Black addition system by a plurality of scannings |
-
1981
- 1981-07-10 JP JP10778581A patent/JPS589468A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS53102620A (en) * | 1977-02-19 | 1978-09-07 | Nec Corp | Black addition system by a plurality of scannings |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60139013A (ja) * | 1983-12-27 | 1985-07-23 | Toshiba Corp | ノイズ軽減回路 |
| WO1990007244A1 (en) * | 1988-12-22 | 1990-06-28 | Rank Cintel Limited | Image processing system |
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