JPS5895412A - 集積回路装置 - Google Patents
集積回路装置Info
- Publication number
- JPS5895412A JPS5895412A JP56194151A JP19415181A JPS5895412A JP S5895412 A JPS5895412 A JP S5895412A JP 56194151 A JP56194151 A JP 56194151A JP 19415181 A JP19415181 A JP 19415181A JP S5895412 A JPS5895412 A JP S5895412A
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- JP
- Japan
- Prior art keywords
- circuit
- amplifier
- negative feedback
- input terminal
- terminal
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 230000003321 amplification Effects 0.000 claims description 6
- 238000003199 nucleic acid amplification method Methods 0.000 claims description 6
- 230000009977 dual effect Effects 0.000 abstract description 6
- 239000003990 capacitor Substances 0.000 description 6
- 230000008878 coupling Effects 0.000 description 3
- 238000010168 coupling process Methods 0.000 description 3
- 238000005859 coupling reaction Methods 0.000 description 3
- 238000010586 diagram Methods 0.000 description 3
- 239000004606 Fillers/Extenders Substances 0.000 description 1
- 238000000034 method Methods 0.000 description 1
Landscapes
- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、電力壇幅器を集積化した果槓回路装置に関す
るものである。
るものである。
集積回路化された篭力壇幅器には、大別すると増幅器を
１つ有する１チヤンネルのものと独立した増幅器を２つ
有する２チヤンネルのものがあるが、本発明は後者に関
するものである。
１つ有する１チヤンネルのものと独立した増幅器を２つ
有する２チヤンネルのものがあるが、本発明は後者に関
するものである。
２チヤンネルの集積回路の使用方法としては、プーアル
アンプとＢＴＬアンプの２通りがあり、２つの負帰還冷
−器２００，３００をもつ集槓回路１００を用いたそれ
ぞれの回路例を第１図及び第２図に示す。第１図の実施
例では二つの入力信号源ｖｓ、 ｅ ｖＳｔに対してそ
れぞれ帰還抵抗１（、、、九をもつ二つの負帰還電力増
幅回路２００，３００が独立に増−機能を持ち各負荷ル
Ｌｌｅ凡り、にコンテンツＣ３，Ｃ４を介して出力を与
えるものである。尚、抵。
アンプとＢＴＬアンプの２通りがあり、２つの負帰還冷
−器２００，３００をもつ集槓回路１００を用いたそれ
ぞれの回路例を第１図及び第２図に示す。第１図の実施
例では二つの入力信号源ｖｓ、 ｅ ｖＳｔに対してそ
れぞれ帰還抵抗１（、、、九をもつ二つの負帰還電力増
幅回路２００，３００が独立に増−機能を持ち各負荷ル
Ｌｌｅ凡り、にコンテンツＣ３，Ｃ４を介して出力を与
えるものである。尚、抵。
抗Ｒ，，Ｒ，、コンデンサＣ１，Ｃ，は負帰還用のもの
である。一方、高出力電力を得たい時は、第２図の回路
例の様に負帰還増幅回路２００に入力信号Ｖｓ、を与え
、その出力を負荷ＲＩＬ、の一方の端子に与えるととも
に、抵抗鳥を介して負帰還増幅回路３００の反転入力端
子に入力し、この負帰還増幅回路３００の出力゛を負荷
）Ｌｘ、ｓの他方の端子に与えるようにＢＴＬ接続とし
て使用する。この時負帰還増幅回路３００の非反転入力
端はコンデンサＣ１で接地しておく。
である。一方、高出力電力を得たい時は、第２図の回路
例の様に負帰還増幅回路２００に入力信号Ｖｓ、を与え
、その出力を負荷ＲＩＬ、の一方の端子に与えるととも
に、抵抗鳥を介して負帰還増幅回路３００の反転入力端
子に入力し、この負帰還増幅回路３００の出力゛を負荷
）Ｌｘ、ｓの他方の端子に与えるようにＢＴＬ接続とし
て使用する。この時負帰還増幅回路３００の非反転入力
端はコンデンサＣ１で接地しておく。
しかしこの２通りの使用方法を１個の集積回路に薫用さ
せる拳は従来の集積回路では大変難かしく、また切換え
に多数の外付は部品を必要とした。
せる拳は従来の集積回路では大変難かしく、また切換え
に多数の外付は部品を必要とした。
本発明の目的は、これらデュアルアンプとＢＴＬアンプ
の２通シの機能を兼用する事ができ、しかも切換え回路
を自振する◆によシこれらの機能切換えが容易な集積回
路化されたｔ力増物器を提供するにある。
の２通シの機能を兼用する事ができ、しかも切換え回路
を自振する◆によシこれらの機能切換えが容易な集積回
路化されたｔ力増物器を提供するにある。
以下に図面を参照して本発明をより畦細に欣明する。
第３図は本発明の具体的一実施例である。一点鎖線１０
０が集積回路である。集積回路１０−６は負帰還電力増
幅回路２００及び３００、切換え回路４００％スイッチ
回路ｓｗ、、ｓｗ！、ｓｗ、 で−ｍａされている。さ
らに集積回路１００は信号入力端子ａ及び０％帰還端子
す及びｄ１出力端子ｆ及びｇ１ＢＴＬ用帰還端子ｉ１切
換え回路制御端子Ｊ１電源供給端子ｈ１接地端子Ｃを有
している。また外付けのスイッチ８Ｗａ、ＳＷｂ、ＳＷ
ｃは連動である。
０が集積回路である。集積回路１０−６は負帰還電力増
幅回路２００及び３００、切換え回路４００％スイッチ
回路ｓｗ、、ｓｗ！、ｓｗ、 で−ｍａされている。さ
らに集積回路１００は信号入力端子ａ及び０％帰還端子
す及びｄ１出力端子ｆ及びｇ１ＢＴＬ用帰還端子ｉ１切
換え回路制御端子Ｊ１電源供給端子ｈ１接地端子Ｃを有
している。また外付けのスイッチ８Ｗａ、ＳＷｂ、ＳＷ
ｃは連動である。
いま、スイッチＳＷａが第３図の位置にあるとすれば、
切換え回路制御端子ｊが開放状態でスイッチ回路ＳＷ、
が導通状態、スイッチ回路ＳＷ、及びＳＷ、が開放状態
となり、信号入力端子ａ及びＣはそれぞれ負帰還増幅器
１ＩｖＩ［ｇ回路２００及び３００の非反転入力端子に
接続される。さらに、出力端子ｇ及びｆ［、それぞれス
イッチＳＷｂ及び８Ｗｃを介して結合コンデンサＣ３及
びＣ４の一端に接続される。
切換え回路制御端子ｊが開放状態でスイッチ回路ＳＷ、
が導通状態、スイッチ回路ＳＷ、及びＳＷ、が開放状態
となり、信号入力端子ａ及びＣはそれぞれ負帰還増幅器
１ＩｖＩ［ｇ回路２００及び３００の非反転入力端子に
接続される。さらに、出力端子ｇ及びｆ［、それぞれス
イッチＳＷｂ及び８Ｗｃを介して結合コンデンサＣ３及
びＣ４の一端に接続される。
この時信号源Ｖｓ、により信号入力端子ａに加えられた
信号は、負帰還電力増幅回路２００によって増幅されて
出力端子ｇよ多出力され、スイッチｓｗｂ。
信号は、負帰還電力増幅回路２００によって増幅されて
出力端子ｇよ多出力され、スイッチｓｗｂ。
結合コンデンサＣ３を介して負荷抵抗ＲＬ、に出力され
る。同様にして、信号源Ｖｓ、によ）信号入力端子Ｃに
加えられた信号は、負帰還電力増幅回路３００により増
幅されて負荷抵抗ＲＬ、に出力される。この様にして集
積回路１００はデュアルアンプとして機能する。
る。同様にして、信号源Ｖｓ、によ）信号入力端子Ｃに
加えられた信号は、負帰還電力増幅回路３００により増
幅されて負荷抵抗ＲＬ、に出力される。この様にして集
積回路１００はデュアルアンプとして機能する。
一方、スイッチＳＷａによシ切換え回路制御端子ｊが接
地される場合には、スイッチ回路ＳＷ、及びＳＷ、が導
通状態、スイッチ回路ＳＷ、が開放状態となる。この時
信号入力端子ａは直接に、また信号入力端子Ｃはスイッ
チ回路Ｓ鳥を介して共に負帰還電力増幅器２００の非反
転入力端子に接続され、負帰還電力増幅器３００の非反
転入力端子はスイッチ回路ＳＷ、によ＃）信号入力端子
Ｃと分離される。
地される場合には、スイッチ回路ＳＷ、及びＳＷ、が導
通状態、スイッチ回路ＳＷ、が開放状態となる。この時
信号入力端子ａは直接に、また信号入力端子Ｃはスイッ
チ回路Ｓ鳥を介して共に負帰還電力増幅器２００の非反
転入力端子に接続され、負帰還電力増幅器３００の非反
転入力端子はスイッチ回路ＳＷ、によ＃）信号入力端子
Ｃと分離される。
このとき負帰還増幅器３００の非反転入力端子が内部で
バイアスされていない場曾は、スイッチ回路ＳＷ、によ
シ非反転入力端子を基準電位に接地する。さらに、負帰
還−力増幅回路２００の出力端子ｇは、抵抗Ｒ３及びス
イッチ回路ＳＷ３を介してＢＴＬ用帰還端子ｉに接続さ
れる。また、出力端子ｇ及びｆはスイッチ回路す及び８
Ｗｃを介して負荷抵抗ＲＬ、と接続され、結合コンデン
サＣ１及びＣ４とは分離される。この時信号源Ｖｓ１に
よシ伯号入力端子ａに加えられた信号と、信号源Ｖｓ、
により信号入力端子Ｃに加えられた信号は、スイッチ回
路ｓｗ、ｔ−介して混合され共に負帰還電力増幅回路２
００の非反転入力端子に伝達される。そして負帰還電力
増幅回路２００により増幅された信号は出力端子ｇより
負荷抵抗ＲＬ、に出力される。同時に、出力端子ｇに出
力された信号は抵抗も及びスイッチ（ロ）路ＳＷ、を介
してＢＴＬ＃３帰還端子ｉに伝達され、抵抗Ｒ１とＲ１
とによυ減哀されて帰還コンデンサＣ１を介して帰還端
子ｄに伝達される。そして負帰還電力増幅回路３０００
反転入力端子に加えられた信号は、反転出力として出力
端子ｆよシ負荷抵抗ＲＬ、に出力される。この様にして
集積回路１００はＢＴＬアンプとして機能する。
バイアスされていない場曾は、スイッチ回路ＳＷ、によ
シ非反転入力端子を基準電位に接地する。さらに、負帰
還−力増幅回路２００の出力端子ｇは、抵抗Ｒ３及びス
イッチ回路ＳＷ３を介してＢＴＬ用帰還端子ｉに接続さ
れる。また、出力端子ｇ及びｆはスイッチ回路す及び８
Ｗｃを介して負荷抵抗ＲＬ、と接続され、結合コンデン
サＣ１及びＣ４とは分離される。この時信号源Ｖｓ１に
よシ伯号入力端子ａに加えられた信号と、信号源Ｖｓ、
により信号入力端子Ｃに加えられた信号は、スイッチ回
路ｓｗ、ｔ−介して混合され共に負帰還電力増幅回路２
００の非反転入力端子に伝達される。そして負帰還電力
増幅回路２００により増幅された信号は出力端子ｇより
負荷抵抗ＲＬ、に出力される。同時に、出力端子ｇに出
力された信号は抵抗も及びスイッチ（ロ）路ＳＷ、を介
してＢＴＬ＃３帰還端子ｉに伝達され、抵抗Ｒ１とＲ１
とによυ減哀されて帰還コンデンサＣ１を介して帰還端
子ｄに伝達される。そして負帰還電力増幅回路３０００
反転入力端子に加えられた信号は、反転出力として出力
端子ｆよシ負荷抵抗ＲＬ、に出力される。この様にして
集積回路１００はＢＴＬアンプとして機能する。
尚、不実施例においては抵抗Ｒ，、１−Ｌ４及び馬が集
積回路ｌＯＯの内部に含まれている＃ｉＪ会を示したが
、内部に含まれない場合でも同様である。
積回路ｌＯＯの内部に含まれている＃ｉＪ会を示したが
、内部に含まれない場合でも同様である。
以上述べた様に本発明によれば、デュアルアンプとして
のまたＢＴＬアンプとしての機能を兼用する事ができ、
しかも機能の切換えが容易な、集積回路化された電力増
幅器を実現する事ができる。
のまたＢＴＬアンプとしての機能を兼用する事ができ、
しかも機能の切換えが容易な、集積回路化された電力増
幅器を実現する事ができる。
第１図は従来のデュアルアンプの一例を示す回路プロ、
り図である。 第２図は従来のＢＴＬアンプの一例を示す回路プロ、り
図である。 第３図は本発明の一実施例を示す回路ブロック図でおる
。 １００・・・・・・集積回路、２００，３００・・・・
・・負帰還電力ｔＪ＃１幅回路、４００・・・・・・切
換え回路、８Ｗ、〜ＳＷ。 ・・・・・・クイ２才回路、Ｖｓ、〜Ｖｓ、・・・・・
・信号源、Ｒ８−Ｒ１・・・・・抵抗、ＫＬ１〜ＫＬ、
・・・・・・負荷抵抗、Ｃ１〜Ｃ。 ・・・・・・コンテンプ、５ＷａＡ−８Ｗｃ・・°・°
°スイッナ、 ａ、Ｃ・・・・・・信号入力端子、ｂ、
ｄ・・・・・・帰還端子、ｅ・・・・・・接地端子、ｆ
、ｇ・・・・・・出力端子、ｈ・・・・・・電称供給端
子、ｉ・・・・・・ＢＴＬＪ４１ｆｉ達端子、ｊ・・・
・・・切換え端子。
り図である。 第２図は従来のＢＴＬアンプの一例を示す回路プロ、り
図である。 第３図は本発明の一実施例を示す回路ブロック図でおる
。 １００・・・・・・集積回路、２００，３００・・・・
・・負帰還電力ｔＪ＃１幅回路、４００・・・・・・切
換え回路、８Ｗ、〜ＳＷ。 ・・・・・・クイ２才回路、Ｖｓ、〜Ｖｓ、・・・・・
・信号源、Ｒ８−Ｒ１・・・・・抵抗、ＫＬ１〜ＫＬ、
・・・・・・負荷抵抗、Ｃ１〜Ｃ。 ・・・・・・コンテンプ、５ＷａＡ−８Ｗｃ・・°・°
°スイッナ、 ａ、Ｃ・・・・・・信号入力端子、ｂ、
ｄ・・・・・・帰還端子、ｅ・・・・・・接地端子、ｆ
、ｇ・・・・・・出力端子、ｈ・・・・・・電称供給端
子、ｉ・・・・・・ＢＴＬＪ４１ｆｉ達端子、ｊ・・・
・・・切換え端子。
Claims (1)
- 非反転及び反転入力端子と出力端子とを有する第１の負
・帰還電力増幅回路と、前記第１の負帰還電力増幅回路
と同一構成の第２の負帰還電力増幅回路と、前記第１の
負帰還電力増幅回路の非反転入力端子に接続される纂１
の信号入力端子と、前記第２の負帰還電力増幅回路の非
反転入力端子と第２の信号入力端子との閾に設けられ前
記第２の負帰還電力増幅回路の非反転入力端子を第２の
信号入力端子より分離または接続する第１のスイッチ回
路と、前記第１の負帰還電力増幅回路の非反転入力端子
と前記第２の信号入力端子との闇に設けられ前記第１゛
の負帰還電力増幅回路の非反転入力端子を前記第２の信
号入力端子より分離または接続する第２のスイッチ回路
と、前記ＷＪ１の負帰還電力増幅回路の出力端子と前記
第２の負帰還電力増幅回路の反転入力端子との間に設け
られ前記第１の負帰還電力増１階回路の出力端子を前記
第２の負帰還を力増幅回路の反転入力端子より分喉また
は接続する第３のスイッチ回路と、前記第１のスイッチ
回路の状態と前記第２及び第３のスイッチ回路の状態と
を互いに逆の状態となる様に制御する切換え回路と、前
記切換え回路を駆動する切換え端子とを含むことを特徴
とする来秋回路装置。
Priority Applications (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56194151A JPS5895412A (ja) | 1981-12-02 | 1981-12-02 | 集積回路装置 |
| US06/446,131 US4494077A (en) | 1981-12-02 | 1982-12-02 | Amplifier system switchable between two amplifying operations |
| US06/639,296 US4596957A (en) | 1981-12-02 | 1984-08-10 | Amplifier system switchable between two amplifying operations |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56194151A JPS5895412A (ja) | 1981-12-02 | 1981-12-02 | 集積回路装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5895412A true JPS5895412A (ja) | 1983-06-07 |
Family
ID=16319760
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56194151A Pending JPS5895412A (ja) | 1981-12-02 | 1981-12-02 | 集積回路装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5895412A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6385917U (ja) * | 1986-11-21 | 1988-06-04 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4834654A (ja) * | 1971-09-08 | 1973-05-21 | ||
| JPS4837602B1 (ja) * | 1972-07-04 | 1973-11-12 |
-
1981
- 1981-12-02 JP JP56194151A patent/JPS5895412A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS4834654A (ja) * | 1971-09-08 | 1973-05-21 | ||
| JPS4837602B1 (ja) * | 1972-07-04 | 1973-11-12 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6385917U (ja) * | 1986-11-21 | 1988-06-04 |
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