JPS59160927A - 動作時素回路 - Google Patents
動作時素回路Info
- Publication number
- JPS59160927A JPS59160927A JP3632883A JP3632883A JPS59160927A JP S59160927 A JPS59160927 A JP S59160927A JP 3632883 A JP3632883 A JP 3632883A JP 3632883 A JP3632883 A JP 3632883A JP S59160927 A JPS59160927 A JP S59160927A
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- Japan
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- circuit
- relay
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- 238000007599 discharging Methods 0.000 claims description 2
- 239000003990 capacitor Substances 0.000 description 23
- 230000003111 delayed effect Effects 0.000 description 2
- 238000010586 diagram Methods 0.000 description 2
- 230000000694 effects Effects 0.000 description 2
- 230000010355 oscillation Effects 0.000 description 2
- 239000002253 acid Substances 0.000 description 1
- 230000007423 decrease Effects 0.000 description 1
Landscapes
- Relay Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業−４−の利用分野
本発明は、直流入力電圧が印加された後所定の時間経過
後にリレーを動作させる動作時素回路、例えは自動列車
制御袋ガ（以下ＡＴＣ装置と称する）、自動列車停止ｌ
−装置（以下ＡＴＳ装置と称する）、路切制御装置また
はその他の各種保安装置に使用されるフェールセーフ形
の動作時素回路に関する。
後にリレーを動作させる動作時素回路、例えは自動列車
制御袋ガ（以下ＡＴＣ装置と称する）、自動列車停止ｌ
−装置（以下ＡＴＳ装置と称する）、路切制御装置また
はその他の各種保安装置に使用されるフェールセーフ形
の動作時素回路に関する。
従来技術とその問題点
この種の動作時素回路の従来例としては、モータ動作に
よる動作時素リレーまたは２個のリレーによって構成さ
れた動作時素リレーを用いたものが知られている。しか
しなから、これらのものは、外形が大きく重量が大であ
り、高価であると言う難点がある上に、精度が±２０％
程度と低い。
よる動作時素リレーまたは２個のリレーによって構成さ
れた動作時素リレーを用いたものが知られている。しか
しなから、これらのものは、外形が大きく重量が大であ
り、高価であると言う難点がある上に、精度が±２０％
程度と低い。
本発明の目的
本発明は、小型軽量で、コストが安価であり、しかも時
素設定を高精度で行なうことができるフェールセーフ性
の高い動作時素回路を提供することを目的とする。
素設定を高精度で行なうことができるフェールセーフ性
の高い動作時素回路を提供することを目的とする。
本発明の構成
上記目的を達成するため、本発明は、直流入力電圧か印
加された後所定の時間経過後にリレーを動作させる動作
時素回路において、前記入力電圧印加と同時に動作時間
設定を行なう動作時間設定回路と、前記リレーに直列に
接続され前記動作時間設定回路の出・カによって制御さ
れるスインチ回路とを備え、前記動作時間設定回路は、
前記入力端子の印加から所定の時間経過後に前記スイッ
チ回路をオン状態にする回路と、前記入力電圧の印加と
同時に抵抗を通してコンデンサに充電を開始し前記スイ
ンチ回路がオン状ｙルになった時に該充゛電電荷を放電
させて前記リレーを動作ごせる回路と、該リレーの動作
後は前記入力電圧がなくなるまで該リレーを自己保持す
る回路とを備え、前記リレーの抵抗値と前記抵抗の値を
、所定の動作時間に比べて充分小さい時間に前記スイッ
チ回路がオン状態になっても前記充電電荷では前記リレ
ーの動作電圧まで達しないように設定することにより、
回路故障時に所定の動作時間より短い時間ではｎ１ｊ記
リレが動作しないようにしたことを特徴とする。
加された後所定の時間経過後にリレーを動作させる動作
時素回路において、前記入力電圧印加と同時に動作時間
設定を行なう動作時間設定回路と、前記リレーに直列に
接続され前記動作時間設定回路の出・カによって制御さ
れるスインチ回路とを備え、前記動作時間設定回路は、
前記入力端子の印加から所定の時間経過後に前記スイッ
チ回路をオン状態にする回路と、前記入力電圧の印加と
同時に抵抗を通してコンデンサに充電を開始し前記スイ
ンチ回路がオン状ｙルになった時に該充゛電電荷を放電
させて前記リレーを動作ごせる回路と、該リレーの動作
後は前記入力電圧がなくなるまで該リレーを自己保持す
る回路とを備え、前記リレーの抵抗値と前記抵抗の値を
、所定の動作時間に比べて充分小さい時間に前記スイッ
チ回路がオン状態になっても前記充電電荷では前記リレ
ーの動作電圧まで達しないように設定することにより、
回路故障時に所定の動作時間より短い時間ではｎ１ｊ記
リレが動作しないようにしたことを特徴とする。
実施例
第１図は本発明に係る動作時素回路の電気回路接続図で
ある。図において、ｆＲは条件入力用の接点、１は該接
点ｆＲの動作条件で直流入力電圧Ｅを印加する入力端子
、２は動作時間設定回路、３は該動作時間設定回路２の
出力によって制御されるスイッチ回路であり、この実施
例ではサイリスタＳＣＨによって構成しである。
ある。図において、ｆＲは条件入力用の接点、１は該接
点ｆＲの動作条件で直流入力電圧Ｅを印加する入力端子
、２は動作時間設定回路、３は該動作時間設定回路２の
出力によって制御されるスイッチ回路であり、この実施
例ではサイリスタＳＣＨによって構成しである。
前記動作時間設定回路２は、ユニジャンクションＩ・ラ
ンジスタＴｒ、抵抗Ｒ１−Ｒ４及びコンデンサ０１等に
よる弛張発振回路と、抵抗Ｒ５及びコンデンサＣ２によ
る時定数充電回路とを、条件入力ライン４に並列に接続
すると共に、該時定数充電回路の接続点よりは後の条件
入力ライン４に、リレーＲＹ及びそのフロント接点ｆ
ＲＹＩ を直列に接続し、リレーＲＹ及び接点ｆＲ”ｌ
ｌの接続点と前記コンデンサＣ２の一端との間にタイオ
ードＤ１を接続した回路構成となっている。ｆ ＲＹ２
はリレーＲＹの接点、Ｒ６は該接点ｆ ＲＹ２が構成さ
れたときコンデンサＣ２に充電された電荷を放電する抵
抗である。
ンジスタＴｒ、抵抗Ｒ１−Ｒ４及びコンデンサ０１等に
よる弛張発振回路と、抵抗Ｒ５及びコンデンサＣ２によ
る時定数充電回路とを、条件入力ライン４に並列に接続
すると共に、該時定数充電回路の接続点よりは後の条件
入力ライン４に、リレーＲＹ及びそのフロント接点ｆ
ＲＹＩ を直列に接続し、リレーＲＹ及び接点ｆＲ”ｌ
ｌの接続点と前記コンデンサＣ２の一端との間にタイオ
ードＤ１を接続した回路構成となっている。ｆ ＲＹ２
はリレーＲＹの接点、Ｒ６は該接点ｆ ＲＹ２が構成さ
れたときコンデンサＣ２に充電された電荷を放電する抵
抗である。
次に第２ＶＩのタイムチャートを８！卵して、本発明に
係る動作時素回路の動作を説明する。
係る動作時素回路の動作を説明する。
ます、第２図（ａ）に示すように、接げ７． ｆ Ｒが
ｔｏ時でオンとなりｔ２時でオフとなる条件で動作した
場合、入力端子ｌには第２１図（ｂ）に示すように、接
点ｆＲの動作条件に応した直流入力電圧Ｅか印加される
。直流入力電圧Ｅが印加されると、コンデンサＣ２か時
定数Ｒ５，Ｃ２で第２図（ｄ）の如く充電されて行く。
ｔｏ時でオンとなりｔ２時でオフとなる条件で動作した
場合、入力端子ｌには第２１図（ｂ）に示すように、接
点ｆＲの動作条件に応した直流入力電圧Ｅか印加される
。直流入力電圧Ｅが印加されると、コンデンサＣ２か時
定数Ｒ５，Ｃ２で第２図（ｄ）の如く充電されて行く。
コンデンサＣ２の端子電圧はタイオートＤ１及びリレー
ＲＹを通してスイッチ回路３を構成するサイリスタＳＣ
Ｒのアノード、カソード間に印加される。
ＲＹを通してスイッチ回路３を構成するサイリスタＳＣ
Ｒのアノード、カソード間に印加される。
−・方、コンデンサＣ２に対する充電と並列的に、弛張
発振回路を構成するコンデンサＣ１が時定数Ｒ１，Ｃ１
で第２図（Ｃ）に示すり１１＜充電されて行く。乙の充
電作用によりコンデンサＣ１の端子’ｉ’ｌｉ：圧か、
条件入力時ｔｏより時間Ｔｄだけ遅しタｔ １ 時に、
ユニジャンクショントランジスタＴｒのトリガ電圧Ｖｐ
を越えると、コンデンサＣＩに蓄積された充電電荷がユ
ニジャンクショントランジスタＴｒ及び抵抗Ｒ３を通し
て急激に放電され、ユニジャンクショントランジスタＴ
ｒがオンとなり、サイリスタＳＣＲで構成されたスイッ
チ回路３かｔ１時でオン状態となる。
発振回路を構成するコンデンサＣ１が時定数Ｒ１，Ｃ１
で第２図（Ｃ）に示すり１１＜充電されて行く。乙の充
電作用によりコンデンサＣ１の端子’ｉ’ｌｉ：圧か、
条件入力時ｔｏより時間Ｔｄだけ遅しタｔ １ 時に、
ユニジャンクショントランジスタＴｒのトリガ電圧Ｖｐ
を越えると、コンデンサＣＩに蓄積された充電電荷がユ
ニジャンクショントランジスタＴｒ及び抵抗Ｒ３を通し
て急激に放電され、ユニジャンクショントランジスタＴ
ｒがオンとなり、サイリスタＳＣＲで構成されたスイッ
チ回路３かｔ１時でオン状態となる。
ｔ１時ではコンデンサＣ２か抵抗Ｒ５を通して既に充分
に充電されているので、サイリスクＳＣＲがオン状態に
なるｔｉ時に、コンデンサＣ２→タイオードＤｉ→リレ
ーＲＹ→サイリスタＳＣＲの回路ループで、コンデンサ
Ｃ２に蓄積されていた電荷が放電され、リレーＲＹが動
作する。従って、第２図（ｅ）に示す如く、条件入力時
ｔｏより時間Ｔｄだけ遅れた動作時素Ｔｄが街られる。
に充電されているので、サイリスクＳＣＲがオン状態に
なるｔｉ時に、コンデンサＣ２→タイオードＤｉ→リレ
ーＲＹ→サイリスタＳＣＲの回路ループで、コンデンサ
Ｃ２に蓄積されていた電荷が放電され、リレーＲＹが動
作する。従って、第２図（ｅ）に示す如く、条件入力時
ｔｏより時間Ｔｄだけ遅れた動作時素Ｔｄが街られる。
この放電作用により、コンデンサｃ２の蓄積電荷は急激
に減少するか、リレーＲＹの動作によりその＋ｉｉＩに
挿入した接点ｆＲＹＩが閉しるので、リレーＲＹか該接
点ｆＲＹｌによって自己保すされる。この自己保持動作
は条件人力がなくなるｔ２時まで継続する。従って動作
時素Ｔｄで、動作時間ＴＩ２の動作時素回路が得られる
。
に減少するか、リレーＲＹの動作によりその＋ｉｉＩに
挿入した接点ｆＲＹＩが閉しるので、リレーＲＹか該接
点ｆＲＹｌによって自己保すされる。この自己保持動作
は条件人力がなくなるｔ２時まで継続する。従って動作
時素Ｔｄで、動作時間ＴＩ２の動作時素回路が得られる
。
上述のように、本発明に係る動作時素回路は、ユニジャ
ンクショントランジスタＴｒ、ダイオードＤＩ、サイリ
スタＳＣＲまたはコンデンサＣ１、Ｃ２及び抵抗Ｒ１−
Ｒ６等の電子部品によって構成されているため、従来の
モータ動作による動作時素リレー或いは２個のリレーに
よる動作時素リレーに比へて、著しく小型軽量化され、
かつコストか安価になる。しかも、動作時素Ｔｄはコン
デンサ（Ｃ１、Ｃ２）及び抵抗（Ｒ１、Ｒ５）によって
定まる時定数を可変することにより、高精度で簡単に調
整することができる。このため、精度の高い動作時素回
路が得られる。
ンクショントランジスタＴｒ、ダイオードＤＩ、サイリ
スタＳＣＲまたはコンデンサＣ１、Ｃ２及び抵抗Ｒ１−
Ｒ６等の電子部品によって構成されているため、従来の
モータ動作による動作時素リレー或いは２個のリレーに
よる動作時素リレーに比へて、著しく小型軽量化され、
かつコストか安価になる。しかも、動作時素Ｔｄはコン
デンサ（Ｃ１、Ｃ２）及び抵抗（Ｒ１、Ｒ５）によって
定まる時定数を可変することにより、高精度で簡単に調
整することができる。このため、精度の高い動作時素回
路が得られる。
次に本発明に係る動作時素回路のフェールセーフ性につ
いて述べる。
いて述べる。
まず、スイッチ回路３を構成するサイリスタＳＣＲが集
面導通し続けるような故障を生じたときは、コンデンサ
Ｃ２の端子電圧は抵抗Ｒ５とリレーＲＹとの分圧となる
。ここで、抵抗Ｒ５の値及びリレーＲＹの抵抗値の関係
を、リレーＲＹに印加される分圧電圧が正常動作時の電
圧レベルに比較して低く、リレーＲＹがこの分圧電圧で
は動作しないように酸室しであるから、コンデンサＣ２
にはリレーＲＹを動作させるのに必要な電荷が蓄積され
ず−、リレーＲＹは動作しない。従ってフェールセーフ
性が確保される。
面導通し続けるような故障を生じたときは、コンデンサ
Ｃ２の端子電圧は抵抗Ｒ５とリレーＲＹとの分圧となる
。ここで、抵抗Ｒ５の値及びリレーＲＹの抵抗値の関係
を、リレーＲＹに印加される分圧電圧が正常動作時の電
圧レベルに比較して低く、リレーＲＹがこの分圧電圧で
は動作しないように酸室しであるから、コンデンサＣ２
にはリレーＲＹを動作させるのに必要な電荷が蓄積され
ず−、リレーＲＹは動作しない。従ってフェールセーフ
性が確保される。
コンデンサＣ１の端子の断線等により、条件入力か与え
られた直後にサイリスタＳＣＲが導通状態となった場合
も、上記と同様の回路作用になり、フェールセーフ性が
確保される。
られた直後にサイリスタＳＣＲが導通状態となった場合
も、上記と同様の回路作用になり、フェールセーフ性が
確保される。
またユニジャンクショントランジスタＴｒ、ダイオ−１
’Ｄｌ、サイリスタＳＣＲまたはコンデンサＣ１、Ｃ２
の各々の開放もしくは短絡、更には条件入力接点ｆＲの
開放に対しても、リレーＲＹが動作しないから、フェー
ルセーフ性が確保される。
’Ｄｌ、サイリスタＳＣＲまたはコンデンサＣ１、Ｃ２
の各々の開放もしくは短絡、更には条件入力接点ｆＲの
開放に対しても、リレーＲＹが動作しないから、フェー
ルセーフ性が確保される。
本発明の効果
以−１，述へたように、本発明に係る動作時素回路は、
直流入力電圧が印加された後所定の時間経過後にリレー
を動作させる動作時素回路において、前記入力端子印加
とｌｉ１時に動作時間設定を行なう動作時間設定回路と
、前記リレーに直列に接続され前記動作時間設定回路の
出力によって制御されるスインチ回路とを備え、前記動
作時間設定回路は、１ｉｅｆ記、入力電圧の印加がら所
定の時間経過後に前記スインチ回路をオン状態にする回
路と、前記入力電圧の印加と同時に抵抗を通してコンデ
ンサに充電を開始し前記スインチ回路がオン状ｙバーに
なった時に該充電電荷を放電させてＨｆＪ記リレーを動
作させる回路と、該リレーの動作後は前記入力電圧がな
くなるまで該リレーを自己保持する回路とを備え、前記
リレーの抵抗値と前記抵抗の値を、所定の動作時間に比
べて充分小さい時間に前記スインチ回路がオン状態にな
っても前記充電電荷、では前記リレーの動作電圧まで達
しないように設定することにより、回路故障時に所定の
動作時間よりｈｙい時間では動作しないようにしたこと
を特徴とするから、フェールセーフ性が非常に高く、し
かも従来のものに比べて小型軽量で、コストが安価であ
り、ＡＴＣ装置、ＡＴＳ装置、踏切制御装置またはその
他の各種保安装置等に使用するのに誠に好適な動作時素
回路を提供することができる。
直流入力電圧が印加された後所定の時間経過後にリレー
を動作させる動作時素回路において、前記入力端子印加
とｌｉ１時に動作時間設定を行なう動作時間設定回路と
、前記リレーに直列に接続され前記動作時間設定回路の
出力によって制御されるスインチ回路とを備え、前記動
作時間設定回路は、１ｉｅｆ記、入力電圧の印加がら所
定の時間経過後に前記スインチ回路をオン状態にする回
路と、前記入力電圧の印加と同時に抵抗を通してコンデ
ンサに充電を開始し前記スインチ回路がオン状ｙバーに
なった時に該充電電荷を放電させてＨｆＪ記リレーを動
作させる回路と、該リレーの動作後は前記入力電圧がな
くなるまで該リレーを自己保持する回路とを備え、前記
リレーの抵抗値と前記抵抗の値を、所定の動作時間に比
べて充分小さい時間に前記スインチ回路がオン状態にな
っても前記充電電荷、では前記リレーの動作電圧まで達
しないように設定することにより、回路故障時に所定の
動作時間よりｈｙい時間では動作しないようにしたこと
を特徴とするから、フェールセーフ性が非常に高く、し
かも従来のものに比べて小型軽量で、コストが安価であ
り、ＡＴＣ装置、ＡＴＳ装置、踏切制御装置またはその
他の各種保安装置等に使用するのに誠に好適な動作時素
回路を提供することができる。
第１図は本発明に係る動作時素回路の電気回路接続図、
第２図（ａ）〜、（ｅ）は同しく各部のタイムチャート
である。
第２図（ａ）〜、（ｅ）は同しく各部のタイムチャート
である。
Claims (1)
- 直流入力電圧が印加された後所定のＩｔ！１間経過後に
リレーを動作させる動作時素回路において、前記入力端
子印加と同時に動作時間設定を行なう動作時間設定回路
と、前記リレーに直列に接続され前記動作時間設定回路
の出力によって制ｉ２１されるスイッチ回路とを備え、
前記動作時間設定回路は、前記入力電圧の印加から所だ
の時間経過後に前記スイ・ンチ回路をオン状態にする回
路と ｆｉｉｉ記入力重入力電圧と同時に抵抗を通して
コンデンサに充電を開始し前記スイッチ回路かオン状態
になった時に該充電電荷を放電させて前記リレーを動作
させる回路と、該リレーの動作後は前記入力電圧がなく
なるまで該リレーを自己保持する回路とを備え、前記リ
レーの抵抗値と前記抵抗の値を、所定の動作時間に比べ
て充分小さい時間に前記スイッチ回路がオン状態になっ
ても前記充電電荷では１ｉｉｊ記リレーの動作電圧まで
達しないように設定することにより、回路故障時に所定
の動作時間より短いｎ！１間では動作しないようにした
ことを特徴とする動作時素回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3632883A JPS59160927A (ja) | 1983-03-04 | 1983-03-04 | 動作時素回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3632883A JPS59160927A (ja) | 1983-03-04 | 1983-03-04 | 動作時素回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59160927A true JPS59160927A (ja) | 1984-09-11 |
| JPH0526289B2 JPH0526289B2 (ja) | 1993-04-15 |
Family
ID=12466765
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3632883A Granted JPS59160927A (ja) | 1983-03-04 | 1983-03-04 | 動作時素回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59160927A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2013191200A (ja) * | 2012-02-16 | 2013-09-26 | Canon Inc | 情報処理装置、情報処理装置の制御方法 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5424034U (ja) * | 1977-07-21 | 1979-02-16 |
-
1983
- 1983-03-04 JP JP3632883A patent/JPS59160927A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5424034U (ja) * | 1977-07-21 | 1979-02-16 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2013191200A (ja) * | 2012-02-16 | 2013-09-26 | Canon Inc | 情報処理装置、情報処理装置の制御方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0526289B2 (ja) | 1993-04-15 |
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