JPS593557A - スタツクメモリ制御方式 - Google Patents

スタツクメモリ制御方式

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Publication number
JPS593557A
JPS593557A JP57112866A JP11286682A JPS593557A JP S593557 A JPS593557 A JP S593557A JP 57112866 A JP57112866 A JP 57112866A JP 11286682 A JP11286682 A JP 11286682A JP S593557 A JPS593557 A JP S593557A
Authority
JP
Japan
Prior art keywords
stack memory
return
instruction
stack
address
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP57112866A
Other languages
English (en)
Inventor
Katsumi Kubo
久宝 克己
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP57112866A priority Critical patent/JPS593557A/ja
Publication of JPS593557A publication Critical patent/JPS593557A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F9/00Arrangements for program control, e.g. control units
    • G06F9/06Arrangements for program control, e.g. control units using stored programs, i.e. using an internal store of processing equipment to receive or retain programs
    • G06F9/44Arrangements for executing specific programs
    • G06F9/448Execution paradigms, e.g. implementations of programming paradigms
    • G06F9/4482Procedural
    • G06F9/4484Executing subprograms

Landscapes

  • Engineering & Computer Science (AREA)
  • Software Systems (AREA)
  • Theoretical Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • General Physics & Mathematics (AREA)
  • Executing Machine-Instructions (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 囚 発明の技術分野 本発明はリンク命令により指定のアドレスへ分岐すると
ともに、スタックメモリにMff先アドレスをセーブし
、リターン命令に↓9#戻り先アドレスに戻る分岐方式
を有する7−タ処理装置におけるスタックメモリ制御方
式に関するものであり、特にスタックメモリのアンダン
ロー検出処理に関するものである。
(B)  技術の背景 リンク命令により指定のアドレスへ分岐し、リターン命
令により、リンク命令の次の戻り先アトにセーブしてお
き、リターン命令が出るとスタックしであるアドレスへ
ブランチさせる方式が一般的である。また、スタックメ
モリの段数は限られており、マイクロプログラムのミス
を防ぐため等し過ぎを検出することが行なわれる。この
ようなスタ、クメそりを有するデータ処理装置は例えば
特開昭46−7761号公報(特公昭56−4943号
公報)に示されているように極めて一般的なものである
C従来技術と問題点 上述の如きスタックメモリを利用して命令の分岐制御を
行なう従来のデータ処理装置においてはスタックメモリ
のアンダフローすなわち、スタックカウンタがゼロにも
かかわらずリターン命令を発した場合には、マイクロプ
ログラムにとっての他の異常状態と同様に、アンダフロ
ーが起きた場合の専用の割込み回路等を設けたり、アン
ダフローの信号を割込み制御回路に出す必要があった。
■)発明の目的 従って本発明の目的は、上述の如き欠点を解消し、スタ
ックカウンタがゼロを示しているにもかかわらず、マイ
クロプログラムがリターン命令を発しスタックメモリが
アンダフローを起したようが場合に、このアンダーフロ
ーに対する異常処理プログラムへの異常通知を特別の割
り込み回路。
割り込み制御回路を介することなく容易に行なえるよう
にすることにある。
(ト)発明の構成 この目的を達成するために本発明は、リンク命令により
指定のアドレスへ分熱するとともに、スタックメモリに
戻り先アドレスをセーブし、リターン命令により該戻り
先アドレスに戻る分岐方式を有するデータ処理装置であ
って、前記リターン命令が発行された時前記スタックメ
モリの最後段に、スタックカウンタリセット命令が発行
された時に前記スタックメモリの初段に、アンダーンロ
ー処理プログラムの先頭アドレスをセットする手段を有
し、アンダーフロー検出処理を行なうことを特徴として
いる。
(ト)発明の実施例 図は本発明の一実施例を示すものであり、図中STMは
スタックメモリ、STCはスタックカウンタ、pcVi
プログラムカウンタ、LINKtjリンク命令を表わす
信号、RTNはリターン命令を表わす信号、R8TST
Cはリセットスタックカウンタ命令を表わす信号、C8
はコントロールストレッジ、AFADはアンダーフロー
処理マイクロプログラムルーチンの先頭アドレスを示す
周知の通りプログラムカウンタpci;を所定のプログ
ラム実行のために読出丁べきコントロールストレッジC
8内の命令アドレスを指示するものであり、1命令の読
み出し後自動的に歩進される。
通常はこの歩進により、プログラムはシーケンシャルに
実行される。
一方コントロールストレッジC8から読み出された命令
がリンク命令(LINK)すなわちサブルーチン呼び出
し命令やジャンプ命令であるときには、元のプログラム
は中断され、他のプログラムルーチンに分岐し、この他
のプログラムルーチンの終了時にリターン命令(RTN
)によって元のプ[1グラムに戻るように制御が行なわ
れる。
この場合、中断された元のプログラムへの戻り先アドレ
スすなわちプログラムカウンタPCI装置かれている次
命令アドレスはスタックメモリSTMにセーブされる。
本実施例はスタックメモリSTMがSTO〜5T3tで
4段で構成された例を示す。
リンク命令LINKによってスタックメモリSTMの初
段STOにスタックされた戻り先アドレスは分岐先のプ
ログラムで更にリンク命令LINKが発せられ他のプロ
グラムへの分岐が生じた時にはスタックメモリSTMの
次段5TIK移され、新しい戻り先アドレスがSTOに
セーブされる。同様にしてリンク命令LINKが発せら
れる毎に戻り先アドレスはスタックメモ987M中をシ
フ)されながらセーブされる。
分岐先のプログラムが終了し、リターン命令PTNが発
せられるとスタックメモリSTMの初段STOにセーブ
されていた戻り先アドレスが取り出され=ry)o−A
/ストレ、ジcsの読み出しアドレスとされる。そして
、それぞれスタックメモリS1’Mの後段STI〜ST
3にセーブされていた戻り先アドレスはそれぞれ1段づ
つ移動される。
従って本実施例では4重の分岐が可能でおる。
このような分岐方式においてはスタックメモリSTMの
段数は限られており、マイクロプログラムのミスを防ぐ
ため等の目的でスタックのカウンタSTCを設けて、リ
ンク命令の出し過ぎや、リンク命令に対するリターン命
令の出し過ぎを検出することも実施される。
0VDETはスタックオーバーフローを検出するオ−バ
ーフロー検出回路である。
従来の方式では、スタックカウンター5T(4)アンダ
ーフローすなわち、スタックカウンタがゼロにもかかわ
らずリターン命令を発した場合には、マイクロプログラ
ムにとっての他の異常状態と同様+C,アンダフローが
起きた場合の専用の割込み回路等を設けたり、アンダフ
ローの信号線を割込み制御回路に出すなどしていた。
本発明では図に示すように、リターン命令RTNが出さ
れた時にアンダーフロー処理プログラムの先頭番地AF
ADがスタックメモリSTMの最後段ST3に書き込む
ようにされている。従って、リンク命令の数似上すなわ
ちスタックカウンタSTCがOあるにもかかわらずリタ
ーン命令が出された場合、戻り先番地のかわりに自動的
にスタックアンダーフロー処理プログラムの先頭番地が
あたかも戻シ先番地であるかのようにスタックメモlj
sTMから出され、何ら割り込み処理回路、割り込み制
御回路を介することなく、アンダー70−処理ルーチン
に入ることができる。
また、リンク先で、マイクロプログラムが元の処理の続
行は不要だと判断した場合にスタックカウンタをリセッ
トする必要もある。
この場合も同様にスタックメモリSTMの初段STOに
アンダーフロー処理プログラムの先頭番地AFADが書
き込まれ、自動的にアンダーフロー処理プログラムに入
ることができる。
わらず、マイクロプログラムがリターン命令を発しスタ
ックメモリがアンダーフローを起したような場合に、こ
のアンダーフローに対する異常処理プログラムへの異常
通知を特別の割り込み回路。
【図面の簡単な説明】
図は本発明の一実施例を示すものでおり、図中STMは
スタックメモリ、STCはスタックカウンタ、PCはプ
ログラムカウンタ、LINKはリンク命令を表わす信号
、RTNはリターン命令を表わす信号、R8TSTCは
リセットスタックカウンタ命令を表わす信号、C8はコ
ントロールストレッジ、AFADはアンダーフロー処理
マイクロプログラムルーチンの先頭アドレスを示す。

Claims (1)

    【特許請求の範囲】
  1. リンク命令により指定のアドレスへ分岐するとともに、
    スタックメモリに戻り先アドレスをセーブし、リターン
    命令により該戻シ先アドレスに戻る分岐方式を有するデ
    ータ処理装置で6って、前記リターン命令が発行された
    時前記スタックメモリの最後段に、スタック力ウンタリ
    セ、ト命令が発行された時に前記スタックメモリの初段
    に、アン・ダーツロー処理プログラムの先頭アドレスを
    セットする手段を有し、アンダーフロー検出処理を行な
    うことを特徴とするスタックメモリ制御方式。
JP57112866A 1982-06-30 1982-06-30 スタツクメモリ制御方式 Pending JPS593557A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP57112866A JPS593557A (ja) 1982-06-30 1982-06-30 スタツクメモリ制御方式

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP57112866A JPS593557A (ja) 1982-06-30 1982-06-30 スタツクメモリ制御方式

Publications (1)

Publication Number Publication Date
JPS593557A true JPS593557A (ja) 1984-01-10

Family

ID=14597485

Family Applications (1)

Application Number Title Priority Date Filing Date
JP57112866A Pending JPS593557A (ja) 1982-06-30 1982-06-30 スタツクメモリ制御方式

Country Status (1)

Country Link
JP (1) JPS593557A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6118898A (ja) * 1984-07-06 1986-01-27 株式会社日立製作所 放射性廃棄物固化体及びその製造方法

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6118898A (ja) * 1984-07-06 1986-01-27 株式会社日立製作所 放射性廃棄物固化体及びその製造方法

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