JPS594330Y2 - 基準電圧回路 - Google Patents
基準電圧回路Info
- Publication number
- JPS594330Y2 JPS594330Y2 JP8459878U JP8459878U JPS594330Y2 JP S594330 Y2 JPS594330 Y2 JP S594330Y2 JP 8459878 U JP8459878 U JP 8459878U JP 8459878 U JP8459878 U JP 8459878U JP S594330 Y2 JPS594330 Y2 JP S594330Y2
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- JP
- Japan
- Prior art keywords
- reference voltage
- voltage
- voltage side
- power supply
- transistor
- Prior art date
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- Continuous-Control Power Sources That Use Transistors (AREA)
Description
【考案の詳細な説明】
本考案は基準電圧を所望の一定電圧でバイアスすること
のできる基準電圧回路に関するものである。
のできる基準電圧回路に関するものである。
基準電圧を一定電圧の上に設定するような基準電圧回路
として第1図に示すようなものがあった。
として第1図に示すようなものがあった。
すなわち第1図において、1は直流電源、2は基準電圧
発生器、3はツェナーダイオードである。
発生器、3はツェナーダイオードである。
直流電源1の高圧側は基準電圧発生器2の高圧側入力端
に接続され、直流電源1の低圧側はツェナーダイオード
3を介して基準電圧発生器2の低圧側入力端に接続され
ている。
に接続され、直流電源1の低圧側はツェナーダイオード
3を介して基準電圧発生器2の低圧側入力端に接続され
ている。
基準電圧発生器2の低圧側入力端はその低圧側出力端に
結合されている。
結合されている。
前記ツェナーダイオード3はそのアノードが直流電源1
の低圧側に、カソードが基準電圧発生器2の低圧側入力
端にそれぞれ接続されている。
の低圧側に、カソードが基準電圧発生器2の低圧側入力
端にそれぞれ接続されている。
このような構成において、回路に所定の電流i。
が流れるとツェナーダイオード3に一定のツェナー電圧
V2が生ずる。
V2が生ずる。
また、基準電圧発生器2は一定の基準電圧Vrefを出
力する。
力する。
この場合、基準電圧Vrefは直流電源1の低圧側より
みるとツェナー電圧■でバイアスされたことになってい
る。
みるとツェナー電圧■でバイアスされたことになってい
る。
しかし、この一定のツェナー電圧v2はツェナーダイオ
ード3の特性に依存し、通常はIV程度のバラツキがあ
り、任意の一定電圧を得ることは困難な欠点がある。
ード3の特性に依存し、通常はIV程度のバラツキがあ
り、任意の一定電圧を得ることは困難な欠点がある。
本考案は、このような欠点を除き、簡単な回路によって
所望のバイアス電圧を得てこれによって基準電圧をバイ
アスすることのできる基準電圧回路を実現しようとした
ものである。
所望のバイアス電圧を得てこれによって基準電圧をバイ
アスすることのできる基準電圧回路を実現しようとした
ものである。
以下図面を用いて本考案を詳細に説明する。
第2図は本考案に係る基準電圧回路の一実施例を示す電
気的構成説明図である。
気的構成説明図である。
第2図において、第1図と同等素子には同一符号を付し
、その説明を省略する。
、その説明を省略する。
21はトランジスタ、22.23は抵抗値がそれぞれR
1,R2の抵抗器である。
1,R2の抵抗器である。
トランジスタ21のエミッタは基準電圧発生器2の低圧
側入力端に、そのコレクタは直流電源1の低圧側にそれ
ぞれ接続されている。
側入力端に、そのコレクタは直流電源1の低圧側にそれ
ぞれ接続されている。
一端が基準電圧発生器2の高圧側出力端に接続された抵
抗値R1の抵抗器22の他端は、トランジスタ21のベ
ースに接続されると共に、抵抗値R2の抵抗器23を介
して直流電源1の低圧側に接続されている。
抗値R1の抵抗器22の他端は、トランジスタ21のベ
ースに接続されると共に、抵抗値R2の抵抗器23を介
して直流電源1の低圧側に接続されている。
このような構成において、トランジスタ21のベース・
コレクタ間に生じた電圧VBは次式で表わされる。
コレクタ間に生じた電圧VBは次式で表わされる。
一旦2
VB−(Vref+VBE) (1)1
ここに、VBE : )ランジスタ21のベース・エミ
ッタ間電圧 トランジスタ21のエミッタ・コレクタ間電圧Vは ■=VB+VBE 2 −”Vref+ (1+、 ) VBE (2
)RI R1 となる。
ッタ間電圧 トランジスタ21のエミッタ・コレクタ間電圧Vは ■=VB+VBE 2 −”Vref+ (1+、 ) VBE (2
)RI R1 となる。
(2)式から明らかなように抵抗値R1,R2を適当な
値に選定することにより任意の一定の電圧いわゆるバイ
アス電圧■を得ることができる。
値に選定することにより任意の一定の電圧いわゆるバイ
アス電圧■を得ることができる。
これにより基準電圧発生器2が出力する基準電圧Vre
fを一定のバイアス電圧■でバイアスすることができる
。
fを一定のバイアス電圧■でバイアスすることができる
。
第3図はトランジスタ21のベース・エミッタ間電圧■
BEを温度補償する具体的な電気的構成説明図である。
BEを温度補償する具体的な電気的構成説明図である。
第3図において、ダイオード24.25はその順方向が
電流11の方向と同方向になるように直列接続されて、
抵抗器22と23の間に挿入接続されている。
電流11の方向と同方向になるように直列接続されて、
抵抗器22と23の間に挿入接続されている。
このような構成において、ダイオード31.32に生し
たフォワードドロップ電[Vfがトランジスタ21のベ
ース・エミッタ間電圧VBEに等しいとき、温度補償さ
れたバイアス電圧■は次のようになる。
たフォワードドロップ電[Vfがトランジスタ21のベ
ース・エミッタ間電圧VBEに等しいとき、温度補償さ
れたバイアス電圧■は次のようになる。
この場合も、抵抗値R1,R2を選定することにより任
意の一定のバイアス電圧Vを得て、基準電圧Vrefを
バイアスすることができる。
意の一定のバイアス電圧Vを得て、基準電圧Vrefを
バイアスすることができる。
第4図は、本考案の基準電圧回路を応用して、単−電源
例えば電池などで大型集積回路(以下LSIと略す)を
駆動する場合の電気的構成説明図である。
例えば電池などで大型集積回路(以下LSIと略す)を
駆動する場合の電気的構成説明図である。
第4図において、41は電圧2vDの電池、42は正、
負電源電圧+vD’−voで駆動されると同時に基準電
圧Vrefを要するLSIである。
負電源電圧+vD’−voで駆動されると同時に基準電
圧Vrefを要するLSIである。
この場合、バイアス電圧Vを電池電圧2vDの半分の電
圧VDに設定することにより、基準電圧回路は+vD、
Vrefo及び−vDの各電圧を出力しLSIに供給す
ることができる。
圧VDに設定することにより、基準電圧回路は+vD、
Vrefo及び−vDの各電圧を出力しLSIに供給す
ることができる。
以上説明したように、本考案の基準電圧回路によれば、
所望の一定のバイアス電圧を設定し得えてこれにより基
準電圧をバイアスして出力することができ、特に単一電
源でLSIを駆動する場合に利用して好適である。
所望の一定のバイアス電圧を設定し得えてこれにより基
準電圧をバイアスして出力することができ、特に単一電
源でLSIを駆動する場合に利用して好適である。
第1図は従来の基準電圧回路の説明図、第2図は本考案
に係る基準電圧回路の一実施例を示す電気的構成説明図
、第3図は第2図のトランジスタのベース・エミッタ間
電圧を温度補償する場合の電気的構成説明図、第4図は
第2図回路をLSI駆動に適用した場合の電気的構成説
明図である。
に係る基準電圧回路の一実施例を示す電気的構成説明図
、第3図は第2図のトランジスタのベース・エミッタ間
電圧を温度補償する場合の電気的構成説明図、第4図は
第2図回路をLSI駆動に適用した場合の電気的構成説
明図である。
Claims (1)
- 基準電圧を発生する基準電圧発生器、高圧側が前記基準
電圧発生回路の高圧側入力端に接続された直流電源、前
記基準電圧発生器の高圧側出力端と前記直流電源の低圧
側との間に直列的に接続された少なくとも2個の抵抗器
、前記基準電圧発生器の低圧側出力端に結合された低圧
側入力端にエミッタが接続され前記直流電源の低圧側に
コレクタが接続されかつ前記2個の抵抗器の共通接続点
にベースが接続されたトランジスタを具備し、前記抵抗
器の抵抗値を選定することにより前記トランジスタのエ
ミッタ・コレクタ間の電圧を一定電圧に設定し得えてこ
の一定電圧で前記基準電圧をバイアスすることを特徴と
する基準電圧回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8459878U JPS594330Y2 (ja) | 1978-06-20 | 1978-06-20 | 基準電圧回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8459878U JPS594330Y2 (ja) | 1978-06-20 | 1978-06-20 | 基準電圧回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS54184440U JPS54184440U (ja) | 1979-12-27 |
| JPS594330Y2 true JPS594330Y2 (ja) | 1984-02-08 |
Family
ID=29007442
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8459878U Expired JPS594330Y2 (ja) | 1978-06-20 | 1978-06-20 | 基準電圧回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS594330Y2 (ja) |
-
1978
- 1978-06-20 JP JP8459878U patent/JPS594330Y2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS54184440U (ja) | 1979-12-27 |
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