JPS5951789B2 - 位相同期装置 - Google Patents

位相同期装置

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JPS5951789B2
JPS5951789B2 JP53159784A JP15978478A JPS5951789B2 JP S5951789 B2 JPS5951789 B2 JP S5951789B2 JP 53159784 A JP53159784 A JP 53159784A JP 15978478 A JP15978478 A JP 15978478A JP S5951789 B2 JPS5951789 B2 JP S5951789B2
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Japan
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pass filter
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JP53159784A
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JPS5585145A (en
Inventor
三男 磯辺
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Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Publication of JPS5951789B2 publication Critical patent/JPS5951789B2/ja
Expired legal-status Critical Current

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    • HELECTRICITY
    • H03ELECTRONIC CIRCUITRY
    • H03LAUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
    • H03L7/00Automatic control of frequency or phase; Synchronisation
    • H03L7/06Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
    • H03L7/08Details of the phase-locked loop
    • H03L7/085Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
    • H03L7/093Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal using special filtering or amplification characteristics in the loop

Landscapes

  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)

Description

【発明の詳細な説明】 本発明は位相制御ループ□を有1ニジた位相同期装置に
関し、位相制−ルニ→°の同期1訣態を正確か1ら簡易
に検出するとともに、特に集積回路に適した構成の位相
同期装置を提供することを目的とするものである。
本発明に関係する位相制御ループでは、周知のフェーズ
ロックドループ(P、L、L) 方式のヨウに電圧制御
形見振器と、この発信器に低域ろ波器を通じて制御信号
を供給する位相比較器とを有し、この位相比較器は入力
信号と前記電圧制御形発振慕の出力信号との位相差に応
じた誤差信号を発生するものである。
このようなループの位相同期状態は電圧制御形見振器の
自走周波数が入力信号の周波数と01ぼ等しいときに得
られ、このとき両者め周波数は一致し、それらの間の位
相差はほはπ/2(rad)である。
一方非同期状態は前述した電圧制御形見振器の自走周波
数と入力信号の周波数とが異なるときに生じやすく、こ
の状態で生じた位相比較器の出力のピード信号が低域ろ
波器に上って減衰されると、このループはもはや同期状
態への復帰機能を有さな:い。
従って復帰のために(1電圧制御形発振器の自□走癌波
数を人力信号の周波数に近づけるための作用が必要であ
る。
このよう:な位相制御ループを肴した受信装置では、非
同期状態で生じたビートによる廁音の除去、ある:いは
非同期状態の表示、さら(、:′は同期状態への復帰を
自動的に行なわせることが望ましく、従来(こおけるこ
の種の装置としては、たとえば本革願人に上る特願昭5
1−1”54627号「位相同期装置」に記載のものが
ある。
この装置は第1図に示すように電圧制御形見振器1、電
圧制御船発振器1の出力f2と入力信号f1とが供給さ
れる第1の位相比較器]、低域ろ波器3とによつそ構成
した位相制御ループと、電圧制御形見振器1の出力をπ
/2(rid) ’移相する移相器4、久力信4 fx
と移相器4の出方が供給されてなる第2の位相比較器5
、その出力側に配置され第2の位箱比岐器の復調極性と
は逆の整流極性を含む検出出力向”路6とで構成した同
期検出回路とを含むものである。
この装置においては入力信号f1がインパルス雑音によ
って振幅成分のみでなく位相的なひずみを受けた場合、
特に入力信号の搬送波の位相が反転されるような場合に
は第2の位相比較器5の出力に生じる雑音によって位相
同期ループが同期状態にあっても同期検出回路が動作を
開始して誤動作を生じるおそれがあった。
本発明は特に雑音を含む入力信号に対して誤動作するこ
とのない位相同期装置を提供せんとするものであり、以
下図面とともにその一実施例を詳細に説明するが前述し
た第1図と同じ機能を有したものについては便宜上同一
番号を付すことにする。
。第2図はこの発明によって構成された位相
同期装置の基本構成を示したものである。
第2図では低域ろ波器3′の入力と出力とが供給され、
それらの差信号を出力する差動回路7と、高域ろ波器を
構成するこの差動回路7の出力を受けてなる整流回路8
とが夾されている。
差動回路7の第1の入力信号aは位相比較器2の出力で
あり、位相同期ループが非同期状態にあるときは位相比
較器2の2つの入力信号f工とf2とのビート信号であ
る。
また差動回路の他の入力信号すは前述したビート信号が
低域ろ波や3を通過した成分であって、そのビートの周
波数が低域ろ波器3の通過帯域内であれば第1の入力信
号aとの同相成分となるのでこの場合には差動回路7は
応答しない。
一方、位相比較器2が茜生ずるビート信号の周波数が高
くなると、言し、)か、えれば入力信号f1と電圧制御
形光振器1の出力f2:との周波数差が大きくなると、
このビート信号は低域ろ波器3の出力側には得られない
従ってこっとき差動回路7の出力6日は第1の入力信号
aからのこのビート信号が得られ整流回路8の出力には
ビート信号に応した直流電圧が得られる。
1 。次に位相同期ループが同期状勢にべろ、ときを考
えると位相比較器2の出力には入力信、号f1が振幅変
調を受(すている場合には直流盛分ρ※が、また周波数
変調を受けている場合には復調出力が得られる。
差動回路7は直流成分に対しては応答せず、周波午弯調
信号の復調出力に対して(よ低域ろ波器3の通過帯域内
に対しても応答すな、いのでこの状態では整流回路8の
出力には何ら:の電圧は発生しない。
ここでこの発明の特徴である雑音に対する新規な作用を
説明する。
入力信号f1が含むインパルス雑音の中で位相比較器2
の出力に得られる特に幅の広い雑音は低周波成分を含み
、この成分は差動回路7の第1の入力信号aとなるのみ
でなく低域ろ波器3を通過して差動回路7の第2の入力
信号すとなる。
既に述べたように差動回路7はこのような雑音の低周波
成分に対しては、入力が互いに同相となるため応答しな
いのでその出力には高周波の雑音のみが得られる。
ところがこの高周波性の成分も低域ろ波器3があるため
、結局差動回路7の出力に生じるインパルス雑音の高周
波成分はそのエネルギーが非常に小さくなり、整流回路
8の出力に発生する信号のレベルを微小なものにし得る
言うまでもなく微弱な信号を入力f1とした場合に生じ
る雑音に対してもその低周波成分に応答しないことは上
述したインパルス雑音に対する低域の作用と同一である
上述したこの発明の位相同期装置で配置した同期検出回
路の出力は位相同期ループの同期状態の検出が雑音に対
して誤動作することなく極めて安定でありミューティン
グあるいは同期状態の表示のための制御信号に用い得る
のみでなく種々の制御信号として用いることができる。
例えば第3図で示したように位相同期ループの引込範囲
の拡大(9)路にも応用することが可能であり、以下に
その実施例を説明する。
ここでも第1図、第2図と同じ機能を有するものについ
ては同一番号を用いるこ、ととする。
第3図では同期検出回路の一部を構成する整流回路8の
出力によって制御される掃引電圧発生回路9の出力が電
圧制御形光振器1に供給されることを示している。
この掃引電圧発生回路9は位相同期ループが非同期状態
にあるときに電圧制御形光振器1の発振周波数を強制掃
引するものである:。
電圧制御形発振器1は通常の同期状態にあるときは低域
ろ波器3の出力信号すによってのみ制−される。
非同期状態においては第1に位相比較器2の出力のビー
ト周波数が低い場合、すなわち入力信号f1と電圧制御
形光振器1の出力f2との周波数差が小さいときには既
に尿べたように差動回路7が応答しないために掃引電圧
発生回路9は停止状態にある。
従ってこのと等位相同期ループは低域ろ波器:3と電圧
制御形光振器1および位相比較器2によって形成され、
低域ろ波器3の伝達特性とループ利得によって引込範囲
が決定される。
一方、入力信号f1と電圧制御形光振器1の出力f2と
の周波数差が大きくなって位相比較器2の出力のビート
周波数が高くなると、このビート成分は低域ろ波器3に
よって減衰される。
従ってこのとき電圧制御形光振器1は低域ろ波器3の出
力には応答しないが差動回路7がこのビート成分に応答
するので掃引電圧発生回路9はその動作を開始する。
電圧制御形光振器1はこの掃引電圧発生回路9の出力に
よって発振周波数が変更されるが入力信号f1に近ずく
と位相比較器2の出力のビート周波数は低くなる。
この低いビート成分は低域ろ波器3を通過して電圧制御
形光振器1の制御信号となって位相同期ループを同期状
態に突入させ、このとき差動回路7は応答しないから掃
引電圧発生回路9はその動作を停止する。
上述の説明の中では第1の位相同期ループとして電圧制
御形光振器1が低域ろ波器3の出力によって制御される
場合と差動回路7.整流回路8゜掃引電圧発生回路9か
らなる第2の位相同期ループによって制御される場合と
を明確に区別したが、言うまでもなく電圧制御形光振器
9が前述した第1および第2の位相同期ループの両方に
よって同時に制御されるようなビート周波数の領域があ
るが、この場合第1、あるいは第2の位相同期ループの
何れかによって電圧制御形光振器1が制御されて位相比
較器2の出力ビート周波数が前期第1の位相同期ループ
の引込範囲内に入ればも・はや差動回路7は応答しない
から、掃引電圧発生回路9はその動作を停止する。
次に本発明をさらに具体的に構成した第4図に示す実施
例について説明する。
トランジロ:ンQ1.Q2によつで構成した差動増幅器
には抵抗R1,およびコンデンサC1からなる低域ろ波
器3の入力と出力とが供給される。
この差動増幅器の出力は負荷抵抗およびトランジスタQ
3の増幅器を介して整流回路8を構成するトランジスタ
Q4に印加される。
この整流回路8の出力はダイオードD1とこのダイオー
ドD1のカソードに抵抗R3゜R4のバイアス回路で構
成したゲート回路1oに供給される。
第4図では掃引電圧発生回路9がゲート回路10の出力
で駆動される構成を示しているがこのゲート回路の出力
で他のミューティング回路等を制御することも可能であ
る。
第4図の構成で差動増幅器をなすトランジスタ対Q1.
Q2を通過するような周波数のビート信号は、整流トラ
ンジスタQ4を駆動し、エミッタに接続したコンデンサ
C2を充電してダイオードD1のカソード側に電源電圧
Vccを抵抗R3,R4で分圧したバイアス電圧よりも
高い直流信号を発生させて掃引電圧発生回路9の動作を
開始させる構成である。
この構成から明らかなようにこの発明の位相同期装置で
は同期検出回路は全て直結構成が可能であり集積回路に
適したものである。
上記の実施例からも明らかなように本発明による位相同
期装置は、位相同期ループの中の低域ろ波器の入力と出
力の差に応答して高域ろ波器を形成する差動回路の出力
を整流して同期状態を検出する回路を有したものであり
、雑音に対して極めq二(Bt!!15i−作をさせる
ことができるのみならず、が可能で集積回路化にも適し
た優れた ものである。
【図面の簡単な説明】
第1図は従来の位相同期装置を示すブロック図、第2図
は本発明の位相同期装置の一実施例を示すブロック図、
第3図は本発明を応用した実施例を示すブロック図、第
4図は第3図の構成の一具体例を示す回路図である。 1・・・・・・電圧制御形光振器、2・・・・・・位相
比較器、3・・・・・・低域ろ波器、7・・・・・・差
動回路、8・・・・・・整流回路、9・・・・・・掃引
電圧発生回路。

Claims (1)

  1. 【特許請求の範囲】 1 電圧制御形見振器、該電圧制御形見振器の出力と入
    力信号どの位相差に:比例した誤差信号を発生する位相
    比較器;該位相比較器の出力を入力となし前記電圧制御
    形発振器の制御信号を発止する低域ろ波器とからなる位
    相同期回路と、前記低域ろ波器の入力と出力との差信号
    に応答する差動回路で構成した高域ろ波器と、該高域ろ
    波器め屈力を整流し同期検出信号を生ずる整流回路とを
    □備えたことを特徴どする位相同期装置。 □:′2 電圧制御形見振器、該□電圧制御形
    発振蘇ア出力と入力信号とめ位相差に:比例した誤差信
    号1番発生する位相比較−1該位相比較器の出力を人力
    系なし前期電圧制御形発振器め制御信号を発生′□干る
    低域ろ波器とから庵:る位相:同地回路と、前記低′嫌
    ろ波器の入力と出方との差j言分′:に応答する差動回
    路で構成した高域あ□波器と、該:永域ろ波器の出力を
    整流する整流回路とを備:えJ該整流回路の:出力で制
    御される掃引・電圧発生回路と、該掃引電痒廃生回路の
    出力で前舶電圧制−形:発振器を制御するループを設け
    たごと剖特徴とず・る位相同期装倣二
JP53159784A 1978-12-22 1978-12-22 位相同期装置 Expired JPS5951789B2 (ja)

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JPS5585145A JPS5585145A (en) 1980-06-26
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JPH02144591U (ja) * 1989-03-29 1990-12-07
JPH06115590A (ja) * 1993-03-29 1994-04-26 Nippon Shirika Kogyo Kk 超微粉末粉体の運搬用容器

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JPS5585145A (en) 1980-06-26

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