JPS5971185A - ペ−ジ履歴メモリ処理方式 - Google Patents
ペ−ジ履歴メモリ処理方式Info
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- JPS5971185A JPS5971185A JP57182331A JP18233182A JPS5971185A JP S5971185 A JPS5971185 A JP S5971185A JP 57182331 A JP57182331 A JP 57182331A JP 18233182 A JP18233182 A JP 18233182A JP S5971185 A JPS5971185 A JP S5971185A
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- JP
- Japan
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- page
- storage device
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- memory
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-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F12/00—Accessing, addressing or allocating within memory systems or architectures
- G06F12/02—Addressing or allocation; Relocation
- G06F12/08—Addressing or allocation; Relocation in hierarchically structured memory systems, e.g. virtual memory systems
- G06F12/0802—Addressing of a memory level in which the access to the desired data or data block requires associative addressing means, e.g. caches
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- Engineering & Computer Science (AREA)
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- General Engineering & Computer Science (AREA)
- General Physics & Mathematics (AREA)
- Debugging And Monitoring (AREA)
- Memory System Of A Hierarchy Structure (AREA)
- Techniques For Improving Reliability Of Storages (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の属する技術分野〕
本発明は、ページ履歴メモリ処理方式、特に、仮想記憶
方式を採用した情報処理装置におけるページ履歴メそり
処理するためのページ履歴メモリ処理方式に関する。
方式を採用した情報処理装置におけるページ履歴メそり
処理するためのページ履歴メモリ処理方式に関する。
一般に、仮想記憶方式を採用した情報処理装置において
は、仮想記憶を実現するために仮想記憶の全空間の内容
を二次記憶装置上におきプログラムの実行に当っては必
要な部分、すなわち、ページのみを主記憶装置上にロー
ドしてプログラムの実行を行なうようになっている。
は、仮想記憶を実現するために仮想記憶の全空間の内容
を二次記憶装置上におきプログラムの実行に当っては必
要な部分、すなわち、ページのみを主記憶装置上にロー
ドしてプログラムの実行を行なうようになっている。
ここで、主記憶装置の容量は仮想記憶の容量にくらべて
小さいため、主記憶装置がオーバーフローを起こした場
合には主記憶装置上のすでに情報のロードされているペ
ージに二次記憶装置から必要な情報を持つてこなければ
ならたくなる。
小さいため、主記憶装置がオーバーフローを起こした場
合には主記憶装置上のすでに情報のロードされているペ
ージに二次記憶装置から必要な情報を持つてこなければ
ならたくなる。
このとき、主記憶装置−ヒの置換されるページの卓
情報に対し何らの処理を施こしておかなければ、もし、
主記憶装置上の情報が書き換えられていれば、二次記憶
装置に記憶された情報は誤まった情報となってしまうた
め、二次記憶装置から主記憶装置へのロードに先だって
主記憶装置から当該ページの内容を二次記憶装置に格納
しなければならない。
主記憶装置上の情報が書き換えられていれば、二次記憶
装置に記憶された情報は誤まった情報となってしまうた
め、二次記憶装置から主記憶装置へのロードに先だって
主記憶装置から当該ページの内容を二次記憶装置に格納
しなければならない。
従来のページ履歴メモリ処理方式は、情報を記憶する二
次記憶装置と、前記情報をページ単位で記憶する主記憶
装置と、ページが前記主記憶装置上で書き換えられたか
否かを示す変更情報を前記ページごとに記憶し読み出さ
れた前記変更情報がページが書き換えられたことを示し
ているときに前記主記憶装置に格納されているページを
前記二次記憶装置に格納することを指示する格納指示信
号を発生するベージ婉歴メモリとを含んで構成される。
次記憶装置と、前記情報をページ単位で記憶する主記憶
装置と、ページが前記主記憶装置上で書き換えられたか
否かを示す変更情報を前記ページごとに記憶し読み出さ
れた前記変更情報がページが書き換えられたことを示し
ているときに前記主記憶装置に格納されているページを
前記二次記憶装置に格納することを指示する格納指示信
号を発生するベージ婉歴メモリとを含んで構成される。
このように、従来の履歴メモリ処理方式は、ロード１；
先だって二次記憶装置に主記憶装置に格納されている情
報の書きかえがあったときのみ格納させる。すなわち、
ページ履歴メモリ上の変更ビットの内容によって主記憶
装置に格納されていた情報が１・き換えられたかどうか
を知り、もし書き換えられていれば対応する二次記憶装
置に主記憶装置の内容を書いたあとで新たな情報をロー
ドするような構成となっている。
先だって二次記憶装置に主記憶装置に格納されている情
報の書きかえがあったときのみ格納させる。すなわち、
ページ履歴メモリ上の変更ビットの内容によって主記憶
装置に格納されていた情報が１・き換えられたかどうか
を知り、もし書き換えられていれば対応する二次記憶装
置に主記憶装置の内容を書いたあとで新たな情報をロー
ドするような構成となっている。
しかしながら、従来のページ履歴メモリ処理方式は、変
更ビットが障害を起した場合には、主記憶装置６′上の
情報と対応する二次記憶装置上の情報の不一致が起こる
ため、システムダウンが発生するという欠点があった。
更ビットが障害を起した場合には、主記憶装置６′上の
情報と対応する二次記憶装置上の情報の不一致が起こる
ため、システムダウンが発生するという欠点があった。
本発明の目的はシステムダウンの発生を防止できるペー
ジ履歴メモリ処理方式を提供することにある。
ジ履歴メモリ処理方式を提供することにある。
すなわち、本発明の目的は変更情報の記憶に障害が発生
したときに、その出力を強制的に、対応するページの１
：き換えがあったように置き換えることにより上記欠点
全解決し、変更情報の障害の発生時においてもシステム
ダウンに陥いることなく処理を紗行できるようにしたペ
ージ履歴メモリ処理方式を提供することにある。
したときに、その出力を強制的に、対応するページの１
：き換えがあったように置き換えることにより上記欠点
全解決し、変更情報の障害の発生時においてもシステム
ダウンに陥いることなく処理を紗行できるようにしたペ
ージ履歴メモリ処理方式を提供することにある。
本発明のページ履歴メモリ処理方式は、情報を記憶する
二次記憶装置と、前記情報をページ単位で記憶する主記
憶装置と、ページが前記主記憶装置上で書き換えられた
か否かを示す変更情報に応じた誤り検出情報を発生する
誤り検出情報発生手段と、前記変更情報と前記誤り検出
情報とを前記ページごとに記憶するページ履歴メモリと
、読み出した前記変更情報と前記誤シ検出情報とによシ
誤りが検出されたときに前記ページ履歴メモリに障害が
あることを示す障害報告信号を発生する障害検出手段と
、読み出された前記変更情報がページが書き換えられた
ことを示しているときおよび前記障害報告信号が発生し
たときに前記主記憶装置に格納されているページを前記
二次記憶装ｆｆに５− 格納することを指示する 格納指示信号を発生する変更
情報固定手段とを含んで・楕、Ａされる。
二次記憶装置と、前記情報をページ単位で記憶する主記
憶装置と、ページが前記主記憶装置上で書き換えられた
か否かを示す変更情報に応じた誤り検出情報を発生する
誤り検出情報発生手段と、前記変更情報と前記誤り検出
情報とを前記ページごとに記憶するページ履歴メモリと
、読み出した前記変更情報と前記誤シ検出情報とによシ
誤りが検出されたときに前記ページ履歴メモリに障害が
あることを示す障害報告信号を発生する障害検出手段と
、読み出された前記変更情報がページが書き換えられた
ことを示しているときおよび前記障害報告信号が発生し
たときに前記主記憶装置に格納されているページを前記
二次記憶装ｆｆに５− 格納することを指示する 格納指示信号を発生する変更
情報固定手段とを含んで・楕、Ａされる。
すなわち、本発明のページ履歴メモリ処理方式は、ペー
ジ単位に管理される主記憶装置と、前記ページが前記主
記憶装置上で書き換えられたか否かを示す変更情報を保
持するページ履歴メモリと前記変更情報の障害を検出す
る障害検出手段と、前記ページ履歴メモリから読み出さ
れた変更情報を強制的にページが書き換えられたことを
示すようにする変更ビット固定手段とを有し、前記ペー
ジ履歴メモリを読み出したときに前記障害検出手段によ
って前記変更ビットの障害が検出された場合に前記変更
ビット固定手段によって前記ページが書き換えられたこ
とを示すように置き換えるように構成される。
ジ単位に管理される主記憶装置と、前記ページが前記主
記憶装置上で書き換えられたか否かを示す変更情報を保
持するページ履歴メモリと前記変更情報の障害を検出す
る障害検出手段と、前記ページ履歴メモリから読み出さ
れた変更情報を強制的にページが書き換えられたことを
示すようにする変更ビット固定手段とを有し、前記ペー
ジ履歴メモリを読み出したときに前記障害検出手段によ
って前記変更ビットの障害が検出された場合に前記変更
ビット固定手段によって前記ページが書き換えられたこ
とを示すように置き換えるように構成される。
次に、本発明の実施例について、図面を参照して詳細に
説明する。
説明する。
第１図は本発明の一実施例を示すブロック図、第２図は
第１図に示すページ履歴メモリの詳細ブロック図である
。
第１図に示すページ履歴メモリの詳細ブロック図である
。
６−
第１図において、１０１は中央処理装置、１０２はペー
ジ膣麿：メモリ、１０３は主起ゼ１装置、１０４は二次
記憶装置である。
ジ膣麿：メモリ、１０３は主起ゼ１装置、１０４は二次
記憶装置である。
第１図に示す実施例のような仮想記憶システムにおいて
は仮律記憶空間は実記憶空間よシ大きいため仮想記憶空
間全体の内容は二次配憶装置１０４上におかれ、実行は
必要に応じてページ単位に主記憶装置１０３上にロード
して行なわれる。
は仮律記憶空間は実記憶空間よシ大きいため仮想記憶空
間全体の内容は二次配憶装置１０４上におかれ、実行は
必要に応じてページ単位に主記憶装置１０３上にロード
して行なわれる。
このとき、主記憶装［１０３上のページに、以前に存在
した情報が有効なものである場合には新しい情報をロー
ドする前にその内容を二次Ｈ１シ憶装ｗ１０４の対応す
る所へ戻しておく必要がある。
した情報が有効なものである場合には新しい情報をロー
ドする前にその内容を二次Ｈ１シ憶装ｗ１０４の対応す
る所へ戻しておく必要がある。
但し主記憶装置ｆｉ １０３の内容は二次記憶装置１０
４の写しであるため、情報がロードされてから主配憶装
ｆｆ１１０３上で内容の変更が行なわれていなければ二
次記憶装置１０４へ戻す必要はなく新たな情報を重ね書
きしても問題はない。
４の写しであるため、情報がロードされてから主配憶装
ｆｆ１１０３上で内容の変更が行なわれていなければ二
次記憶装置１０４へ戻す必要はなく新たな情報を重ね書
きしても問題はない。
ページ履歴メモリ１０２は、このための機能であり、主
記憶装置１０３上でページ単位にそのページが書き換え
られたかどうかを示す変更ビットを変更情報として記憶
したメモリで、対応するページの情報をアドレスである
ページ指定信号２０２として入力するとそのページが書
き換えられた場合には変更ビット出力信号２０７として
′１１が出力されるような構成となっている。
記憶装置１０３上でページ単位にそのページが書き換え
られたかどうかを示す変更ビットを変更情報として記憶
したメモリで、対応するページの情報をアドレスである
ページ指定信号２０２として入力するとそのページが書
き換えられた場合には変更ビット出力信号２０７として
′１１が出力されるような構成となっている。
したがって、通常の動作のときに、新たにページをロー
ドする場合にはページ履歴メモ！Ｊ１０２の対応するペ
ージの変更ピッｌ−２１２’に変更ビット出力信号２０
７として読み出し、ページの喪き換えがあったかどうか
調べ、書き換えのあった場合のみそのページを二次記憶
装置１０４の対応する部分へ戻しておくように制御され
る。
ドする場合にはページ履歴メモ！Ｊ１０２の対応するペ
ージの変更ピッｌ−２１２’に変更ビット出力信号２０
７として読み出し、ページの喪き換えがあったかどうか
調べ、書き換えのあった場合のみそのページを二次記憶
装置１０４の対応する部分へ戻しておくように制御され
る。
次に、第２図を参照して、ページ履歴メモリ１０２の詳
細および変更ビットが障害を起したときの動作について
説明を行なう。
細および変更ビットが障害を起したときの動作について
説明を行なう。
ページ履歴メモ！Ｊ １０２は変更ビット２１２および
パリティビット２１３’ｅ記憶するためのメモリ部２１
１と、パリティ作成部２１０と、障害検出部２１４と、
変更ビット固定部を構成するオア回路２１５より構成さ
れている。
パリティビット２１３’ｅ記憶するためのメモリ部２１
１と、パリティ作成部２１０と、障害検出部２１４と、
変更ビット固定部を構成するオア回路２１５より構成さ
れている。
通常動作時には、主記憶装置１０３の内容が書き換えら
れると対応するページの変更ビット２１２が、中央処理
袋［１０１からの変更ビット書込信号２０１およびペー
ジ指定信号２０２を通じて論理ＩＩＩＫ書き換えられる
。このとき、パリティ作成部２１０によってパリティビ
ット２１３が付加される。一方、二次記憶装置１０４か
ら主記憶装置１０３へのページのロードの要求が起った
場合に、中央処理袋ｆＷｌｏ１はページ指定信号２０２
および変更ビット読出信号２０３を対応するページの変
更ビット２１２として読み出して、変更ビット読出信号
２０３が論理１１＠であればそのページを二次記憶装置
１０４の対応する位置へ書き込みを行なったあとで、ま
た、変更ビット読出信号２０３が論理ＩＯＩなら書込み
を行なわずに、二？、記悔装置１０４から新たな内容を
書き込む。
れると対応するページの変更ビット２１２が、中央処理
袋［１０１からの変更ビット書込信号２０１およびペー
ジ指定信号２０２を通じて論理ＩＩＩＫ書き換えられる
。このとき、パリティ作成部２１０によってパリティビ
ット２１３が付加される。一方、二次記憶装置１０４か
ら主記憶装置１０３へのページのロードの要求が起った
場合に、中央処理袋ｆＷｌｏ１はページ指定信号２０２
および変更ビット読出信号２０３を対応するページの変
更ビット２１２として読み出して、変更ビット読出信号
２０３が論理１１＠であればそのページを二次記憶装置
１０４の対応する位置へ書き込みを行なったあとで、ま
た、変更ビット読出信号２０３が論理ＩＯＩなら書込み
を行なわずに、二？、記悔装置１０４から新たな内容を
書き込む。
変更ビット２１２を読み出したときに障害検出部２１４
によって障害が検出されると、障害検出部２１４はオア
回路２１５に対してその出力が論理１１１となるように
して、中央処理装置１０１に９一 対しては変更ビット２１２の出力である変更ビット読出
信号２０３が論理１１１になっているように見せるとと
もに障害報告信号２０４全通して障害の発生したことを
中央処理装置１０１に報告する０このようにすると、変
更ビット２１２に障害が起ってもそのページは必ず二次
記憶装置１１０４の対応する位置に戻されるので主記憶
装置１０３と二次記憶装置１０４の不一致が起こら々い
ため、システムダウンにすることなく処理を続行するこ
とができる。
によって障害が検出されると、障害検出部２１４はオア
回路２１５に対してその出力が論理１１１となるように
して、中央処理装置１０１に９一 対しては変更ビット２１２の出力である変更ビット読出
信号２０３が論理１１１になっているように見せるとと
もに障害報告信号２０４全通して障害の発生したことを
中央処理装置１０１に報告する０このようにすると、変
更ビット２１２に障害が起ってもそのページは必ず二次
記憶装置１１０４の対応する位置に戻されるので主記憶
装置１０３と二次記憶装置１０４の不一致が起こら々い
ため、システムダウンにすることなく処理を続行するこ
とができる。
変更ビットの障害が間欠的なものでめった場合にはこの
まま何もすることなく処理ヲ紘行できるが、もし固定的
な故障の場合にはそのページに二次記憶装置１０４から
データがロードされようとするたびに、本来そのページ
が主記憶装置１０３上で書き換えられていなくても二次
記憶装置１０４上へ戻されることになる。
まま何もすることなく処理ヲ紘行できるが、もし固定的
な故障の場合にはそのページに二次記憶装置１０４から
データがロードされようとするたびに、本来そのページ
が主記憶装置１０３上で書き換えられていなくても二次
記憶装置１０４上へ戻されることになる。
しかし、このことによる論理的な矛盾は存在しないため
、性能の低下はあってもそのまま処理は続行できる。但
しこの場合には障害報告信号２０４１０− でページ履歴メモリ１０２の障害が報告されているため
それを調べることによって固定的な故障と判断でき、そ
れによって修理等の指示を与えることが可能である。
、性能の低下はあってもそのまま処理は続行できる。但
しこの場合には障害報告信号２０４１０− でページ履歴メモリ１０２の障害が報告されているため
それを調べることによって固定的な故障と判断でき、そ
れによって修理等の指示を与えることが可能である。
上述の実施例では、ベージ履滑メモリを中央処理装置内
部におく構成をとったが、これは主記憶装置ｔ １１１
１におく構成にすることも可能である。
部におく構成をとったが、これは主記憶装置ｔ １１１
１におく構成にすることも可能である。
本発明のベージ籍歴メモリ処坤方式は、障害検出手段を
追加することによシ、主ｔｆｅｔｕ装置のページを置換
するに際しページが書きかえられたか否かを示す変更情
報がページが書きかえられたことを示していないときで
も障害発生時には、当該ページを主記憶装置から二次記
憶装置゛に格納させることができるため、主記憶装置と
二次記憶装置とで格納される情報の不一致を々くすこと
ができるので、システムダウンを防止できるという効果
がある。
追加することによシ、主ｔｆｅｔｕ装置のページを置換
するに際しページが書きかえられたか否かを示す変更情
報がページが書きかえられたことを示していないときで
も障害発生時には、当該ページを主記憶装置から二次記
憶装置゛に格納させることができるため、主記憶装置と
二次記憶装置とで格納される情報の不一致を々くすこと
ができるので、システムダウンを防止できるという効果
がある。
すなわち、本発明のページ履歴メモリ処理方式は、ペー
ジ履歴メモリに記憶した変更ビットの出１１− 力を、その障害が検出されたときに強制的にページが書
き換えられたことを示すようにすることによって、変更
ビットの障害時においてもシステムダウンとすることな
く処理を続行できるという効果がある。
ジ履歴メモリに記憶した変更ビットの出１１− 力を、その障害が検出されたときに強制的にページが書
き換えられたことを示すようにすることによって、変更
ビットの障害時においてもシステムダウンとすることな
く処理を続行できるという効果がある。
【図面の簡単な説明】
第１図は本発明の一実施例を示すブロック図、第２図は
第１１′ｙ、Ｉに示すページ履歴メモリの詳細ブロック
図である。 １０１・・・・・・中央処理装置、１０２・・・・・・
ページ履歴メモリ、１０３・・・・・・主記憶装置、１
０４・・・・・・二次記憶装置、２０１・・・・・・変
更ビット書込信号、２０２・・・・・・ページ指定信号
、２０３・・・・・・変更ビット読出信号、２０４・・
・・・・障害報告信号、２１０・・・・・・パリティ作
成部、２］１・・・・・・メモリ部、２］２・・・・・
・変更ビット、２１３・・・・・・パリティビット、２
１４・・・・・・障害検出部、２１５・・・・・・オア
回路、２０５・・・・・・パリティ書込信号、２０６・
・・・・・パリティビット読第１図 ２θ／ 冶２圀
第１１′ｙ、Ｉに示すページ履歴メモリの詳細ブロック
図である。 １０１・・・・・・中央処理装置、１０２・・・・・・
ページ履歴メモリ、１０３・・・・・・主記憶装置、１
０４・・・・・・二次記憶装置、２０１・・・・・・変
更ビット書込信号、２０２・・・・・・ページ指定信号
、２０３・・・・・・変更ビット読出信号、２０４・・
・・・・障害報告信号、２１０・・・・・・パリティ作
成部、２］１・・・・・・メモリ部、２］２・・・・・
・変更ビット、２１３・・・・・・パリティビット、２
１４・・・・・・障害検出部、２１５・・・・・・オア
回路、２０５・・・・・・パリティ書込信号、２０６・
・・・・・パリティビット読第１図 ２θ／ 冶２圀
Claims (1)
- 情報を記憶する二次記憶装置と、前記情報をページ単位
で記憶する主記憶装置と、ページが前記主記憶装置上で
１：き換えられたか否かを示す変更情報に応じた誤シ検
出情＠を発生する誤り検出情報発生手段と、前記変更情
報と前記誤力検出情報とを前記ページごとに記憶するペ
ージ履歴メモリと、読み出した前記変更情報と前ｆｌｆ
誤シ検出情報とにより誤りが検出されたときに前記ペー
ジ履歴メモリに障害があることを示す障害報告信号を発
生する障害検出手段と、読み出された前記変更情報がペ
ージが書き換えられたことを示しているときおよび前記
障害報告信号が発生したときに前記主記憶装置に格納さ
れているページを前記二次記憶装置に格納することを指
示する格納指示信号を発生する変更情報固定手段とを含
むことを特徴とするページ履歴メモリ処理方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57182331A JPS5971185A (ja) | 1982-10-18 | 1982-10-18 | ペ−ジ履歴メモリ処理方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57182331A JPS5971185A (ja) | 1982-10-18 | 1982-10-18 | ペ−ジ履歴メモリ処理方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5971185A true JPS5971185A (ja) | 1984-04-21 |
Family
ID=16116433
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57182331A Pending JPS5971185A (ja) | 1982-10-18 | 1982-10-18 | ペ−ジ履歴メモリ処理方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5971185A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6459549A (en) * | 1987-08-31 | 1989-03-07 | Fujitsu Ltd | System for protecting data in data processor |
-
1982
- 1982-10-18 JP JP57182331A patent/JPS5971185A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6459549A (en) * | 1987-08-31 | 1989-03-07 | Fujitsu Ltd | System for protecting data in data processor |
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