JPS5996844U - 半導体装置用リ−ドフレ−ム - Google Patents
半導体装置用リ−ドフレ−ムInfo
- Publication number
- JPS5996844U JPS5996844U JP19218382U JP19218382U JPS5996844U JP S5996844 U JPS5996844 U JP S5996844U JP 19218382 U JP19218382 U JP 19218382U JP 19218382 U JP19218382 U JP 19218382U JP S5996844 U JPS5996844 U JP S5996844U
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- JP
- Japan
- Prior art keywords
- lead frame
- semiconductor device
- insulating
- semiconductor devices
- electrode portions
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
- 239000004065 semiconductor Substances 0.000 title claims description 10
- 238000000034 method Methods 0.000 claims description 3
- 239000011347 resin Substances 0.000 claims 2
- 229920005989 resin Polymers 0.000 claims 2
- 238000003486 chemical etching Methods 0.000 claims 1
- 229920001721 polyimide Polymers 0.000 claims 1
- 239000009719 polyimide resin Substances 0.000 claims 1
- 238000010586 diagram Methods 0.000 description 1
Landscapes
- Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
第1図、第2図は、本考案に係る半導体装置用リードフ
レームの全体を示す平面図および裏面図、第3図、第4
図は、その部分拡大平面図および正面図、第5図ないし
第7図は上記フレーム上の半導体装置用パッケージの形
成過程を示す工程図、第8図は、上記パツをージの斜視
図、第9図は、上記パッケージを用いて半導体装置を組
立てた状態の断面図である。 1・・・リードフレーム、3・・・連結部、4・・・半
導体装置用パツゲージ、5・・・電極部、6・・・接続
部。
レームの全体を示す平面図および裏面図、第3図、第4
図は、その部分拡大平面図および正面図、第5図ないし
第7図は上記フレーム上の半導体装置用パッケージの形
成過程を示す工程図、第8図は、上記パツをージの斜視
図、第9図は、上記パッケージを用いて半導体装置を組
立てた状態の断面図である。 1・・・リードフレーム、3・・・連結部、4・・・半
導体装置用パツゲージ、5・・・電極部、6・・・接続
部。
Claims (3)
- (1)平面上に等間隔配置された複数の連結部と、この
連結部間に接続された複数の電極部と、この電極部を互
いに絶縁分離する手段と、この電極部上に一体的に形成
され、かつ前記連結部の長手力向に沿って配置された複
数の半導体装置用パッケージと、この隣接するパッケー
ジ間を擦続する接続部とを有することを特徴とする半導
体装置用リードフレーム。 - (2)前記パッケージは、絶縁性樹脂で形成されている
−ことを特徴とする実用新案登録請求の範囲第1項記載
の半導体装置用リードフレーム。 - (3)前記絶縁性樹脂は、ポリイミド系樹脂であること
を特−徴とする実用新案登録請求の範囲第1項記載の半
導体装置用リードフレーム。=(4)前記電極部を互い
に絶縁分離する手段は、化学エッチング法等によって形
成したスリットであることを特徴生する実用新案登録請
求の範囲第1項ないし第4項記載の半導体装置用リード
フレーム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19218382U JPS5996844U (ja) | 1982-12-21 | 1982-12-21 | 半導体装置用リ−ドフレ−ム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP19218382U JPS5996844U (ja) | 1982-12-21 | 1982-12-21 | 半導体装置用リ−ドフレ−ム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5996844U true JPS5996844U (ja) | 1984-06-30 |
Family
ID=30413657
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP19218382U Pending JPS5996844U (ja) | 1982-12-21 | 1982-12-21 | 半導体装置用リ−ドフレ−ム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5996844U (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11251486A (ja) * | 1998-02-27 | 1999-09-17 | Origin Electric Co Ltd | 表面実装型の半導体装置の製造方法および半導体装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57177548A (en) * | 1981-04-06 | 1982-11-01 | Int Rectifier Corp | Module for semiconductor device |
-
1982
- 1982-12-21 JP JP19218382U patent/JPS5996844U/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57177548A (en) * | 1981-04-06 | 1982-11-01 | Int Rectifier Corp | Module for semiconductor device |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH11251486A (ja) * | 1998-02-27 | 1999-09-17 | Origin Electric Co Ltd | 表面実装型の半導体装置の製造方法および半導体装置 |
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