JPS60154564A - 半導体装置 - Google Patents

半導体装置

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Publication number
JPS60154564A
JPS60154564A JP59010695A JP1069584A JPS60154564A JP S60154564 A JPS60154564 A JP S60154564A JP 59010695 A JP59010695 A JP 59010695A JP 1069584 A JP1069584 A JP 1069584A JP S60154564 A JPS60154564 A JP S60154564A
Authority
JP
Japan
Prior art keywords
layer
bevel
electrode film
shaped
thyristor
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59010695A
Other languages
English (en)
Inventor
Kenya Oohira
大衡 建也
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fuji Electric Co Ltd
Original Assignee
Fuji Electric Corporate Research and Development Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Fuji Electric Corporate Research and Development Ltd filed Critical Fuji Electric Corporate Research and Development Ltd
Priority to JP59010695A priority Critical patent/JPS60154564A/ja
Publication of JPS60154564A publication Critical patent/JPS60154564A/ja
Pending legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D18/00Thyristors
    • H10D18/60Gate-turn-off devices 
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10DINORGANIC ELECTRIC SEMICONDUCTOR DEVICES
    • H10D62/00Semiconductor bodies, or regions thereof, of devices having potential barriers
    • H10D62/10Shapes, relative sizes or dispositions of the regions of the semiconductor bodies; Shapes of the semiconductor bodies
    • H10D62/102Constructional design considerations for preventing surface leakage or controlling electric field concentration
    • H10D62/103Constructional design considerations for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse-biased devices
    • H10D62/104Constructional design considerations for preventing surface leakage or controlling electric field concentration for increasing or controlling the breakdown voltage of reverse-biased devices having particular shapes of the bodies at or near reverse-biased junctions, e.g. having bevels or moats

Landscapes

  • Electrodes Of Semiconductors (AREA)
  • Thyristors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の属する技術分野〕 本発明は電力用ゲートターンオフ(GTO)サイリスタ
あるいけパワートランジスタのように交互に異なる導電
形の複数層からなる半導体基板の表面層に主電極膜、表
面層に隣接する層に達するまで堀り込まれた凹面に補助
電極膜をそれぞれ有し基板外周部にベベル面が形成され
た半導体装置に関する。
〔従来技術とその問題点〕
この種の半導体装置では、半導体主面上に主電極膜と制
御電極膜とを有する。主電極膜に通電のための電極板を
接触させた時、この電極板が制御電極膜とは接触短絡す
ることの無いように、二つの電極膜の高さを変える目的
で半導体の一生面に凹凸を設けている。
第1図にそのような半導体装置の例として電力用GTO
の素子の平面図、第2図にその内部構造をカソード電極
板を含めての部分的な拡大断面図で示す。半導体基板1
は、p形エミッタ(pH,。
形ベース(n、)hp形ペース(p8)およびn形エミ
ッタ(町)の4層を有しろう材3によシ支持板2に固着
されている。へ上にはゲート電極膜4%n、上にはカソ
ード電極膜5が設けられ、カソードード8が接続されて
いる。カソード電極膜5上にカソード電極板6を置くの
は、電流が細いカソード電極膜5を横に流れて電圧降下
が生ずるのを防ぐためと、半導体内で生じた熱をカソー
ド電極板6を通して外部に放出するためであり、電力用
半導体装置で一般的に行われている方法である。ゲート
電極膜4とカソード電極膜5との下の半導体基板に凹凸
を形成してゲート電極膜を凹面10に位置させ、二つの
電極間に段差を形成しであるため1両電極膜4,5がカ
ソード電極板6で短絡されることはない。GTOとして
は、カソード電極膜5をゲート電極膜4より高く構成し
た方が逆の場合より一般的であり、本発明も第2図のよ
うにゲート部類込みを行った、すなわちカソード電極板
6に対してカソード電極膜5は当接するが、ゲート電極
膜4は当接しない電極構造をもった半導体装置を対称と
している。
第2図の構造のGTOサイリスタにおいて、耐圧特性を
実現する上で最も問題となるのはpn接合が表面に出る
外周部分である。一般に電力用半導体では、高い耐圧を
実現するためにpn接合面に対して傾斜した表面を形成
した。いわゆるベベル構造をとるのが普通であり、特に
サイリスタでは順逆阻止耐圧を出すため、傾斜面11.
12を二段に形成した二段ベベル構造をとるものが多い
特に上段のベベルはネガティブベベルになるため通常1
0°以下の低い角度に作られる。
第2図に示した従来のGTOサイリスタに順電圧を印加
した場合のサイリスタ内部のpn接合9の両側に空乏層
は点線13.14のように広がる。
馬肉での空乏層に着目すると、ベベル部では内部より上
方迄伸びている。更に印加電圧を増大させると鎖線15
.16のようになり、ゲート電極膜4の作られた面10
に達するとそれ以上印加電圧を増すことは出来ない。耐
圧をこれ以上に向上さ 。
せるKは、ベベル部の傾斜角を小さくし沿面長を長くす
る方法があるが、傾斜角を余り小さくするとベベル部分
が広くなり過ぎ半導体全体での通電できる面積が減少す
るため実用的でない。
〔発明の目的〕
*8□1.、。ヶやヤ、よ、□66.。。 1角を小さ
くすることなく耐圧を高めた半導体装置を提供すること
を目的とする。
〔発明の要点〕
本発明による半導体装置においては半導体基板のベベル
形成部分には表面層を形成しないで隣接の異なる導電形
の層を主表面と同じ平面に達しているととKより、空乏
層の伸びるととのできる範囲を拡大して上記の目的を達
成する。
〔発明の実施例〕
以下本発明を実施例に基き説明する。第3図は本発明に
よるGTOサイリスタの断面図であり、第2図と共通の
部分には同一符号が付されている。
この場合は、半導体基板1の外周部分で28層が半導体
基板1の上表面に迄伸びて居り、この部分にベベル面1
2が作られている。通常の電力用半導体では”@+pB
間の接合9の深さは60〜100μであり、ゲート部分
の凹面10堀込み深さは20〜30μであるので、同一
傾斜角でベベルを作るとすれば沿面は20〜30%以上
長くできる。
第3図に示す構造を形成する方法は極めて容易である。
従来基板上表面から全面拡散によりn3層を形成してい
たのを外周部をマスクして拡散することによシ、ベベル
が形成される部分ではへ層を上表面に露出させておく。
次にゲート部の凹面10の、例えばエツチングによる堀
込みの際にも外周部をマスクしておくことにより n 
26層が上表面と同じ平面に達したtまの状態を残して
おく。そしてとの外周部に従来と同様な方法でベベルを
形成すればよい。
〔発明の効果〕
本発明は、従来表面層に隣接する異にる導電形の層まで
堀り込まれた凹面より下側で形成されていたベベル面を
、隣接層を主表面に露出させその部分に形成するもので
、これによりベベル傾斜角を小さくすることなくベベル
面を拡大することができ、通電面積をほとんど減少させ
ないで耐圧を向上できるので、GTOサイリスタあるい
はノくワートランジスタで主電極膜と制御電極膜との間
に段差のある半導体装置の特性向上に極めて有効である
【図面の簡単な説明】
第1図はGTOサイリスタ基板の平面図、第2図はカソ
ード電極膜を含めてのGTOサイリスタの部分的縦断面
図、第3図は本発明の一実施例のGTOサイリスタ基板
の部分的縦断面図である。 1・・・半導体基板、4・・・ゲート電極膜、5・・・
カソード電極膜、10・・・凹面、12・・・上部ベベ
ル面。 第1図 第2図 3−XJ。 2」 第8図

Claims (1)

    【特許請求の範囲】
  1. 1)交互に異なる導電形の複数層からなる半導体基板の
    表面層に主電極膜、前記表面層に隣接する層に達するま
    で掘り込まれた凹面に補助電極膜をそれぞれ有し、半導
    体基板の外周部にベベル面が形成されるものにおいて、
    ベベル部分には表面層が形成されず、表面層に隣接する
    層が表面層上の主表面と同じ平面に達していることを特
    徴とする半導体装置。
JP59010695A 1984-01-24 1984-01-24 半導体装置 Pending JPS60154564A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59010695A JPS60154564A (ja) 1984-01-24 1984-01-24 半導体装置

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59010695A JPS60154564A (ja) 1984-01-24 1984-01-24 半導体装置

Publications (1)

Publication Number Publication Date
JPS60154564A true JPS60154564A (ja) 1985-08-14

Family

ID=11757416

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59010695A Pending JPS60154564A (ja) 1984-01-24 1984-01-24 半導体装置

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JP (1) JPS60154564A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH06211437A (ja) * 1993-01-20 1994-08-02 Kansai Electric Power Co Inc:The コード巻取り装置
EP0923136B1 (de) * 1997-10-24 2008-07-02 ABB Schweiz AG Abschaltthyristor mit Stopschicht

Citations (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5617068A (en) * 1979-07-20 1981-02-18 Meidensha Electric Mfg Co Ltd Turn-off thyristor
JPS58206155A (ja) * 1982-05-25 1983-12-01 Toshiba Corp 半導体装置

Patent Citations (2)

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