JPS60187067A - メモリ機能を有するフオトカプラ - Google Patents
メモリ機能を有するフオトカプラInfo
- Publication number
- JPS60187067A JPS60187067A JP59043372A JP4337284A JPS60187067A JP S60187067 A JPS60187067 A JP S60187067A JP 59043372 A JP59043372 A JP 59043372A JP 4337284 A JP4337284 A JP 4337284A JP S60187067 A JPS60187067 A JP S60187067A
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- JP
- Japan
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- light
- led
- turned
- light emitting
- phototransistor
- Prior art date
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- Granted
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Classifications
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L25/00—Baseband systems
- H04L25/02—Details ; arrangements for supplying electrical power along data transmission lines
- H04L25/20—Repeater circuits; Relay circuits
- H04L25/26—Circuits with optical sensing means, i.e. using opto-couplers for isolation
Landscapes
- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Photo Coupler, Interrupter, Optical-To-Optical Conversion Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
[発明の技術分野]
本発明は、たとえば入出力回路の絶縁を要求される箇所
に使用されるメモリ機能を有するフォトカプララに関す
る。
に使用されるメモリ機能を有するフォトカプララに関す
る。
[発明の技術的背景]
従来、光結合によりメモリ回路を構成する場合、第1図
に示す回路方式が用いられていた。この回路方式は、既
存の2個のフォトカブラPi 、 R2および5個の外
付抵抗R1−R5を図示のように接続することにより、
双安定マルチバイブレータ(フリップフロップ回路)を
構成し、メモリ機能を持たせる方式である。
に示す回路方式が用いられていた。この回路方式は、既
存の2個のフォトカブラPi 、 R2および5個の外
付抵抗R1−R5を図示のように接続することにより、
双安定マルチバイブレータ(フリップフロップ回路)を
構成し、メモリ機能を持たせる方式である。
[背景技術の問題点]
しかしながら、上述した従来の回路方式では次のような
問題があった。すなわち、メモリ機能を有しない個別の
フォトカブラを用いるため、外付素子を多数用いて回路
構成しなければならない。
問題があった。すなわち、メモリ機能を有しない個別の
フォトカブラを用いるため、外付素子を多数用いて回路
構成しなければならない。
また、回路構成のための所要面積を広く必要とする。ま
た、部品点数に比例してメモリ機能当りの価格が高価と
なる。さらに、外付素子が多くなることに伴い信頼性が
阻害される。
た、部品点数に比例してメモリ機能当りの価格が高価と
なる。さらに、外付素子が多くなることに伴い信頼性が
阻害される。
[発明の目的コ
本発明は上記事情に鑑みてなされたもので、その目的と
するところは、部品点数の削減および低価格化が図れ、
信頼性も著しく向上するメモリ機能を有するフォトカブ
ラを提供することにある。
するところは、部品点数の削減および低価格化が図れ、
信頼性も著しく向上するメモリ機能を有するフォトカブ
ラを提供することにある。
[発明の概要コ
本発明は、上記目的を達成するために、メモリ回路機能
を単一のフォトカプラに持たせるように構成したもので
ある。
を単一のフォトカプラに持たせるように構成したもので
ある。
[発明の実施例]
以下、本発明の一実施例について図面を参照して説明す
る。
る。
第2図において、破線で囲んだ部分は本発明に係るフォ
トカプラを示し、外付けされた抵抗R1゜R2は実使用
に際しての電流制限用抵抗である。
トカプラを示し、外付けされた抵抗R1゜R2は実使用
に際しての電流制限用抵抗である。
本フォトカブラは、セット信号の入力により発光動作す
る第1発光素子としての発光ダイオードLD1、リセッ
ト信号の入力により発光動作する第2発光素子としての
発光ダイオード102、これら発光ダイオードLD1.
LD2とそれぞれ光学的に結合され、それらからの光信
号によりオン動作する第1、第2受光素子としてのフォ
トトランジスタPTs 、PT2 、上記フォトトラン
ジスタPT1と光学的に結合され、そのフォトトランジ
スタPTIのコレクタに直列接続された第3発光素子と
しての発光ダイオードLD3から構成されている。そし
て、上記フォトトランジスタPT2がオンするとフォト
トランジスタPT1がオフ動作するように回路接続され
ている。なお、図中のPDsはフォトトランジスタPT
tのフォトダイオードを、PD2はフォトトランジスタ
PT2のフォトダイオードをそれぞれ示す。
る第1発光素子としての発光ダイオードLD1、リセッ
ト信号の入力により発光動作する第2発光素子としての
発光ダイオード102、これら発光ダイオードLD1.
LD2とそれぞれ光学的に結合され、それらからの光信
号によりオン動作する第1、第2受光素子としてのフォ
トトランジスタPTs 、PT2 、上記フォトトラン
ジスタPT1と光学的に結合され、そのフォトトランジ
スタPTIのコレクタに直列接続された第3発光素子と
しての発光ダイオードLD3から構成されている。そし
て、上記フォトトランジスタPT2がオンするとフォト
トランジスタPT1がオフ動作するように回路接続され
ている。なお、図中のPDsはフォトトランジスタPT
tのフォトダイオードを、PD2はフォトトランジスタ
PT2のフォトダイオードをそれぞれ示す。
次に、このような構成において動作を説明すとる。
今、セット信号が発光ダイオードLDsに印加されると
、発光ダイオードLDrは発光動作し、その光信号は光
結合によりフォトダイオードPD1に導かれ、フォトダ
イオードPDlはオン動作し、よってフォトトランジス
タPT工はオン動作する。
、発光ダイオードLDrは発光動作し、その光信号は光
結合によりフォトダイオードPD1に導かれ、フォトダ
イオードPDlはオン動作し、よってフォトトランジス
タPT工はオン動作する。
これにより、フォトトランジスタPT1のコレクタ・エ
ミッタ間は低インピーダンス特性を示し、この結果、フ
ォトトランジスタPT1のコレクタに直列接続されてい
る発光ダイオードLD3は通電されて発光動作する。発
光ダイオードLD3からの光信号は光結合によりフォト
ダイオードPD!に導かれ、これによりフォトトランジ
スタPT1のオン動作が保持される。この状態は、セッ
ト信号がオフとなった後も持続し、リセット、信号が入
力されるまで継続する。これがセットメモリの状態であ
り、出力信号は低レベル状態を維持する。
ミッタ間は低インピーダンス特性を示し、この結果、フ
ォトトランジスタPT1のコレクタに直列接続されてい
る発光ダイオードLD3は通電されて発光動作する。発
光ダイオードLD3からの光信号は光結合によりフォト
ダイオードPD!に導かれ、これによりフォトトランジ
スタPT1のオン動作が保持される。この状態は、セッ
ト信号がオフとなった後も持続し、リセット、信号が入
力されるまで継続する。これがセットメモリの状態であ
り、出力信号は低レベル状態を維持する。
しかして、このセットメモリ状態はリセット信号を発光
ダイオードしD2に印加することによりクリアされる。
ダイオードしD2に印加することによりクリアされる。
すなわち、発光ダイオードLD2からの光信号は光結合
によりフォトダイオードPD2に導かれ、フォトダイオ
ードPD2はオン動作し、よってフォトトランジスタP
T2はオン動作する。このとき、フォトトランジスタP
T2のコレクタ・エミッタ間飽和電圧ガフオドトランジ
スタPT1のベース・エミッタ間電圧よりも低いことに
より、フォトトランジスタPTIのベースバイアス電流
をしゃ断させ、フォトトランジスタPTsをオフ動作さ
せる。これに伴い発光ダイオードLD3もオフとなって
発光を停止し、フォトトランジスタPT1は完全にオフ
する。これがリセットメモリの状態で、出力信号は高レ
ベルとなり、再度セット信号が印加されるまで持続する
。
によりフォトダイオードPD2に導かれ、フォトダイオ
ードPD2はオン動作し、よってフォトトランジスタP
T2はオン動作する。このとき、フォトトランジスタP
T2のコレクタ・エミッタ間飽和電圧ガフオドトランジ
スタPT1のベース・エミッタ間電圧よりも低いことに
より、フォトトランジスタPTIのベースバイアス電流
をしゃ断させ、フォトトランジスタPTsをオフ動作さ
せる。これに伴い発光ダイオードLD3もオフとなって
発光を停止し、フォトトランジスタPT1は完全にオフ
する。これがリセットメモリの状態で、出力信号は高レ
ベルとなり、再度セット信号が印加されるまで持続する
。
以上説明したような構成であれば、単一の素子でメモリ
機能を持たせることができるので、外付素子数の削減が
図れるとともに、従来のように回路構成のための所要面
積を広く必要としない。また、外付素子数の削減に伴い
信頼性も著しく向上し、かつメモリ機能当りの低価格化
が図れる。
機能を持たせることができるので、外付素子数の削減が
図れるとともに、従来のように回路構成のための所要面
積を広く必要としない。また、外付素子数の削減に伴い
信頼性も著しく向上し、かつメモリ機能当りの低価格化
が図れる。
[発明の効1]
以上詳述したように本発明によれば、部品点数の削減お
よび低価格化が図れ、信頼性も著しく向上するメモリ機
能を有するフォトカプラを提供できる。
よび低価格化が図れ、信頼性も著しく向上するメモリ機
能を有するフォトカプラを提供できる。
第1図は従来の光結合によるメモリ回路を示す構成図、
第2図は本発明の一実施例を示す構成図である。 LDl・・・・・・発光ダイオード(第1発光素子)、
LD2・・・・・・発光ダイオード(第2発光素子)、
LDa・・・・・・発光ダイオード(第3発光素子)、
PTl・・・・・・フォトトランジスタ(第1受光素子
)、PT2・・・・・・フォトトランジスタ(第2受光
素子)。 出願人代理人 弁理士 鈴江武彦 第1図 第2図
第2図は本発明の一実施例を示す構成図である。 LDl・・・・・・発光ダイオード(第1発光素子)、
LD2・・・・・・発光ダイオード(第2発光素子)、
LDa・・・・・・発光ダイオード(第3発光素子)、
PTl・・・・・・フォトトランジスタ(第1受光素子
)、PT2・・・・・・フォトトランジスタ(第2受光
素子)。 出願人代理人 弁理士 鈴江武彦 第1図 第2図
Claims (3)
- (1)セット信号の入力により発光動作する第1発光素
子と、この第1発光素子と光学的に結合され第1発光素
子からの光信号によりオン動作する第1受光素子と、こ
の第1受光素子と光学的に結合され第1受光素子がオン
動作すると発光動作する第3発光素子と、リセット信号
の入力により発光動作する第2発光素子と、この第2発
光素子と光学的に結合され第2発光素子からの光信号に
よりオン動作して前記第1受光素子をオフ動作せしめる
第2受光素子とを具備したことを特徴とするメモリ機能
を有するフォトカブラ。 - (2)前記第1、第2、第3発光素子はそれぞれ発光ダ
イオードである特許請求の範囲第1項記載のメモリ機能
を有するフ)1トカブラ。 - (3)前記第1、第2受光素子はそれぞれフォトトラン
ジスタである特許請求の範囲第1項記載のメモリ機能を
有するフォトカブラ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4337284A JPH0652804B2 (ja) | 1984-03-07 | 1984-03-07 | メモリ機能を有するフオトカプラ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4337284A JPH0652804B2 (ja) | 1984-03-07 | 1984-03-07 | メモリ機能を有するフオトカプラ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60187067A true JPS60187067A (ja) | 1985-09-24 |
| JPH0652804B2 JPH0652804B2 (ja) | 1994-07-06 |
Family
ID=12662009
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4337284A Expired - Lifetime JPH0652804B2 (ja) | 1984-03-07 | 1984-03-07 | メモリ機能を有するフオトカプラ |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0652804B2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52133764A (en) * | 1976-04-30 | 1977-11-09 | Shimadzu Corp | Photo coupled multivibrator |
-
1984
- 1984-03-07 JP JP4337284A patent/JPH0652804B2/ja not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS52133764A (en) * | 1976-04-30 | 1977-11-09 | Shimadzu Corp | Photo coupled multivibrator |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0652804B2 (ja) | 1994-07-06 |
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