JPS60200546A - 半導体装置 - Google Patents

半導体装置

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JPS60200546A
JPS60200546A JP59056025A JP5602584A JPS60200546A JP S60200546 A JPS60200546 A JP S60200546A JP 59056025 A JP59056025 A JP 59056025A JP 5602584 A JP5602584 A JP 5602584A JP S60200546 A JPS60200546 A JP S60200546A
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JP59056025A
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Yasuo Maruyama
丸山 泰男
Yoshimi Hagiwara
萩原 義美
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Hitachi Ltd
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔技術分野〕 本発明は半導体装置、特にパワートランジスタ。
パワーIC等の高出力半導体装置に関する。
〔背景技術〕
パワートランジスタ、パワーIC等の半導体装置は、た
とえば、電子材料、1973年1,6月号。
112〜117頁(産業用パワートランジスタ)あるい
は電子材料、1980年、4月号、65〜73頁(電力
用トランジスタ)に記載されているように、コレクタ・
ベース耐圧は160QVと極めて高いものもある。この
ため、露出するpn接合部分の高耐圧化を維持するため
に、チップは逆メサ構造(ベベル構造)を採用するとと
もに、ワニス系、シリコーン系等の樹脂(レジン)によ
ってコーティングが施されている。また、パワー1〜ラ
ンジスタ等のチップはたとえば、電子材料。
1972年10月号、153頁(パ’7−ICにおける
熱放散)にも記載されているように、支持板に半田で固
定されることが多い。
ところで、前者のチップコートたとえば、電子材料、1
974年、11月号、73〜78頁(電子部品コーティ
ング用樹脂:特にシリコーン樹脂について)にも記載さ
れているように、低粘度レジンあるいは高粘度レジンが
使用されている。低粘度レジンはコーティング層が薄く
またピンホールができ易いことから、重ね塗りが行わ九
るのが一般的であり、工数の悪さ、信頼度の低さ等の問
題がある。また、高粘度レジンはコーティング層が厚く
なり易く、脱泡処理が必用となるとともに、充分なキュ
アーを行わないと、リード線の半田付は前の洗浄時の溶
剤で剥離、溶解が生じることもあり、耐圧歩留りが悪い
欠点がある。また、同文献にも記載されているように、
コーティングレジンの選択およびコーティング方法の選
択は過去の経験に基づく試行錯誤の状態化にある。
−古本出願人は、コレクタ・ベース耐圧が1800Vに
もおよぶ製品を開発している。そして、この場合のコー
ティングレジンとしては、ポリイミドレジン系のレジン
を用いている。このレジンは粘度が高いが、エポキシレ
ジンとの接着性が良くがつ熱膨張率がエポキシレジンと
略同程度と多くの特長があり、耐圧歩留りが高くできる
しかし、このレジンによるベベル構造のチップのコーテ
ィングは、製造段階で常時良好に行うことは難しいとい
うことが本発明者によってあきらかとされた。
すなわち、第1図は従来の支持板(ヘッダー)lに半田
2を介してチップ3を固定し、がっワイヤ4の接続がな
されたチップ3をポリイミドレジン系のレジン5(以下
、単にレジンと称する。)でコーティングし、チップ3
をコーティングレジン(コーティング層)5で被った状
態を示す図である。厚さ200μm程度のチップ3はそ
の周面は逆メサ構造(ベベル溝道)となっていて、その
表面(上面)から30〜4oμrn程度の深さにpn接
合6を有している。そして、従来の方法によってレジン
コーティングを行うと、レジンは本来p r+接合6の
露出部分を被覆する目的であるにもかかわらず、レジン
の大部分は庇状となったチップ3の下部周縁に吸い取ら
れてしまい、pn接合6露出部分を被うコーティング層
5は、同図に示されるように、薄くなってしまい、耐圧
劣化が生じてしまう。これに対して、pn接合6の露出
部覆を被うコーティング層5を厚くしようとすると、t
\ツダー1近傍のチップ3下部周縁にレジン5が流れ込
み、同図に示されるように、この部分のコーティング層
5は非常に厚くなり、作業規定通りの時間キュアーを行
っても、レジンの硬化が不充分となったり、コーティン
グ層5の内部に発生した気泡7の抜けが悪くなる等の副
作用が生じ耐圧留りの低下、信頼度の低下が生じる。前
記気泡7の発生はコーティング層5の厚さが厚くなれば
なるほど多くなる傾向にある。また、このレジンは粘度
が高く、薄めて粘度を低くシ難い難点があるが、仮に薄
めてレジンの重ね塗りをした場合は良好なコーティング
が行えるかも知れないが、極めて作業性が悪くなり、量
産化には適さないという欠点がある。
一方、半田2を用いてチップ3をヘッダー1に固定する
作業は従来、チップ固定治具やチップ3に押しイ1け荷
重を加えるウェイトの細工をして半田付けを行っている
が、ヘッダ1が平坦であることから、半田溶融時にチッ
プ3のずれが生じ、その後の組立工程において位置合わ
せ作業が追加され、スループッ1〜が低下するという欠
点があった。
〔発明の目的〕
本発明の目的はチップがレジンコーティングされた構造
の半導体装置の耐圧向上を達成することにある。
本発明の目的はチップがレジンコーティングされた構造
の半導体装置の耐圧向上を達成することにある。
本発明の他の目的はレジンコーティング作業がし易い構
造の半導体装置を提供することにある。
本発明の他の目的はチップ固定精度が高くできる構造の
半導体装置を提供することにある。本発明の前記ならび
にそのほかの目的と新規な特徴は、本明細書の記述およ
び添付図面からあきらかになるであろう。
〔発明の概要〕
本願において開示される発明のうち代表的なものの概要
を簡単に説明すれば、下記のとおりである。
すなわち、本発明の半導体装置はチップが固定されるヘ
ッダーのチップ固定面にチップの固定領域周縁に沿って
内周縁が固定領域周縁に一致する溝を設けることにより
、チップ固定時は半田の表面張力によって高精度に位置
決め固定させ、レジノコ−ティング時にはレジンの塗布
量が多くてもヘッダーに設けた溝にレジンを引き込んで
チップの周面におけるコーティング層の厚さを均一とし
気泡が無い硬化充分なコーティング層を形成することに
よって、歩留りの向上、生産性の向上を図り、半導体装
置の製造コストの低減を達成するものである。
〔実施例〕
第2図は本発明の一実施例による半導体装置、すなわち
、高耐圧パワートランジスタの斜視図、第3図は同じく
チップコーティング状態を示す断面図である。
本実施例の高耐圧パワー1ヘランジスタ(以下、単にト
ランジスタと称する。)は第1図に示されるように、矩
形のレジンパッケージ8と、このレジンパッケージ8の
一端面から突出する3本のり一ド9と、からなっている
。また、レジンパッケージ8にはトランジスタの実装時
にネジを挿し込む取付孔10が設けられている。この取
付孔1゜はヘッダーlに設けられた孔11よりも小さく
なっていることから、絶縁性のレジンパッケージによっ
て形成さ汎ている。
一方、前記リード9において、中央のリード9はコレク
タリード12となり、レジンパッケージ8内で途中で下
方に一段折れ曲がり、ヘッダー1に繋がっている。また
、両側のり一ド9はそれぞれベースリード13.エミッ
タリード14となっている。前記ヘッダー1の主面には
第3図にも示されるように、ベベル構造のチップ3が半
田2を介して固定されている。そして、チップ3のエミ
ッタ部分およびベース部分とこれに対応するエミッタリ
ード14.ベースリード13の内端部分はそ九ぞれ表面
を銀メッキした銅線からなるワイヤによって接続されて
いる。チップ3はたとえば、厚さが200μmとなり、
表面(上面)から30〜40μmの深さにpn接合6を
有している。このpn接合6の下部はn形のコレクタ領
域16となり、その上部はp形のベース領域17となっ
ている。また、ベース領域17の表層部分には部分的に
n形のエミッタ領域18が形成されている。
なお、チップ3の表面は部分的に絶縁膜19が設けられ
ている。そして、ワイヤ4は半II(20によってチッ
プ3の所定部分に接続されている。また、ワイヤ4の他
端は溶接によってそれぞれリード9に接続されている。
同図で注目すべきはヘッダー1の主面にはチップ3の固
定領域の緑に沿う溝15が設けられているということで
ある。この溝15はその内周縁チップ3の固定領域の縁
に一致しかつその幅はたとえば、Q 、 2 nwu程
度となっている。また、溝15の深さは溝幅と同程度あ
るいは浅くても良い。この溝15の断面寸法は後述する
チップコートするレジンの流入する量に合わせて決定す
ればよい。
そして、ヘッダー1に固定されかつワイヤ4が数句゛ら
れたチップ3はポリイミドレジン系のレジンによってコ
ーティングされ、コーティングレジン(コーティング層
)5によって被われている。このレジン5は電界破壊が
生じないように、たとえば、20〜30μm程度の厚さ
に形成される。また、このレジンコーティングの際、余
分なレジンは前記溝15内に流れ込みチップ3の周面に
は余分なレジンは付着せず、コーティング層5は均一な
厚さとなる。また、このレジンは粘度が高いことがらベ
ベル構造のチップ3の先鋭周縁部分をも厚くコーティン
グできることとなる。また、コーティング層5中に発生
する気泡7は溝15内に溜まるコーティング層5部分に
発生し、チップ3の周面部分のコーティングJWS中に
は発生し難くなる。
したがって、レジンコーテイング後の脱泡処理によって
、チップ3の周面および上部のコーティング層5内には
気泡7は存在せず、わずかに、耐圧劣化に支障のない溝
15内のコーティング層5内にのみ存在することになり
、耐圧歩留りが向上する。すなわち、本発明者の実験等
によると、チップ3の上面から100μm程度下がった
位置に亙る領域のコーティング層5部分の良否が耐圧歩
留りの良否に影響するということを確認している。
そして、本発明によるレジンコーティングによれば、前
記100μmにも亙たるコーティング層5部分は充分コ
ーティング効果を有する厚さでかつ気泡がなく、さらに
均一な厚さとなっていることから作業規格通りのキュア
一時間で充分な硬度となっているため、耐圧歩留りが向
上する。
他方、チップ3の固定は、あらかじめヘッダー1のチッ
プ固定領域に設けられた半田ペースト上にチップ3が載
置され、その後の半田リフローによって固定される。こ
の際、溝1519取り囲まれたチップ固定領域はチップ
寸法と一致している。
この結果、チップ3は溶けた半田の表面張力によって自
動的にチップ固定領域の中心にチップ3の中心が一致す
るように移動し、その状態で固定され、チップ固定精度
が高くなる。したがって、その後の組立工程におけるチ
ップに対する位置合わせ作業が容易となり、1−ランジ
スタ製造における生産性が向上する。
〔効果〕
■0本発明の高耐圧パワート・ランジスタは、ヘッダー
1のチップ固定領域の周縁に沿って溝15が設けられて
いることから、チップ3を被うコーティング層5を厚く
塗ろうとして、比較的多くレジンを塗っても、余分なレ
ジンは前記溝15内に流れ込み、チップ3の上面および
周面には均一なコーティング層5が形成される。また、
コーティングN5が均一な厚さとなることから、キュア
ーも均一に行われ、レジン硬化も充分となるとともに、
少なくともチップ3の周面のコーティング層5部分の脱
泡処理も良好になされ、気泡7も存在しなくなる。この
ようなことから、本発明による1〜ランジスタの耐圧歩
留りが向上する。
2、上記1からレジンコーティング時塗布するレジンの
量の加減はそれほど厳しくない。この結果、量産体勢に
も充分対応できることとなり、トランジスタの製造コス
トの軽減が達成できる。
3、本発明のトランジスタはその製造時、ヘッダー1の
チップ固定領域上におおまかにチップ3を載量し、半田
リフローを行うだけでチップ3は半田の表面張力によっ
て高精度に所定位置に固定される。したがって、その後
の組立におけるチップに対する位置合わせ作業が容易と
なり、結果としてトランジスタの製造工数が低下し、1
〜ランジスタの製造コストの軽減ができる。
4、上記3から、本発明のトランジスタはその製造にお
けるチップ固定作業の自動化も達成できる。
5、上記1〜4により、本発明によれば高耐圧の1−ラ
ンジスタ等の半導体装置を安価に提供することができる
という相乗効果が得られる。
以上本発明者によってなされた発明を実施例に基づき具
体的に説明したが、本発明は上記実施例に限定されるも
のではなく、その要旨を逸脱しない範囲で種々変更可能
であることはいうまでもない、たとえば、八ツグーの主
面に設ける溝は前記実施例のU字溝以外の7字溝等でも
同様に効果が得られる。また、チップ固定領域の寸法は
チップ寸法よりも僅かに大きくあるいは小さくても、半
田の表面張力による中心方向へのチップの移動作用によ
ってチップの固定位置精度は高くなる。したがって、こ
の場合には、チップの固定精度のある程度の緩和を行え
ば、一種類のへラグ−にチップサイズが異なるチップを
固定でき、ヘッダー品種を多く取り揃える必要がなく、
半導体装置コストの軽減が達成できる。
また、本発明は第4図に示すように、高耐圧製品以外の
チップ3の固定技術に利用すれば、チップ3の高精度位
置決めが可能となり、かつチップ固定作業の自動化も達
成できる。
〔利用分野〕
以」二の説明では主として本発明者によってなされた発
明をその背景となった利用分野である高耐圧パワートラ
ンジスタの製造技術に適用した場合について説明したが
、それに限定されるものではなく、たとえば、半導体装
置の製造技術以外に、単に物品を所望位置に固定する固
定技術などに適用できる。
【図面の簡単な説明】
第1図は従来のチップコーティング状態を示す断面図、 第2図は本発明の一実施例による高耐圧パワー1〜ラン
ジスタを示す斜視図、 第3図は同じくチップコーティング状態を示す断面図、 第4図は本発明の他の実施例によるチップボンディング
状態を示す断面図である。 1・・・ヘッダー、2・・・半田、3・・・チップ、4
・・・ワイヤ、5・・・コーティング層、6・・・pn
接合、7・・・気泡 8・・・レジンパッケージ、9・
・・リード、10・・・数句孔、11・・・孔、12・
・・コレクタリード、13・・・ベースリード、14・
・・エミッタリード、15・・・溝、16・・・コレク
タ領域、17・・・ベース領域、I8・・・エミッタ領
域、19・・・絶縁膜、20・・・半田。 第 1 図 第 3 図

Claims (1)

  1. 【特許請求の範囲】 1、支持板と、この支持板の主面に固定材により固定さ
    れたチップと、このチップを被うコーティングレジンと
    、を有する半導体装置であって、前記支持板主面にはチ
    ップ固定領域に沿って溝が設けられていることを特徴と
    する半導体装置。 2、前記溝の内周縁はチップ固定領域の縁と一致してい
    ることを特徴とする特許請求の範囲第1項記載の半導体
    装置。
JP59056025A 1984-03-26 1984-03-26 半導体装置 Pending JPS60200546A (ja)

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Application Number Priority Date Filing Date Title
JP59056025A JPS60200546A (ja) 1984-03-26 1984-03-26 半導体装置

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JP59056025A JPS60200546A (ja) 1984-03-26 1984-03-26 半導体装置

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JPS60200546A true JPS60200546A (ja) 1985-10-11

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JP59056025A Pending JPS60200546A (ja) 1984-03-26 1984-03-26 半導体装置

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Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62257753A (ja) * 1986-04-30 1987-11-10 Ibiden Co Ltd 半導体搭載用基板およびその製造方法
JPS639956A (ja) * 1986-06-30 1988-01-16 Ibiden Co Ltd 半導体搭載用基板およびその製造方法
JPH01293557A (ja) * 1988-05-20 1989-11-27 Mitsubishi Electric Corp 半導体装置
JP2014192518A (ja) * 2013-03-28 2014-10-06 Toyota Motor Corp 半導体装置およびその製造方法
JP2014216459A (ja) * 2013-04-25 2014-11-17 三菱電機株式会社 半導体装置

Cited By (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62257753A (ja) * 1986-04-30 1987-11-10 Ibiden Co Ltd 半導体搭載用基板およびその製造方法
JPS639956A (ja) * 1986-06-30 1988-01-16 Ibiden Co Ltd 半導体搭載用基板およびその製造方法
JPH01293557A (ja) * 1988-05-20 1989-11-27 Mitsubishi Electric Corp 半導体装置
JP2014192518A (ja) * 2013-03-28 2014-10-06 Toyota Motor Corp 半導体装置およびその製造方法
JP2014216459A (ja) * 2013-04-25 2014-11-17 三菱電機株式会社 半導体装置

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