JPS60206369A - 画信号補正方式 - Google Patents
画信号補正方式Info
- Publication number
- JPS60206369A JPS60206369A JP59063053A JP6305384A JPS60206369A JP S60206369 A JPS60206369 A JP S60206369A JP 59063053 A JP59063053 A JP 59063053A JP 6305384 A JP6305384 A JP 6305384A JP S60206369 A JPS60206369 A JP S60206369A
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は、ファクシミリ等において光電変摸索より画信
号を得る場合の画信号補正方式に関する。
号を得る場合の画信号補正方式に関する。
従来、ファクシミリ等において、原稿からの反射光をレ
ンズで集光して光′醒変換素子の受光面に結像させ、こ
の光電変換素子より画信号を得ているが、このようにし
て得られる画信号は、原稿の中央部のレベルが周辺部の
レベルより大きくなり、いわゆるシェーディング歪を生
じる。
ンズで集光して光′醒変換素子の受光面に結像させ、こ
の光電変換素子より画信号を得ているが、このようにし
て得られる画信号は、原稿の中央部のレベルが周辺部の
レベルより大きくなり、いわゆるシェーディング歪を生
じる。
このため従来、第１図に示すように、原稿１とレンズ２
との間にシェーディング板３と称される板を挿入し、中
央部の透過光ｆを制限することＫより、光電変換素子４
の受光面における光量が一様になるように補正を行なっ
ていた。
との間にシェーディング板３と称される板を挿入し、中
央部の透過光ｆを制限することＫより、光電変換素子４
の受光面における光量が一様になるように補正を行なっ
ていた。
なお、５は原稿１を照射する光源である。
しかしながら、このような従来の画信号補正方式におい
ては、レンズ２の特性偏差および光源５の光量分布の偏
差を補正するために、各機毎にシェーディング板３の謂
整を行なう必要があり、また画信号に対するビット単位
の微細な補正は不可能である。さらに光源５の劣化等に
もとづく長期的なシェーディング波形の変化に追随でき
ない等の釉々の欠点を有するものであった。
ては、レンズ２の特性偏差および光源５の光量分布の偏
差を補正するために、各機毎にシェーディング板３の謂
整を行なう必要があり、また画信号に対するビット単位
の微細な補正は不可能である。さらに光源５の劣化等に
もとづく長期的なシェーディング波形の変化に追随でき
ない等の釉々の欠点を有するものであった。
さらに、光源５０点火直後には光源５の温度変化による
光量の変化が太きいため、原稿１の読取り中に原稿１か
らの反射光量が変化するものであるから、このような光
量変化に対応する補正手段を設けることも必要とされて
いた。
光量の変化が太きいため、原稿１の読取り中に原稿１か
らの反射光量が変化するものであるから、このような光
量変化に対応する補正手段を設けることも必要とされて
いた。
本発明は、上述した点に鑑みてなされたもので、シェー
ディング波形の補正のみならず、シェーディング波形の
長期的変化および光源の短期的な光量変化をも電気的に
補正できる画信号補正方式を提供することを目的とする
。
ディング波形の補正のみならず、シェーディング波形の
長期的変化および光源の短期的な光量変化をも電気的に
補正できる画信号補正方式を提供することを目的とする
。
そこで、本発明は、画信号のシェーディング波形を記憶
する記憶器（ＲＡＭ又はＲＯＭ ）と、画信号中の基準
レベルを検出して記憶する基準レベル検出回路と、補正
用演算ｆｔ０Ｍとを備え、画信号と記憶器の出力とを演
算ＲＯＭに入力してシェーディング補正を行ない、次（
Ｊでこの演算ＲＯＭよりの出力画信号と基準レベル検出
回路の出力信号とを再びこの演％ＲＯＭに入力すること
によりレベル補正を行なうようになされた補正方式によ
って上記目的を達成した。
する記憶器（ＲＡＭ又はＲＯＭ ）と、画信号中の基準
レベルを検出して記憶する基準レベル検出回路と、補正
用演算ｆｔ０Ｍとを備え、画信号と記憶器の出力とを演
算ＲＯＭに入力してシェーディング補正を行ない、次（
Ｊでこの演算ＲＯＭよりの出力画信号と基準レベル検出
回路の出力信号とを再びこの演％ＲＯＭに入力すること
によりレベル補正を行なうようになされた補正方式によ
って上記目的を達成した。
第２図は、本発明に適用される画信号補正回路の一実施
例をブロック図で示したものであり、６はＡ ／ Ｄ変
換器、７はシェーディング波形を記憶するＲＡＭ、 ８
および９はセレクタ、ｌＯ。
例をブロック図で示したものであり、６はＡ ／ Ｄ変
換器、７はシェーディング波形を記憶するＲＡＭ、 ８
および９はセレクタ、ｌＯ。
１１．１２８よび１３はフリップ、フロップ構成のラッ
チ、１４は演算ＲＯＭ、１５は画信号の基準レベルを検
出して記憶する基準レベル検出回路、１６はカウンタで
ある。
チ、１４は演算ＲＯＭ、１５は画信号の基準レベルを検
出して記憶する基準レベル検出回路、１６はカウンタで
ある。
上記の構成において、まず原稿１の挿入直前（３）
に背面ローラ（図示せず）から白レベルをレンズ２を介
して光電変換素子４で絖取り、ム／Ｄ変換器６を介して
ＲＡＭ ７にシェーディング波形として記憶しておく。
して光電変換素子４で絖取り、ム／Ｄ変換器６を介して
ＲＡＭ ７にシェーディング波形として記憶しておく。
このシェーディング波形は第３図（ａ）の曲線日として
示されている。また演算ＲＯＭ１４にはアドレスの上位
６ビツトをム、下位６ビツ）１１Ｎ：Ｂとして、ム／Ｂ
Ｘ３２の演算結果が誓ぎこまれている。次に原稿１を挿
入して、光電変換素子４より第３図（ＩＬ）の曲線Ｐで
示されている画信号を得るが、この画信号はム／Ｄ変換
器６、セレクタ８、ラッチ１０を介して演算ＲＯＭ１４
に入力される。またＲＡＭ７より続出されたシェーディ
ング波形ｔあられす出力信号は１セレクタ９、ラッチ１
１を介して演算ＲＯＭ１４に入力され、演算ＲＯＭ１４
において（画信号）／（ＲＡＭの出力信号）×３２の計
算が行なわれる。この計算によって、シェーディング補
正が行なわれ、演算ＲＯＭ１４の第１回目の出力は、第
３図（１’）に示されているように、シェーディング歪
の除去された一様なものとなる。この演算（４） ＲＯＭ１４の第１回目の出力は、セレクタ８、ラッチ１
０ｔ’介して再び演算ＲＯＭ１４に入力される。また演
算ＲＯＭ１４の第１回目の出力は、ラッチ１２を介して
基準レベル検出回路１５に加えられ、この基準レベル検
出回路１５より出力される第３図（０）に示されている
ような演算ＲＯＭ１４の第１回目の出力の基準レベルを
あられす出力信号がセレクタ９、ラッチ１１１に介し【
演算ＲＯＭ１４に入力され、演算ＲＯＭ１４において（
演算ＲＯＭ１４の第１回目の出力）／（基準レベル検出
回路１５の出力）×３２の計算６を行なわれる。この第
２回目の計算によって、第３図（ｄ）に示すように、原
稿の白レベルが補正されて３２となった画信号が演算Ｒ
ＯＭ１４より得られ、ラッチ１３１に介して外部に出力
される。
示されている。また演算ＲＯＭ１４にはアドレスの上位
６ビツトをム、下位６ビツ）１１Ｎ：Ｂとして、ム／Ｂ
Ｘ３２の演算結果が誓ぎこまれている。次に原稿１を挿
入して、光電変換素子４より第３図（ＩＬ）の曲線Ｐで
示されている画信号を得るが、この画信号はム／Ｄ変換
器６、セレクタ８、ラッチ１０を介して演算ＲＯＭ１４
に入力される。またＲＡＭ７より続出されたシェーディ
ング波形ｔあられす出力信号は１セレクタ９、ラッチ１
１を介して演算ＲＯＭ１４に入力され、演算ＲＯＭ１４
において（画信号）／（ＲＡＭの出力信号）×３２の計
算が行なわれる。この計算によって、シェーディング補
正が行なわれ、演算ＲＯＭ１４の第１回目の出力は、第
３図（１’）に示されているように、シェーディング歪
の除去された一様なものとなる。この演算（４） ＲＯＭ１４の第１回目の出力は、セレクタ８、ラッチ１
０ｔ’介して再び演算ＲＯＭ１４に入力される。また演
算ＲＯＭ１４の第１回目の出力は、ラッチ１２を介して
基準レベル検出回路１５に加えられ、この基準レベル検
出回路１５より出力される第３図（０）に示されている
ような演算ＲＯＭ１４の第１回目の出力の基準レベルを
あられす出力信号がセレクタ９、ラッチ１１１に介し【
演算ＲＯＭ１４に入力され、演算ＲＯＭ１４において（
演算ＲＯＭ１４の第１回目の出力）／（基準レベル検出
回路１５の出力）×３２の計算６を行なわれる。この第
２回目の計算によって、第３図（ｄ）に示すように、原
稿の白レベルが補正されて３２となった画信号が演算Ｒ
ＯＭ１４より得られ、ラッチ１３１に介して外部に出力
される。
第４図は第２図の回路の動作をあられすタイミングチャ
ー１−示し、第４図（ａ）はム／Ｄ変換器６の出力画信
号を、第４図（ｂ）はセレクタ８．９の動作を、第４図
（０）はラッチｔｏ、１１の動作Ｙ：％第４図（ｄ）は
演算ＲＯＭ１４のアドレスを、第４図（−）は演算ＲＯ
Ｍ１４の出力をそれぞれ示す。
ー１−示し、第４図（ａ）はム／Ｄ変換器６の出力画信
号を、第４図（ｂ）はセレクタ８．９の動作を、第４図
（０）はラッチｔｏ、１１の動作Ｙ：％第４図（ｄ）は
演算ＲＯＭ１４のアドレスを、第４図（−）は演算ＲＯ
Ｍ１４の出力をそれぞれ示す。
セレクタ８，９は１画素の長さを２等分し、その前半は
ムｔＢＹ選択する。なお、Ａ、Ｂはシェーディング補正
の場合を、ＡＩＢはレベル補正の場合をそれぞれ示す、
Ａ、Ｂはラッチ１０，１１で一画素分遅延された後、演
算ＲＯＭＩ ４の後半アドレスになる。第１回目の演算
によって演算ＲＯＭ１４からム／ＢＸ３２の計算結果Ａ
′が出力される。基準レベル検出回路１５は、この演算
ＲＯＭ１４の出力Ａ′が入力されると、このＡ′のうち
の定められた範囲内で最大のＡ′を基準レベルＢ′とし
て記憶する。Ｂ′は原稿の白レベル上あられし、Ｂ′の
変化は短期的な光源の光量変化をあられす。
ムｔＢＹ選択する。なお、Ａ、Ｂはシェーディング補正
の場合を、ＡＩＢはレベル補正の場合をそれぞれ示す、
Ａ、Ｂはラッチ１０，１１で一画素分遅延された後、演
算ＲＯＭＩ ４の後半アドレスになる。第１回目の演算
によって演算ＲＯＭ１４からム／ＢＸ３２の計算結果Ａ
′が出力される。基準レベル検出回路１５は、この演算
ＲＯＭ１４の出力Ａ′が入力されると、このＡ′のうち
の定められた範囲内で最大のＡ′を基準レベルＢ′とし
て記憶する。Ｂ′は原稿の白レベル上あられし、Ｂ′の
変化は短期的な光源の光量変化をあられす。
セレクタ８，９がそれぞれム′、Ｂ′を選択すると、ラ
ッチ１０．１１で一画素分遅延された後、演算ＲＯＭ１
４の前半アドレスになる。第２回目の演算によって演、
３！ＲＯＭ１４からはＡ’／Ｂ’Ｘ３２の計算結果Ｃが
出力され、このＯは補正後の画信号としてラッチ１３を
介して外部へ出力される。
ッチ１０．１１で一画素分遅延された後、演算ＲＯＭ１
４の前半アドレスになる。第２回目の演算によって演、
３！ＲＯＭ１４からはＡ’／Ｂ’Ｘ３２の計算結果Ｃが
出力され、このＯは補正後の画信号としてラッチ１３を
介して外部へ出力される。
この場合、ラッチ１２は演算ＲＯＭ１４の出力のうちＡ
′Ｙ 、ラッチ１３は演算ＲＯＭ１４の出力のうちのａ
ｙそれぞれ保持するだめのものである。
′Ｙ 、ラッチ１３は演算ＲＯＭ１４の出力のうちのａ
ｙそれぞれ保持するだめのものである。
以上の説明で明らかなように、本発明による画信号補正
方式においては、演算ＲＯＭ １４ ’ｌ ２回使用す
るようになされているから、単一の演４ｎｏＭ１４によ
ってシェーディング補正と、光源の光量変化および原稿
の白レベルの補正とを行なうことができる。
方式においては、演算ＲＯＭ １４ ’ｌ ２回使用す
るようになされているから、単一の演４ｎｏＭ１４によ
ってシェーディング補正と、光源の光量変化および原稿
の白レベルの補正とを行なうことができる。
本発明による画信号補正方式によれば、シェーディング
板３を必要としないので、各機毎にシェーディング板３
の調整を必要とするという従来の画信号補正方式の有す
る欠点を解消できるのみでな（、ＲＡＭ７に１ビット単
位の信号としてシェーディング波形が記憶されるため、
ビット単位の微細な補正が可能になる。また光源５の劣
化による長期的な光量変化が生じても、原稿挿入ごとに
シェーディング波形Ｙ［取るよう ）Ｋしているので、
長期的なシェーディング波形の変化を補正できる。さら
に、短期的な光量変（７） 化および原稿の白レベルを単一の演算ＲＯＭ１４を用い
て補正できる利点がある。
板３を必要としないので、各機毎にシェーディング板３
の調整を必要とするという従来の画信号補正方式の有す
る欠点を解消できるのみでな（、ＲＡＭ７に１ビット単
位の信号としてシェーディング波形が記憶されるため、
ビット単位の微細な補正が可能になる。また光源５の劣
化による長期的な光量変化が生じても、原稿挿入ごとに
シェーディング波形Ｙ［取るよう ）Ｋしているので、
長期的なシェーディング波形の変化を補正できる。さら
に、短期的な光量変（７） 化および原稿の白レベルを単一の演算ＲＯＭ１４を用い
て補正できる利点がある。
第１図は従来のシェーディング補正方式の説明図、第２
図は本発明に適用される画信号補正回路のブロック図、
第３図（ａ）〜（ｄ）はその各部の波形図、第４図（ａ
）〜（ｅ）はタイミングチャートである。 ｌ・・・原稿、２・・・レンズ、３・・・シェーディン
グ板、４・・・光電変換素子、５・・・光源、６・・・
ム／Ｄ変換器、７・・・ＲＡＭ、 ８．９・・・セレク
タ、 １０，１１゜１２．１３・・・ラッチ、１４・・
・演算ＲＯＭ、 ｌ ５・・・基準レベル検出回路、１
６・・・カウンタ （８）
図は本発明に適用される画信号補正回路のブロック図、
第３図（ａ）〜（ｄ）はその各部の波形図、第４図（ａ
）〜（ｅ）はタイミングチャートである。 ｌ・・・原稿、２・・・レンズ、３・・・シェーディン
グ板、４・・・光電変換素子、５・・・光源、６・・・
ム／Ｄ変換器、７・・・ＲＡＭ、 ８．９・・・セレク
タ、 １０，１１゜１２．１３・・・ラッチ、１４・・
・演算ＲＯＭ、 ｌ ５・・・基準レベル検出回路、１
６・・・カウンタ （８）
Claims (1)
- 光電変換素子より出力される画信号のシェーディング波
形を記憶する記憶器と、入力される画信号の基準レベル
を検出して記憶する基準レベル検出回路と、演Ｊ！ＲＯ
Ｍとを備え、前記光電変換素子より出力される画信号と
前記記憶器より続出された出力信号とを前記演算ＲＯＭ
に入力して演ＪＴ、ヲ行ない、該演算ＲＯＭよりシェー
ディング補正のなされた第１の出力信号を得、次いで該
第１の出力信号？前記基準レベル検出回路に印加してこ
れより前記第１の出力信号の基準レベルケあられす検出
信号を得、該検出信号と前記第１の出力信号とを前記演
算ＲＯＭに入力して演算を行なうことにより、該演算Ｒ
ＯＭよりシェーディング補正およびレベル補正のなされ
た第２の出力信号を得ることを特徴とする画信号補正方
式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59063053A JPS60206369A (ja) | 1984-03-30 | 1984-03-30 | 画信号補正方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59063053A JPS60206369A (ja) | 1984-03-30 | 1984-03-30 | 画信号補正方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60206369A true JPS60206369A (ja) | 1985-10-17 |
| JPH0380390B2 JPH0380390B2 (ja) | 1991-12-24 |
Family
ID=13218204
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59063053A Granted JPS60206369A (ja) | 1984-03-30 | 1984-03-30 | 画信号補正方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60206369A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62155675A (ja) * | 1985-11-28 | 1987-07-10 | Matsushita Electric Ind Co Ltd | 信号補正回路 |
-
1984
- 1984-03-30 JP JP59063053A patent/JPS60206369A/ja active Granted
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62155675A (ja) * | 1985-11-28 | 1987-07-10 | Matsushita Electric Ind Co Ltd | 信号補正回路 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0380390B2 (ja) | 1991-12-24 |
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